JPH01277371A - データ復調器 - Google Patents
データ復調器Info
- Publication number
- JPH01277371A JPH01277371A JP63105657A JP10565788A JPH01277371A JP H01277371 A JPH01277371 A JP H01277371A JP 63105657 A JP63105657 A JP 63105657A JP 10565788 A JP10565788 A JP 10565788A JP H01277371 A JPH01277371 A JP H01277371A
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- Japan
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- frequency
- voltage
- converter
- vfo
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- Signal Processing For Digital Recording And Reproducing (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、大容量の情報記憶機能を有する光ディスク、
光カード、磁気ディスク、磁気カードなどの記録媒体の
データ復調器に関するものである。
光カード、磁気ディスク、磁気カードなどの記録媒体の
データ復調器に関するものである。
従来の技術
従来、記録媒体からの再生信号のデータ復調は第２図に
示すデータ復調器を用いて行っている。
示すデータ復調器を用いて行っている。
第２図において、１はＰ Ｌ Ｌ （Ｐｈａｓｅ Ｌｏ
ｃｋｅｄＬｏｏｐ）と呼ばれる位相同期回路である。こ
のＰＬＬ回路１は位相比較器２とループフィルタ３と電
圧−周波数変換器（以下、ＶＦＯという）４にて構成さ
れており、位相比較器２は記録媒体からの再生信号５と
ＶＦＯ４から発生する。再生クロック信号６どの位相誤
差７を出力し、ループフィルタ３に入力する。ループフ
ィルタ３によって位相補償および帯域制限され生成され
たＶＦＯ制御信号８はＶＦＯ４に入力され、結果的に記
録媒体からの再生信号５中のクロック信号とＶＦＯ４か
らの再生クロック信号６どの位相が同期されるように、
矢印で示すようなＰＬＬループ９が構成される。
ｃｋｅｄＬｏｏｐ）と呼ばれる位相同期回路である。こ
のＰＬＬ回路１は位相比較器２とループフィルタ３と電
圧−周波数変換器（以下、ＶＦＯという）４にて構成さ
れており、位相比較器２は記録媒体からの再生信号５と
ＶＦＯ４から発生する。再生クロック信号６どの位相誤
差７を出力し、ループフィルタ３に入力する。ループフ
ィルタ３によって位相補償および帯域制限され生成され
たＶＦＯ制御信号８はＶＦＯ４に入力され、結果的に記
録媒体からの再生信号５中のクロック信号とＶＦＯ４か
らの再生クロック信号６どの位相が同期されるように、
矢印で示すようなＰＬＬループ９が構成される。
このとき、ＶＦＯ４のもつ自己発振周波数の中心周波数
は固定であり、たとえば、システム起動時、ＰＬＬルー
プ９を引き込むときには、ループゲイン切り換え信号１
０によってループフィルタ３のカットオフ特性を広帯域
に切り換え、ループを高ゲイン状態にし、短時間で引き
込みを完了させ。
は固定であり、たとえば、システム起動時、ＰＬＬルー
プ９を引き込むときには、ループゲイン切り換え信号１
０によってループフィルタ３のカットオフ特性を広帯域
に切り換え、ループを高ゲイン状態にし、短時間で引き
込みを完了させ。
引き込み後は、ループゲイン切り換え信号１０によって
ループフィルタ３のカットオフ特性を狭帯域にし、ルー
プを低ゲインとして少々の外乱では位相同期が外れない
ような構成となっている。
ループフィルタ３のカットオフ特性を狭帯域にし、ルー
プを低ゲインとして少々の外乱では位相同期が外れない
ような構成となっている。
また、再生信号５と再生クロック信号６はデータ分離器
１１に入力され、データ成分１２が抽出されてデータ復
調が完了する。
１１に入力され、データ成分１２が抽出されてデータ復
調が完了する。
発明が解決しようとする課題
しかしながら、上記従来の構成では、ＶＦＯ４の中心周
波数は固定であり、ＰＬＬループ９が記録媒体と再生信
号読み取り器（以下、ピックアップという、）との相対
速度変動から起こる再生信号５の周波数変動に追従して
位相をロックできる周波数範囲は、ＶＦＯ４のダイナミ
ックレンジによって制限されるため、再生信号５の周波
数変動範囲が比較的狭いＶＦＯ４のダイナミックレンジ
の周波数範囲内でなければ位相をロックできず、従来の
データ復調器は、相対速度変動による再生信号の周波数
変動に弱いという問題を有し、さらにループフィルタに
アナログフィルタを用いているため、経時変化や温度特
性などが問題となったり、ループゲイン切り換え時のシ
ョックノイズで同期が不安定になるという問題を有して
いた。
波数は固定であり、ＰＬＬループ９が記録媒体と再生信
号読み取り器（以下、ピックアップという、）との相対
速度変動から起こる再生信号５の周波数変動に追従して
位相をロックできる周波数範囲は、ＶＦＯ４のダイナミ
ックレンジによって制限されるため、再生信号５の周波
数変動範囲が比較的狭いＶＦＯ４のダイナミックレンジ
の周波数範囲内でなければ位相をロックできず、従来の
データ復調器は、相対速度変動による再生信号の周波数
変動に弱いという問題を有し、さらにループフィルタに
アナログフィルタを用いているため、経時変化や温度特
性などが問題となったり、ループゲイン切り換え時のシ
ョックノイズで同期が不安定になるという問題を有して
いた。
本発明は上記従来の問題を解決するもので、ＶＦＯの中
心周波数を再生信号の周波数に応じて制御して相対速度
変動による再生信号の周波数変動に強く、シかも、ルー
プフィルタの経時変化や温度特性などの問題を防ぐとと
もに、ループゲイン切り換え時のショックノイズなどで
同期が不安定になるという問題を防ぐことのできるデー
タ復調器を提供することを目的とするものである。
心周波数を再生信号の周波数に応じて制御して相対速度
変動による再生信号の周波数変動に強く、シかも、ルー
プフィルタの経時変化や温度特性などの問題を防ぐとと
もに、ループゲイン切り換え時のショックノイズなどで
同期が不安定になるという問題を防ぐことのできるデー
タ復調器を提供することを目的とするものである。
課題を解決するための手段
上記構成を解決するために本発明のデータ復調器は、記
録媒体に記録されたディジタルまたはアナログデータを
、ＰＬＬ回路の出力クロック信号を用いて復調し、デー
タを再生するデータ復調器であって、前記記録媒体の再
生信号の周波数を電圧に変換する周波数−電圧変換器を
設け、前記周波数−電圧変換器の出力電圧を参照して、
前記ＰＬＬ回路の電圧−周波数変換器（Ｖ Ｆ Ｏ）′
は自己発振周波数の中心周波数を、前記記録媒体と再生
信号読み取り器（ピックアップ）との相対速度変動によ
る再生信号の周波数変動に追従させるように構成したも
のである。
録媒体に記録されたディジタルまたはアナログデータを
、ＰＬＬ回路の出力クロック信号を用いて復調し、デー
タを再生するデータ復調器であって、前記記録媒体の再
生信号の周波数を電圧に変換する周波数−電圧変換器を
設け、前記周波数−電圧変換器の出力電圧を参照して、
前記ＰＬＬ回路の電圧−周波数変換器（Ｖ Ｆ Ｏ）′
は自己発振周波数の中心周波数を、前記記録媒体と再生
信号読み取り器（ピックアップ）との相対速度変動によ
る再生信号の周波数変動に追従させるように構成したも
のである。
さらに、本発明のデータ復調器は、ＰＬＬ回路のループ
フィルタがディジタルフィルタで構成され、刻々変化す
る電圧−周波数変換器の中心周波数に適合するカットオ
フ周波数を持つように前記ディジタルフィルタを周波数
−電圧変換器の出力電圧により制御するマイクロコンピ
ュータを備えたものである。
フィルタがディジタルフィルタで構成され、刻々変化す
る電圧−周波数変換器の中心周波数に適合するカットオ
フ周波数を持つように前記ディジタルフィルタを周波数
−電圧変換器の出力電圧により制御するマイクロコンピ
ュータを備えたものである。
作用
上記構成により、再生信号の大幅な周波数変動が起こっ
ても、ＶＦＯの自己発振周波数の中心周波数を変化させ
て、ＶＦＯの出力クロック信号と再生信号との位相同期
を保持するようにし、広い周波数帯域に対応するＰＬＬ
回路を構成することができ、再生信号の周波数変動に強
いデータ復調器が得られる。さらに、ＰＬＬ回路のルー
プフィルタをディジタルフィルタで構成したことにより
。
ても、ＶＦＯの自己発振周波数の中心周波数を変化させ
て、ＶＦＯの出力クロック信号と再生信号との位相同期
を保持するようにし、広い周波数帯域に対応するＰＬＬ
回路を構成することができ、再生信号の周波数変動に強
いデータ復調器が得られる。さらに、ＰＬＬ回路のルー
プフィルタをディジタルフィルタで構成したことにより
。
ループフィルタの経時変化や温度特性などが良好であり
、また、このディジタルフィルタに対してＶＦＯの中心
周波数における最適なループ特性を周波数−電圧変換器
の出力電圧により、マイクロコンピュータで制御すると
ともに、マイクロコンピュータでディジタルフィルタの
カットオフ周波数を変化させるときのショックノイズも
皆無であり、ＰＬＬ回路の安定性を向上させることがで
きる。
、また、このディジタルフィルタに対してＶＦＯの中心
周波数における最適なループ特性を周波数−電圧変換器
の出力電圧により、マイクロコンピュータで制御すると
ともに、マイクロコンピュータでディジタルフィルタの
カットオフ周波数を変化させるときのショックノイズも
皆無であり、ＰＬＬ回路の安定性を向上させることがで
きる。
実施例
以下、本発明の一実施例について図面を参照しながら説
明する。
明する。
第１図は本発明の一実施例を示すデータ復調器のブロッ
ク図である。第１図において、記録媒体からの再生信号
２１はＦ／Ｖ変換器（周波数−電圧変換器）２２に入力
され、再生信号の周波数に比例した電圧が出力される。
ク図である。第１図において、記録媒体からの再生信号
２１はＦ／Ｖ変換器（周波数−電圧変換器）２２に入力
され、再生信号の周波数に比例した電圧が出力される。
この電圧を参照電圧２３とする。この参照電圧２３はＡ
／Ｄ変換器（電圧−ディジタルデータ変換器）２４に入
力されてディジタルデータに変換され、マイクロコンピ
ュータ２５に取り込まれる。マイクロコンピュータ２５
はこのデジタルデータからその時点における再生信号２
１の周波数を逆算し、その周波数における最適なループ
ゲインを算出し、ディジタルフィルタ２６のカットオフ
周波数を決定し制御を実行する。同時に参照電圧２３は
ＶＦ○２７の周波数レンジ制御入力に入力され、ＶＦＯ
２７の自己発振周波数の中心周波数を制御する。
／Ｄ変換器（電圧−ディジタルデータ変換器）２４に入
力されてディジタルデータに変換され、マイクロコンピ
ュータ２５に取り込まれる。マイクロコンピュータ２５
はこのデジタルデータからその時点における再生信号２
１の周波数を逆算し、その周波数における最適なループ
ゲインを算出し、ディジタルフィルタ２６のカットオフ
周波数を決定し制御を実行する。同時に参照電圧２３は
ＶＦ○２７の周波数レンジ制御入力に入力され、ＶＦＯ
２７の自己発振周波数の中心周波数を制御する。
一方、再生信号２１は位相比較器２８に入力され、ＶＦ
Ｏ２７から出力される再生クロック信号２９と位相比較
され１位相誤差３０として出力される。この位相誤差３
０はディジタルフィルタ２６にて位相補償および帯域制
限を受けた後、ＶＦＯ制御信号３１となりＶＦＯ２７に
入力され、ＰＬＬ回路３２を構成するようになっている
。このようにして、位相が同期状態にある再生信号２１
と再生クロック信号２９はデータ分離器３３に入力され
、データ成分３４が抽出されて、データ復調が完了する
。
Ｏ２７から出力される再生クロック信号２９と位相比較
され１位相誤差３０として出力される。この位相誤差３
０はディジタルフィルタ２６にて位相補償および帯域制
限を受けた後、ＶＦＯ制御信号３１となりＶＦＯ２７に
入力され、ＰＬＬ回路３２を構成するようになっている
。このようにして、位相が同期状態にある再生信号２１
と再生クロック信号２９はデータ分離器３３に入力され
、データ成分３４が抽出されて、データ復調が完了する
。
たとえば、記録媒体とピックアップとの相対速度が大き
くなり、再生信号２１の周波数が上昇するとＦ／Ｖ変換
器２２からの参照電圧２３も上昇し、これにより、ＶＦ
Ｏ２７の中心周波数を高くし、ＰＬＬ回路３１が位相同
期しやすいように制御がかかる。
くなり、再生信号２１の周波数が上昇するとＦ／Ｖ変換
器２２からの参照電圧２３も上昇し、これにより、ＶＦ
Ｏ２７の中心周波数を高くし、ＰＬＬ回路３１が位相同
期しやすいように制御がかかる。
同時にマイクロコンピュータ２５はディジタルフィルタ
２６に再生信号２１の周波数に応じた最適なカットオフ
周波数を持たせ、ＰＬＬループゲインが最適になるよう
常に制御をかける。
２６に再生信号２１の周波数に応じた最適なカットオフ
周波数を持たせ、ＰＬＬループゲインが最適になるよう
常に制御をかける。
逆に、相対速度が小さくなり、再生信号２１の周波数が
低下したときも同様な制御方法がとられる。
低下したときも同様な制御方法がとられる。
このように、相対速度変動から起こる再生信号２１の周
波数変動にＶＦＯ２７の中心周波数が追従するように帰
還をかけ、再生信号２１の大幅な周波数変動が起こって
も、ＶＦＯ２７自体が自己発振周波数の中心周波数を変
化させ、ＶＦＯ２７の再生クロック信号２９と再生信号
２１中のクロック信号とを同期させて、この位相同期を
保持するようにし、広い周波数帯域に対応するＰＬＬ回
路３１を構成することができる。さらに、ＶＦＯ２７の
中心周波数が変化するとループフィルタのカットオフ周
波数を変化させねばならないが、このループフィルタを
ディジタルフィルタ２６で構成し、刻々と変動するＶＦ
Ｏ２７の中心周波数における最適なループ特性をマイク
ロコンピュータによって算出し、このループ特性をディ
ジタルフィルタ２６にリアルタイムに持たせるようにし
て、ＰＬＬ回路の安定性を向上させるようにしたもので
ある。また、ディジタルフィルタは従来のループフィル
タとしてのアナログフィルタと比較して経時変化や温度
特性などが良好で、かつ位相の不規則な回転も少なく、
マイクロコンピュータでカットオフ周波数を変化させる
ときのショックノイズも皆無に近い、したがって、大幅
な相対速度変動による再生信号の大幅な周波数変動が起
こっても、安定したデータ復調が可能となるため機構系
による記録媒体の駆動精度に対する要求が緩和され、全
体的なシステム設計が容易となる。
波数変動にＶＦＯ２７の中心周波数が追従するように帰
還をかけ、再生信号２１の大幅な周波数変動が起こって
も、ＶＦＯ２７自体が自己発振周波数の中心周波数を変
化させ、ＶＦＯ２７の再生クロック信号２９と再生信号
２１中のクロック信号とを同期させて、この位相同期を
保持するようにし、広い周波数帯域に対応するＰＬＬ回
路３１を構成することができる。さらに、ＶＦＯ２７の
中心周波数が変化するとループフィルタのカットオフ周
波数を変化させねばならないが、このループフィルタを
ディジタルフィルタ２６で構成し、刻々と変動するＶＦ
Ｏ２７の中心周波数における最適なループ特性をマイク
ロコンピュータによって算出し、このループ特性をディ
ジタルフィルタ２６にリアルタイムに持たせるようにし
て、ＰＬＬ回路の安定性を向上させるようにしたもので
ある。また、ディジタルフィルタは従来のループフィル
タとしてのアナログフィルタと比較して経時変化や温度
特性などが良好で、かつ位相の不規則な回転も少なく、
マイクロコンピュータでカットオフ周波数を変化させる
ときのショックノイズも皆無に近い、したがって、大幅
な相対速度変動による再生信号の大幅な周波数変動が起
こっても、安定したデータ復調が可能となるため機構系
による記録媒体の駆動精度に対する要求が緩和され、全
体的なシステム設計が容易となる。
発明の効果
以上のように本発明によれば、記録媒体とピックアップ
との相対速度変動が大きく、また、再生信号の周波数ド
リフトが大きいときでも、安定したデータ復調が可能と
なり、同時に機構系による記録媒体の駆動精度に対する
要求が緩和されるので全体的なシステム設計が容易とな
る。
との相対速度変動が大きく、また、再生信号の周波数ド
リフトが大きいときでも、安定したデータ復調が可能と
なり、同時に機構系による記録媒体の駆動精度に対する
要求が緩和されるので全体的なシステム設計が容易とな
る。
第１図は本発明の一実施例を示すデータ復調器のブロッ
ク図、第２図は従来のデータ復調器のブロック図である
。 ２１・・・再生信号、２２・・・Ｆ／Ｖ変換器（周波数
−電圧変換器）、２３・・・参照電圧、２５・・・マイ
クロコンビュータ、２６・・・ディジタルフィルタ、２
７・・・ＶＦＯ（電圧−周波数変換器）、２８・・・位
相比較器、２９・・・再生クロック信号（出力クロック
信号）、３ｏ・・・位相誤差、３１・・・ＶＦＯ制御信
号、３２・・・Ｐ・ＬＬ回路、３３・・・データ分離器
、３４・・・データ成分。 代理人 森 本 義 弘 第１図 、３３ ２／−０−再生化号 ２３−参照電圧 ２／ ・−再ギ２０ッ７う１号 ３／ 、、・イΣ’−Ｆ８＃ンぐノづ；３／−７７：θ
仙、￥噂号 ３２−ＦＬＬ ［１路 ｕ −−−テ′−７へ４（
ク図、第２図は従来のデータ復調器のブロック図である
。 ２１・・・再生信号、２２・・・Ｆ／Ｖ変換器（周波数
−電圧変換器）、２３・・・参照電圧、２５・・・マイ
クロコンビュータ、２６・・・ディジタルフィルタ、２
７・・・ＶＦＯ（電圧−周波数変換器）、２８・・・位
相比較器、２９・・・再生クロック信号（出力クロック
信号）、３ｏ・・・位相誤差、３１・・・ＶＦＯ制御信
号、３２・・・Ｐ・ＬＬ回路、３３・・・データ分離器
、３４・・・データ成分。 代理人 森 本 義 弘 第１図 、３３ ２／−０−再生化号 ２３−参照電圧 ２／ ・−再ギ２０ッ７う１号 ３／ 、、・イΣ’−Ｆ８＃ンぐノづ；３／−７７：θ
仙、￥噂号 ３２−ＦＬＬ ［１路 ｕ −−−テ′−７へ４（
Claims (1)
- 【特許請求の範囲】 １、記録媒体に記録されたディジタルまたはアナログデ
ータを、ＰＬＬ回路の出力ロック信号を用いて復調し、
データを再生するデータ復調器であって、前記記録媒体
の再生信号の周波数を電圧に変換する周波数−電圧変換
器を設け、前記周波数−電圧変換器の出力電圧を参照し
て、前記ＰＬＬ回路の電圧−周波数変換器（ＶＦＯ）は
自己発振周波数の中心周波数を、前記記録媒体と再生信
号読み取り器（ピックアップ）との相対速度変動による
再生信号の周波数変動に追従させるように構成したデー
タ復調器。 ２、ＰＬＬ回路のループフィルタがディジタルフィルタ
で構成され、刻々変化する電圧−周波数変換器の中心周
波数に適合するカットオフ周波数を持つように前記ディ
ジタルフィルタを周波数−電圧変換器の出力電圧により
制御するマイクロコンピュータを備えた請求項１記載の
データ復調器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63105657A JPH01277371A (ja) | 1988-04-28 | 1988-04-28 | データ復調器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63105657A JPH01277371A (ja) | 1988-04-28 | 1988-04-28 | データ復調器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH01277371A true JPH01277371A (ja) | 1989-11-07 |
Family
ID=14413515
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63105657A Pending JPH01277371A (ja) | 1988-04-28 | 1988-04-28 | データ復調器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01277371A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03212860A (ja) * | 1990-01-16 | 1991-09-18 | Pioneer Electron Corp | クロック生成用ｐｌｌ回路を含む読取線速度可変型ディスク記録情報再生装置 |
| US5448543A (en) * | 1991-09-03 | 1995-09-05 | Hitachi, Ltd. | Apparatus for reproducing data from a regenerative signal using a PLH circuit having loop gain control |
| WO2011091261A3 (en) * | 2010-01-21 | 2011-11-17 | Texas Instruments Incorporated | Method and apparatus for frequency-modulation control of an oscillator |
| US8693296B2 (en) | 2006-12-22 | 2014-04-08 | Nec Corporation | PLL circuit and disk drive |
-
1988
- 1988-04-28 JP JP63105657A patent/JPH01277371A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03212860A (ja) * | 1990-01-16 | 1991-09-18 | Pioneer Electron Corp | クロック生成用ｐｌｌ回路を含む読取線速度可変型ディスク記録情報再生装置 |
| US5448543A (en) * | 1991-09-03 | 1995-09-05 | Hitachi, Ltd. | Apparatus for reproducing data from a regenerative signal using a PLH circuit having loop gain control |
| US8693296B2 (en) | 2006-12-22 | 2014-04-08 | Nec Corporation | PLL circuit and disk drive |
| WO2011091261A3 (en) * | 2010-01-21 | 2011-11-17 | Texas Instruments Incorporated | Method and apparatus for frequency-modulation control of an oscillator |
| US8405464B2 (en) | 2010-01-21 | 2013-03-26 | Texas Instruments Deutschland Gmbh | Electronic device for controlling a frequency modulation index and a method of frequency-modulating |
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