JPH0131353B2 - - Google Patents
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- Publication number
- JPH0131353B2 JPH0131353B2 JP54145048A JP14504879A JPH0131353B2 JP H0131353 B2 JPH0131353 B2 JP H0131353B2 JP 54145048 A JP54145048 A JP 54145048A JP 14504879 A JP14504879 A JP 14504879A JP H0131353 B2 JPH0131353 B2 JP H0131353B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- pulse
- synchronization signal
- gate
- horizontal synchronization
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 238000001514 detection method Methods 0.000 claims description 7
- 238000010586 diagram Methods 0.000 description 5
- 230000010354 integration Effects 0.000 description 4
- 230000003111 delayed effect Effects 0.000 description 3
- 230000000630 rising effect Effects 0.000 description 2
- 230000001960 triggered effect Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/76—Television signal recording
- H04N5/91—Television signal processing therefor
- H04N5/93—Regeneration of the television signal or of selected parts thereof
- H04N5/94—Signal drop-out compensation
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Television Signal Processing For Recording (AREA)
Description
【発明の詳細な説明】
本発明は記録情報再生装置における再生水平同
期信号の位相誤差を検出する位相誤差検出装置に
関するものである。
期信号の位相誤差を検出する位相誤差検出装置に
関するものである。
VTR（ビデオテープレコーダ）やVDP（ビデオ
デイスクプレーヤ）等における記録情報再生装置
においては、再生水平同期信号が基準の信号に対
してその位相がいくらずれているかを検出してそ
の位相誤差に応じて再生ベツトやデイスクの回転
速度を所望に制御しもつて再生画像の時間ずれ等
を正確に補正するサーボ制御装置が設けられてい
る。
デイスクプレーヤ）等における記録情報再生装置
においては、再生水平同期信号が基準の信号に対
してその位相がいくらずれているかを検出してそ
の位相誤差に応じて再生ベツトやデイスクの回転
速度を所望に制御しもつて再生画像の時間ずれ等
を正確に補正するサーボ制御装置が設けられてい
る。
かゝるサーボ制御のための水平同期信号の位相
誤差検出装置においては、ドロツプアウトにより
水平同期信号が欠如すると、仮に正規の回転速度
であつても速度を早めるようにサーボが動作して
しまうし、また水平同期信号の間にノイズ状のパ
ルスや更には等価パルス等の不要パルスが存在し
ていると、これら不要パルスと基準信号との位相
比較がなされて誤つた位相差信号を生じて速度を
遅くするようにサーボが動作してしまいそのため
に大幅にサーボが乱れる欠点がある。
誤差検出装置においては、ドロツプアウトにより
水平同期信号が欠如すると、仮に正規の回転速度
であつても速度を早めるようにサーボが動作して
しまうし、また水平同期信号の間にノイズ状のパ
ルスや更には等価パルス等の不要パルスが存在し
ていると、これら不要パルスと基準信号との位相
比較がなされて誤つた位相差信号を生じて速度を
遅くするようにサーボが動作してしまいそのため
に大幅にサーボが乱れる欠点がある。
従つて、本発明はこれら不要パルスを除去しか
つドロツプアウトにより水平同期信号が存在しな
いときには擬似の同期信号を発生するようにして
常に良好な位相誤差検出をなすようにしてサーボ
系の大幅な乱れをなくした記録情報再生装置にお
ける再生水平同期信号位相誤差検出装置を提供す
ることを目的としている。
つドロツプアウトにより水平同期信号が存在しな
いときには擬似の同期信号を発生するようにして
常に良好な位相誤差検出をなすようにしてサーボ
系の大幅な乱れをなくした記録情報再生装置にお
ける再生水平同期信号位相誤差検出装置を提供す
ることを目的としている。
本発明の再生水平同期信号位相誤差検出装置
は、水平同期信号と等しい周波数を有する基準信
号を用いて再生水平同期信号のパルス幅よりやや
大なるパルス幅を有しこのパルス期間中に基準信
号の発生タイミングを含むようなゲートパルスを
発生せしめ、このゲートパルスの存在期間中に再
生水平同期信号があるときにはこの再生水平同期
信号（若しくはその反転信号）を通過せしめまた
再生水平同期信号がないときにはゲートパルス
（若しくはその反転信号）を通過せしめるように
し、この通過出力を用いて基準信号との位相差を
検出するようにしたことを特徴としている。
は、水平同期信号と等しい周波数を有する基準信
号を用いて再生水平同期信号のパルス幅よりやや
大なるパルス幅を有しこのパルス期間中に基準信
号の発生タイミングを含むようなゲートパルスを
発生せしめ、このゲートパルスの存在期間中に再
生水平同期信号があるときにはこの再生水平同期
信号（若しくはその反転信号）を通過せしめまた
再生水平同期信号がないときにはゲートパルス
（若しくはその反転信号）を通過せしめるように
し、この通過出力を用いて基準信号との位相差を
検出するようにしたことを特徴としている。
以下に本発明を図面を用いて説明する。
第１図は本発明の一実施例を示す回路ブロツク
図であり、ノイズ状パルスや等価パルスを含み更
にはドロツプアウトにより一部欠如した再生水平
同期信号ＡはNANDゲート１の１入力となり、
このゲート出力Ｇは単安定マルチバイブレータ
（以下MMVと略記す）２のトリガ入力となる。
このMMV２の出力Ｈは位相比較器３において基
準の信号Ｂと位相比較されて、誤差信号が出力さ
れ所定のサーボ用制御信号として用いられる。こ
のNANDゲート１およびMMV２によつて、基
準同期信号と比較すべき信号を発生するパルス発
生手段を構成している。
図であり、ノイズ状パルスや等価パルスを含み更
にはドロツプアウトにより一部欠如した再生水平
同期信号ＡはNANDゲート１の１入力となり、
このゲート出力Ｇは単安定マルチバイブレータ
（以下MMVと略記す）２のトリガ入力となる。
このMMV２の出力Ｈは位相比較器３において基
準の信号Ｂと位相比較されて、誤差信号が出力さ
れ所定のサーボ用制御信号として用いられる。こ
のNANDゲート１およびMMV２によつて、基
準同期信号と比較すべき信号を発生するパルス発
生手段を構成している。
この基準信号Ｂとしては、例えば水平同期信号
の２倍の周波数を有する発振器４の出力を1/2に
分周して得られる15.75KHzのデユーテイが50％
のパルス信号が用いられる。このデユーテイ50％
の基準パルス信号ＢはMMV６のトリガ入力とな
ると共にNORゲート７の１入力となる。この
NORゲート７の他入力はMMV６の出力Ｃが用
いられる。当該NORゲート７の出力Ｄは積分
（遅延）回路８へ印加されて積分（遅延）され、
この出力Ｅがレベル比較器９の正相入力となる。
その逆相入力としては基準電圧V1が用いられ、
この基準電圧V1より入力Ｅが大なるときに高レ
ベルのパルス信号Ｆが得られる。そしてこのパル
ス信号ＦがNANDゲート１の他方のゲート入力
となる如き構成である。
の２倍の周波数を有する発振器４の出力を1/2に
分周して得られる15.75KHzのデユーテイが50％
のパルス信号が用いられる。このデユーテイ50％
の基準パルス信号ＢはMMV６のトリガ入力とな
ると共にNORゲート７の１入力となる。この
NORゲート７の他入力はMMV６の出力Ｃが用
いられる。当該NORゲート７の出力Ｄは積分
（遅延）回路８へ印加されて積分（遅延）され、
この出力Ｅがレベル比較器９の正相入力となる。
その逆相入力としては基準電圧V1が用いられ、
この基準電圧V1より入力Ｅが大なるときに高レ
ベルのパルス信号Ｆが得られる。そしてこのパル
ス信号ＦがNANDゲート１の他方のゲート入力
となる如き構成である。
第２図は第１図のブロツクにおける各部波形図
であつて、両図において同一符号は同等部分の波
形を示している。1/2分周器５からは水平同期信
号と同一の周波数（15.75KHz）を有してデユー
テイが50％のパルス状基準信号Ｂが発生されてお
り、この信号と再生水平同期信号Ａとの位相差が
遂次判別されるものであるが、本発明において
は、先ずこの基準パルスＢの各立下りタイミング
によつてトリガされるMMV６の出力Ｃと当該基
準パルスＢとの否定論理和をNORゲート７によ
り得るようにして、各基準信号の発生タイミング
（立上り）から一定期間遅れて立上りかつ次の基
準信号の発生タイミングにて立下る一定幅のパル
ス列Ｄを得ている。このパルス列Ｄの各パルスを
次段の積分（遅延）回路８により積分（遅延）し
て略三角波パルスＥを得、しかる後に基準レベル
V1と比較してこのレベルより三角波パルスのレ
ベルが大なるときに高レベルとなるパルス列Ｆを
発生させている。従つて、積分（遅延）回路８の
積分時定数及び比較器９の比較レベルV1を適当
に設定することによつて、基準パルスＢの各立上
り（発生タイミング）を高レベルの期間内に含ん
で、かつ水平同期信号のパルス幅よりやや大なる
パルス幅を有するゲートパルス列Ｆが得られるこ
とになる。
であつて、両図において同一符号は同等部分の波
形を示している。1/2分周器５からは水平同期信
号と同一の周波数（15.75KHz）を有してデユー
テイが50％のパルス状基準信号Ｂが発生されてお
り、この信号と再生水平同期信号Ａとの位相差が
遂次判別されるものであるが、本発明において
は、先ずこの基準パルスＢの各立下りタイミング
によつてトリガされるMMV６の出力Ｃと当該基
準パルスＢとの否定論理和をNORゲート７によ
り得るようにして、各基準信号の発生タイミング
（立上り）から一定期間遅れて立上りかつ次の基
準信号の発生タイミングにて立下る一定幅のパル
ス列Ｄを得ている。このパルス列Ｄの各パルスを
次段の積分（遅延）回路８により積分（遅延）し
て略三角波パルスＥを得、しかる後に基準レベル
V1と比較してこのレベルより三角波パルスのレ
ベルが大なるときに高レベルとなるパルス列Ｆを
発生させている。従つて、積分（遅延）回路８の
積分時定数及び比較器９の比較レベルV1を適当
に設定することによつて、基準パルスＢの各立上
り（発生タイミング）を高レベルの期間内に含ん
で、かつ水平同期信号のパルス幅よりやや大なる
パルス幅を有するゲートパルス列Ｆが得られるこ
とになる。
よつて、このゲートパルスＦを再生同期信号を
１入力とするNANDゲート１に印加することに
より、図Ｇに示す如き波形がNAND出力となる
ことが判る。すなわち、ゲートパルスＦの存在期
間中に再生水平同期信号が存在すれば、この水平
同期信号が反転されて出力されまたその間にドロ
ツプアウト等によつて再生水平同期信号が点線ｂ
のように消失してないときにはゲートパルスが反
転して出力されることになる。従つてこのゲート
出力の立上りにてトリガされるMMV２の出力は
図Ｈに示すように再生水平同期信号の発生タイミ
ングに一致したものとなり、比較器３にて正規の
位相比較をなすことになる。再生水平同期信号が
欠如していると、ゲートパルスＦの反転出力であ
るゲート出力Ｇの立上りタイミングと一致して
MMV２の出力が立上るから、本来の再生水平同
期信号のタイミングよりやゝ遅れたMMV２の出
力が位相比較器３の入力となつて、完全に再生水
平同期信号がなくても近似の位相比較がなされう
ることになる。
１入力とするNANDゲート１に印加することに
より、図Ｇに示す如き波形がNAND出力となる
ことが判る。すなわち、ゲートパルスＦの存在期
間中に再生水平同期信号が存在すれば、この水平
同期信号が反転されて出力されまたその間にドロ
ツプアウト等によつて再生水平同期信号が点線ｂ
のように消失してないときにはゲートパルスが反
転して出力されることになる。従つてこのゲート
出力の立上りにてトリガされるMMV２の出力は
図Ｈに示すように再生水平同期信号の発生タイミ
ングに一致したものとなり、比較器３にて正規の
位相比較をなすことになる。再生水平同期信号が
欠如していると、ゲートパルスＦの反転出力であ
るゲート出力Ｇの立上りタイミングと一致して
MMV２の出力が立上るから、本来の再生水平同
期信号のタイミングよりやゝ遅れたMMV２の出
力が位相比較器３の入力となつて、完全に再生水
平同期信号がなくても近似の位相比較がなされう
ることになる。
また、図Ａのａに示すようにパルス状ノイズ若
しくは等価パルス等の不要ノイズが存在してもこ
れがゲートパルスＦの存在期間中にない限りにお
いて、これら不要パルスはゲート１にて阻止され
除去されるものである。
しくは等価パルス等の不要ノイズが存在してもこ
れがゲートパルスＦの存在期間中にない限りにお
いて、これら不要パルスはゲート１にて阻止され
除去されるものである。
以上のように、不要パルスを除くと共にドロツ
プアウト等により水平同期信号が欠如しても擬似
パルスを発生させるから、サーボ制御が大幅に乱
れることなく正確にかつ安定になされる利点があ
る。
プアウト等により水平同期信号が欠如しても擬似
パルスを発生させるから、サーボ制御が大幅に乱
れることなく正確にかつ安定になされる利点があ
る。
上記のブロツク図は一実施例を示すにすぎず、
これに限定されることなく種々の改変が可能であ
ることは勿論である。例えば各部における信号の
極性を異ならしめても良くそれに応じて各ゲート
の種類や比較器の比較入力を適当に可変制御して
用いればよいものである。
これに限定されることなく種々の改変が可能であ
ることは勿論である。例えば各部における信号の
極性を異ならしめても良くそれに応じて各ゲート
の種類や比較器の比較入力を適当に可変制御して
用いればよいものである。
第１図は本発明の一実施例を示すブロツク図、
第２図Ａ〜Ｈは第１図のブロツクにおける各部動
作波形図である。 主要部分の符号の説明、１，７……ゲート、
２，６……MMV、３……位相比較器、９……レ
ベル比較器。
第２図Ａ〜Ｈは第１図のブロツクにおける各部動
作波形図である。 主要部分の符号の説明、１，７……ゲート、
２，６……MMV、３……位相比較器、９……レ
ベル比較器。
Claims (1)
- 【特許請求の範囲】 １ 再生水平同期信号と水平同期信号と等しい周
波数を有する基準同期信号との位相差を検出して
所定サーボ回路の制御信号を発生する記録情報再
生装置における位相誤差検出装置であつて、 前記基準同期信号を発生する手段と、 前記基準同期信号を用いて前記再生水平同期信
号のパルス幅よりやや大なるパルス幅を有し、か
つそのパルス幅内に前記再生水平同期信号が発生
するタイミングが存在するゲートパルスを発生す
る手段と、 前記ゲートパルスの存在期間中に前記再生水平
同期信号が存在するときには、前記再生水平同期
信号の発生タイミングと同一の発生タイミングを
有する信号を、かつ前記ゲートパルスの存在期間
中に前記再生水平同期信号が存在しないときに
は、前記ゲートパルスの終了タイミングと同一の
発生タイミングを有する信号を出力するパルス発
生手段と、 前記パルス発生手段の出力信号と前記基準同期
信号との位相差を検出する位相比較手段とを具備
することを特徴とする記録情報再生装置における
位相誤差検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14504879A JPS5668076A (en) | 1979-11-09 | 1979-11-09 | Horizontal synchronizing signal phase error detecting device in recorded information reproducing device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14504879A JPS5668076A (en) | 1979-11-09 | 1979-11-09 | Horizontal synchronizing signal phase error detecting device in recorded information reproducing device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5668076A JPS5668076A (en) | 1981-06-08 |
| JPH0131353B2 true JPH0131353B2 (ja) | 1989-06-26 |
Family
ID=15376172
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14504879A Granted JPS5668076A (en) | 1979-11-09 | 1979-11-09 | Horizontal synchronizing signal phase error detecting device in recorded information reproducing device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5668076A (ja) |
-
1979
- 1979-11-09 JP JP14504879A patent/JPS5668076A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5668076A (en) | 1981-06-08 |
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