JPH0134130Y2 - - Google Patents
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- Publication number
- JPH0134130Y2 JPH0134130Y2 JP1980171428U JP17142880U JPH0134130Y2 JP H0134130 Y2 JPH0134130 Y2 JP H0134130Y2 JP 1980171428 U JP1980171428 U JP 1980171428U JP 17142880 U JP17142880 U JP 17142880U JP H0134130 Y2 JPH0134130 Y2 JP H0134130Y2
- Authority
- JP
- Japan
- Prior art keywords
- output
- transistor
- swr
- indicator
- cpu
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- Measurement Of Resistance Or Impedance (AREA)
Description
【考案の詳細な説明】
〔産業上の利用分野〕
本考案は無線送信機のSWR計で特にCPU制御
により進行波検出出力とSWR検出出力の切換の
いらない自動SWR計に関する。
により進行波検出出力とSWR検出出力の切換の
いらない自動SWR計に関する。
従来技術のSWR計の基本回路を第１図に示し、
その動作を説明する。SWR回路を通過する高周
波電力は進行波と反射波の検出回路１により進行
波電力に比例する進行波出力１Ａと反射波電力に
比例する反射波出力１Ｂをダイオードで整流して
直流出力として比較する。そのためにSWR指示
器２を感度調整器３を通して進行波出力側に接
ぎ、計器がフルスケールを指示するように感度調
整器を合わせる。次に計器を反射波出力側に切換
えて、その際の計器の目盛からSWR値を読み取
るものである。
その動作を説明する。SWR回路を通過する高周
波電力は進行波と反射波の検出回路１により進行
波電力に比例する進行波出力１Ａと反射波電力に
比例する反射波出力１Ｂをダイオードで整流して
直流出力として比較する。そのためにSWR指示
器２を感度調整器３を通して進行波出力側に接
ぎ、計器がフルスケールを指示するように感度調
整器を合わせる。次に計器を反射波出力側に切換
えて、その際の計器の目盛からSWR値を読み取
るものである。
本考案はSWR計の指示値をCPU（Central
Processing Unit）の制御により常時自動的に計
測表示する回路の提供を目的とする。
Processing Unit）の制御により常時自動的に計
測表示する回路の提供を目的とする。
本考案は、送信機に組込まれて機器の動作の自
動化に使用しているCPUの余力を利用して、
SWR計を自動表示させるものであり、SWR回路
の進行波電力とSWR値を並行検出し、同一抵抗
値の負荷抵抗を通し、同一出力内部抵抗のトラン
ジスタに夫々接続する。SWR値の出力側トラン
ジスタに並列に指示計を設け、進行波検出の出力
側トランジスタに指示計の内部抵抗と等しい抵抗
をコレクタ・エミツタ間に並列接続する。従つて
これらのトランジスタ回路のインピーダンスは等
しい。更に進行波の出力側トランジスタの出力は
コンパレータの一端子に加えられ、他の端子には
指示計のフルスケールに等しい基準電圧を加え比
較してCPUの入力とし、CPUの出力は制御信号
をＤ／Ａ変換器でアナログ変換して前記の各トラ
ンジスタのベースに加えられトランジスタの電流
制御をして指示計に適値を表示させる構成であ
る。
動化に使用しているCPUの余力を利用して、
SWR計を自動表示させるものであり、SWR回路
の進行波電力とSWR値を並行検出し、同一抵抗
値の負荷抵抗を通し、同一出力内部抵抗のトラン
ジスタに夫々接続する。SWR値の出力側トラン
ジスタに並列に指示計を設け、進行波検出の出力
側トランジスタに指示計の内部抵抗と等しい抵抗
をコレクタ・エミツタ間に並列接続する。従つて
これらのトランジスタ回路のインピーダンスは等
しい。更に進行波の出力側トランジスタの出力は
コンパレータの一端子に加えられ、他の端子には
指示計のフルスケールに等しい基準電圧を加え比
較してCPUの入力とし、CPUの出力は制御信号
をＤ／Ａ変換器でアナログ変換して前記の各トラ
ンジスタのベースに加えられトランジスタの電流
制御をして指示計に適値を表示させる構成であ
る。
本考案の一実施例を第２図について説明する。
進行波と反対波の検出回路１の進行波検出出力１
Ａと反射波検出出力１Ｂの負荷としては、それぞ
れ同一値の負荷抵抗４Ａ，４Ｂに同一特性のトラ
ンジスタ５Ａ，５Ｂの出力内部抵抗（バイポー
ラ・トランジスタではコレクタ・エミツタ間抵抗
であり、FETではドレイン・ソース間抵抗であ
る）を接続し、反射波側のトランジスタ５Ａに並
列にSWR指示計２を接続し、進行波側トランジ
スタ５Ａには指示計２の内部抵抗と等しい抵抗６
を並列に接続する。トランジスタ５Ａ，５Ｂの制
御入力は並列に接続されて共通のバイアスで制御
されるから、トランジスタ５Ａの内部抵抗とトラ
ンジスタ５Ｂの内部抵抗とは同一の値で変化する
ことになり、指示計２をトランジスタ５Ａ側に接
いでもトランジスタ５Ｂ側に接いでも計器の感度
は同一で、指示は検出回路１の進行波検出出力１
Ａと反射波検出出力１Ｂに比例する。従つて第２
図のごとく指示計２はトランジスタ５Ｂの電圧降
下を指示し、トランジスタ５Ａの電圧降下を計器
のフルスケールの値と一致するように制御入力を
設定すれば、第１図のように指示計２の接続を切
り替えることなしに、指示計２は常に進行波に対
する反対波の割合を指示するから、これをSWR
で目盛つて直読することが可能である。
進行波と反対波の検出回路１の進行波検出出力１
Ａと反射波検出出力１Ｂの負荷としては、それぞ
れ同一値の負荷抵抗４Ａ，４Ｂに同一特性のトラ
ンジスタ５Ａ，５Ｂの出力内部抵抗（バイポー
ラ・トランジスタではコレクタ・エミツタ間抵抗
であり、FETではドレイン・ソース間抵抗であ
る）を接続し、反射波側のトランジスタ５Ａに並
列にSWR指示計２を接続し、進行波側トランジ
スタ５Ａには指示計２の内部抵抗と等しい抵抗６
を並列に接続する。トランジスタ５Ａ，５Ｂの制
御入力は並列に接続されて共通のバイアスで制御
されるから、トランジスタ５Ａの内部抵抗とトラ
ンジスタ５Ｂの内部抵抗とは同一の値で変化する
ことになり、指示計２をトランジスタ５Ａ側に接
いでもトランジスタ５Ｂ側に接いでも計器の感度
は同一で、指示は検出回路１の進行波検出出力１
Ａと反射波検出出力１Ｂに比例する。従つて第２
図のごとく指示計２はトランジスタ５Ｂの電圧降
下を指示し、トランジスタ５Ａの電圧降下を計器
のフルスケールの値と一致するように制御入力を
設定すれば、第１図のように指示計２の接続を切
り替えることなしに、指示計２は常に進行波に対
する反対波の割合を指示するから、これをSWR
で目盛つて直読することが可能である。
次にトランジスタ５Ａの電圧降下の設定には、
この電圧降下Vfをコンパレータ７の一方の入力
に加え、他方の入力には指示計２のフルスケール
電圧に等しい基準電圧Vrを加えて比較し、Vrに
対するVfの大小に応じてコンパレータの出力は
逆転するから、これをCPU８のＩ／Ｏの入力ポ
ートに加え、第３図のフローチヤートのようなサ
ブルーチンで簡単な作業によりＩ／Ｏの出力ポー
トの例えば８ビツトのバイナリ出力において、１
回の演算ごとに１を増減する作業が行なわれ、そ
の出力はＤ／Ａコンバータ９で直流変換され、ト
ランジスタ５Ａ，５Ｂの制御バイアスとなり、そ
の内部抵抗を変化させて、VfとVrが一致するま
で行われる。ここに使用するＤ／Ａコンバータ９
としては高度の性能は必要ないので、第４図のよ
うな抵抗により重り付けの簡単な回路でよい。実
際にはスタート時に指示計を振り切らせないため
に、トランジスタ５Ａ，５Ｂの電圧降下で小さい
状態からスタートすることが望ましいので、内部
抵抗が最小の状態からスタートするように入力バ
イアスを設定するが、バイポーラ・トランジスタ
とFETとではバイアスの方向が異る場合がある
ので、使用素子の特性に合致させる必要がある
が、要するに、コンパレータ入力の変化→CPU
出力の増減→Ｄ／Ａ変換出力の増減→トランジス
タ内部抵抗の変化→コンパレータ入力、のループ
の動作が、Vf＝Vrに収れんする方向に構成すれ
ばよい。第５図にCPU部分の入出力の接続例を
示す。
この電圧降下Vfをコンパレータ７の一方の入力
に加え、他方の入力には指示計２のフルスケール
電圧に等しい基準電圧Vrを加えて比較し、Vrに
対するVfの大小に応じてコンパレータの出力は
逆転するから、これをCPU８のＩ／Ｏの入力ポ
ートに加え、第３図のフローチヤートのようなサ
ブルーチンで簡単な作業によりＩ／Ｏの出力ポー
トの例えば８ビツトのバイナリ出力において、１
回の演算ごとに１を増減する作業が行なわれ、そ
の出力はＤ／Ａコンバータ９で直流変換され、ト
ランジスタ５Ａ，５Ｂの制御バイアスとなり、そ
の内部抵抗を変化させて、VfとVrが一致するま
で行われる。ここに使用するＤ／Ａコンバータ９
としては高度の性能は必要ないので、第４図のよ
うな抵抗により重り付けの簡単な回路でよい。実
際にはスタート時に指示計を振り切らせないため
に、トランジスタ５Ａ，５Ｂの電圧降下で小さい
状態からスタートすることが望ましいので、内部
抵抗が最小の状態からスタートするように入力バ
イアスを設定するが、バイポーラ・トランジスタ
とFETとではバイアスの方向が異る場合がある
ので、使用素子の特性に合致させる必要がある
が、要するに、コンパレータ入力の変化→CPU
出力の増減→Ｄ／Ａ変換出力の増減→トランジス
タ内部抵抗の変化→コンパレータ入力、のループ
の動作が、Vf＝Vrに収れんする方向に構成すれ
ばよい。第５図にCPU部分の入出力の接続例を
示す。
本考案においては従来のSWR計における進行
波の大小に応じて指示計の感度を調整する手動操
作を不要としたことにより取扱いの容易であるの
は勿論、使用中は連続的に監視し得るので、送信
機に組込んで使用するのにも便利である。
波の大小に応じて指示計の感度を調整する手動操
作を不要としたことにより取扱いの容易であるの
は勿論、使用中は連続的に監視し得るので、送信
機に組込んで使用するのにも便利である。
第１図は従来のSWR計の原理を示す回路図、
第２図は本考案の一実施例を示すブロツク図、第
３図はCPUの動作を示すフローチヤート、第４
図はＤ／Ａコンバータの回路図、第５図はCPU
の入出力回路図を示す。 １……検出回路、２……指示計、３……感度調
整器、４Ａ，４Ｂ……負荷抵抗、５Ａ，５Ｂ……
トランジスタ、７……コンパレータ、８……
CPU、９……Ｄ／Ａコンバータ。
第２図は本考案の一実施例を示すブロツク図、第
３図はCPUの動作を示すフローチヤート、第４
図はＤ／Ａコンバータの回路図、第５図はCPU
の入出力回路図を示す。 １……検出回路、２……指示計、３……感度調
整器、４Ａ，４Ｂ……負荷抵抗、５Ａ，５Ｂ……
トランジスタ、７……コンパレータ、８……
CPU、９……Ｄ／Ａコンバータ。
Claims (1)
- 送信機の出力端と負荷の中間に挿入して、進行
波強度に比例する電圧と反射波強度に比例する電
圧を同時にかつ別個に出力する検出回路の各出力
負荷は同一値の負荷抵抗と同一特性のトランジス
タの出力内部抵抗の直列接続によりなり、反射波
側のトランジスタには並列にSWR直読目盛の
SWR指示計を接続し、進行波側のトランジスタ
にはSWR指示計の内部抵抗と等しい抵抗を並列
に接続する手段と、前記進行波のトランジスタの
電圧降下をコンパレータの一方に加え、他方の入
力には基準電圧を加え、コンパレータの出力側は
CPUの入力ポートに接続し、出力ポートのバイ
ナリ出力の増減をコントロールする手段と、該
CPUの出力をＤ／Ａ変換器でアナログ変換され
た電圧を前記進行波検出回路と反射波検出回路の
各トランジスタの制御入力として共通に加える手
段とを具備したことを特徴とする自動SWR計。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1980171428U JPH0134130Y2 (ja) | 1980-11-29 | 1980-11-29 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1980171428U JPH0134130Y2 (ja) | 1980-11-29 | 1980-11-29 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5793873U JPS5793873U (ja) | 1982-06-09 |
| JPH0134130Y2 true JPH0134130Y2 (ja) | 1989-10-17 |
Family
ID=29529784
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1980171428U Expired JPH0134130Y2 (ja) | 1980-11-29 | 1980-11-29 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0134130Y2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5551755U (ja) * | 1978-10-04 | 1980-04-05 |
-
1980
- 1980-11-29 JP JP1980171428U patent/JPH0134130Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5793873U (ja) | 1982-06-09 |
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