JPH0137760B2 - - Google Patents

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JPH0137760B2
JPH0137760B2 JP61271591A JP27159186A JPH0137760B2 JP H0137760 B2 JPH0137760 B2 JP H0137760B2 JP 61271591 A JP61271591 A JP 61271591A JP 27159186 A JP27159186 A JP 27159186A JP H0137760 B2 JPH0137760 B2 JP H0137760B2
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JP
Japan
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data
octave
note
key
circuit
Prior art date
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Expired
Application number
JP61271591A
Other languages
Japanese (ja)
Other versions
JPS62135896A (en
Inventor
Akio Hyoshi
Akira Nakada
Tsutomu Suzuki
Eiichiro Aoki
Takatoshi Okumura
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Yamaha Corp
Original Assignee
Yamaha Corp
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Publication date
Application filed by Yamaha Corp filed Critical Yamaha Corp
Priority to JP61271591A priority Critical patent/JPS62135896A/en
Publication of JPS62135896A publication Critical patent/JPS62135896A/en
Publication of JPH0137760B2 publication Critical patent/JPH0137760B2/ja
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  • Electrophonic Musical Instruments (AREA)

Description

【発明の詳細な説明】[Detailed description of the invention]

〔産業上の利用分野〕 この発明は、所望楽音周波数に対応する周期で
繰返し変化する変数データを発生し、この変数デ
ータを楽音信号発生のために使用する電子楽器の
ウエーブゼネレータに関する。 〔従来の技術〕 波形メモリに記憶した波形の順次サンプル点振
幅値を順次読み出して楽音信号もしくは音源信号
を得る場合、発生すべき音の周波数に対応する定
数を繰返し演算(加算又は減算)し、その演算結
果に応じて前記波形メモリの読み出しアドレスを
進める方式の電子楽器は既に公知である。このよ
うな電子楽器において、従来は上述の周波数に対
応する定数を鍵盤の各音に個々に対応して記憶装
置に記憶させておくようにしていた(特開昭49−
130213号公報参照)。 〔発明が解決しようとする問題点〕 従来の電子楽器では、周波数に対応する定数を
鍵盤の各音に個々に対応して記憶装置に記憶させ
ておくようにしているため、例えば、鍵数が61鍵
であれば、61の種類の定数を記憶させておくこと
になり、該記憶装置に比較的大きな容量が要求さ
れ、コスト高になるという問題があつた。 この発明は、上述の点に鑑みてなされたもの
で、周波数に対応する定数を記憶する記憶装置を
小容量化したウエーブゼネレータを提供すること
を目的とする。 〔問題点を解決するための手段および作用〕 この発明によれば、複数の鍵を有する鍵盤と、
前記鍵盤での鍵操作に対応して該操作された鍵の
音名およびオクターブを示す音名データおよびオ
クターブデータからなるキーデータを発生するキ
ーデータ発生手段と、所定オクターブの各音名の
楽音の周波数にそれぞれ対応する複数ビツトから
なる複数の定数データを記憶する記憶手段と、前
記記憶手段から前記音名データに基づき、該音名
データが示す音名に対応する前記定数データを読
み出す読出し手段と、前記記憶手段から読み出さ
れた定数データに基づき前記楽音の周波数に対応
した周期で繰返し変化する複数ビツトからなる変
数データを出力する変数データ発生手段と、前記
変数データ発生手段から出力された変数データの
ビツト位置を前記オクターブデータに応じてシフ
トすることにより該変数データを変更し、前記キ
ーデータが示す鍵の楽音周波数に対応する周期で
繰返し変化するデータを出力する変更手段と、前
記変更手段から出力されるデータに基づき対応す
る周波数の楽音信号を発生する楽音発生手段と を具えて構成される。 〔実施例〕 以下この発明の一実施例を添付図面にもとづい
て詳細に説明しよう。 第1図はこの発明のウエーブゼネレータ10を
使用した電子楽器の一例を示す概略ブロツク図
で、押鍵検出回路12は鍵盤11に配された各鍵
のキースイツチのオンまたはオフ動作を検出し、
押圧された鍵を識別する情報を出力する。発音割
当て回路13は押鍵検出回路12から前記押圧さ
れた鍵を識別する情報を受入して、この情報が表
わす鍵の発音を同時最大発音数(例えば12音)に
対応するチヤンネルのいずれかに割当てる。発音
割当て回路13は各チヤンネルに対応する記憶位
置を有し、或る鍵の発音が割当てられたチヤンネ
ルに対応する記憶位置にその鍵を表わすキーコー
ドKCを記憶し、各チヤンネルに記憶したキーコ
ードKCを時分割的に順次出力する。鍵盤11に
おける各鍵を識別するために、第1表に示すよう
にキーコードKCは鍵盤種類を表わす2ビツトの
鍵盤コードK1,K2、オクターブ音域を表わす3
ビツトのオクターブコードB1,B2,B3及び1オ
クターブ内の12の音名を表わす4ビツトのノート
コードN1,N2,N3,N4の計9ビツトのコード
によつて構成される。 なお、この実施例においては、鍵盤11の鍵域
がC2音からC7音までの範囲であるものとする。
そして、第1オクターブ音域のオクターブコード
“000”は最低音のC2音にだけ使用されるものと
しており、そのコードB3〜N1は“0001110”とな
る。“001”という値の第2オクターブ音域のオク
ターブコードB3,B2,B1はC# 2音からC3音まで
に使用し、以下同様に、低音側のC# 音から高音
側のC音までを1オクターブとして同一のオクタ
ーブコードB3,B2,B1を使用するものとし、第
6オクターブ音域“101”のオクターブコードは
C# 6〜C7音に使用される。
[Industrial Application Field] The present invention relates to a wave generator for an electronic musical instrument that generates variable data that repeatedly changes at a cycle corresponding to a desired musical tone frequency and uses this variable data to generate musical tone signals. [Prior Art] When obtaining a musical tone signal or a sound source signal by sequentially reading sample point amplitude values of a waveform stored in a waveform memory, a constant corresponding to the frequency of the sound to be generated is repeatedly calculated (added or subtracted), An electronic musical instrument of a type in which the read address of the waveform memory is advanced in accordance with the calculation result is already known. Conventionally, in such electronic musical instruments, constants corresponding to the above-mentioned frequencies were stored in a storage device in correspondence with each note of the keyboard (Japanese Patent Application Laid-Open No. 1983-1999).
(See Publication No. 130213). [Problems to be solved by the invention] In conventional electronic musical instruments, constants corresponding to frequencies are stored in a storage device for each note on the keyboard. If there were 61 keys, 61 types of constants would have to be stored, which would require a relatively large capacity of the storage device, resulting in high costs. The present invention has been made in view of the above-mentioned points, and an object of the present invention is to provide a wave generator in which the capacity of a storage device for storing constants corresponding to frequencies is reduced. [Means and effects for solving the problem] According to the present invention, a keyboard having a plurality of keys;
key data generating means for generating key data consisting of note name data and octave data indicating the note name and octave of the operated key in response to a key operation on the keyboard; a storage means for storing a plurality of constant data consisting of a plurality of bits each corresponding to a frequency; and a reading means for reading out the constant data corresponding to the pitch name indicated by the pitch name data from the storage means based on the pitch name data. , variable data generation means for outputting variable data consisting of a plurality of bits that repeatedly changes at a cycle corresponding to the frequency of the musical tone based on the constant data read from the storage means; and a variable output from the variable data generation means. a changing means for changing the variable data by shifting the bit position of the data according to the octave data, and outputting data that changes repeatedly at a cycle corresponding to the musical tone frequency of the key indicated by the key data; and the changing means and musical tone generating means for generating a musical tone signal of a corresponding frequency based on the data output from the. [Embodiment] Hereinafter, an embodiment of the present invention will be described in detail based on the accompanying drawings. FIG. 1 is a schematic block diagram showing an example of an electronic musical instrument using the wave generator 10 of the present invention, in which a key press detection circuit 12 detects the ON or OFF operation of the key switch of each key arranged on the keyboard 11.
Outputs information identifying the pressed key. The sound generation assignment circuit 13 receives information identifying the pressed key from the pressed key detection circuit 12, and assigns the sound of the key represented by this information to one of the channels corresponding to the maximum number of simultaneous sounds (for example, 12 notes). Assign. The sound generation assignment circuit 13 has a memory location corresponding to each channel, stores a key code KC representing a certain key in the memory location corresponding to the channel to which the sound of a certain key is assigned, and stores the key code KC stored in each channel. KC is output sequentially in a time-division manner. In order to identify each key on the keyboard 11, as shown in Table 1, the key code KC is a 2-bit keyboard code K 1 , K 2 representing the keyboard type, and 3 representing the octave range.
It consists of a total of 9-bit codes: octave codes B 1 , B 2 , B 3 and 4-bit note codes N 1 , N 2 , N 3 , N 4 representing the 12 note names within one octave. Ru. In this embodiment, it is assumed that the keyboard range of the keyboard 11 is from C2 note to C7 note.
The octave code "000" in the first octave range is used only for the lowest C2 note, and the codes B3 to N1 are "0001110". The octave codes B 3 , B 2 , and B 1 in the second octave range with the value “001” are used from C# 2 to C 3 , and in the same way from C# on the bass side to C on the treble side. The same octave codes B 3 , B 2 , and B 1 are used, assuming that the range up to the note is one octave, and the octave code of the 6th octave range "101" is used for C# 6 to C 7 notes.

【表】【table】

【表】 この実施例においては、複数の音を同時に発音
可能とするために各種カウンタ、論理回路、記憶
装置等を時分割的に供用せしめるようにダイナミ
ツク論理的に構成してあるので、装置の動作を規
制するクロツクパルスの時間関係は極めて重要で
ある。第2図aは主にクロツクパルスφ1を示す
グラフで、このパルスφ1は各チヤンネルの時分
割動作を制御するものであり、例えば1μs(マイク
ロ秒;10-6秒)の周期を有している。チヤンネル
数が12であるから、主クロツクパルスφ1によつ
て順次区切られる1μs幅のタイムスロツトは第1
チヤンネル〜第12チヤンネルに順次対応させられ
る。第2図bに示すように、各タイムスロツトを
順に第1チヤンネル時間〜第12チヤンネル時間と
いうことにする。各チヤンネル時間は循環して発
生する。従つて、発音割当て回路13で発音割当
てされた鍵を表わすキーコードKCは、割当てら
れたチヤンネルの時間に一致して順次時分割的に
出力される。例えば、第1チヤンネルにペダル鍵
盤の第2オクターブ音域のC音(C3)が割当て
られ、第2チヤンネルに上鍵盤の第5オクターブ
音域のG音(G6)が割当てられ、第3チヤンネ
ルに上鍵盤の第5オクターブ音域のC音(C6)
が割当てられ、第4チヤンネルに下鍵盤の第4オ
クターブ音域のE音(E5)が割当てられており、
第5〜第12チヤンネルには発音が割当てられてい
ないとすると、発音割当て回路13から各チヤン
ネル時間に同期して時分割的に出力されるキーコ
ードKCの内容は第2図cのようになる。第5チ
ヤンネルから第12チヤンネルの出力はすべて
“0”である。 また、発音割当て回路13は押圧鍵が発音割当
てされたチヤンネルにおいて発音がなされるべき
であることを表わすアタツク開始信号(またはキ
ーオン信号)ASを各チヤンネル時間に同期して
時分割的に出力する。更に、各チヤンネルに発音
割当てされた鍵が離鍵され、これにより発音が減
衰状態となるべきことを表わすデイケイ開始信号
(またはキーオフ信号)DSを各チヤンネル時間に
同期して時分割的に出力する。これらの信号AS,
DSは楽音の振幅エンベロープ制御(発音制御)
のために利用される。更に、発音割当て回路13
では、エンベロープ発生器14からそのチヤンネ
ルにおける発音が終了したことを表わすデイケイ
終了信号DFを受入し、その信号DFにもとづいて
当該チヤンネルに関する各種記憶をクリアし発音
割当てを完全に解消するクリア信号CCを出力す
る。第2図cの例において、第1チヤンネルと第
2チヤンネルに割当てられた鍵が現在押圧中であ
り、第3チヤンネルと第4チヤンネルに割当てら
れた鍵が離鍵されその発音が減衰状態であり、第
4チヤンネルにおいてはタイムスロツトt1のとき
発音終了してデイケイ終了信号DFが発生され、
12チヤンネル時間遅れたタイムスロツトt2のとき
クリア信号CCが出力されるとすると、第2図d
〜gに示すように各信号AS,DS,DF,CCが生
じる。なお、タイムスロツトt2のときクリア信号
CCが出力されるので、第4チヤンネルのアタツ
ク開始信号ASとデイケイ開始信号DSは消去され
る。このとき第2図cの第4チヤンネル時間のキ
ーコードKCが消去されるが、図では説明の都合
上そのまま描いてある。 発音割当て回路13から出力される各種信号
KC,AS,DS,CCがどのチヤンネルのものであ
るかは、第2図に示したように、チヤンネル時間
によつて区別できるようになつている。 発音割当て回路13から出力されたキーコード
KCはウエーブゼネレータ10に加わり、該ウエ
ーブゼネレータ10からは、波形メモリ15から
楽音(音源)波形の順次サンプル点振幅値を読み
出させるための変数データ(アドレスデータ)
XqFが発生される。この実施例では波形メモリ
15はフイート数の異なる音源波形が並列的に読
み出されるようになつており、2フイート2′、
4フイート4′、8フイート8′、16フイート1
6′、32フイート32′の音にそれぞれ対応してメ
モリ15A〜15Eが設けられている。 エンベロープ発生器14は、発音割当て回路1
3から与えられる各種信号AS,DS,CC等にも
とづいて、アタツク・デイケイ等の特性をもつエ
ンベロープ波形EVを発生する。このエンベロー
プ波形EVによつて波形メモリ15から読み出さ
れる音源波形信号に経時的な音量振幅エンベロー
プが付加され、発音が制御される。 波形メモリ15から読み出された各フイート
2′〜32′の音源波形信号は分配回路16に加わ
り、鍵盤種類などに応じてライン17または18
に適宜分配される。ライン17に分配された音源
波形信号は電圧制御型フイルタ(VCF)19に
加わり、音色制御がなされる。ライン18に分配
された音源波形信号は音色フイルタ群20に加わ
り、音色制御がなされる。電圧制御型フイルタ1
9のフイルタ特性は制御電圧(図示せず)によつ
て可変され、音色フイルタ群20のフイルタ特性
は各種音色に対応して固定されている。従つて両
系列において異なつた音質の音が作り出される。
音色制御された楽音波形信号はエクスプレツシヨ
ン等その他適宜の音制御回路21を経て、サウン
ドシステム22から発音される。 ウエーブゼネレータ10の詳細例は第3図及び
第4図に分割して示されている。ウエーブゼネレ
ータ10のうちノートデコーダ23、定数メモリ
24、キーボルト発生回路25の詳細例は第3図
に、アキユムレータ26、オクターブ制御回路2
7、ビツト位置切替え回路28の詳細例は第4図
に示されている。 第3図及び第4図の回路において各種回路素子
は第5図に示すような手法で図示されている。第
5図aはインバータ、同図b,cはアンド回路、
同図d,eはオア回路、同図fは1ビツトの遅延
フリツプフロツプを示す。アンド回路あるいはオ
ア回路において入力数が少ない場合は同図b,d
に示すような通常の表示図法を採用し、入力数が
多い場合は同図c,eの図法を採用する。同図
c,eにおいては、回路の入力側に1本の入力線
を描き、複数の信号線をこの入力線に交叉させ、
同回路に入力されるべき信号の信号線と入力線と
の交叉点を丸印で囲むようにしている。従つて同
図cの場合、論理式はQ=A・B・Dであり、同
図eの例の場合、論理式はQ=A+B+Cであ
る。また、第5図gはシフトレジスタを示し、ブ
ロツク中に括弧でくくつて示した分数の分子の数
はシフトレジスタのステージ数、分母の数はシフ
トレジスタの入力データのビツト数を示す。遅延
フリツプフロツプ及びシフトレジスタにはシフト
用クロツクパルスを特に図示しないが、1μs周期
の主クロツクパルスφ1(詳しくは2相クロツクパ
ルス)によつてシフトされる。 発音割当て回路13から供給されるキーコード
KCのうちノーコードN1〜N4はノートデコーダ
23に加わり、該ノートコードN1〜N4が表わす
音名に対応する出力ラインにデコード出力を生じ
る。定数メモリ24は1オクターブ内の12の音名
C〜Bの周波数に比例する定数データFを2進形
式で予め記憶したもので、前記ノートデコーダ2
3の出力に応じてノートコードN1〜N4が表わす
音名に対応する定数データFが読み出される。ア
キユムレータ26はメモリ24から読み出された
定数データFを規則的時間間隔T毎に繰返し加算
し、変数データqFを得る。qは、時間間隔Tが
経過する毎に、1、2、3、4、…と順次増加す
る変数である。 アキユムレータ26の出力qFはビツト位置切
替え回路28に加えられ、オクターブ制御回路2
7から与えられるオクターブ切替データXの値に
応じてその2進ビツト位置が左または右へシフト
される。換言すれば、1オクターブ内の各音名周
波数に対応して規則的に変化する変数データqF
に対してオクターブ切替データXを乗算し、該オ
クターブ切替データXが指定するオクターブ音域
における当該音名の周波数に対応する変数データ
XqFを得る。 オクターブ切替データXはオクターブコード
B1〜B3の内容にもとづいて発生される。1オク
ターブのへだたりは周波数比が2:1であるの
で、定数メモリ24に記憶した音名の属するオク
ターブ音域を基本オクターブとすると、発生しよ
うとする音のオクターブ音域がこの基本オクター
ブよりもnオクターブ上のときはXの値は2nであ
り、nオクターブ下のときはXの値は2-nである。
すなわち、オクターブ単位の周波数の関係は2の
ベキ乗であるため、2進ビツト位置切替回路28
によつてオクターブの切替制御を行なうことがで
きるのである。 ところで、定数メモリ24に記憶する定数デー
タFの値は、前記基本オクターブにおける当該音
名の周波数fと、アキユムレータ26において同
じデータFが1秒間に加算される回数Nと、波形
メモリ15に記憶した波形1周期分のアドレス数
Mとによつて定まる。すなわち、 F=f・M/N …(1) という関係式によつて定数データFの10進値が決
定される。第(1)式にもとづいて求めた各音名に対
応する定数データFを2進数に変換し、この2進
の定数データFを定数メモリ24に予め記憶させ
ておく。 変数データXqFにおいて変数qの値は1秒後
にNとなるので、前記(1)式は下記のように書き換
えることができる。 XF=Xf・M/N …(2) 従つてオクターブ切換データXの値に比例して
周波数が切替わる。前述のようにデータXは2の
ベキで与えられるので、周波数Xfは基本オクタ
ーブの周波数fの2のベキ乗で切替わることにな
り、オクターブ単位で発生音の周波数が切替えら
れる。すなわち発生音のオクターブ音域が選択さ
れる。 従つて、ビツト位置切替回路28においてアキ
ユムレータ26の出力データqFのビツト位置を
左に(上位桁に)シフトすると、データXによつ
て2nの乗算を行なうことになるので、シフトした
ビツト位置の数nだけオクターブが上がる。ま
た、同切替え回路28においてデータqFのビツ
ト位置を右に(下位桁に)シフトすると、データ
Xによつて2-nの乗算を行なうことになるので、
シフトしたビツト位置の数nだけオクターブが下
がる。 第3図において、ノートデコーダ23は前記第
1表に示したような内容のノートコードN1〜N4
を各音名C# 〜C別にデコードし得るように論理
が組まれたアンド回路群23Aによつて構成され
ている。定数メモリ24は、デコーダ23の出力
に応じて所定の値の10ビツトの2進定数データF
(F1〜F10)を得るように論理が組まれたオア回路
群24Aと、鍵盤コードK1,K2の内容に応じて
オア回路群24Aの出力を選択するゲート部24
Bとを具えている。 第4図に示すビツト位置切替え回路28は左シ
フト動作(2nの掛算)を行なうようになつている
ので、定数メモリ24には最低オクターブ音域に
おける各12音の周波数に比例する定数データFを
記憶している。但し、前記第1表に示した真の最
低オクターブ音域はオクターブコードB1,B2,
B3の内容が“000”である第1オクターブ音域で
あるが、前述の通り、この第1オクターブ音域に
属する音はC2音だけである。そこで、この実施
例のウエーブゼネレータ10ではオクターブコー
ドB3,B2,B1の内容が“001”である第2オクタ
ーブ音域を最低オクターブ(基本オクターブ)と
して取扱うようにし、該第2オクターブ音域に属
する12音名(C2# 、D2、…B2、C3)の周波数に
対応する定数データFをメモリ24の各アドレス
にそれぞれ記憶させている。そして、第1オクタ
ーブ音域に属する唯一の音、C2音に関しても特
別に定数データFを記憶しておくようにしてい
る。すなわち、第2表に示すように基本オクター
ブ(第2オクターブ音域)に属するC音(C3)
の1/2の値のデータがC2音の定数データFとして
読み出されるようにオア回路群24Aにおいて論
理が組まれている。また、この実施例においては
鍵盤種類別に若干異なる値のデータFをメモリ2
4に記憶しているが、第2表には下鍵盤音のみに
ついて示した。
[Table] In this embodiment, in order to be able to produce multiple sounds at the same time, various counters, logic circuits, storage devices, etc. are configured in a dynamic logical manner so that they are used in a time-sharing manner. The time relationship of the clock pulses regulating operation is extremely important. Figure 2a is a graph mainly showing the clock pulse φ 1 , which controls the time division operation of each channel, and has a period of, for example , 1 μs (microsecond; 10 -6 seconds). There is. Since the number of channels is 12, the 1 μs wide time slots successively separated by the main clock pulse φ1 are the first
Channels 1 to 12 will be supported sequentially. As shown in FIG. 2b, each time slot is designated as a first channel time to a twelfth channel time in order. Each channel time occurs cyclically. Therefore, the key code KC representing the key to which the sound generation is assigned by the sound generation assignment circuit 13 is sequentially output in a time-division manner in accordance with the time of the assigned channel. For example, the first channel is assigned the C note (C 3 ) in the second octave range of the pedal keyboard, the second channel is assigned the G note (G 6 ) in the fifth octave range of the upper keyboard, and the third channel is assigned the C note (C 3 ) in the second octave range of the pedal keyboard. C note (C 6 ) in the 5th octave range of the upper keyboard
is assigned, and the E note (E 5 ) in the fourth octave range of the lower keyboard is assigned to the fourth channel.
Assuming that no sound is assigned to the 5th to 12th channels, the content of the key code KC output from the sound generation assignment circuit 13 in a time-sharing manner in synchronization with the time of each channel is as shown in Figure 2c. . All outputs from the 5th channel to the 12th channel are "0". Furthermore, the sound generation assignment circuit 13 time-divisionally outputs an attack start signal (or key-on signal) AS indicating that sound should be generated in the channel to which the pressed key is assigned the sound generation, in synchronization with the time of each channel. Furthermore, a decay start signal (or key-off signal) DS indicating that the key assigned to each channel is released and the sound should be attenuated is output in a time-divisional manner in synchronization with the time of each channel. . These signals AS,
DS is amplitude envelope control of musical tones (pronunciation control)
used for. Furthermore, the sound generation assignment circuit 13
Then, the decay end signal DF indicating that the sound generation in that channel has ended is received from the envelope generator 14, and based on the signal DF, a clear signal CC is generated that clears various memories related to the channel and completely cancels the sound generation assignment. Output. In the example shown in Figure 2c, the keys assigned to the first and second channels are currently being pressed, and the keys assigned to the third and fourth channels have been released and their sound is attenuated. , in the fourth channel, the sound generation ends at time slot t1 , and the decay end signal DF is generated.
Assuming that the clear signal CC is output at time slot t 2 with a delay of 12 channels, Fig. 2 d
As shown in ~g, each signal AS, DS, DF, CC is generated. In addition, when time slot t 2 , the clear signal
Since CC is output, the attack start signal AS and decay start signal DS of the fourth channel are erased. At this time, the key code KC of the fourth channel time in FIG. 2c is erased, but is drawn as is for convenience of explanation. Various signals output from the sound generation assignment circuit 13
As shown in FIG. 2, the channels to which KC, AS, DS, and CC belong can be distinguished based on the channel time. Key code output from pronunciation assignment circuit 13
KC joins the wave generator 10, and the wave generator 10 receives variable data (address data) for sequentially reading sample point amplitude values of the musical tone (sound source) waveform from the waveform memory 15.
XqF is generated. In this embodiment, the waveform memory 15 is configured such that sound source waveforms having different numbers of feet are read out in parallel, 2 feet 2',
4 feet 4', 8 feet 8', 16 feet 1
Memories 15A to 15E are provided corresponding to the sounds of 6' and 32 feet 32', respectively. The envelope generator 14 is connected to the sound generation assignment circuit 1
Based on various signals AS, DS, CC, etc. given from 3, an envelope waveform EV having characteristics such as attack decay is generated. Using this envelope waveform EV, a time-dependent volume amplitude envelope is added to the sound source waveform signal read out from the waveform memory 15, and the sound generation is controlled. The sound source waveform signals of each foot 2' to 32' read out from the waveform memory 15 are applied to a distribution circuit 16, and are sent to lines 17 or 18 depending on the type of keyboard.
will be distributed accordingly. The sound source waveform signal distributed to the line 17 is applied to a voltage controlled filter (VCF) 19 to perform timbre control. The sound source waveform signal distributed to the line 18 is applied to a timbre filter group 20, where timbre control is performed. Voltage controlled filter 1
The filter characteristics of 9 are varied by a control voltage (not shown), and the filter characteristics of timbre filter group 20 are fixed corresponding to various tones. Therefore, sounds with different tonal qualities are produced in both series.
The timbre-controlled musical sound waveform signal passes through an appropriate sound control circuit 21 such as an expression, and is outputted from a sound system 22. A detailed example of the wave generator 10 is shown separately in FIGS. 3 and 4. A detailed example of the note decoder 23, constant memory 24, and key voltage generation circuit 25 of the wave generator 10 is shown in FIG.
7. A detailed example of the bit position switching circuit 28 is shown in FIG. In the circuits of FIGS. 3 and 4, various circuit elements are illustrated in the manner shown in FIG. Figure 5a is an inverter, Figures b and c are AND circuits,
Figures d and e in the figure show an OR circuit, and f in the figure shows a 1-bit delay flip-flop. If the number of inputs is small in an AND circuit or an OR circuit, b and d in the same figure
A normal display diagram as shown in Figure 1 is used, and if there are a large number of inputs, the diagrams shown in Figures c and e are used. In Figures c and e, one input line is drawn on the input side of the circuit, and multiple signal lines are crossed with this input line.
The intersection point between the signal line of the signal to be input to the circuit and the input line is surrounded by a circle. Therefore, in the case of c in the same figure, the logical formula is Q=A・B・D, and in the case of the example in e of the same figure, the logical formula is Q=A+B+C. Further, FIG. 5g shows a shift register, and the number of the numerator of the fraction shown in parentheses in the block indicates the number of stages of the shift register, and the number of the denominator indicates the number of bits of input data to the shift register. Although shift clock pulses are not particularly shown in the delay flip-flop and shift register, they are shifted by a main clock pulse φ 1 (specifically, a two-phase clock pulse) having a period of 1 μs. Key code supplied from pronunciation assignment circuit 13
Of the KCs, no codes N1 to N4 are applied to the note decoder 23, and decoded outputs are generated on output lines corresponding to the note names represented by the note codes N1 to N4 . The constant memory 24 stores in advance constant data F in binary format that is proportional to the frequencies of the 12 note names C to B within one octave.
In response to the output of No. 3, constant data F corresponding to the note names represented by the note codes N 1 to N 4 is read out. The accumulator 26 repeatedly adds the constant data F read from the memory 24 at regular time intervals T to obtain variable data qF. q is a variable that increases sequentially as 1, 2, 3, 4, . . . each time the time interval T elapses. The output qF of the accumulator 26 is applied to the bit position switching circuit 28 and the octave control circuit 2
The binary bit position is shifted to the left or right according to the value of the octave switching data X given from 7. In other words, variable data qF that changes regularly corresponding to each note frequency within one octave.
is multiplied by octave switching data X, and variable data corresponding to the frequency of the note name in the octave range specified by the octave switching data
Get XqF. Octave switching data X is octave code
Generated based on the contents of B1 to B3 . Since the gap in one octave has a frequency ratio of 2:1, if the octave range to which the note name stored in the constant memory 24 belongs is the basic octave, then the octave range of the note to be generated is n more than this basic octave. When the octave is above, the value of X is 2 n , and when it is n octaves below, the value of X is 2 - n .
In other words, since the frequency relationship in octave units is a power of 2, the binary bit position switching circuit 28
This allows octave switching control to be performed. By the way, the value of the constant data F stored in the constant memory 24 is the frequency f of the note name in the basic octave, the number N of times the same data F is added per second in the accumulator 26, and the value stored in the waveform memory 15. It is determined by the number M of addresses for one cycle of the waveform. That is, the decimal value of the constant data F is determined by the relational expression F=f·M/N (1). Constant data F corresponding to each pitch name determined based on equation (1) is converted into a binary number, and this binary constant data F is stored in the constant memory 24 in advance. In the variable data XqF, the value of the variable q becomes N after one second, so the above equation (1) can be rewritten as follows. XF=Xf·M/N (2) Therefore, the frequency is switched in proportion to the value of the octave switching data X. As mentioned above, since the data X is given as a power of 2, the frequency Xf is switched as a power of 2 of the frequency f of the fundamental octave, and the frequency of the generated sound is switched in octave units. That is, the octave range of the generated sound is selected. Therefore, when the bit position of the output data qF of the accumulator 26 is shifted to the left (to the upper digits) in the bit position switching circuit 28, multiplication by 2 n is performed by the data X. The octave goes up by a number n. Furthermore, when the bit position of data qF is shifted to the right (to the lower digit) in the same switching circuit 28, multiplication by 2 - n is performed by data X, so
The octave is lowered by the number n of shifted bit positions. In FIG. 3, the note decoder 23 outputs note codes N 1 to N 4 as shown in Table 1 above.
It is constituted by a group of AND circuits 23A having a logic so that it can decode each pitch name C# to C separately. The constant memory 24 stores 10-bit binary constant data F of a predetermined value in accordance with the output of the decoder 23.
( F1 to F10 ); and a gate section 24 that selects the output of the OR circuit group 24A according to the contents of the keyboard codes K1 and K2 .
It has B. Since the bit position switching circuit 28 shown in FIG. 4 is designed to perform a left shift operation (multiplication by 2n ), the constant data F proportional to the frequency of each of the 12 tones in the lowest octave range is stored in the constant memory 24. I remember. However, the true lowest octave range shown in Table 1 above is the octave code B 1 , B 2 ,
The content of B3 is "000" in the first octave range, but as mentioned above, the only note belonging to this first octave range is the C2 note. Therefore, in the wave generator 10 of this embodiment, the second octave range in which the contents of the octave codes B 3 , B 2 , and B 1 are "001" is handled as the lowest octave (basic octave), and the second octave range is Constant data F corresponding to the frequencies of the 12 tone names (C 2 #, D 2 , . . . B 2 , C 3 ) belonging to the note name is stored in each address of the memory 24, respectively. Constant data F is also specially stored for the C2 note, which is the only note belonging to the first octave range. In other words, as shown in Table 2, the C note (C 3 ) belonging to the basic octave (second octave range)
Logic is set up in the OR circuit group 24A so that data with a value of 1/2 is read out as constant data F of the C2 note. In addition, in this embodiment, data F with slightly different values for each type of keyboard is stored in the memory 2.
4, Table 2 shows only the lower keyboard tones.

【表】 C2音に関する定数データFはC2音のみに使用
されるので、ノートデコーダ23においてノート
コードN1〜N4がC2音のものかあるいはそれ以外
のC音のものであるかを区別する必要がある。そ
こで、C2音専用のアンド回路29がアンド回路
群23Aに設けられている。このアンド回路29
にはオクターブコードの各ビツトB1〜B3のデー
タをインバータで反転したデータB1〜B3が加わ
つており、オクターブコードB1〜B3が第1オク
ターブ音域の場合、データ“000”が反転されて
“111”となるのでアンド回路29が動作可能とな
る。従つて、第1オクターブ音域のC音すなわち
C2音のノートコードN1〜N4が供給されると、ア
ンド回路29の出力が“1”となり、メモリ24
からC2音専用の定数データFが読み出される。 なお、定数メモリ24から読み出された定数デ
ータFはすべて同一オクターブ音域(基本オクタ
ーブ)のものとして取扱われるので、C2音に対
応する第1オクターブ音域を表わすオクターブコ
ードB1〜B3を第2オクターブ音域のデータに変
換する必要がある。そのため、オクターブコード
B1〜B3を第4図のノア回路30に入力し、“000”
のとき該ノア回路30から生じる信号“1”をオ
ア回路31に加えてビツトB1のデータを“1”
にする。これにより、オクターブコードB3,B2,
B1が“000”の場合“001”に変換され、その後、
オクターブ制御回路27の3ビツトの12ステージ
シフトレジスタ27Aに入力される。 ノア回路30の出力“1”はライン32を経て
第3図のインバータ34で反転され、ノートデコ
ーダ23のアンド回路33に加わる。アンド回路
33は第1オクターブ音域のC音(C2音)以外
のC音のノートコードN1〜N4をデコードするた
めの回路であり、C2音のノートコードN1〜N4が
供給された場合ライン32からの信号“1”によ
つて該アンド回路33が不動作となる。 この実施例においては、同じ音名でも所属鍵盤
に応じて若干異なる値の定数データFがメモリ2
4から読み出されるようになつている。第3図に
おいて、鍵盤コードK1,K2はデコーダ24Cで
デコードされ、その内容に応じて上鍵盤信号UE、
下鍵盤信号LE、またはペダル鍵盤信号PEが発生
させる。オア回路群24Aからはノートデコーダ
23の出力にもとづいて同一音名に関する定数デ
ータFが各鍵盤別に並列的に読み出され、それら
の定数データFがゲート部24Bにおいて前記鍵
盤信号UE,LE,PEに応じて選択される。 オア回路群24Aにおける入力接続態様を参照
すれば明らかなように、ビツトF4よりも下位の
ビツトのデータが鍵盤別に異なつており、ビツト
F5よりも上位のビツトのデータは各鍵盤とも同
一である。従つて、鍵盤毎の定数データFの値の
相違はごく僅かであり、この相違は、この定数デ
ータFを使用して発生した楽音波形信号に対して
僅かなピツチのずれをもたらす。この実施例で
は、前記第2表に示すように設定された下鍵盤音
の各音名C# 〜Cに関する定数データFが正規の
ピツチの楽音波形を発生しうるようになつてい
る。従つて、第6図に示すように下鍵盤音はピツ
チずれが0セントである。また、上鍵盤音の各音
名に対応する定数データFは正規のピツチよりも
幾分高いピツチの楽音波形を発生し得るような値
に設定されており、しかも各音名のピツチずれは
一様ではなく、第6図に示すようにC# からC音
へと音高が上がるにつれてピツチずれ量は+3.7
セントから+1.86セントまで下がるようになつて
いる。また、ペダル鍵盤音の各音名に対応する定
数データFは正規のピツチよりも幾分低いピツチ
の楽音波形を発生しうるような値に設定されてい
る。しかも第6図に示すようにC# からC音へと
音高が上がるにつれてピツチずれ量は−3.7セン
トから−1.86セントとへ移行するようになつてい
る。 以上のように鍵盤別に定数データFの値を若干
異ならせるようにした理由は、同時に発生される
楽音波形の位相が完全に逆相になつて発生音が打
消されるような事態の発生を防止するためであ
る。すなわち、異なる鍵盤間において同一音高の
鍵が2つ同時に押鍵されることはよくあることで
あり、この場合両鍵盤音を全く同一周波数で発生
すると、両音の位相が逆相となつた場合に音が打
消されるという不都合が生じる。しかし、この実
施例のように定数データFの値を若干異ならせれ
ば、異なる鍵盤間において同一音高の鍵が同時に
押鍵された場合でも両押鍵音の位相が完全に逆相
となることは起り得ず、音が打消されることはな
い。 ゲート部24Bにおいては、鍵盤信号UE,LE
またはPEによつて動作可能となつたアンド回路
を経て定数データFの各ビツトデータF1〜F10が
選択され、オア回路で各ビツト別にまとめられ
る。キーコードN1〜N4,B1〜B3,K1,K2は前
述のように各チヤンネル別に時分割的に供給され
るので、定数メモリ24からは各チヤンネルに割
当てられた音の音名に対応する定数データF(F1
〜F10)が時分割的に読み出される。 読み出された定数データFは第4図のアキユム
レータ26に供給される。アキユムレータ26は
21ビツトの加算器群26Aと21ビツトの12ステー
ジシフトレジスタ群26Bとを有する。加算器群
26Aの出力はアンド回路群26Cを介してシフ
トレジスタ群26Bで12チヤンネル時間遅延され
る。シフトレジスタ群26Bの各ビツト出力Q1
〜Q21(qF)はビツト位置切替え回路28に加わ
ると共に、加算器群26Aに帰還され、定数デー
タF1〜F10(F)が加算される。従つて各チヤンネル
別に時分割的に定数データFを累算することが可
能になつており、1つのチヤンネルに関する定数
データFは12チヤンネル時間(12μs)毎に繰返し
加算される。加算器群26Aの下位10ビツトの加
算器としては全加算器が用いられており、定数デ
ータFの各ビツトデータF1〜F10が下位10ビツト
の全加算器群に対する加算入力となる。加算器群
26Aの上位11ビツトの加算器には半加算器が用
いられており、これらの半加算器群においては下
位ビツトに加算器のキヤリイ出力COからキヤリ
イ入力CIに加わるキヤリイ信号とシフトレジス
タ群26Bの対応ビツト位置から帰還されるビツ
トが加算される。アンド回路群26Cは発音割当
て回路13から与えられるクリア信号CCによつ
て不動作となり、アキユムレータ26の計算値を
クリアする。 ビツト位置切替え回路28は、オクターブ切替
え済みの変数データXqFの各ビツトS1〜S15を導
き出すための15個の5入力型オア回路から成るオ
ア回路群28Aと、このオア回路群28A内の各
オア回路に対応してそれぞれ5個設けられた合計
75個の2入力型アンド回路から成るアンド回路群
28Bとを具えている。アンド回路群28Bにお
いて各ビツトS1〜S15に対応してそれぞれ5個設
けられているアンド回路は、オクターブ制御回路
27のデコーダ27Bの5本の出力ラインの信号
によつてそれぞれ各別に動作可能とされるように
なつている。アキユムレータ26の出力Q1〜Q21
はデコーダ27Bの5本の出力X1,X2,X3,
X4,X5にそれぞれ対応して所定のビツトS1〜S15
に振分けられるようにアンド回路群28に入力さ
れる。変数データqFの各ビツトQ1〜Q21のビツト
位置がデコーダ27Bの各出力X2〜X1に対応し
て切替えられて変数データXqF(S1〜S15)が得ら
れる態様は第3表の通りである。
[Table] Constant data F related to C2 note is used only for C2 note, so the note decoder 23 determines whether note codes N1 to N4 are for C2 note or other C notes. It is necessary to distinguish between Therefore, an AND circuit 29 dedicated to the C2 note is provided in the AND circuit group 23A. This AND circuit 29
is added with data B 1 to B 3 obtained by inverting the data of each bit B 1 to B 3 of the octave code using an inverter, and if the octave code B 1 to B 3 is in the first octave range, the data “000” is Since it is inverted and becomes "111", the AND circuit 29 becomes operable. Therefore, the C note in the first octave range, i.e.
When the note codes N 1 to N 4 of C 2 notes are supplied, the output of the AND circuit 29 becomes “1” and the memory 24
Constant data F exclusively for the C2 note is read from. Note that all the constant data F read from the constant memory 24 are treated as belonging to the same octave range (basic octave), so the octave codes B 1 to B 3 representing the first octave range corresponding to the C2 note are It is necessary to convert the data into a two-octave range. Therefore, the octave chord
Input B 1 to B 3 to the NOR circuit 30 in Fig. 4 and set it to “000”.
When , the signal “1” generated from the NOR circuit 30 is added to the OR circuit 31 to set the data of bit B1 to “1”.
Make it. As a result, the octave chords B 3 , B 2 ,
If B 1 is “000”, it is converted to “001”, and then
The signal is input to a 3-bit 12-stage shift register 27A of the octave control circuit 27. The output "1" of the NOR circuit 30 is inverted by the inverter 34 in FIG. The AND circuit 33 is a circuit for decoding note codes N 1 to N 4 of C note other than C note (C 2 note) in the first octave range, and the note codes N 1 to N 4 of C note 2 are supplied. In this case, the signal "1" from the line 32 disables the AND circuit 33. In this embodiment, the memory 2 stores constant data F with slightly different values depending on the keyboard to which it belongs even if the note name is the same.
It is designed to be read from 4. In FIG. 3, keyboard codes K 1 and K 2 are decoded by a decoder 24C, and depending on the contents, upper keyboard signals UE and
Generated by lower keyboard signal LE or pedal keyboard signal PE. From the OR circuit group 24A, constant data F regarding the same note name is read out in parallel for each keyboard based on the output of the note decoder 23, and these constant data F are sent to the gate section 24B as the keyboard signals UE, LE, PE. selected according to As is clear from the input connection mode in the OR circuit group 24A, the data of bits lower than bit F4 differs depending on the keyboard, and the bit
The data for bits higher than F5 is the same for each key. Therefore, the difference in the value of the constant data F for each keyboard is very small, and this difference causes a slight pitch shift in the musical waveform signal generated using the constant data F. In this embodiment, the constant data F for each of the note names C# to C of the lower keyboard tones set as shown in Table 2 can generate a musical sound waveform of a regular pitch. Therefore, as shown in FIG. 6, the pitch shift of the lower keyboard tone is 0 cents. Furthermore, the constant data F corresponding to each note name of the upper keyboard tone is set to a value that can generate a musical sound waveform with a pitch slightly higher than the normal pitch, and the pitch deviation of each note name is uniform. As shown in Figure 6, the pitch shift increases by +3.7 as the pitch increases from C# to C.
cents to +1.86 cents. Further, the constant data F corresponding to each note name of the pedal keyboard tone is set to a value that can generate a musical sound waveform with a pitch slightly lower than the normal pitch. Moreover, as shown in FIG. 6, as the pitch increases from C# to C note, the pitch shift amount shifts from -3.7 cents to -1.86 cents. As mentioned above, the reason why the value of the constant data F is made to be slightly different for each keyboard is to prevent the occurrence of a situation where the phases of musical sound waveforms generated at the same time are completely reversed and the generated sound is canceled out. This is to do so. In other words, it is common for two keys of the same pitch to be pressed at the same time on different keyboards, and in this case, if both keyboard tones are generated at exactly the same frequency, the phases of the two tones will be opposite. In some cases, the inconvenience arises that the sound is canceled out. However, if the value of the constant data F is slightly different as in this example, even if keys of the same pitch are pressed at the same time on different keyboards, the phases of the sounds of both pressed keys will be completely opposite. cannot occur, and the sound is never cancelled. In the gate section 24B, the keyboard signals UE, LE
Alternatively, each bit data F 1 to F 10 of constant data F is selected through an AND circuit enabled to operate by PE, and each bit is grouped by an OR circuit. Since the key codes N 1 to N 4 , B 1 to B 3 , K 1 , and K 2 are supplied time-divisionally for each channel as described above, the constant memory 24 stores the sounds assigned to each channel. Constant data F (F 1
~F 10 ) are read out in a time-division manner. The read constant data F is supplied to the accumulator 26 shown in FIG. Accumulator 26 is
It has a 21-bit adder group 26A and a 21-bit 12-stage shift register group 26B. The output of the adder group 26A is delayed by 12 channel times in the shift register group 26B via an AND circuit group 26C. Each bit output Q 1 of shift register group 26B
.about.Q 21 (qF) is applied to the bit position switching circuit 28 and fed back to the adder group 26A, where constant data F 1 to F 10 (F) are added. Therefore, it is possible to accumulate constant data F on a time-division basis for each channel, and constant data F regarding one channel is repeatedly added every 12 channel times (12 μs). A full adder is used as the adder for the lower 10 bits of the adder group 26A, and each bit data F 1 to F 10 of the constant data F becomes an addition input to the lower 10 bit full adder group. Half adders are used for the upper 11 bits of the adder group 26A, and in these half adders, the lower bits contain the carry signal applied from the adder's carry output CO to the carry input CI and the shift register. Bits returned from corresponding bit positions in group 26B are added. The AND circuit group 26C is rendered inactive by the clear signal CC applied from the sound generation allocation circuit 13, and clears the calculated value of the accumulator 26. The bit position switching circuit 28 includes an OR circuit group 28A consisting of 15 5-input type OR circuits for deriving each bit S 1 to S 15 of variable data XqF that has been octave switched, and each OR circuit group 28A in this OR circuit group 28A. A total of 5 each corresponding to the OR circuit.
The AND circuit group 28B is composed of 75 two-input type AND circuits. In the AND circuit group 28B, five AND circuits are provided corresponding to each bit S1 to S15 , and each of the AND circuits can be operated individually according to the signals from the five output lines of the decoder 27B of the octave control circuit 27. It has come to be regarded as Output Q 1 to Q 21 of accumulator 26
are the five outputs X 1 , X 2 , X 3 ,
Predetermined bits S 1 to S 15 corresponding to X 4 and X 5 , respectively
The signals are input to the AND circuit group 28 so as to be distributed to the following. Table 3 shows how variable data XqF (S 1 to S 15 ) is obtained by switching the bit positions of each bit Q 1 to Q 21 of variable data qF in accordance with each output X 2 to X 1 of the decoder 27B. It is as follows.

〔発明の効果〕〔Effect of the invention〕

以上説明したようにこの発明によれば、周波数
に対応する定数データとして所望オクターブ内の
各音に対応するものだけをメモリに記憶しておけ
ばよいので、メモリの記憶容量が全鍵数分の定数
データを記憶する従来の装置に比べてはるかに縮
小される。
As explained above, according to the present invention, it is only necessary to store in the memory constant data corresponding to frequencies that correspond to each note within a desired octave. It is much smaller than conventional devices for storing constant data.

【図面の簡単な説明】[Brief explanation of drawings]

第1図はこの発明のウエーブゼネレータの一実
施例を電子楽器の全体的構成と関連して示すブロ
ツク図、第2図は第1図に示した発音割当て回路
の動作を説明するためのタイミングチヤート、第
3図及び第4図は第1図に示したウエーブゼネレ
ータ各部の詳細例を示す回路図、第5図は各種回
路素子の図示方法を説明するための図、第6図は
鍵盤別に定数データFの値を僅かに異ならせるこ
とによつて実現される各鍵盤音のピツチずれの状
態を示すグラフ、第7図はキーボルト発生回路に
おける最高音検出動作を説明するためのタイミン
グチヤートである。 10……ウエーブゼネレータ、15……波形メ
モリ、24……定数メモリ、26……アキユムレ
ータ、27……オクターブ制御回路、28……ビ
ツト位置切替え回路。
FIG. 1 is a block diagram showing one embodiment of the wave generator of the present invention in relation to the overall configuration of an electronic musical instrument, and FIG. 2 is a timing chart for explaining the operation of the sound generation assignment circuit shown in FIG. 1. , Figures 3 and 4 are circuit diagrams showing detailed examples of each part of the wave generator shown in Figure 1, Figure 5 is a diagram for explaining how to illustrate various circuit elements, and Figure 6 shows constants for each keyboard. FIG. 7 is a graph showing the state of pitch deviation of each keyboard tone achieved by slightly different values of data F, and is a timing chart for explaining the highest note detection operation in the key bolt generation circuit. 10... Wave generator, 15... Waveform memory, 24... Constant memory, 26... Accumulator, 27... Octave control circuit, 28... Bit position switching circuit.

Claims (1)

【特許請求の範囲】 1 複数の鍵を有する鍵盤と、 前記鍵盤での鍵操作に対応して該操作された鍵
の音名およびオクターブを示す音名データおよび
オクターブデータからなるキーデータを発生する
キーデータ発生手段と、 所定オクターブの各音名の楽音の周波数にそれ
ぞれ対応する複数ビツトからなる複数の定数デー
タを記憶する記憶手段と、 前記記憶手段から前記音名データに基づき、該
音名データが示す音名に対応する前記定数データ
を読み出す読出し手段と、 前記記憶手段から読み出された定数データに基
づき前記楽音の周波数に対応した周期で繰返し変
化する複数ビツトからなる変数データを出力する
変数データ発生手段と、 前記変数データ発生手段から出力された変数デ
ータのビツト位置を前記オクターブデータに応じ
てシフトすることにより該変数データを変更し、
前記キーデータが示す鍵の楽音周波数に対応する
周期で繰返し変化するデータを出力する変更手段
と、 前記変更手段から出力されるデータに基づき対
応する周波数の楽音信号を発生する楽音発生手段
と を具えた電子楽器のウエーブゼネレータ。
[Claims] 1. A keyboard having a plurality of keys, and generating key data consisting of pitch name data and octave data indicating the pitch name and octave of the operated key in response to key operations on the keyboard. key data generation means; storage means for storing a plurality of constant data consisting of a plurality of bits each corresponding to the frequency of a musical tone of each note name in a predetermined octave; reading means for reading the constant data corresponding to the note name indicated by; and a variable for outputting variable data consisting of a plurality of bits that repeatedly changes at a cycle corresponding to the frequency of the musical tone based on the constant data read from the storage means. data generating means; changing the variable data by shifting the bit position of the variable data output from the variable data generating means according to the octave data;
A changing means for outputting data that repeatedly changes at a cycle corresponding to a musical tone frequency of a key indicated by the key data, and a musical tone generating means for generating a musical tone signal of a corresponding frequency based on the data output from the changing means. A wave generator for electronic musical instruments.
JP61271591A 1986-11-14 1986-11-14 Wave generator for electronic musical apparatus Granted JPS62135896A (en)

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