JPH0158175U - - Google Patents
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- Publication number
- JPH0158175U JPH0158175U JP15315587U JP15315587U JPH0158175U JP H0158175 U JPH0158175 U JP H0158175U JP 15315587 U JP15315587 U JP 15315587U JP 15315587 U JP15315587 U JP 15315587U JP H0158175 U JPH0158175 U JP H0158175U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- frequency
- voltage
- shot multi
- power source
- Prior art date
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- Pending
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Description
第１Ａ図はこの考案の一実施例によるＦ―Ｖコ
ンバータの構成図、第１Ｂ図はそのＦ―Ｖ特性を
説明するための図、第２Ａ図および第３Ａ図はそ
れぞれ従来のＦ―Ｖコンバータの構成図、第２Ｂ
図および第３Ｂ図は第２Ａ図および第３Ａ図の各
Ｆ―Ｖ特性を説明するための図である。 １…ワンシヨツトマルチ回路、Ｒ１…固定抵抗
、Ｃ…コンデンサ、２…積分回路、４…インバー
タ、ＴＲ…スイツチングトランジスタ、Ｅ…直流
電源、Ｅ０…電源電圧、Ｖ…出力電圧。なお、図
中、同一符号は同一または相当部分を示す。
ンバータの構成図、第１Ｂ図はそのＦ―Ｖ特性を
説明するための図、第２Ａ図および第３Ａ図はそ
れぞれ従来のＦ―Ｖコンバータの構成図、第２Ｂ
図および第３Ｂ図は第２Ａ図および第３Ａ図の各
Ｆ―Ｖ特性を説明するための図である。 １…ワンシヨツトマルチ回路、Ｒ１…固定抵抗
、Ｃ…コンデンサ、２…積分回路、４…インバー
タ、ＴＲ…スイツチングトランジスタ、Ｅ…直流
電源、Ｅ０…電源電圧、Ｖ…出力電圧。なお、図
中、同一符号は同一または相当部分を示す。
Claims (1)
- 周波数の可変な入力パルスを加えることにより
トリガされるワンシヨツトマルチ回路と、このワ
ンシヨツトマルチ回路からの出力パルスを積分す
る積分回路とを備えた周波数―電圧変換回路にお
いて、上記ワンシヨツトマルチ回路と積分回路と
の間に、ワンシヨツトマルチ回路からの出力パル
ス信号によりオンオフされるスイツチング素子と
電圧可変の直流電源とからなるインバータを介挿
し、上記直流電源の電源電圧を可変制御すること
により、入力周波数の変化に対応させて積分回路
の出力電圧を可変制御するように構成したことを
特徴とする周波数―電圧変換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15315587U JPH0158175U (ja) | 1987-10-05 | 1987-10-05 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15315587U JPH0158175U (ja) | 1987-10-05 | 1987-10-05 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0158175U true JPH0158175U (ja) | 1989-04-11 |
Family
ID=31428738
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15315587U Pending JPH0158175U (ja) | 1987-10-05 | 1987-10-05 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0158175U (ja) |
-
1987
- 1987-10-05 JP JP15315587U patent/JPH0158175U/ja active Pending