JPH0158176U - - Google Patents
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- Publication number
- JPH0158176U JPH0158176U JP15315787U JP15315787U JPH0158176U JP H0158176 U JPH0158176 U JP H0158176U JP 15315787 U JP15315787 U JP 15315787U JP 15315787 U JP15315787 U JP 15315787U JP H0158176 U JPH0158176 U JP H0158176U
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- JP
- Japan
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- ary counter
- pulse
- frequency
- reference clock
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- 230000001960 triggered effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
- 238000006243 chemical reaction Methods 0.000 description 2
Landscapes
- Analogue/Digital Conversion (AREA)
Description
第１図はこの考案の一実施例によるＦ―Ｖコン
バータの構成図、第２図はタイミングチヤート、
第３図はＦ―Ｖ変換特性図、第４図は従来のＦ―
Ｖコンバータの構成図である。 ２…積分回路、３…ｎ進カウンタ、４…基準ク
ロツクパルス発生器、ａ…入力パルス、ｂ…基準
クロツクパルス、ｃ…出力パルス。なお、図中の
同一符号は同一または相当部分を示す。
バータの構成図、第２図はタイミングチヤート、
第３図はＦ―Ｖ変換特性図、第４図は従来のＦ―
Ｖコンバータの構成図である。 ２…積分回路、３…ｎ進カウンタ、４…基準ク
ロツクパルス発生器、ａ…入力パルス、ｂ…基準
クロツクパルス、ｃ…出力パルス。なお、図中の
同一符号は同一または相当部分を示す。
Claims (1)
- 周波数の可変な入力パルスを加えることにより
トリガされて基準クロツクパルスをｎ個カウント
して所定のパルスを出力するｎ進カウンタと、こ
のｎ進カウンタに上記の基準クロツクパルスを入
力するクロツクパルス発生器と、上記ｎ進カウン
タからの出力パルスを積分して出力する積分回路
とを具備し、入力周波数の変化に対応させて積分
回路の出力電圧を可変制御するように構成したこ
とを特徴とする周波数−電圧変換回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15315787U JPH0158176U (ja) | 1987-10-05 | 1987-10-05 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15315787U JPH0158176U (ja) | 1987-10-05 | 1987-10-05 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0158176U true JPH0158176U (ja) | 1989-04-11 |
Family
ID=31428742
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15315787U Pending JPH0158176U (ja) | 1987-10-05 | 1987-10-05 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0158176U (ja) |
-
1987
- 1987-10-05 JP JP15315787U patent/JPH0158176U/ja active Pending