JPH0164230U - - Google Patents

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JPH0164230U
JPH0164230U JP1987157537U JP15753787U JPH0164230U JP H0164230 U JPH0164230 U JP H0164230U JP 1987157537 U JP1987157537 U JP 1987157537U JP 15753787 U JP15753787 U JP 15753787U JP H0164230 U JPH0164230 U JP H0164230U
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JP
Japan
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lower bits
digital
adder
pulse width
width modulator
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JP1987157537U
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  • Analogue/Digital Conversion (AREA)

Description

【図面の簡単な説明】
第１図はこの考案の実施例を示すブロツク図、
第２図は上記実施例におけるパルス幅変調器のブ
ロツク図、第３図は上記実施例における各部の波
形タイムチヤート、第４図は従来のＤ／Ａコンバ
ータの構成図である。 １……Ｄ／Ａコンバータ、２……加算器、３…
…パルス幅変調器、４……パルス発振器、５……
カウンタ、６……比較器。

Claims (1)

    【実用新案登録請求の範囲】
  1. デジタルデータのうちＤ／Ａ変換回路の分解能
    を超える下位ビツトを入力して該下位ビツトの値
    に比例したデユーテイのパルス信号を作成するパ
    ルス幅変調器、上記デジタルデータの上記下位ビ
    ツトを差し引いた残りの上位ビツトに上記パルス
    幅変調器の出力を最小位ビツトとして加算する加
    算器を有し、該加算器の出力が上記Ｄ／Ａ変換回
    路に入力されることを特徴とするデジタル／アナ
    ログ変換装置。
JP1987157537U 1987-10-16 1987-10-16 Pending JPH0164230U (ja)

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JP1987157537U JPH0164230U (ja) 1987-10-16 1987-10-16

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JPH0164230U true JPH0164230U (ja) 1989-04-25

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Family Applications (1)

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JP1987157537U Pending JPH0164230U (ja) 1987-10-16 1987-10-16

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5932223A (ja) * 1982-08-17 1984-02-21 Toshiba Corp デイジタル回路

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5932223A (ja) * 1982-08-17 1984-02-21 Toshiba Corp デイジタル回路

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