JPH0176642U - - Google Patents

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JPH0176642U
JPH0176642U JP1987170267U JP17026787U JPH0176642U JP H0176642 U JPH0176642 U JP H0176642U JP 1987170267 U JP1987170267 U JP 1987170267U JP 17026787 U JP17026787 U JP 17026787U JP H0176642 U JPH0176642 U JP H0176642U
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JP
Japan
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memory
access
circuit
multiple users
data
Prior art date
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Application number
JP1987170267U
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【図面の簡単な説明】
第１図はこの考案の一実施例によるメモリ・ア
クセス調停回路を示すブロツク図、第２図は従来
のメモリ・アクセス調停回路を示すブロツク図で
ある。 図において、１はメモリ・ユーザーＡ、２はメ
モリ・ユーザーＢ、３はデータ・バスＡのゲート
、４はデータ・バスＢのゲート、５はアドレス・
バスＡのデコーダ、６はアドレス・バスＢのデコ
ーダ、７はアドレス・バスＡのゲート、８はアド
レス・バスＢのゲート、９はメモリ・アクセス調
停回路、１０はメモリ回路、１１はアドレス比較
器を示す。なお、図中、同一符号は同一、または
相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 多ユーザーが１つのメモリをアクセスするメモ
    リ・システムのアドレス比較器とデータ有効タイ
    ミング回路を用い、メモリ、アクセス衝突時のア
    クセス・データを多ユーザーが共用する回路を有
    することを特徴とするメモリ・アクセス調停回路
    。
JP1987170267U 1987-11-07 1987-11-07 Pending JPH0176642U (ja)

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JP1987170267U JPH0176642U (ja) 1987-11-07 1987-11-07

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JP1987170267U JPH0176642U (ja) 1987-11-07 1987-11-07

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JPH0176642U true JPH0176642U (ja) 1989-05-24

Family

ID=31461062

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JP1987170267U Pending JPH0176642U (ja) 1987-11-07 1987-11-07

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