JPH0482736U - - Google Patents
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- Publication number
- JPH0482736U JPH0482736U JP12790990U JP12790990U JPH0482736U JP H0482736 U JPH0482736 U JP H0482736U JP 12790990 U JP12790990 U JP 12790990U JP 12790990 U JP12790990 U JP 12790990U JP H0482736 U JPH0482736 U JP H0482736U
- Authority
- JP
- Japan
- Prior art keywords
- memory access
- cpu
- logical memory
- losing
- realized
- Prior art date
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- Pending
Links
- 238000006243 chemical reaction Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 2
Description
第１図はこの考案の一実施例を示すブロツク図
、第２図は従来のブロツク図を示す。図において
、１は６８系μ−ＣＰＵ、２は８６系μ−ＣＰＵ
、３はメモリ、４は制御バス、５はデータバス、
６はアドレスバス、７は入出力回路、８はアドレ
ス制御回路を示す。なお、図中、同一符号は同一
、または相当部分を示す。
、第２図は従来のブロツク図を示す。図において
、１は６８系μ−ＣＰＵ、２は８６系μ−ＣＰＵ
、３はメモリ、４は制御バス、５はデータバス、
６はアドレスバス、７は入出力回路、８はアドレ
ス制御回路を示す。なお、図中、同一符号は同一
、または相当部分を示す。
Claims (1)
- 論理メモリアクセスの異なる２種のμ−ＣＰＵ
を一つのメモリを共有して使用するシステムにお
いて、本来保持している個々のμ−ＣＰＵの処理
能力、速度を失なうことなく論理メモリアクセス
をバス変換によつて実現することを特徴とする論
理メモリアクセス装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12790990U JPH0482736U (ja) | 1990-11-28 | 1990-11-28 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12790990U JPH0482736U (ja) | 1990-11-28 | 1990-11-28 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0482736U true JPH0482736U (ja) | 1992-07-17 |
Family
ID=31875391
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12790990U Pending JPH0482736U (ja) | 1990-11-28 | 1990-11-28 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0482736U (ja) |
-
1990
- 1990-11-28 JP JP12790990U patent/JPH0482736U/ja active Pending
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