JPH0187293U - - Google Patents

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JPH0187293U
JPH0187293U JP18247287U JP18247287U JPH0187293U JP H0187293 U JPH0187293 U JP H0187293U JP 18247287 U JP18247287 U JP 18247287U JP 18247287 U JP18247287 U JP 18247287U JP H0187293 U JPH0187293 U JP H0187293U
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JP
Japan
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section
time
data
memory
outputs
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JP18247287U
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Description

【図面の簡単な説明】
第１図はこの考案の一実施例によるタイマー装
置の使用状態を示すシステムの説明図、第２図は
このタイマー装置のブロツク図である。 図において、４はタイマー、５はリモコン、６
はキーセツト部、８は受信部、９は送信部、１０
は復調部、１１はコントロール部、１２はメモリ
、１３はタイマー、１４は変調部である。なお、
図中、同一符号は同一、又は相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. リモコンの送出データを受信した受信部の受信
    信号をデジタルデータに変換する復調部と、時刻
    を設定するキーセツト部と、データを記憶するメ
    モリと、時刻を出力するタイマーと、前記復調部
    からのデータ及び前記キーセツト部からの設定時
    刻を前記メモリに記憶するとともに前記タイマー
    からの時刻が前記設定時刻になると該メモリから
    記憶データをリードして出力信号を出すコントロ
    ール部と、前記出力信号を変調して送信部に出力
    する変調部とを備えたタイマー装置。
JP18247287U 1987-11-30 1987-11-30 Pending JPH0187293U (ja)

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JP18247287U JPH0187293U (ja) 1987-11-30 1987-11-30

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JP18247287U JPH0187293U (ja) 1987-11-30 1987-11-30

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JPH0187293U true JPH0187293U (ja) 1989-06-08

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JP18247287U Pending JPH0187293U (ja) 1987-11-30 1987-11-30

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