JPH0191319U - - Google Patents
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- Publication number
- JPH0191319U JPH0191319U JP18627587U JP18627587U JPH0191319U JP H0191319 U JPH0191319 U JP H0191319U JP 18627587 U JP18627587 U JP 18627587U JP 18627587 U JP18627587 U JP 18627587U JP H0191319 U JPH0191319 U JP H0191319U
- Authority
- JP
- Japan
- Prior art keywords
- high frequency
- frequency signal
- input terminal
- signal input
- terminal
- Prior art date
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- Pending
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- 238000010586 diagram Methods 0.000 description 3
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- Networks Using Active Elements (AREA)
Description
第１図はこの考案の一実施例を示す回路図であ
る。第２図はこの考案の他の実施例を示す回路図
である。第３図は従来の信号分割器の一例を示す
回路図である。 図において、１０は信号分割器、１２は高周波
信号入力端、１４は共通接続点、１４ａ，１４ｂ
および１４ｃは整合抵抗、１６および１８は分割
端、２０および２２は出力端、２４および２６は
バツフアアンプ、２８ａおよび２８ｂは同軸ケー
ブルを示す。
る。第２図はこの考案の他の実施例を示す回路図
である。第３図は従来の信号分割器の一例を示す
回路図である。 図において、１０は信号分割器、１２は高周波
信号入力端、１４は共通接続点、１４ａ，１４ｂ
および１４ｃは整合抵抗、１６および１８は分割
端、２０および２２は出力端、２４および２６は
バツフアアンプ、２８ａおよび２８ｂは同軸ケー
ブルを示す。
Claims (1)
- 【実用新案登録請求の範囲】 高周波信号入力端、 複数の出力端、 前記高周波信号入力端に共通接続された複数の
整合用素子、および、 それぞれが各整合用素子と各出力端との間に介
挿されたかつそれぞれが所定の入力インピーダン
スを有する複数のバツフアアンプを備える、信号
分割器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18627587U JPH0191319U (ja) | 1987-12-07 | 1987-12-07 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18627587U JPH0191319U (ja) | 1987-12-07 | 1987-12-07 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0191319U true JPH0191319U (ja) | 1989-06-15 |
Family
ID=31477507
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18627587U Pending JPH0191319U (ja) | 1987-12-07 | 1987-12-07 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0191319U (ja) |
-
1987
- 1987-12-07 JP JP18627587U patent/JPH0191319U/ja active Pending
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