JPH0191955U - - Google Patents

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JPH0191955U
JPH0191955U JP18793187U JP18793187U JPH0191955U JP H0191955 U JPH0191955 U JP H0191955U JP 18793187 U JP18793187 U JP 18793187U JP 18793187 U JP18793187 U JP 18793187U JP H0191955 U JPH0191955 U JP H0191955U
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ram
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connects
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JP18793187U
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【図面の簡単な説明】
第１図はこの考案の一実施例によるＲＡＭを用
いたＩ／Ｆ装置を示す概観図、第２図はこの考案
によるＲＡＭを用いたＩ／Ｆ装置のタイミングチ
ヤート図、第３図は従来のＲＡＭを用いたＩ／Ｆ
装置を示す概観図、第４図は従来のＲＡＭを用い
たＩ／Ｆ装置のタイミングチヤート図である。 図において、１は第１の機器、２は第２の機器
、３はバスコントローラ、４は第１のＲＡＭ、５
は第２ＲＡＭ、６は第１のセレクタ、７は第２セ
レクタである。なお図中、同一符号は同一、又は
相当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. 処理時間の異なる第１、第２の機器間のデータ
    転送にＲＡＭを用いて行なうインターフエイス装
    置において、第１のＲＡＭと、上記第１のＲＡＭ
    とリード／ライト処理が逆に動作しつつ上記第１
    、第２の機器間のデータ交信を行なう第２のＲＡ
    Ｍと、上記第１の機器から出力されるデータのデ
    ータバスを上記第１又は第２のＲＡＭのいずれか
    に切換え接続する第１のセレクタと、上記第１の
    セレクタで切換接続されたＲＡＭとは別のＲＡＭ
    に上記第２の機器側のデータバスを接続する第２
    のセレクタと、上記第１、第２の機器の交信が完
    了するタイミングで上記第１、第２のセレクタに
    対しバス切換制御信号を発生する制御手段とを具
    備したことを特徴とするインターフエイス装置。
JP18793187U 1987-12-10 1987-12-10 Pending JPH0191955U (ja)

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JP18793187U JPH0191955U (ja) 1987-12-10 1987-12-10

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JPH0191955U true JPH0191955U (ja) 1989-06-16

Family

ID=31479060

Family Applications (1)

Application Number Title Priority Date Filing Date
JP18793187U Pending JPH0191955U (ja) 1987-12-10 1987-12-10

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JP (1) JPH0191955U (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010026741A (ja) * 2008-07-18 2010-02-04 Mimaki Engineering Co Ltd データ転送方法及びデータ転送装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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