JPH02120933U - - Google Patents
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- Publication number
- JPH02120933U JPH02120933U JP3052689U JP3052689U JPH02120933U JP H02120933 U JPH02120933 U JP H02120933U JP 3052689 U JP3052689 U JP 3052689U JP 3052689 U JP3052689 U JP 3052689U JP H02120933 U JPH02120933 U JP H02120933U
- Authority
- JP
- Japan
- Prior art keywords
- stage
- flop
- type flip
- output
- supplied
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Pulse Circuits (AREA)
Description
第１図は本考案による分周回路の実施例を示す
ブロツク図、第２図は第１図において遅延素子の
デイレイ量を原クロツク周期の４倍として１１分
周を行なつた時の各部の波形を示すタイミング図
、第３図は第１図において遅延素子のデイレイ量
を変化させた時の分周されたクロツク信号を示す
タイミング図、第４図は従来技術による分周回路
の一例（１１分周）を示すブロツク図である。 １１，１２，２１〜２６……Ｄ形フリツプフロ
ツプ、１３……ＡＮＤ回路、１４……遅延素子、
１０１〜１０７……信号線。
ブロツク図、第２図は第１図において遅延素子の
デイレイ量を原クロツク周期の４倍として１１分
周を行なつた時の各部の波形を示すタイミング図
、第３図は第１図において遅延素子のデイレイ量
を変化させた時の分周されたクロツク信号を示す
タイミング図、第４図は従来技術による分周回路
の一例（１１分周）を示すブロツク図である。 １１，１２，２１〜２６……Ｄ形フリツプフロ
ツプ、１３……ＡＮＤ回路、１４……遅延素子、
１０１〜１０７……信号線。
Claims (1)
- 前段Ｄ形フリツプフロツプの一方の入力段にク
ロツク信号を供給し、前記前段Ｄ形フリツプフロ
ツプの反転出力と前記前段Ｄ形フリツプフロツ
プの出力側に接続した後段Ｄ形フリツプフロツプ
の出力との論理積をとつた信号を遅延素子を介
して前記前段フリツプフロツプの他方の入力側に
供給したことを特徴とする分周回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3052689U JPH02120933U (ja) | 1989-03-16 | 1989-03-16 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3052689U JPH02120933U (ja) | 1989-03-16 | 1989-03-16 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02120933U true JPH02120933U (ja) | 1990-10-01 |
Family
ID=31255657
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3052689U Pending JPH02120933U (ja) | 1989-03-16 | 1989-03-16 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02120933U (ja) |
-
1989
- 1989-03-16 JP JP3052689U patent/JPH02120933U/ja active Pending