JPH02123180U - - Google Patents

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JPH02123180U
JPH02123180U JP3190789U JP3190789U JPH02123180U JP H02123180 U JPH02123180 U JP H02123180U JP 3190789 U JP3190789 U JP 3190789U JP 3190789 U JP3190789 U JP 3190789U JP H02123180 U JPH02123180 U JP H02123180U
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JP
Japan
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control device
memory control
field memory
horizontal period
period
Prior art date
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JP3190789U
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  • Television Signal Processing For Recording (AREA)

Description

【図面の簡単な説明】
第1図は実施例の要部を示すブロツク図、第2
図は波形図である。第3図、第4図は従来例の問
題点を説明するための説明図である。 1……メモリセル、2,3……アドレスカウン
タ、4……入力シリアルバツフア、8……ライン
カウンタ、9……フレームカウンタ、10……2
62Hデコーダ、11……524Hデコーダ、1
2……525Hデコーダ。

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力シリアルバツフアのビツト数が、入力され
    る映像信号の1水平期間の整数分の1とは異なる
    フイールドメモリの制御装置において、書き込み
    リセツトパルスとして、nH,n+1H(nは自
    然数で、2n+1が1フレームの水平期間に相当
    する)周期を交互に有するパルスを作成する手段
    と、読み出しリセツトパルスとしてnH,nH,
    1H周期のパルスを作成する手段を備えることを
    特徴とするフイールドメモリの制御装置。
JP3190789U 1989-03-20 1989-03-20 Pending JPH02123180U (ja)

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JP3190789U JPH02123180U (ja) 1989-03-20 1989-03-20

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JPH02123180U true JPH02123180U (ja) 1990-10-09

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JP3190789U Pending JPH02123180U (ja) 1989-03-20 1989-03-20

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