JPH02123629U - - Google Patents
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- Publication number
- JPH02123629U JPH02123629U JP3281589U JP3281589U JPH02123629U JP H02123629 U JPH02123629 U JP H02123629U JP 3281589 U JP3281589 U JP 3281589U JP 3281589 U JP3281589 U JP 3281589U JP H02123629 U JPH02123629 U JP H02123629U
- Authority
- JP
- Japan
- Prior art keywords
- clock signal
- data rate
- section
- buffer memory
- data
- Prior art date
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- Pending
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- 238000012544 monitoring process Methods 0.000 claims 1
- 230000004044 response Effects 0.000 claims 1
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- 238000010586 diagram Methods 0.000 description 2
Description
第１図はこの考案の一実施例を示す機能図、第
２図は従来のデジタル信号入力装置の機能図であ
る。 図において、１は波形整形部、２はデータ記憶
・出力部、３はモノパルス発生部、４はデータ記
憶部、５はデータ出力部、６はデータレート制御
部である。なお、各図中同一符号は同一又は相当
部分を示す。
２図は従来のデジタル信号入力装置の機能図であ
る。 図において、１は波形整形部、２はデータ記憶
・出力部、３はモノパルス発生部、４はデータ記
憶部、５はデータ出力部、６はデータレート制御
部である。なお、各図中同一符号は同一又は相当
部分を示す。
Claims (1)
- デジタル信号及びクロツク信号の立上り部分及
び立下り部分を急峻にし、雑音を除去するための
波形整形部と、波形整形されたクロツク信号を固
定パルス幅のクロツク信号に変換するためのモノ
パルス発生部と、モノパレス発生部からのクロツ
ク信号に同期してデータを一度記憶するバツフア
メモリ部と、入力させる機器からの入力要求クロ
ツク信号によりデータをバツフアメモリ部から読
み出して出力するデータ出力部と、バツフアメモ
リ部の記憶可能量をモニタし、記憶可能量に応じ
て入力されるデジタル信号のデータ速度を制御す
るためのデータレート制御部を備え、速いデータ
レートを有するデジタル信号を連続して入力でき
ることを特徴とするデジタル信号入力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3281589U JPH02123629U (ja) | 1989-03-23 | 1989-03-23 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3281589U JPH02123629U (ja) | 1989-03-23 | 1989-03-23 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02123629U true JPH02123629U (ja) | 1990-10-11 |
Family
ID=31259397
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3281589U Pending JPH02123629U (ja) | 1989-03-23 | 1989-03-23 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02123629U (ja) |
-
1989
- 1989-03-23 JP JP3281589U patent/JPH02123629U/ja active Pending