JPH02132941A - 回線切替システム - Google Patents
回線切替システムInfo
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- JPH02132941A JPH02132941A JP63285806A JP28580688A JPH02132941A JP H02132941 A JPH02132941 A JP H02132941A JP 63285806 A JP63285806 A JP 63285806A JP 28580688 A JP28580688 A JP 28580688A JP H02132941 A JPH02132941 A JP H02132941A
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- 238000000605 extraction Methods 0.000 claims description 5
- 238000003780 insertion Methods 0.000 claims description 3
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- 239000000284 extract Substances 0.000 claims 1
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- 238000013024 troubleshooting Methods 0.000 description 1
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- Digital Transmission Methods That Use Modulated Carrier Waves (AREA)
- Detection And Prevention Of Errors In Transmission (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業トの利川分野］
本９２明は、無線マイクロ波デジタル通信における回線
ｖＪ ｛＋区間が少なくとも二区間縦列に接続してある
場合に使用する回線切替システムに関する． ［従来の技術］ 従来、回線切替区間が少なくとも二区間縦列に接続して
あるような無線マイクロ波デジタル通信ンステムにおい
ては，各切村区間相互の制御は行なわず、各区間が単独
で回路切替を行なっていた． ［解決すへご課題］ しかしながら，上述したように各区間が巾独で回路切｛
＋を行なった場合，特に，」二位の区間が回線りＪＰｆ
を行なったとき、ＣＬＫ信号に急激な位相変化が生じ、
四線゛切替を行なう区間以後において，復調器のビット
同期に使用するＰＬＬ回路の同期が外れてしまうという
欠点があった．これに対し、ＰＬＬ回路の雑音帯域を広
くすることにより同期特性を良好に保つことができるが
、反面、復調器のビット誤り率が劣化する閤題が生ずる
． 本発明はこのような問題点にかんがみてなされたもので
、上位区間の回線切替によるＣＬＫ信号の急激な変化が
あっても安定した同期特性が得られ，しかも良好なビッ
ト誤り率も得ることができる回路切替システムの提供を
目的とする．［課題の解決千段］ 上記｛１的を達成するために本発明は無線マイクロ波デ
ジタル通信における回線切替区間が少なくとも二区間縦
列に接続する回線切替システムにおいて、回線障害情報
および回線切替状態により回線障害救済のための切妊動
作を検知しＦ位区間の回線νノ苔装置に対して五位区間
の切替情報を送出するＬＪＪ ｛＋検知回路と、この切
持検知回路の出力により下位区間送端の補助信号ビット
を挿入する付加ビット挿入回路と，下位区間受端にてＬ
記補助信号ビットを涌出する付加ビット抽出回路と、こ
の付加ビット抽出回路の出力により復ｙＡ器のビット同
期用ＰＬＬ回路の雑音帯域幅を制御し、上位区間が回路
ｖＪ妊を行う直前から切替完了後一定時間の間、上記ビ
ット同期用ＰＬＬ回路の雑音帯域幅を広げる２ｌ音帯域
幅制御回路とを備えた構成としてある． ［実施例］ 以下，本発明の−・実施例について図面を参照して説Ｉ
Ｉｌ１する． 第１図は，本実施例の１７ｉＩ線切替装置における雑丘
帯域幅制御に係る制御ブロック図，第２図（ａ），（ｂ
）は、同装置の雑音帯域幅制御タイムチャートで、同図
（ａ）はチャンネルアラーム発動／解除の場合を示し，
同図（ｂ）はシステムアラーム発動／解除の場合を示す
． 第１図において、１０６は上位区間受端回路切朽装とで
あり，フレーム同期盤１．回期リ３Ｊｉ＃器２．受信符
号処理盤３．受端システム切替塁４および切替検知回路
５を有する． フレーム同基盤１は回線の伝送品質を監視し，伝送品質
が規定された値以上に劣化した場合，回線障害情報とし
てチャンネルアラーム１１を発動し回線の同期切替条件
としている．受信符号処理盤３は、回線の伝送品質を監
視し伝送品貞が規定された値以下に劣化した場合、また
は機器に障害が発生した場合に、回線障害情報としてシ
ステムアラーム３ｌを発動しシステム９Ｊ８条件として
いる．また同期切替器２は切替状態信号２１を出力する
．−ｈ位区間受端！／］｛Ｎａｆｆｌｔｏａの受端シス
テム切替器４は切苔状態信号４１を出力する．切持検知
回路５は，チャンネルアラームｌ１と切苔状７ｍ２１ま
たはシステムアラーム３１と！／Ｊ＃状態４ｌにより，
第２図の雑音帯域幅制御タイムチャートに示す切替検知
出力５ｌを出力する．また、２０１はＦ位区間送端回線
νＪ待装置であり，付加ビット挿入回路としての符号処
Ｊ’Ｊｊｆｉ６を有する．２０６は受端回路切科装置で
あり、付加ビット抽出回路としてのフレーム同期盤７と
雑音・：１？域幅制御回路８を有する．２０５はＦ位区
間受端Ｉ３！調器で、ビット同期ＰＬＬ回路９を内蔵し
ている， ９ｊＰｔ検知回路５から出力されたνＪ．ＦＦ検知出力
５ｌは、下位区間送端回路切替装置２０１の送信符号処
理盤６にて補助信号ビン｝６１に挿入され、下位区間受
端回線りＪ８装置２０６のフレーム同期盤７にて補助信
号ビットを検出し、上位区間回線９ノ袢情報出力７ｌを
出力する．上位区間回線ｖＪ科情報出力７１は、下位区
間受端回線リＪ替装置２０６の雑合帯域＠ルｊ御凹路８
にて一定時間引き延ばされ、下位区間受端復７Ａ器２０
５のビー２ト同期ＰＬＬ回路９の雑音帯域幅を制御する
雑音帯域幅制御信号８ｌを得る． 雑音帯域幅制御信号８ｌは、第２図の雑音幅制御タイム
チャートに示すように，上位区間の回線切替条件が成立
した時点Ｔ１で前記ＰＬＬ回路９の雑音帯域幅を広げる
ような制御を行ない、回線リＪ替を完了した時点Ｔ２か
ら前記ＰＬＬ回路９の同期が安定する時間を経過した時
点Ｔ３にて，前記３Ｉ音１１？域幅の制御を解除し、前
記ＰＬＬ回路９の雑音帯域幅を元の戻す． 次いで、上位区間の回線切替条件が解除された時点Ｔ４
で、前記ＰＬＬ回路の雑音帯域幅を広げるような制御を
行ない、回路切り戻しを完了した時点Ｔ５から前記ＰＬ
Ｌ回路９の同期が安定する時間を経過した時点Ｔ６にて
，前記雑音帯域を元に戻す． 第３図はト述した実施例のシステムを適用する回線切替
区間の一例を示す構成図である．図面において，１０１
，１１１．２０１２１１はそれぞれ送端回路切替装ｔを
示し、１０２，１１２，２０２，２１２１ｆ変調器、１
０３，１１３，２０３，２１３は送信機，１０４，１１
４，２０４，２１４は受信機、１０５，１１５，２０５
，２１５は復５Ｉ器、１０６，１１６，２０６，２１６
は受端回線リＪ科装ごを示している． ［発明の効果］ 以上説明したように本発明は，上位区間の回線切持によ
るＣＬＫ信号の急激な位相変化に対して、復調器のビッ
ト同期に使用されるＰＬＬ回路の雑音帯域幅を広げるこ
とにより，安定な同期特性が｛ｉＪられ，かつ，回線！
／Ｊ＃完了一定時間後、前記雑音帯域幅を元に戻すこと
により，良好なビ，ト誤り率が得られる効果がある．
ｖＪ ｛＋区間が少なくとも二区間縦列に接続してある
場合に使用する回線切替システムに関する． ［従来の技術］ 従来、回線切替区間が少なくとも二区間縦列に接続して
あるような無線マイクロ波デジタル通信ンステムにおい
ては，各切村区間相互の制御は行なわず、各区間が単独
で回路切替を行なっていた． ［解決すへご課題］ しかしながら，上述したように各区間が巾独で回路切｛
＋を行なった場合，特に，」二位の区間が回線りＪＰｆ
を行なったとき、ＣＬＫ信号に急激な位相変化が生じ、
四線゛切替を行なう区間以後において，復調器のビット
同期に使用するＰＬＬ回路の同期が外れてしまうという
欠点があった．これに対し、ＰＬＬ回路の雑音帯域を広
くすることにより同期特性を良好に保つことができるが
、反面、復調器のビット誤り率が劣化する閤題が生ずる
． 本発明はこのような問題点にかんがみてなされたもので
、上位区間の回線切替によるＣＬＫ信号の急激な変化が
あっても安定した同期特性が得られ，しかも良好なビッ
ト誤り率も得ることができる回路切替システムの提供を
目的とする．［課題の解決千段］ 上記｛１的を達成するために本発明は無線マイクロ波デ
ジタル通信における回線切替区間が少なくとも二区間縦
列に接続する回線切替システムにおいて、回線障害情報
および回線切替状態により回線障害救済のための切妊動
作を検知しＦ位区間の回線νノ苔装置に対して五位区間
の切替情報を送出するＬＪＪ ｛＋検知回路と、この切
持検知回路の出力により下位区間送端の補助信号ビット
を挿入する付加ビット挿入回路と，下位区間受端にてＬ
記補助信号ビットを涌出する付加ビット抽出回路と、こ
の付加ビット抽出回路の出力により復ｙＡ器のビット同
期用ＰＬＬ回路の雑音帯域幅を制御し、上位区間が回路
ｖＪ妊を行う直前から切替完了後一定時間の間、上記ビ
ット同期用ＰＬＬ回路の雑音帯域幅を広げる２ｌ音帯域
幅制御回路とを備えた構成としてある． ［実施例］ 以下，本発明の−・実施例について図面を参照して説Ｉ
Ｉｌ１する． 第１図は，本実施例の１７ｉＩ線切替装置における雑丘
帯域幅制御に係る制御ブロック図，第２図（ａ），（ｂ
）は、同装置の雑音帯域幅制御タイムチャートで、同図
（ａ）はチャンネルアラーム発動／解除の場合を示し，
同図（ｂ）はシステムアラーム発動／解除の場合を示す
． 第１図において、１０６は上位区間受端回路切朽装とで
あり，フレーム同期盤１．回期リ３Ｊｉ＃器２．受信符
号処理盤３．受端システム切替塁４および切替検知回路
５を有する． フレーム同基盤１は回線の伝送品質を監視し，伝送品質
が規定された値以上に劣化した場合，回線障害情報とし
てチャンネルアラーム１１を発動し回線の同期切替条件
としている．受信符号処理盤３は、回線の伝送品質を監
視し伝送品貞が規定された値以下に劣化した場合、また
は機器に障害が発生した場合に、回線障害情報としてシ
ステムアラーム３ｌを発動しシステム９Ｊ８条件として
いる．また同期切替器２は切替状態信号２１を出力する
．−ｈ位区間受端！／］｛Ｎａｆｆｌｔｏａの受端シス
テム切替器４は切苔状態信号４１を出力する．切持検知
回路５は，チャンネルアラームｌ１と切苔状７ｍ２１ま
たはシステムアラーム３１と！／Ｊ＃状態４ｌにより，
第２図の雑音帯域幅制御タイムチャートに示す切替検知
出力５ｌを出力する．また、２０１はＦ位区間送端回線
νＪ待装置であり，付加ビット挿入回路としての符号処
Ｊ’Ｊｊｆｉ６を有する．２０６は受端回路切科装置で
あり、付加ビット抽出回路としてのフレーム同期盤７と
雑音・：１？域幅制御回路８を有する．２０５はＦ位区
間受端Ｉ３！調器で、ビット同期ＰＬＬ回路９を内蔵し
ている， ９ｊＰｔ検知回路５から出力されたνＪ．ＦＦ検知出力
５ｌは、下位区間送端回路切替装置２０１の送信符号処
理盤６にて補助信号ビン｝６１に挿入され、下位区間受
端回線りＪ８装置２０６のフレーム同期盤７にて補助信
号ビットを検出し、上位区間回線９ノ袢情報出力７ｌを
出力する．上位区間回線ｖＪ科情報出力７１は、下位区
間受端回線リＪ替装置２０６の雑合帯域＠ルｊ御凹路８
にて一定時間引き延ばされ、下位区間受端復７Ａ器２０
５のビー２ト同期ＰＬＬ回路９の雑音帯域幅を制御する
雑音帯域幅制御信号８ｌを得る． 雑音帯域幅制御信号８ｌは、第２図の雑音幅制御タイム
チャートに示すように，上位区間の回線切替条件が成立
した時点Ｔ１で前記ＰＬＬ回路９の雑音帯域幅を広げる
ような制御を行ない、回線リＪ替を完了した時点Ｔ２か
ら前記ＰＬＬ回路９の同期が安定する時間を経過した時
点Ｔ３にて，前記３Ｉ音１１？域幅の制御を解除し、前
記ＰＬＬ回路９の雑音帯域幅を元の戻す． 次いで、上位区間の回線切替条件が解除された時点Ｔ４
で、前記ＰＬＬ回路の雑音帯域幅を広げるような制御を
行ない、回路切り戻しを完了した時点Ｔ５から前記ＰＬ
Ｌ回路９の同期が安定する時間を経過した時点Ｔ６にて
，前記雑音帯域を元に戻す． 第３図はト述した実施例のシステムを適用する回線切替
区間の一例を示す構成図である．図面において，１０１
，１１１．２０１２１１はそれぞれ送端回路切替装ｔを
示し、１０２，１１２，２０２，２１２１ｆ変調器、１
０３，１１３，２０３，２１３は送信機，１０４，１１
４，２０４，２１４は受信機、１０５，１１５，２０５
，２１５は復５Ｉ器、１０６，１１６，２０６，２１６
は受端回線リＪ科装ごを示している． ［発明の効果］ 以上説明したように本発明は，上位区間の回線切持によ
るＣＬＫ信号の急激な位相変化に対して、復調器のビッ
ト同期に使用されるＰＬＬ回路の雑音帯域幅を広げるこ
とにより，安定な同期特性が｛ｉＪられ，かつ，回線！
／Ｊ＃完了一定時間後、前記雑音帯域幅を元に戻すこと
により，良好なビ，ト誤り率が得られる効果がある．
第１図は本発明の一実施例に係る回線切替システムにお
ける雑音帯域幅制御に関する制御ブロック図、第２図は
（ａ）．（ｂ）は同システムの雑音帯域幅制御タイムチ
ャート，第３図は本発明システムをＡ川する回線切替区
間の一例を示す構成図である． １：フレーム同期ｆｉ １１：チャンネルアラーム２
二同期切替器 ２１二同期切替器の切替状態出力 ３：受信符号処理盤 ３ｌ：システムアラーム４：受端
システム切任器 ４ｌ：受端システム切待器の切替状態出力５ ： ＋Ｊ
Ｊ替検知回路 ５１：切替検知回路出力６：送信符号
処理ｘ ６１＋補助信号ビット７：フレーム同期盤
７１：回線切替情報出力８；雑音帯域幅制御回路 ８１：３ｌ音帯域幅制御信号 ９：復調器Ｔｌ：チャ
ンネルアラーム発動時刻またはシステムアラーム発動時
刻および雑音？ｆＦ域幅制御時刻Ｔ２二同期リ』待器！
ｉｌｌ替時刻または受端システム切替器切林時刻 Ｔ３ ：３ｔ音帯域幅制御の解除時刻 Ｔ４：チャンネルアラーム解除峙刻またはシステムアラ
ーム解除時刻および雑音帯域幅制御時刻Ｔ５．同期切替
器νノ戻時刻又は受端システム切替器リＪ戻時刻 Ｔ６：雑音帯域幅制御の解除時刻 １０１，ｉｌｌ，２０１，２１１ ・送端回線切替装置 １０２，１１２，２０２，２１２：変調器１０３，１１
３，２０３，２１３：送信機１０４，１１４，２０４，
２１４＋受信機１０５，１１５，２０５，２１５：復調
器１０６，１１６，２０６，２１６ ：受端回線切替装置
ける雑音帯域幅制御に関する制御ブロック図、第２図は
（ａ）．（ｂ）は同システムの雑音帯域幅制御タイムチ
ャート，第３図は本発明システムをＡ川する回線切替区
間の一例を示す構成図である． １：フレーム同期ｆｉ １１：チャンネルアラーム２
二同期切替器 ２１二同期切替器の切替状態出力 ３：受信符号処理盤 ３ｌ：システムアラーム４：受端
システム切任器 ４ｌ：受端システム切待器の切替状態出力５ ： ＋Ｊ
Ｊ替検知回路 ５１：切替検知回路出力６：送信符号
処理ｘ ６１＋補助信号ビット７：フレーム同期盤
７１：回線切替情報出力８；雑音帯域幅制御回路 ８１：３ｌ音帯域幅制御信号 ９：復調器Ｔｌ：チャ
ンネルアラーム発動時刻またはシステムアラーム発動時
刻および雑音？ｆＦ域幅制御時刻Ｔ２二同期リ』待器！
ｉｌｌ替時刻または受端システム切替器切林時刻 Ｔ３ ：３ｔ音帯域幅制御の解除時刻 Ｔ４：チャンネルアラーム解除峙刻またはシステムアラ
ーム解除時刻および雑音帯域幅制御時刻Ｔ５．同期切替
器νノ戻時刻又は受端システム切替器リＪ戻時刻 Ｔ６：雑音帯域幅制御の解除時刻 １０１，ｉｌｌ，２０１，２１１ ・送端回線切替装置 １０２，１１２，２０２，２１２：変調器１０３，１１
３，２０３，２１３：送信機１０４，１１４，２０４，
２１４＋受信機１０５，１１５，２０５，２１５：復調
器１０６，１１６，２０６，２１６ ：受端回線切替装置
Claims (1)
- 無線マイクロ波デジタル通信における回線切替区間が少
なくとも二区間縦列に接続する回線切替システムにおい
て、回線障害情報および回線切替状態により回線障害救
済のための切替動作を検知し下位区間の回線切替装置に
対して上位区間の切替情報を送出する切替検知回路と、
この切替検知回路の出力により下位区間送端の補助信号
ビットを挿入する付加ビット挿入回路と、下位区間受端
にて上記補助信号ビットを抽出する付加ビット抽出回路
と、この付加ビット抽出回路の出力により復調器のビッ
ト同期用ＰＬＬ回路の雑音帯域幅を制御し、上位区間が
回路切替を行う直前から切替完了後一定時間の間、上記
ビット同期用ＰＬＬ回路の雑音帯域幅を広げる雑音帯域
幅制御回路とを具備したことを特徴とする回路切替シス
テム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63285806A JP2806534B2 (ja) | 1988-11-14 | 1988-11-14 | 回線切替システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63285806A JP2806534B2 (ja) | 1988-11-14 | 1988-11-14 | 回線切替システム |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02132941A true JPH02132941A (ja) | 1990-05-22 |
| JP2806534B2 JP2806534B2 (ja) | 1998-09-30 |
Family
ID=17696326
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63285806A Expired - Fee Related JP2806534B2 (ja) | 1988-11-14 | 1988-11-14 | 回線切替システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2806534B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8127391B2 (en) | 2007-07-26 | 2012-03-06 | Dainippon Screen Mfg. Co., Ltd. | Subtrate treatment apparatus |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2637796B2 (ja) | 1987-11-10 | 1997-08-06 | 日本電気株式会社 | 回線切替方式 |
-
1988
- 1988-11-14 JP JP63285806A patent/JP2806534B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US8127391B2 (en) | 2007-07-26 | 2012-03-06 | Dainippon Screen Mfg. Co., Ltd. | Subtrate treatment apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2806534B2 (ja) | 1998-09-30 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |