JPH021421B2 - - Google Patents
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- JPH021421B2 JPH021421B2 JP15446480A JP15446480A JPH021421B2 JP H021421 B2 JPH021421 B2 JP H021421B2 JP 15446480 A JP15446480 A JP 15446480A JP 15446480 A JP15446480 A JP 15446480A JP H021421 B2 JPH021421 B2 JP H021421B2
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- G06—COMPUTING OR CALCULATING; COUNTING
- G06T—IMAGE DATA PROCESSING OR GENERATION, IN GENERAL
- G06T1/00—General purpose image data processing
- G06T1/0007—Image acquisition
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N2201/00—Indexing scheme relating to scanning, transmission or reproduction of documents or the like, and to details thereof
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- H04N2201/3201—Display, printing, storage or transmission of additional information, e.g. ID code, date and time or title
- H04N2201/3225—Display, printing, storage or transmission of additional information, e.g. ID code, date and time or title of data relating to an image, a page or a document
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- H—ELECTRICITY
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- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
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- General Physics & Mathematics (AREA)
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- Theoretical Computer Science (AREA)
- Image Input (AREA)
- Storing Facsimile Image Data (AREA)
- Exposure Or Original Feeding In Electrophotography (AREA)
- Combination Of More Than One Step In Electrophotography (AREA)
Description
【発明の詳細な説明】
本発明は、画像処理方法、特に画像記憶手段を
有した画像処理装置に関する。
有した画像処理装置に関する。
原稿の画像をCCD等のラインセンサで電気的
な画像信号に変換し、この画像信号を基にレーザ
ービームプリンタ等のプリンタ装置により複写物
を得る複写装置が開発されている。このよな複写
装置においては画像を電気的に取扱うので画像処
理が容易であり、更に画像情報を記憶手段に一担
記憶させ、記憶された画像情報をアクセスするよ
うな装置であればより多くの画像処理が可能にな
る。しかし、一担記憶手段を介することにより記
憶手段からの読出し時間が処理時間に影響する点
や、記憶手段内のアドレス指定のためにカウンタ
等を設けなければならない点等の欠点も有する。
このために画像情報の転送にはDMA転送が用い
られる。DMA転送を用いると、記憶手段内の画
像情報の読込み及び読出しにおいて高速化が達成
できるが、記憶手段内におけるアドレスは普通１
走査分が連続しているので、画像情報の一部分を
抜き出す場合には１走査ごとに先頭番地と最終番
地の指定をその抜き出す画像情報の副走査に相当
する数だけくりかえさなければならない、この数
は、画素密度を細かくするに従つて増加してしま
う。
な画像信号に変換し、この画像信号を基にレーザ
ービームプリンタ等のプリンタ装置により複写物
を得る複写装置が開発されている。このよな複写
装置においては画像を電気的に取扱うので画像処
理が容易であり、更に画像情報を記憶手段に一担
記憶させ、記憶された画像情報をアクセスするよ
うな装置であればより多くの画像処理が可能にな
る。しかし、一担記憶手段を介することにより記
憶手段からの読出し時間が処理時間に影響する点
や、記憶手段内のアドレス指定のためにカウンタ
等を設けなければならない点等の欠点も有する。
このために画像情報の転送にはDMA転送が用い
られる。DMA転送を用いると、記憶手段内の画
像情報の読込み及び読出しにおいて高速化が達成
できるが、記憶手段内におけるアドレスは普通１
走査分が連続しているので、画像情報の一部分を
抜き出す場合には１走査ごとに先頭番地と最終番
地の指定をその抜き出す画像情報の副走査に相当
する数だけくりかえさなければならない、この数
は、画素密度を細かくするに従つて増加してしま
う。
本発明は以上の点に鑑みてなされたもので、効
率よい画像処理を可能とすることを目的とし、詳
しくは、画像情報をｎ画素毎に１ページ分記憶可
能な記憶手段を具備した画像処理装置において、
ライン毎にシリアルに入力する画像情報をｎ画素
毎の画素群に順次分割し、連続したｎラインの各
ラインの先頭画素群を連続した番地に記憶すると
もに、各ラインの順次分割される画素群をｎ個お
きの飛び越し番地に記憶し、且つ、ｎライン目の
最終画素群の番地に連続する番地にｎ＋１ライン
目の先頭画素群を記憶することにより、ｎ画素×
ｎ画素サイズの画像ブロツクに含まれるｎ個の画
素群の番地が連続し、且つ、各画像ブロツクの最
終画素群の番地が隣り合つた画像ブロツクの先頭
の画素群の番地に連続した状態で、１ページ分の
画像情報を上記記憶手段に記憶する画像処理装置
を提供するものである。
率よい画像処理を可能とすることを目的とし、詳
しくは、画像情報をｎ画素毎に１ページ分記憶可
能な記憶手段を具備した画像処理装置において、
ライン毎にシリアルに入力する画像情報をｎ画素
毎の画素群に順次分割し、連続したｎラインの各
ラインの先頭画素群を連続した番地に記憶すると
もに、各ラインの順次分割される画素群をｎ個お
きの飛び越し番地に記憶し、且つ、ｎライン目の
最終画素群の番地に連続する番地にｎ＋１ライン
目の先頭画素群を記憶することにより、ｎ画素×
ｎ画素サイズの画像ブロツクに含まれるｎ個の画
素群の番地が連続し、且つ、各画像ブロツクの最
終画素群の番地が隣り合つた画像ブロツクの先頭
の画素群の番地に連続した状態で、１ページ分の
画像情報を上記記憶手段に記憶する画像処理装置
を提供するものである。
第１図は本発明による画像処理装置の実施例の
構成を示すブロツク図である。
構成を示すブロツク図である。
１は画像を光電変換するためのCCD等のライ
ンセンサを有したリーダ部、２はリーダ部１から
シリアルに画素として出力する画像情報を所定数
の画素に分割してパラレルに記憶する原稿１ペー
ジ分の容量をもつた記憶手段である半導体メモリ
によるイメージメモリ、３はイメージメモリ２が
シリアルに出力する画像情報に基づいて複写物を
得るプリンタ部、４は画像処理に係る処理情報を
オペレータが入力する入力部、５はコンピユータ
を有し入力部４の処理情報により画像処理を制御
する制御部、６は制御情報と画像情報を転送する
ためのマルチバス、７はイメージメモリ２から抜
き出された画像情報を記憶するバツフアメモリ、
８はイメージメモリ２とバツフアメモリ７との間
のDMA転送を規制するDMAコントローラであ
る。
ンセンサを有したリーダ部、２はリーダ部１から
シリアルに画素として出力する画像情報を所定数
の画素に分割してパラレルに記憶する原稿１ペー
ジ分の容量をもつた記憶手段である半導体メモリ
によるイメージメモリ、３はイメージメモリ２が
シリアルに出力する画像情報に基づいて複写物を
得るプリンタ部、４は画像処理に係る処理情報を
オペレータが入力する入力部、５はコンピユータ
を有し入力部４の処理情報により画像処理を制御
する制御部、６は制御情報と画像情報を転送する
ためのマルチバス、７はイメージメモリ２から抜
き出された画像情報を記憶するバツフアメモリ、
８はイメージメモリ２とバツフアメモリ７との間
のDMA転送を規制するDMAコントローラであ
る。
説明を簡単にするためにA4サイズの原稿の画
像情報の処理の場合について以下に述べる。リー
ダ部１は主走査方向１mm当り12画素の読取り能力
をもつ、また、副走査は１mm当り12ライン行な
う。従つて、Ａサイズ（288mm×210mm）の原稿は
１走査で3456ビツトの信号に変換される、また、
副走査は2520ライン行なわれることになり、原稿
の画像は全部で8709120ビツトの画素として読取
られる。リーダ部１はこの様に読取つた画像情報
も走査１ラインごとシリアルにイメージメモリ２
に出力する。
像情報の処理の場合について以下に述べる。リー
ダ部１は主走査方向１mm当り12画素の読取り能力
をもつ、また、副走査は１mm当り12ライン行な
う。従つて、Ａサイズ（288mm×210mm）の原稿は
１走査で3456ビツトの信号に変換される、また、
副走査は2520ライン行なわれることになり、原稿
の画像は全部で8709120ビツトの画素として読取
られる。リーダ部１はこの様に読取つた画像情報
も走査１ラインごとシリアルにイメージメモリ２
に出力する。
第２図に本発明によるイメージメモリ２のアド
レスマツプの実施例を示す。イメージメモリ２は
１mm当り12画素としたA4サイズに対応したメモ
リ容量を持つ、即ち8709120ビツトのメモリサイ
ズである。原稿を１mm×１mm単位の正方形のブロ
ツクに分け、全部で60480ブロツクで構成する。
つまり単位ブロツクは12ビツト×12ライン＝144
ビツトの画像情報によりなる。主走査方向の12ビ
ツトを１ワードとして１アドレスを与え、副走査
方向に連続したアドレスを与えると、単位ブロツ
クは連続した12のアドレスを持つ。従つて全メモ
リ空間では725760アドレスを持ち、０〜725759番
地、HEXA CODEで表わすと00000〜B12FF番
地のアドレス空間になる。尚、このためのイメー
ジメモリ２内に有するアドレスカウンタは20ビツ
ト構成になる。
レスマツプの実施例を示す。イメージメモリ２は
１mm当り12画素としたA4サイズに対応したメモ
リ容量を持つ、即ち8709120ビツトのメモリサイ
ズである。原稿を１mm×１mm単位の正方形のブロ
ツクに分け、全部で60480ブロツクで構成する。
つまり単位ブロツクは12ビツト×12ライン＝144
ビツトの画像情報によりなる。主走査方向の12ビ
ツトを１ワードとして１アドレスを与え、副走査
方向に連続したアドレスを与えると、単位ブロツ
クは連続した12のアドレスを持つ。従つて全メモ
リ空間では725760アドレスを持ち、０〜725759番
地、HEXA CODEで表わすと00000〜B12FF番
地のアドレス空間になる。尚、このためのイメー
ジメモリ２内に有するアドレスカウンタは20ビツ
ト構成になる。
リーダ部１からシリアルに入力される主走査の
第１ライン分の3456ビツトの画像情報はイメージ
メモリ内の12ビツトシリアルインパラレルアウト
するシフトレジスタに入力し、原稿の長さ１mmに
相当する12ビツトずつ288個の画素群に分割しパ
ラレルに取り出され、イメージメモリ２内に有す
るアドレスカウンタによつてシフトレジスタの出
力と同期して12番地ごとのアドレスが与えられ
る。つまり、最初の画素群は00000番地にストア
され、次の画素群は0000C番地に、以下00018，
00024…と順次ストアされていき、最後の画素群
は00D74番地にストアされる。つまり、分割され
た画素群は12番地ごとにストアされる。
第１ライン分の3456ビツトの画像情報はイメージ
メモリ内の12ビツトシリアルインパラレルアウト
するシフトレジスタに入力し、原稿の長さ１mmに
相当する12ビツトずつ288個の画素群に分割しパ
ラレルに取り出され、イメージメモリ２内に有す
るアドレスカウンタによつてシフトレジスタの出
力と同期して12番地ごとのアドレスが与えられ
る。つまり、最初の画素群は00000番地にストア
され、次の画素群は0000C番地に、以下00018，
00024…と順次ストアされていき、最後の画素群
は00D74番地にストアされる。つまり、分割され
た画素群は12番地ごとにストアされる。
次に入力される第２ライン分の画像情報も同様
に12ビツトずつの画素群に分割されアドレスカウ
ンタが00001から12番地ごとのアドレスを与え
00001，0000D，…00D75番地へ12番地ごとにス
トアされる、以下同様に第12ラインまでストアさ
れる。以上により原稿の巾１mm，長さ288mm分の
画像情報がページメモリ２の00000〜00D7F番地
までに連続したアドレスをもつた12の画素群を画
素グループとし288個の連続した画素グループと
してストアされる。第13ラインの画像情報が入力
されると、同様に12ビツトずつ分割し、00D80番
地からストアを開始し第24ラインの最後の画素群
まで12番地ごとのアドレスを与えストアする。以
下第25ラインから第2520ラインまで同様にストア
される。以上の様な画像のストアを行なうと、前
記した原稿の１mm×１mm単位の正方形を単位にし
て、連続した番地にA4全領域の画像情報がスト
アされる。
に12ビツトずつの画素群に分割されアドレスカウ
ンタが00001から12番地ごとのアドレスを与え
00001，0000D，…00D75番地へ12番地ごとにス
トアされる、以下同様に第12ラインまでストアさ
れる。以上により原稿の巾１mm，長さ288mm分の
画像情報がページメモリ２の00000〜00D7F番地
までに連続したアドレスをもつた12の画素群を画
素グループとし288個の連続した画素グループと
してストアされる。第13ラインの画像情報が入力
されると、同様に12ビツトずつ分割し、00D80番
地からストアを開始し第24ラインの最後の画素群
まで12番地ごとのアドレスを与えストアする。以
下第25ラインから第2520ラインまで同様にストア
される。以上の様な画像のストアを行なうと、前
記した原稿の１mm×１mm単位の正方形を単位にし
て、連続した番地にA4全領域の画像情報がスト
アされる。
以上のようにA4サイズの１ページの原稿の画
像情報がイメージメモリ２に記憶された。次に原
稿の一部分のみを抜き出した複写物をプリンタ装
置３により得るという画像処理を例にして説明す
る。この場合、第１図に示した本実施例の画像処
理装置は、まず、原稿を読取り１ページ全てをイ
メージメモリ２に前述したアドレスマツプに従つ
て記憶する、そして原稿の所望抜き出し部分に対
応した画像情報をバツフアメモリ７にDMA転送
し記憶させる。その後、イメージメモリ２の内容
をクリアして、新たにバツフアメモリ７内の画像
情報を複写材上の画像所望出力位置に対応したイ
メージメモリ２内のアドレスを与えてDMA転送
する。そして、このイメージメモリ２内の画像情
報をシリアルにプリンタ装置３に出力し所望複写
物を得る。DMA転送を説明する。前述した如
く、イメージメモリ２とバツフアメモリ７との間
の画像情報の転送はDMA転送によつてなる。制
御部５はこのDMA転送の必要性が生じたときに
DMAコントローラ８にDMA要求信号を送る。
DMAコントローラ８はそれを受けて制御部５に
ホールド指令を出す。ホールド指令によつて、制
御部５は見かけ上マルチバス６から切りはなされ
たような状態になる。DMAコントローラ８は入
力部４の処理情報を基に前もつて制御部５によ
り、設定されているメモリ上の先頭番地と最終番
地に従つて、制御部５を使わずに画像情報の転送
を開始する。つまり、連続した番地をもつた画像
情報はDMA転送に先だつて制御部５が１度だけ
先頭番地と最終番地を指定することにより、その
番地間の情報は制御部５を介さずに高速に転送さ
れる。ここにおいて、イメージメモリ２から必要
な画像情報をバツフアメモリ７に転送する場合、
本発明による第２図の如くのメモリーマツプに従
つた記憶方法が用いられていると、DMA転送の
為に先頭番地と最終番地を制御部５が１度指示す
ることにより、ラインセンサの主走査方向12ライ
ン、つまり１mm幅の画像情報に対応する画像信号
がイメージメモリ２からバツフアメモリ７へ
DMA転送される。つまり、イメージメモリ２内
のアドレスマツプの構造が原稿の１mm×１mmの正
方形の単位ブロツクごとに連続した12番地で構成
され（例えば00000〜0000B）、主走査方向の隣り
のブロツクの最の番地が前のブロツクの最後の番
地（例えば0000B）の次の番地（例えば0000C）
となつていることにより、イメージメモリ２から
の読出しはブロツク単位で画素グループごとに行
なわれ、12ライン分の画像情報が先頭番地と最終
番地を１度指示することにより出力されることに
なる。
像情報がイメージメモリ２に記憶された。次に原
稿の一部分のみを抜き出した複写物をプリンタ装
置３により得るという画像処理を例にして説明す
る。この場合、第１図に示した本実施例の画像処
理装置は、まず、原稿を読取り１ページ全てをイ
メージメモリ２に前述したアドレスマツプに従つ
て記憶する、そして原稿の所望抜き出し部分に対
応した画像情報をバツフアメモリ７にDMA転送
し記憶させる。その後、イメージメモリ２の内容
をクリアして、新たにバツフアメモリ７内の画像
情報を複写材上の画像所望出力位置に対応したイ
メージメモリ２内のアドレスを与えてDMA転送
する。そして、このイメージメモリ２内の画像情
報をシリアルにプリンタ装置３に出力し所望複写
物を得る。DMA転送を説明する。前述した如
く、イメージメモリ２とバツフアメモリ７との間
の画像情報の転送はDMA転送によつてなる。制
御部５はこのDMA転送の必要性が生じたときに
DMAコントローラ８にDMA要求信号を送る。
DMAコントローラ８はそれを受けて制御部５に
ホールド指令を出す。ホールド指令によつて、制
御部５は見かけ上マルチバス６から切りはなされ
たような状態になる。DMAコントローラ８は入
力部４の処理情報を基に前もつて制御部５によ
り、設定されているメモリ上の先頭番地と最終番
地に従つて、制御部５を使わずに画像情報の転送
を開始する。つまり、連続した番地をもつた画像
情報はDMA転送に先だつて制御部５が１度だけ
先頭番地と最終番地を指定することにより、その
番地間の情報は制御部５を介さずに高速に転送さ
れる。ここにおいて、イメージメモリ２から必要
な画像情報をバツフアメモリ７に転送する場合、
本発明による第２図の如くのメモリーマツプに従
つた記憶方法が用いられていると、DMA転送の
為に先頭番地と最終番地を制御部５が１度指示す
ることにより、ラインセンサの主走査方向12ライ
ン、つまり１mm幅の画像情報に対応する画像信号
がイメージメモリ２からバツフアメモリ７へ
DMA転送される。つまり、イメージメモリ２内
のアドレスマツプの構造が原稿の１mm×１mmの正
方形の単位ブロツクごとに連続した12番地で構成
され（例えば00000〜0000B）、主走査方向の隣り
のブロツクの最の番地が前のブロツクの最後の番
地（例えば0000B）の次の番地（例えば0000C）
となつていることにより、イメージメモリ２から
の読出しはブロツク単位で画素グループごとに行
なわれ、12ライン分の画像情報が先頭番地と最終
番地を１度指示することにより出力されることに
なる。
第３図は、第２図のイメージメモリのアドレス
マツプの一部である。第３図の斜線の部分のアド
レスに記憶されている画像情報をDMA転送する
例を説明する。先頭番地をX1，X2，X3，X4，最
終番地をY1，Y2，Y3，Y4とすると、制御部５に
より１回目の番地設定でX1及びY1が設定される
と、X1番地から始まる単位ブロツクが読出され
続いて隣の単位ブロツクが読出されていきY1番
地で１回目のDMA転送が終了し、制御部５によ
り２回目の番地設定でX2及びY2が設定されると
X2番地から始まる単位ブロツクが読出され続い
て隣の単位ブロツクが読出されていきY2番地で
２回目のDMA転送が終了し、以下同様に３回目
のX3，Y3の設定、４回目のX4，Y4の設定で第３
図の斜線の部分のアドレスに記憶されている画像
情報がDMA転送される。このように１回の番地
設定で12ライン分の画像情報が読出される。
マツプの一部である。第３図の斜線の部分のアド
レスに記憶されている画像情報をDMA転送する
例を説明する。先頭番地をX1，X2，X3，X4，最
終番地をY1，Y2，Y3，Y4とすると、制御部５に
より１回目の番地設定でX1及びY1が設定される
と、X1番地から始まる単位ブロツクが読出され
続いて隣の単位ブロツクが読出されていきY1番
地で１回目のDMA転送が終了し、制御部５によ
り２回目の番地設定でX2及びY2が設定されると
X2番地から始まる単位ブロツクが読出され続い
て隣の単位ブロツクが読出されていきY2番地で
２回目のDMA転送が終了し、以下同様に３回目
のX3，Y3の設定、４回目のX4，Y4の設定で第３
図の斜線の部分のアドレスに記憶されている画像
情報がDMA転送される。このように１回の番地
設定で12ライン分の画像情報が読出される。
従つて、本発明のアドレスマツプによる記憶方
法によるとDMA転送が高速に行なえることにな
り、これにより画像処理時間の短縮も実現する。
法によるとDMA転送が高速に行なえることにな
り、これにより画像処理時間の短縮も実現する。
次にバツフアメモリ７からイメージメモリ２へ
のDMA転送について述べる、この場合も、前述
したDMA転送の場合と同様に12ライン分が１度
の番地指示によつて行なわれるが、抜き出した画
像情報を原稿と同じ位置に出力する場合はリーダ
部１からイメージメモリ２へ入力されたときに与
えられたアドレスを用いればよいが、抜き出した
画像情報を異なつた位置へ移動する場合はその移
動位置に対応したイメージメモリ２のアドレスマ
ツプ上のアドレスに変換しなければならない。こ
のアドレス変換のために、イメージメモリ２内に
アドレス変換器が設けてある。このアドレス変換
器によりバツフアメモリ７から出力される画像信
号はメモリマツプ上の必要なアドレスに変換され
前述した様に１mm×１mmの正方形のブロツクを単
位としてイメージメモリ２に記憶される。
のDMA転送について述べる、この場合も、前述
したDMA転送の場合と同様に12ライン分が１度
の番地指示によつて行なわれるが、抜き出した画
像情報を原稿と同じ位置に出力する場合はリーダ
部１からイメージメモリ２へ入力されたときに与
えられたアドレスを用いればよいが、抜き出した
画像情報を異なつた位置へ移動する場合はその移
動位置に対応したイメージメモリ２のアドレスマ
ツプ上のアドレスに変換しなければならない。こ
のアドレス変換のために、イメージメモリ２内に
アドレス変換器が設けてある。このアドレス変換
器によりバツフアメモリ７から出力される画像信
号はメモリマツプ上の必要なアドレスに変換され
前述した様に１mm×１mmの正方形のブロツクを単
位としてイメージメモリ２に記憶される。
この様に、原稿から抜き出された画像情報がイ
メージメモリ２に記憶され、次にプリント装置に
この画像情報が転送される。この場合はリーダ部
１からイメージメモリ２へ画像情報が送られると
きのアドレス付与と逆の動作が行なわれる。つま
り、イメージメモリ２からアドレスカウンタによ
つて12番地ごとの画像信号を読出し、12ビツトパ
ラレルインシリアルアウトのシフトレジスタを介
してシリアルに出力する、これによりプリンタ装
置へはシリアルな１ライン分の画像信号が入力さ
れ、この画像情報を基に複写物が得られる。
メージメモリ２に記憶され、次にプリント装置に
この画像情報が転送される。この場合はリーダ部
１からイメージメモリ２へ画像情報が送られると
きのアドレス付与と逆の動作が行なわれる。つま
り、イメージメモリ２からアドレスカウンタによ
つて12番地ごとの画像信号を読出し、12ビツトパ
ラレルインシリアルアウトのシフトレジスタを介
してシリアルに出力する、これによりプリンタ装
置へはシリアルな１ライン分の画像信号が入力さ
れ、この画像情報を基に複写物が得られる。
更に、原稿が１mm×１mmの正方形のブロツクで
イメージメモリ内に記憶されているので、上述し
た抜き出す部分の画像情報の指定が原稿上のmm単
位で行なうことができる。
イメージメモリ内に記憶されているので、上述し
た抜き出す部分の画像情報の指定が原稿上のmm単
位で行なうことができる。
尚、本実施例は、ラインセンサの読取り画素数
を１mm当り12ビツトとしたが、これはこの値には
限らないことは当然である。又、１mm当りの画素
数が増加しても、以上述べたことと同様に１mm×
１mm単位ごとに所定数のアドレスを与えることに
より、一回の番地設定で１mm巾の画像情報の
DMA転送を行なうことができる。また、本実施
例ではイメージメモリのアドレスマツプを１mm×
１mmの正方形ブロツクによつて構成したが、この
大きさ以外の単位ブロツクの構成を用いても同様
の効果を得ることができる。
を１mm当り12ビツトとしたが、これはこの値には
限らないことは当然である。又、１mm当りの画素
数が増加しても、以上述べたことと同様に１mm×
１mm単位ごとに所定数のアドレスを与えることに
より、一回の番地設定で１mm巾の画像情報の
DMA転送を行なうことができる。また、本実施
例ではイメージメモリのアドレスマツプを１mm×
１mmの正方形ブロツクによつて構成したが、この
大きさ以外の単位ブロツクの構成を用いても同様
の効果を得ることができる。
以上説明した様に、本発明によると、画像情報
をｎ画素毎に１ページ分記憶可能な記憶手段を具
備した画像処理装置において、ｎ画素×ｎ画素サ
イズの画像ブロツクに含まれるｎ個の画素群の番
地が連続し、且つ、各画像ブロツクの最終画素群
の番地が隣り合つた画像ブロツクの先頭の画素群
の番地に連続した状態で、１ページ分の画像情報
を記憶手段に記憶するので、記憶された画像情報
を効率良く、高速にアクセスすることができ、特
に、ブロツク単位の画像処理の効率を向上せしめ
ることが可能となる。
をｎ画素毎に１ページ分記憶可能な記憶手段を具
備した画像処理装置において、ｎ画素×ｎ画素サ
イズの画像ブロツクに含まれるｎ個の画素群の番
地が連続し、且つ、各画像ブロツクの最終画素群
の番地が隣り合つた画像ブロツクの先頭の画素群
の番地に連続した状態で、１ページ分の画像情報
を記憶手段に記憶するので、記憶された画像情報
を効率良く、高速にアクセスすることができ、特
に、ブロツク単位の画像処理の効率を向上せしめ
ることが可能となる。
第１図は本発明による画像処理装置の構成を示
すブロツク図、第２図は本発明によるイメージメ
モリ２のアドレスマツプ図、第３図は第２図にア
ドレスマツプ図、第３図は第２図のアドレスマツ
プの一部を示す図であり、１はリーダ部、２はイ
メージメモリ、３はプリンタ部、４は入力部、５
は制御部、６はマルチバス、７はバツフアメモ
リ、８はDMAコントローラである。
すブロツク図、第２図は本発明によるイメージメ
モリ２のアドレスマツプ図、第３図は第２図にア
ドレスマツプ図、第３図は第２図のアドレスマツ
プの一部を示す図であり、１はリーダ部、２はイ
メージメモリ、３はプリンタ部、４は入力部、５
は制御部、６はマルチバス、７はバツフアメモ
リ、８はDMAコントローラである。
Claims (1)
- 【特許請求の範囲】 １ 画像情報をｎ画素毎に１ページ分記憶可能な
記憶手段を具備した画像処理装置において、 ライン毎にシリアルに入力する画像情報をｎ画
素毎の画素群に順次分割し、 連続したｎラインの各ラインの先頭画素群を連
続した番地に記憶するともに、 各ラインの順次分割される画素群をｎ個おきの
飛び越し番地に記憶し、且つ、 ｎライン目の最終画素群の番地に連続する番地
にｎ＋１ライン目の先頭画素群を記憶することに
より、 ｎ画素×ｎ画素サイズの画像ブロツクに含まれ
るｎ個の画素群の番地が連続し、且つ、各画像ブ
ロツクの最終画素群の番地が隣り合つた画像ブロ
ツクの先頭画素群の番地に連続した状態で、１ペ
ージ分の画像情報を上記記憶手段に記憶すること
を特徴とする画像処理装置。
Priority Applications (8)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15446480A JPS5778253A (en) | 1980-10-31 | 1980-10-31 | Picture processing device |
| GB8131404A GB2088671B (en) | 1980-10-17 | 1981-10-19 | Facsimile image processing system |
| DE3153373A DE3153373C2 (de) | 1980-10-17 | 1981-10-19 | Bildverarbeitungssystem |
| DE19813141450 DE3141450A1 (de) | 1980-10-17 | 1981-10-19 | "bildverarbeitungssystem" |
| GB08412938A GB2141899B (en) | 1980-10-17 | 1984-05-21 | Facsimile image processing system |
| US06/875,675 US4811109A (en) | 1980-10-17 | 1986-06-18 | Image processing system |
| US07/401,482 US5008760A (en) | 1980-10-17 | 1989-08-30 | Image processing system |
| US08/326,342 US5864407A (en) | 1980-10-17 | 1994-10-20 | Image processing system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15446480A JPS5778253A (en) | 1980-10-31 | 1980-10-31 | Picture processing device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5778253A JPS5778253A (en) | 1982-05-15 |
| JPH021421B2 true JPH021421B2 (ja) | 1990-01-11 |
Family
ID=15584808
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15446480A Granted JPS5778253A (en) | 1980-10-17 | 1980-10-31 | Picture processing device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5778253A (ja) |
Families Citing this family (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS59127463A (ja) * | 1983-01-10 | 1984-07-23 | Fuji Xerox Co Ltd | 画像信号処理装置 |
| JPH0630909B2 (ja) * | 1984-02-24 | 1994-04-27 | キヤノン株式会社 | プリンタ制御装置 |
| JP2771534B2 (ja) * | 1986-03-19 | 1998-07-02 | キヤノン株式会社 | メモリ制御回路 |
| JPS6362079A (ja) * | 1986-09-03 | 1988-03-18 | Agency Of Ind Science & Technol | グラフイツクデイスプレイ |
| JPH07118006B2 (ja) * | 1987-04-14 | 1995-12-18 | 松下電器産業株式会社 | 画像処理装置 |
| JPH02108122A (ja) * | 1988-10-17 | 1990-04-20 | Fujitsu Ltd | 自然画表示メモリのアドレス方式 |
-
1980
- 1980-10-31 JP JP15446480A patent/JPS5778253A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5778253A (en) | 1982-05-15 |
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