JPH02143738A - データ品質監視方式 - Google Patents
データ品質監視方式Info
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- JPH02143738A JPH02143738A JP29915588A JP29915588A JPH02143738A JP H02143738 A JPH02143738 A JP H02143738A JP 29915588 A JP29915588 A JP 29915588A JP 29915588 A JP29915588 A JP 29915588A JP H02143738 A JPH02143738 A JP H02143738A
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- 238000012544 monitoring process Methods 0.000 title claims description 14
- 238000004364 calculation method Methods 0.000 claims abstract description 26
- 125000004122 cyclic group Chemical group 0.000 claims abstract description 7
- 238000001514 detection method Methods 0.000 claims description 5
- 230000005540 biological transmission Effects 0.000 abstract description 12
- 238000006243 chemical reaction Methods 0.000 description 6
- 238000000926 separation method Methods 0.000 description 5
- 238000010586 diagram Methods 0.000 description 3
- 238000000034 method Methods 0.000 description 3
- 238000004458 analytical method Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
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- Detection And Prevention Of Errors In Transmission (AREA)
- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ＣＥ Ｐ Ｔ （Ｅｕｒｏｐｅａｎ Ｐｏ５
ｔ ａｎｄ Ｔｅｌｅｃｏｍｍｕｎｉｃａｔｉｏｎ Ｃ
ｏｎｆｅｒｅｎｃｅ）系の２Ｍ ＰＣＭ系における３８
４ｋｐｂｓデータ伝送の際のデータ品質の監視方式に関
する。
ｔ ａｎｄ Ｔｅｌｅｃｏｍｍｕｎｉｃａｔｉｏｎ Ｃ
ｏｎｆｅｒｅｎｃｅ）系の２Ｍ ＰＣＭ系における３８
４ｋｐｂｓデータ伝送の際のデータ品質の監視方式に関
する。
ＣＥＰＴ系の２Ｍ ＰＣＭ系において、３８４ｋｂｐｓ
のデータの伝送を行う場合、３８４ｋｂｐｓデータの誤
り監視は、特に実施されていない。また、実施されたと
しても、せいぜいＣＣＩＴＴ Ｒｅｄ Ｂｏｏｋの勧告
Ｇ。
のデータの伝送を行う場合、３８４ｋｂｐｓデータの誤
り監視は、特に実施されていない。また、実施されたと
しても、せいぜいＣＣＩＴＴ Ｒｅｄ Ｂｏｏｋの勧告
Ｇ。
７０４にあるように、２Ｍ ＰＣＭ信号全体の誤り監視
がＣｙｃｌｉｃ Ｒｅｄｕｎｄａｎｃｙ Ｃｈｅｃｋ
（巡回符号検査、以下ＣＲＣと記す）によって行われ
ているにとどまっている。
がＣｙｃｌｉｃ Ｒｅｄｕｎｄａｎｃｙ Ｃｈｅｃｋ
（巡回符号検査、以下ＣＲＣと記す）によって行われ
ているにとどまっている。
上述したＺＭ ＰＣＭ系の３８４ｋｂｐｓのデータ伝送
において実施されている２Ｍ ＰＣＭ信号全体の誤り
監視では、２Ｍ ＰＣＭ系の途中で分析。
において実施されている２Ｍ ＰＣＭ信号全体の誤り
監視では、２Ｍ ＰＣＭ系の途中で分析。
挿入される３８４ｋｂｐｓのデータの伝送で機能を果た
さない。また、３８４ｋｂｐｓのデータ伝送の場合、映
像、放送等の高品質の伝送が要求されるため、２ＭＰＣ
Ｍ信号系よりもよりきびしい誤り監視が必要となり、従
来の誤り監視ではそれらに対応することはできない。
さない。また、３８４ｋｂｐｓのデータ伝送の場合、映
像、放送等の高品質の伝送が要求されるため、２ＭＰＣ
Ｍ信号系よりもよりきびしい誤り監視が必要となり、従
来の誤り監視ではそれらに対応することはできない。
本発明の目的は、このような欠点を除去し、２ＭＰＣＭ
系の３８４ｋｂｐｓのデータ伝送に際して、データの誤
りを検出してデータの品質を監視するデータ品質監視方
式を提供することにある。
系の３８４ｋｂｐｓのデータ伝送に際して、データの誤
りを検出してデータの品質を監視するデータ品質監視方
式を提供することにある。
本発明は、複数チャネルのデータをマルチフレーム構成
で送信する送信側と、前記送信側からのデータを受信し
て前記複数チャネルのデータを出力する受信側とを備え
、送受信されるデータの品質を監視するデータ品質監視
方式において、前記送信側は、 前記複数チャネルのデータの巡回符号検査の演算をして
、各チャネルのデータの演算結果をそれぞれ出力する符
号手段と、 前記符号手段からの各チャネルの演算結果を、前記マル
チフレーム構成のそれぞれの所定ビットに多重化して、
多重化信号を前記受信側に送信する多重手段とを備え、 前記受信側は、 受信した前記多重化信号のマルチフレーム構成から、前
記複数チャネルのデータと、前記各チャネルの演算結果
とを分離する分離手段と、前記分離手段からの各チャネ
ルの演算結果から、受信した各チャネルのデータの誤り
を検出して、検出結果をそれぞれ出力する復号手段とを
備えることを特徴としている。
で送信する送信側と、前記送信側からのデータを受信し
て前記複数チャネルのデータを出力する受信側とを備え
、送受信されるデータの品質を監視するデータ品質監視
方式において、前記送信側は、 前記複数チャネルのデータの巡回符号検査の演算をして
、各チャネルのデータの演算結果をそれぞれ出力する符
号手段と、 前記符号手段からの各チャネルの演算結果を、前記マル
チフレーム構成のそれぞれの所定ビットに多重化して、
多重化信号を前記受信側に送信する多重手段とを備え、 前記受信側は、 受信した前記多重化信号のマルチフレーム構成から、前
記複数チャネルのデータと、前記各チャネルの演算結果
とを分離する分離手段と、前記分離手段からの各チャネ
ルの演算結果から、受信した各チャネルのデータの誤り
を検出して、検出結果をそれぞれ出力する復号手段とを
備えることを特徴としている。
次に、本発明の実施例について図面を参照して説明する
。
。
第１図は、本発明の一実施例を示すブロック図である。
このデータ品質監視方式は、伝送路１０１を介して接続
されている２つのＰＣＭ端局装置１０と２０とで構成さ
れている。
されている２つのＰＣＭ端局装置１０と２０とで構成さ
れている。
さらに、ＰＣＭ端局装置１０は、符号部１１．〜１１５
と、マルチフレームジェネレータ１２と、多重部１３゜
１５と、符号部１４と、変換部１６とを備えている。
と、マルチフレームジェネレータ１２と、多重部１３゜
１５と、符号部１４と、変換部１６とを備えている。
ＰＣＭ端局装置２０は、変換部２１と、同期部２２と、
復号・比較部２３と、マルチフレーム同期部２４と、分
離部２５と、復号・比較部２６．〜２６．とを備えてい
る。
復号・比較部２３と、マルチフレーム同期部２４と、分
離部２５と、復号・比較部２６．〜２６．とを備えてい
る。
なお、本実施例では、データ送信側がＰＣＭ端局装置１
０であり、データ受信側がＰＣＭ端局装置２０である場
合について説明している。
０であり、データ受信側がＰＣＭ端局装置２０である場
合について説明している。
このようなデータ品質監視方式において、ＰＣＭ端局装
置ＩＯの符号部１１１〜１１．は、それぞれチャネルＣ
Ｈ１〜ＣＨ５の３８４ｋｂｐｓのデータを入力としてい
る。そして、符号部１１１〜１１．が、ＣＲＣ−４のマ
ルチフレームジェネレータ１２から出力される制御信号
により、それぞれチャネルＣＨＩ〜ＣＨ５のデータのＣ
ＲＣ−４の演算をして、演算結果を多重部１３に出力す
る。
置ＩＯの符号部１１１〜１１．は、それぞれチャネルＣ
Ｈ１〜ＣＨ５の３８４ｋｂｐｓのデータを入力としてい
る。そして、符号部１１１〜１１．が、ＣＲＣ−４のマ
ルチフレームジェネレータ１２から出力される制御信号
により、それぞれチャネルＣＨＩ〜ＣＨ５のデータのＣ
ＲＣ−４の演算をして、演算結果を多重部１３に出力す
る。
多重部１３は、符号部ＩＬ〜１１．からの演算結果と、
チャネルＣＨＩ−ＣＨ５の３８４ｋｂｐｓのデータとを
多重化して、２Ｍ ＰＣＭ信号を符号部１４と多重部１
５とに出力する。
チャネルＣＨＩ−ＣＨ５の３８４ｋｂｐｓのデータとを
多重化して、２Ｍ ＰＣＭ信号を符号部１４と多重部１
５とに出力する。
符号部１４は、マルチフレームジェネレータ１２から出
力される制御信号により、多重部１３からの２ＭＰＣＭ
信号のＣＲＣ−４の演算をして、演算結果を多重部１５
に出力する。
力される制御信号により、多重部１３からの２ＭＰＣＭ
信号のＣＲＣ−４の演算をして、演算結果を多重部１５
に出力する。
多重部１５は、マルチフレームジェネレータ１２から出
力される制御信号により、符号部１４からの演算結果と
多重部１３からの２Ｍ ＰＣＭ信号とを多重化して、ユ
ニポーラの２Ｍ ＰＣＭ信号を変換部１６に出力する。
力される制御信号により、符号部１４からの演算結果と
多重部１３からの２Ｍ ＰＣＭ信号とを多重化して、ユ
ニポーラの２Ｍ ＰＣＭ信号を変換部１６に出力する。
変換部１６は、多重部１５からのユニポーラの２ＭＰＣ
Ｍ信号をバイポーラの２Ｍ ＰＣＭ信号に変換して、
伝送路１０１に送信する。
Ｍ信号をバイポーラの２Ｍ ＰＣＭ信号に変換して、
伝送路１０１に送信する。
ＰＣＭ端局装置２０の変換部２１は、伝送路１０１から
バイポーラの２Ｍ ＰＣＭ信号を受信すると、この信
号をユニポーラの２Ｍ ＰＣＭ信号に変換し、同期部２
２に出力する。
バイポーラの２Ｍ ＰＣＭ信号を受信すると、この信
号をユニポーラの２Ｍ ＰＣＭ信号に変換し、同期部２
２に出力する。
同期部２２は、２Ｍ ＰＣＭ信号の同期回路であり、
変換部２１からユニポーラの２Ｍ ＰＣＭ信号が入力さ
れると、フレーム１マルチフレーム同期をとった後、２
Ｍ ＰＣＭ信号のＣＲＣ−４の同期制御信号を、マルチ
フレーム同期部２４に送る。
変換部２１からユニポーラの２Ｍ ＰＣＭ信号が入力さ
れると、フレーム１マルチフレーム同期をとった後、２
Ｍ ＰＣＭ信号のＣＲＣ−４の同期制御信号を、マルチ
フレーム同期部２４に送る。
マルチフレーム同期部２４は、同期部２２からの同期制
御信号が入力されると同期をとって、復号・比較部２３
に２Ｍ ＰＣＭ信号のＣＲＣ−４の復号制御信号を送り
、分離部２５に３８４ｋｂｐｓのＣＲＣ−４の復号制御
信号を送る。
御信号が入力されると同期をとって、復号・比較部２３
に２Ｍ ＰＣＭ信号のＣＲＣ−４の復号制御信号を送り
、分離部２５に３８４ｋｂｐｓのＣＲＣ−４の復号制御
信号を送る。
復号・比較部２３は、マルチフレーム同期部２４からの
２Ｍ ＰＣＭ信号のＣＲＣ−４の復号制御信号により、
ユニポーラの２Ｍ ＰＣＭ信号のＣＲＣ−４のチエツク
を行う。
２Ｍ ＰＣＭ信号のＣＲＣ−４の復号制御信号により、
ユニポーラの２Ｍ ＰＣＭ信号のＣＲＣ−４のチエツク
を行う。
分離部２５は、マルチフレーム同期部２４からの３８４
ｋｂｐｓのＣＲＣ−４の復号制御信号により、同期部２
２から出力される２Ｍ ＰＣＭ信号から、チャネルＣ
ＨＩ〜ＣＨ５の３８４ｋｂρＳのデータと、それぞれの
データのＣＲＣ−４の比較結果であるＣＲ（、−４信号
とを分離して出力する。
ｋｂｐｓのＣＲＣ−４の復号制御信号により、同期部２
２から出力される２Ｍ ＰＣＭ信号から、チャネルＣ
ＨＩ〜ＣＨ５の３８４ｋｂρＳのデータと、それぞれの
データのＣＲＣ−４の比較結果であるＣＲ（、−４信号
とを分離して出力する。
復号・比較部２６１〜２６．は、分離部２５から出力さ
れるチャネルＣＨＩ −ＣＨ５のＣＲＣ−４信号のエラ
ーチエツクをして、検出結果をそれぞれ出力する。
れるチャネルＣＨＩ −ＣＨ５のＣＲＣ−４信号のエラ
ーチエツクをして、検出結果をそれぞれ出力する。
次に、本実施例の動作について説明する。
チャネルＣＨ１〜ＣＨ５の３８４ｋｂｐｓのデータが、
ＰＣＭ端局装置１０の符号部１１．〜１１．と、多重部
１３とに人力される。一方、ＣＲＣ−４のマルチフレー
ムジェネレータ１２から出力される制御信号が、符号部
１１１〜ｌｌｓ、 １４と多重部１５とに入力される。
ＰＣＭ端局装置１０の符号部１１．〜１１．と、多重部
１３とに人力される。一方、ＣＲＣ−４のマルチフレー
ムジェネレータ１２から出力される制御信号が、符号部
１１１〜ｌｌｓ、 １４と多重部１５とに入力される。
符号部１１ ＋〜ｌｌｓが、マルチフレームジェネレー
タ１２からの制御信号により、チャネルＣＨＩ〜ＣＨ５
のデータのＣＲＣ−４の演算をして、演算結果を多重部
１３に出力する。多重部１３が、符号部１１、〜１１．
からの演算結果とチャネルＣＨＩ〜ＣＨ５のデータとを
多重化して、２Ｍ ＰＣＭ信号を符号部１４と多重部１
５とに出力する。符号部１４は、多重部１３から２Ｍ
ＰＣＭ信号が入力されると、マルチフレームジェネレ
ータ１２からの制御（Ｋ 号により、この２Ｍ ＰＣＭ
信号のＣＲＣ−４の演算をして、演算結果を多重部１５
に出力する。多重部１５は、マルチフレームジェネレー
タ１２からの制御コ■信号により、多重部１３からの２
Ｍ ＰＣＭ信号と符号部１４からの演算結果とを多重
化して、ユニポーラの２Ｍ ＰＣＭ信号を出力する。
タ１２からの制御信号により、チャネルＣＨＩ〜ＣＨ５
のデータのＣＲＣ−４の演算をして、演算結果を多重部
１３に出力する。多重部１３が、符号部１１、〜１１．
からの演算結果とチャネルＣＨＩ〜ＣＨ５のデータとを
多重化して、２Ｍ ＰＣＭ信号を符号部１４と多重部１
５とに出力する。符号部１４は、多重部１３から２Ｍ
ＰＣＭ信号が入力されると、マルチフレームジェネレ
ータ１２からの制御（Ｋ 号により、この２Ｍ ＰＣＭ
信号のＣＲＣ−４の演算をして、演算結果を多重部１５
に出力する。多重部１５は、マルチフレームジェネレー
タ１２からの制御コ■信号により、多重部１３からの２
Ｍ ＰＣＭ信号と符号部１４からの演算結果とを多重
化して、ユニポーラの２Ｍ ＰＣＭ信号を出力する。
このような２Ｍ ＰＣＭ信号のマルチフレーム構成が、
第２図に示されている。
第２図に示されている。
第２図に示されるように、この２Ｍ ＰＣＭ信号のマル
チフレームが、２つのサブマルチフレームＩ、■とで構
成されている。サブマルチフレームＩがフレームＮｏ、
Ｏ〜７のフレームで構成されており、サブマルチフレ
ーム■がフレームＮｏ、 ８〜１５のフレームで構成さ
れている。そして、フレームＮｏ、 Ｏ〜１５のフレー
ムがそれぞれビットＮｏ。
チフレームが、２つのサブマルチフレームＩ、■とで構
成されている。サブマルチフレームＩがフレームＮｏ、
Ｏ〜７のフレームで構成されており、サブマルチフレ
ーム■がフレームＮｏ、 ８〜１５のフレームで構成さ
れている。そして、フレームＮｏ、 Ｏ〜１５のフレー
ムがそれぞれビットＮｏ。
１〜８のビットで構成されている。このようなマルチフ
レームにおいて、本実施例は、サブマルチフレーム■の
、フレームＮｏ、１． ３． ５． ７のビットＮｏ、
４〜８のビット及びサブマルチフレームＨの、フレー
ムＮｏ、 ９ 、１１．１３．１５のビットＮｏ。
レームにおいて、本実施例は、サブマルチフレーム■の
、フレームＮｏ、１． ３． ５． ７のビットＮｏ、
４〜８のビット及びサブマルチフレームＨの、フレー
ムＮｏ、 ９ 、１１．１３．１５のビットＮｏ。
４〜８のビットを用いて、チャネルＣＨＩ〜ＣＨ５の３
８４ ｋｂｐｓのデータのＣＲＣ−４演算結果を伝送す
る。フレーム１，３，５，７，９，１１，１３゜１５の
ビア１−Ｎｏ、４〜８のビットは、本来ＺＭ ＰＣＭフ
レーム構成中のタイムスロットＯの国内使用のＦｒｅｅ
ｂｉｔ （以下、スペア−ビットと記す）５ｂｉｔで
ある。このスペア−ビットを用いて、次のようにしてＣ
ＲＣ−４の演算結果が伝送される。
８４ ｋｂｐｓのデータのＣＲＣ−４演算結果を伝送す
る。フレーム１，３，５，７，９，１１，１３゜１５の
ビア１−Ｎｏ、４〜８のビットは、本来ＺＭ ＰＣＭフ
レーム構成中のタイムスロットＯの国内使用のＦｒｅｅ
ｂｉｔ （以下、スペア−ビットと記す）５ｂｉｔで
ある。このスペア−ビットを用いて、次のようにしてＣ
ＲＣ−４の演算結果が伝送される。
符号部１１．で演算された、チャネルＣＨＩのデータの
ＣＲＣ−４の演算結果は、フレームＮｏ、 ｌ 。
ＣＲＣ−４の演算結果は、フレームＮｏ、 ｌ 。
３．５．７及びフレームＮｏ、 ９ 、１１．１３．１
５のビットＮ００４のビットに多重化されて伝送される
。
５のビットＮ００４のビットに多重化されて伝送される
。
すなわち、ビットＣ１〜ＣＩ４に演算結果が多重化され
て伝送される。同様にして、チャネルＣＨ２゜ＣＨ３，
ＣＨ４，ＣＨ５のデータのＣＲＣ−４演算結果が、それ
ぞれビットＣ２１〜Ｃ２４１Ｃ：ｌｌ−Ｃ３４゜Ｃ４１
〜Ｃ，４，Ｃ５，〜ＣＳａを用いて伝送される。なお、
第２図において、ビットＳｉは国際使用のためのスペア
−ビットであり、ビットＡは警報ビットである。
て伝送される。同様にして、チャネルＣＨ２゜ＣＨ３，
ＣＨ４，ＣＨ５のデータのＣＲＣ−４演算結果が、それ
ぞれビットＣ２１〜Ｃ２４１Ｃ：ｌｌ−Ｃ３４゜Ｃ４１
〜Ｃ，４，Ｃ５，〜ＣＳａを用いて伝送される。なお、
第２図において、ビットＳｉは国際使用のためのスペア
−ビットであり、ビットＡは警報ビットである。
多重部１５から出力されるこのようなユニポーラの２Ｍ
ＰＣＭ信号が変換部１６に入力される。変換部１６が
、ユニポーラの２Ｍ ＰＣＭ信号をバイポーラの２Ｍ
ＰＣＭ信号に変換して、伝送路１０１に送信する。
ＰＣＭ信号が変換部１６に入力される。変換部１６が
、ユニポーラの２Ｍ ＰＣＭ信号をバイポーラの２Ｍ
ＰＣＭ信号に変換して、伝送路１０１に送信する。
ＰＣＭ端局装置１０と対向するＰＣＭ端局装置２０の変
換部２１が、伝送路１０１からバイポーラの２ＭＰＣＭ
信号を受信すると、この信号をユニポーラの２Ｍ ＰＣ
Ｍ信号に変換して、同期部２２に出力する。同期部２２
は、変換部２１からユニポーラの２Ｍ ＰＣＭ信号が入
力されると、フレーム、マルチフレーム同期をとった後
、２Ｍ ＰＣＭ信号のＣＲＣ−４の同期制御信号をマル
チフレーム同期部２４へ出力する。マルチフレーム同期
部２４は、２Ｍ ＰＣＭ信号のＣＲＣ−４の同期制御
信号が入力されると同期をとって、復号・比較部２３に
２ＭＰＣＭ信号のＣＲＣ−４の復号制御信号を出力し、
分離部２５に３８４ｋｂｐｓのＣＲＣ−４の復号制御信
号を出力する。復号・比較部２３が、２Ｍ ＰＣＭ信号
のＣＲＣ−４の復号制御信号により、ユニポーラの２Ｍ
ＰＣＭ信号のＣＲＣ−４ビツトのチエツクを行う。そ
して、擬似同期等によりエラーレイトが多すぎるなどの
場合には、制御信号を分離部２５に出力して、次段以降
の回路に対し制御を行う。一方、２Ｍ ＰＣＭ信号中の
ＣＲＣ−４にエラーレイトの多すぎるなどの問題がなけ
れば、分離部２５が、マルチフレーム同期回路２４から
の３８４ｋｂｐｓのＣＲＣ−４の復号制御信号により、
同期部２２から出力される、第２図に示されるフレーム
構造の２Ｍ ＰＣＭ信号から、チャネルＣＨＩ〜ＣＨ
５の３８４ｋｂｐｓのデータと、それぞれのデータのＣ
ＲＣ−４の比較結果であるＣＲＣ−４信号とを分離して
出力する。復号・比較部２６１ は、チャネルＣＨＩの
ＣＲＣ−４信号が入力されると、このＣＲＣ−４信号に
基づいて、エラーチエツクしその結果を、チャネルＣＨ
Ｉの３８４ｋｂｐｓデータのエラーレイト検出結果とし
て出力端子２０１がら出力する。同様にして、復号・比
較部２６□〜２６．もチャネルＣＨ２〜ＣＨ５のデータ
のエラーレイト検出結果を、それぞれ出力端子２０２〜
２０５から出力する。
換部２１が、伝送路１０１からバイポーラの２ＭＰＣＭ
信号を受信すると、この信号をユニポーラの２Ｍ ＰＣ
Ｍ信号に変換して、同期部２２に出力する。同期部２２
は、変換部２１からユニポーラの２Ｍ ＰＣＭ信号が入
力されると、フレーム、マルチフレーム同期をとった後
、２Ｍ ＰＣＭ信号のＣＲＣ−４の同期制御信号をマル
チフレーム同期部２４へ出力する。マルチフレーム同期
部２４は、２Ｍ ＰＣＭ信号のＣＲＣ−４の同期制御
信号が入力されると同期をとって、復号・比較部２３に
２ＭＰＣＭ信号のＣＲＣ−４の復号制御信号を出力し、
分離部２５に３８４ｋｂｐｓのＣＲＣ−４の復号制御信
号を出力する。復号・比較部２３が、２Ｍ ＰＣＭ信号
のＣＲＣ−４の復号制御信号により、ユニポーラの２Ｍ
ＰＣＭ信号のＣＲＣ−４ビツトのチエツクを行う。そ
して、擬似同期等によりエラーレイトが多すぎるなどの
場合には、制御信号を分離部２５に出力して、次段以降
の回路に対し制御を行う。一方、２Ｍ ＰＣＭ信号中の
ＣＲＣ−４にエラーレイトの多すぎるなどの問題がなけ
れば、分離部２５が、マルチフレーム同期回路２４から
の３８４ｋｂｐｓのＣＲＣ−４の復号制御信号により、
同期部２２から出力される、第２図に示されるフレーム
構造の２Ｍ ＰＣＭ信号から、チャネルＣＨＩ〜ＣＨ
５の３８４ｋｂｐｓのデータと、それぞれのデータのＣ
ＲＣ−４の比較結果であるＣＲＣ−４信号とを分離して
出力する。復号・比較部２６１ は、チャネルＣＨＩの
ＣＲＣ−４信号が入力されると、このＣＲＣ−４信号に
基づいて、エラーチエツクしその結果を、チャネルＣＨ
Ｉの３８４ｋｂｐｓデータのエラーレイト検出結果とし
て出力端子２０１がら出力する。同様にして、復号・比
較部２６□〜２６．もチャネルＣＨ２〜ＣＨ５のデータ
のエラーレイト検出結果を、それぞれ出力端子２０２〜
２０５から出力する。
このようにして本実施例は、ＺＭ ＰＣＭフレーム構
成中のタイムスロットＯの国内使用のスペア−ビット５
ビツト （ｎｏｎ ５ｙｎｃ ｗｏｒｄ）を３８４ｋｂ
ｐｓの５チヤネルのそれぞれに対応させ、２Ｍ ＰＣＭ
信号用ＣＲＣ−４マルチフレームの構成にあわせ、３８
４ｋｂｐｓデータのチャネルのＣＲＣ−４の演算結果を
伝送することにより、２Ｍ ＰＣＭ信号レベルのエラ
ーレイトのチエツクのみならず、３８４ｋｂｐｓデータ
のチャネルごとのエラーチエツクが可能となる。
成中のタイムスロットＯの国内使用のスペア−ビット５
ビツト （ｎｏｎ ５ｙｎｃ ｗｏｒｄ）を３８４ｋｂ
ｐｓの５チヤネルのそれぞれに対応させ、２Ｍ ＰＣＭ
信号用ＣＲＣ−４マルチフレームの構成にあわせ、３８
４ｋｂｐｓデータのチャネルのＣＲＣ−４の演算結果を
伝送することにより、２Ｍ ＰＣＭ信号レベルのエラ
ーレイトのチエツクのみならず、３８４ｋｂｐｓデータ
のチャネルごとのエラーチエツクが可能となる。
以上説明したように本発明は、送信側で各チャネルの巡
回符号検査の演算をして、この演算結果を受信側に送り
、受信側でこの演算結果に基づいて各チャネルのデータ
の誤りを検出するので、送受信するデータの品質をチャ
ネル単位で監視することが可能となる効果がある。
回符号検査の演算をして、この演算結果を受信側に送り
、受信側でこの演算結果に基づいて各チャネルのデータ
の誤りを検出するので、送受信するデータの品質をチャ
ネル単位で監視することが可能となる効果がある。
第１図は、本発明の一実施例を示すブロック図、第２図
は、第１図の実施例に使用されるマルチフレーム構成の
一例を示す図である。 １０、２０・・・ＰＣＭ端局装置 １１、１４・・・符号部 １２・・・・・マルチフレームジェネレータ１３、１５
・・・多重部 １６、２１・・・変換部 ２２・・・・・同期部 ２３、２６・・・復号・比較部 ２４・・・・・マルチフレーム同期部 ２５・・・・・分離部
は、第１図の実施例に使用されるマルチフレーム構成の
一例を示す図である。 １０、２０・・・ＰＣＭ端局装置 １１、１４・・・符号部 １２・・・・・マルチフレームジェネレータ１３、１５
・・・多重部 １６、２１・・・変換部 ２２・・・・・同期部 ２３、２６・・・復号・比較部 ２４・・・・・マルチフレーム同期部 ２５・・・・・分離部
Claims (1)
- （１）複数チャネルのデータをマルチフレーム構成で送
信する送信側と、前記送信側からのデータを受信して前
記複数チャネルのデータを出力する受信側とを備え、送
受信されるデータの品質を監視するデータ品質監視方式
において、 前記送信側は、 前記複数チャネルのデータの巡回符号検査の演算をして
、各チャネルのデータの演算結果をそれぞれ出力する符
号手段と、 前記符号手段からの各チャネルの演算結果を、前記マル
チフレーム構成のそれぞれの所定ビットに多重化して、
多重化信号を前記受信側に送信する多重手段とを備え、 前記受信側は、 受信した前記多重化信号のマルチフレーム構成から、前
記複数チャネルのデータと、前記各チャネルの演算結果
とを分離する分離手段と、 前記分離手段からの各チャネルの演算結果から、受信し
た各チャネルのデータの誤りを検出して、検出結果をそ
れぞれ出力する復号手段とを備えることを特徴とするデ
ータ品質監視方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29915588A JPH02143738A (ja) | 1988-11-25 | 1988-11-25 | データ品質監視方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29915588A JPH02143738A (ja) | 1988-11-25 | 1988-11-25 | データ品質監視方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02143738A true JPH02143738A (ja) | 1990-06-01 |
Family
ID=17868839
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29915588A Pending JPH02143738A (ja) | 1988-11-25 | 1988-11-25 | データ品質監視方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02143738A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006014232A (ja) * | 2004-06-29 | 2006-01-12 | Chugoku Electric Power Co Inc:The | 通信システム |
| US7324913B2 (en) * | 2006-02-01 | 2008-01-29 | International Business Machines Corporation | Methods and apparatus for testing a link between chips |
-
1988
- 1988-11-25 JP JP29915588A patent/JPH02143738A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006014232A (ja) * | 2004-06-29 | 2006-01-12 | Chugoku Electric Power Co Inc:The | 通信システム |
| US7324913B2 (en) * | 2006-02-01 | 2008-01-29 | International Business Machines Corporation | Methods and apparatus for testing a link between chips |
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