JPH02165084A - タイム・ディレイ測定方法及びその装置 - Google Patents
タイム・ディレイ測定方法及びその装置Info
- Publication number
- JPH02165084A JPH02165084A JP63321373A JP32137388A JPH02165084A JP H02165084 A JPH02165084 A JP H02165084A JP 63321373 A JP63321373 A JP 63321373A JP 32137388 A JP32137388 A JP 32137388A JP H02165084 A JPH02165084 A JP H02165084A
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- Japan
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- signal
- transmission
- time
- time delay
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
この発明は、アクティブ・フェーズド、アレイアンテナ
の各素子は送信・受信の制御が可能という特徴を利用し
て、ハード・ウェアの構成によって生じる送信・受信間
のタイム・ディレィを測定する方法及びその装置に関す
るものである。
の各素子は送信・受信の制御が可能という特徴を利用し
て、ハード・ウェアの構成によって生じる送信・受信間
のタイム・ディレィを測定する方法及びその装置に関す
るものである。
第３図は、従来の送信・受信間のハード・ウェテの構成
によって生じるタイム・ディレィの測定を行うための構
成図であり、図において、（１）は基準信号を発生する
送信機、（２）は上記送信機（１］からの基準信号が直
接、入力されて、受信系で出力されるアクティブ・フェ
ーズド・アレイ・アンテナ、（３）は上記アンテナ（２
）からの受信信号を増幅後、振幅検波を行いディジタル
受信信号に変換する受信機、（４）は上記送信ａ（１）
への送信トリガを発生する送信トリガ発生器、（５）は
上記受信機（３）からのディジタル受信信号のレンジ・
ビン数を算出するレンジ・ビン数算出器、（６）は上記
レンジ・ビン数算出器（５）からの出力であるレンジ・
ビン数を時間に変換する時間変換器、（７）は上記時間
変換器（６）からの出力を保持しておくためのメモリ、
（８）は上記送信トリガ発生！ （４１、レンジ・ビン
数算出器（５）、時間変換器（６）およびメモリ（７）
から構成される信号処理器、（９）は上記送信トリガ発
生器（４）からの１−リガ信号によって、上記アクティ
ブ・フェーズド・アレイ・アンテナ（２）の各素子の送
信・受信の制御ならびに位相量の設定を行うビーム制御
器である。
によって生じるタイム・ディレィの測定を行うための構
成図であり、図において、（１）は基準信号を発生する
送信機、（２）は上記送信機（１］からの基準信号が直
接、入力されて、受信系で出力されるアクティブ・フェ
ーズド・アレイ・アンテナ、（３）は上記アンテナ（２
）からの受信信号を増幅後、振幅検波を行いディジタル
受信信号に変換する受信機、（４）は上記送信ａ（１）
への送信トリガを発生する送信トリガ発生器、（５）は
上記受信機（３）からのディジタル受信信号のレンジ・
ビン数を算出するレンジ・ビン数算出器、（６）は上記
レンジ・ビン数算出器（５）からの出力であるレンジ・
ビン数を時間に変換する時間変換器、（７）は上記時間
変換器（６）からの出力を保持しておくためのメモリ、
（８）は上記送信トリガ発生！ （４１、レンジ・ビン
数算出器（５）、時間変換器（６）およびメモリ（７）
から構成される信号処理器、（９）は上記送信トリガ発
生器（４）からの１−リガ信号によって、上記アクティ
ブ・フェーズド・アレイ・アンテナ（２）の各素子の送
信・受信の制御ならびに位相量の設定を行うビーム制御
器である。
次に動作について説明する。送信・受信間のタイム・デ
ィレィを測定するために、送信機（１）では送信トリガ
発生器（４）からの送信トリガが供給されると、予めハ
ード・ウェアで設定された時間（Ｔ１）だけ遅延させて
基準信号を発生する。次いで、上記送信機（１）で発生
した基準信号は、アンテナ（２）に直接入力され、内部
を通過後、受信系で出力される。次いで、上記アンテナ
（２）内を通過した基準信号は受信信号として受信機（
３）で増幅された後、振幅検波を行いディジタル受信信
号に変換されろ。
ィレィを測定するために、送信機（１）では送信トリガ
発生器（４）からの送信トリガが供給されると、予めハ
ード・ウェアで設定された時間（Ｔ１）だけ遅延させて
基準信号を発生する。次いで、上記送信機（１）で発生
した基準信号は、アンテナ（２）に直接入力され、内部
を通過後、受信系で出力される。次いで、上記アンテナ
（２）内を通過した基準信号は受信信号として受信機（
３）で増幅された後、振幅検波を行いディジタル受信信
号に変換されろ。
次いで、上記受信機（３）から出力されるディジタル受
信信号は、送信機（１）で設定された遅延時間（Ｔ１）
に加えて、ハード・ウェアの構成によって生じるタイム
・ディレィ（ＴＯ）分だけ遅延されて信号処理器（８）
に入力される。次いで、上記受信機（３）からの（ＴＩ
＋ＴＯ）だけ遅延したディジタル受信信号のレジン・ビ
ン数がレンジ・ビン数算出器（５）によって算出される
。次いで、上記レンジ・ビン数算出器（５）からのレン
ジ・ビン数は、時間変換器（６）で時間に変換され、さ
らにその値より送信機（１）で設定された遅延時ｖｉ（
ＴＩ）を減算し、タイム・ディレィ（ＴＯ）分だけの時
間を算出する。次いで、上記時間変換器（６）で算出さ
れたハード・ウェアの構成によって生じるタイム・ディ
レィ（ＴＯ）は、メモリ（７）内に保持される。
信信号は、送信機（１）で設定された遅延時間（Ｔ１）
に加えて、ハード・ウェアの構成によって生じるタイム
・ディレィ（ＴＯ）分だけ遅延されて信号処理器（８）
に入力される。次いで、上記受信機（３）からの（ＴＩ
＋ＴＯ）だけ遅延したディジタル受信信号のレジン・ビ
ン数がレンジ・ビン数算出器（５）によって算出される
。次いで、上記レンジ・ビン数算出器（５）からのレン
ジ・ビン数は、時間変換器（６）で時間に変換され、さ
らにその値より送信機（１）で設定された遅延時ｖｉ（
ＴＩ）を減算し、タイム・ディレィ（ＴＯ）分だけの時
間を算出する。次いで、上記時間変換器（６）で算出さ
れたハード・ウェアの構成によって生じるタイム・ディ
レィ（ＴＯ）は、メモリ（７）内に保持される。
第４図は、送信トリガが発生してから基準信号が受信さ
れるまでの時間的経過を示したものである。００）は送
信トリガ、（川は基準信号、囮はディジタル受信信号で
ある。
れるまでの時間的経過を示したものである。００）は送
信トリガ、（川は基準信号、囮はディジタル受信信号で
ある。
従来の送信・受信間のタイム・ディレィを測定する方法
及びその装置では、以上のような方法で行われており、
かつ、以上のように構成されているため、予め設定され
た時間（ＴＩ）ｔ！け基準信号を遅延させるために、送
信機（１）内に専用のハード・ウェアが必要であった。
及びその装置では、以上のような方法で行われており、
かつ、以上のように構成されているため、予め設定され
た時間（ＴＩ）ｔ！け基準信号を遅延させるために、送
信機（１）内に専用のハード・ウェアが必要であった。
また、その遅延時間を調整するために人手と時間を必要
とするという課題があった。
とするという課題があった。
この発明は、上記のような課題を解決するためになされ
たもので、アクティブ・フェーズド・アレイ・アンテナ
各素子は送信・受信の制御が可能であるという特徴を利
用して、１素子のみ送信し、その漏れ込みを他の受信専
用の素子で直接、受信することにより、送信機（１）内
のハード・ウェアで遅延時間を発生させる必要がなく、
かつ、ハード・ウェアの構成によって生じる送信・受信
間のタイム・ディレィだけを容易に測定するための方法
及びその装置を得ることを目的とする。
たもので、アクティブ・フェーズド・アレイ・アンテナ
各素子は送信・受信の制御が可能であるという特徴を利
用して、１素子のみ送信し、その漏れ込みを他の受信専
用の素子で直接、受信することにより、送信機（１）内
のハード・ウェアで遅延時間を発生させる必要がなく、
かつ、ハード・ウェアの構成によって生じる送信・受信
間のタイム・ディレィだけを容易に測定するための方法
及びその装置を得ることを目的とする。
この発明に係わる送信・受信間のタイム・ディレィを測
定する方法とその装置は、このような目的を達成するた
めに、アクティブ・フェーズド・アレイ・アンテナの各
素子は送信・受信の制御が可能であるという特徴を利用
して、１素子のみ送信し、その゛漏れ込みを他の受信専
用の素子で直接、受信するという機能を付加したもので
ある。
定する方法とその装置は、このような目的を達成するた
めに、アクティブ・フェーズド・アレイ・アンテナの各
素子は送信・受信の制御が可能であるという特徴を利用
して、１素子のみ送信し、その゛漏れ込みを他の受信専
用の素子で直接、受信するという機能を付加したもので
ある。
この発明によって、送信・受信間のタイム・ディレィを
設定する際に、アクティブ・フェーズド・アレイ・アン
テナの各素子は送信・受信の制御が可能という特徴を利
用して、１素子のみ送信し、その漏れ込みを他の受信専
用の素子で受信することにより、直接、タイム・ディレ
ィを測定することが可能となる。また、送信機（１）内
の遅延時間の発生するための専用ハード・ウェアが必要
なくなり、その結果、遅延時間を調整するための時間と
人手の削減が可能となる効果がある。
設定する際に、アクティブ・フェーズド・アレイ・アン
テナの各素子は送信・受信の制御が可能という特徴を利
用して、１素子のみ送信し、その漏れ込みを他の受信専
用の素子で受信することにより、直接、タイム・ディレ
ィを測定することが可能となる。また、送信機（１）内
の遅延時間の発生するための専用ハード・ウェアが必要
なくなり、その結果、遅延時間を調整するための時間と
人手の削減が可能となる効果がある。
以下、この発明の一実施例に基づいて説明する。
第１図は、この発明に係わるタイム・ディレィ測定装置
の構成図である。図において、（１）〜（９）は上記の
従来のタイムデイレイ測定装置と全く同一の８１器であ
る。（１３）はビーム制ｉｌ［ＩＩＩ器（９）によって
送信状態になるように制御されている送信素子、（４）
はビーム制御器（９）によって受信状態になるように制
御されている受信素子である。
の構成図である。図において、（１）〜（９）は上記の
従来のタイムデイレイ測定装置と全く同一の８１器であ
る。（１３）はビーム制ｉｌ［ＩＩＩ器（９）によって
送信状態になるように制御されている送信素子、（４）
はビーム制御器（９）によって受信状態になるように制
御されている受信素子である。
次に、この発明による送信・受信間のタイム・ディレィ
の測定方法ならびにその装置の動作について説明する。
の測定方法ならびにその装置の動作について説明する。
送信トリガ発生器（４）よりトリガ信号が出力されると
、送信機（１）は基準信号を通常の送信系からアクティ
ブ・フェーズド・アレイ・アンテナ（２）へ供給し、ビ
ーム制御器（９）はアクティブ・フェーズド・アレイ・
アンテナ（２）の１素子だけを送信状態にし、通常、グ
ランド・クラッタ抑圧のために使用されている素子だけ
が受信状態になるように各素子を制御する。次いで、こ
の送信状態の素子より基準信号は空間に放射され、その
基準信号の漏れ込みを受信状態の素子より直接、受信す
る。次いで、この受信信号は受信機（３）で増幅後、振
幅検波を行いディジタル受信信号に変換される。
、送信機（１）は基準信号を通常の送信系からアクティ
ブ・フェーズド・アレイ・アンテナ（２）へ供給し、ビ
ーム制御器（９）はアクティブ・フェーズド・アレイ・
アンテナ（２）の１素子だけを送信状態にし、通常、グ
ランド・クラッタ抑圧のために使用されている素子だけ
が受信状態になるように各素子を制御する。次いで、こ
の送信状態の素子より基準信号は空間に放射され、その
基準信号の漏れ込みを受信状態の素子より直接、受信す
る。次いで、この受信信号は受信機（３）で増幅後、振
幅検波を行いディジタル受信信号に変換される。
次いで、レンジ・ビン数算出器（５）で受信信号のレン
ジ・ビン数が算出され、時間変換器（６）にてそのレン
ジ・ビン数が時間に変換され、受信・送信間のタイム・
ディレィが算出される。次いで、このタイム・ディレィ
の値がメモリ（７）内に保持される。
ジ・ビン数が算出され、時間変換器（６）にてそのレン
ジ・ビン数が時間に変換され、受信・送信間のタイム・
ディレィが算出される。次いで、このタイム・ディレィ
の値がメモリ（７）内に保持される。
第２図は、上記の発明における、送信トリガが発生して
から基準信号が受信されるまでの時間的経過を示したも
のである。叫は送信トリガ、０１）は基準信号、（（２
）はディジタル受信信号である。
から基準信号が受信されるまでの時間的経過を示したも
のである。叫は送信トリガ、０１）は基準信号、（（２
）はディジタル受信信号である。
以上のように、この発明は従来のタイム・ディレィＷＨ
Ａ定装Ｍに、アクティブ・フェーズド・アレイ・アンテ
ナの各素子は送信・受信の制御が可能であるという特徴
を利用して、１素子のみ送信し、その漏れ込みを他の受
信専用の素子で直接、受信する機能を付加するという簡
単な方法で、ハード・ウェアの構成によって生じるタイ
ム・ディレィを直接、測定することが可能となる。また
、送イ８機（１）内の遅延時間の発生するための専用ハ
ード・ウェアが必要なくなり、その結果、遅延時間を調
整するための時間と人手の削減が可能となるという効果
がある。
Ａ定装Ｍに、アクティブ・フェーズド・アレイ・アンテ
ナの各素子は送信・受信の制御が可能であるという特徴
を利用して、１素子のみ送信し、その漏れ込みを他の受
信専用の素子で直接、受信する機能を付加するという簡
単な方法で、ハード・ウェアの構成によって生じるタイ
ム・ディレィを直接、測定することが可能となる。また
、送イ８機（１）内の遅延時間の発生するための専用ハ
ード・ウェアが必要なくなり、その結果、遅延時間を調
整するための時間と人手の削減が可能となるという効果
がある。
第１図は、この発明に係わるタイム・ディレィ測定装置
の構成図、第２図はこの発明に係わる装置において、送
信トリガが発生してから基準信号が受信されるまでの時
間的経過を示した図、第３図は、従来のタイム・ディレ
ィ測定装置の構成図、第４図は、従来の装置において、
送信トリガが発生してから基準信号が受信されるまでの
時間的経過を示した図である。図において、（１）は送
信機、（２）はアクティブ・フェーズド・アレイ・アン
テナ、（３）は受信機、（４）は送信トリガ発生！、（
５１はレンジ・ビン数算出益、（６）は時間変換器、（
７）はメモリ、（８）は信号処理器、（９）はビーム制
御器、α■は送信トリガ、０１）は基準信号、囮はディ
ジタル受信信号、（１３）は送信素子、（４）は受信素
子である。 なお、図中、同一あるいは相当部分には同一符号を付し
て示しである。
の構成図、第２図はこの発明に係わる装置において、送
信トリガが発生してから基準信号が受信されるまでの時
間的経過を示した図、第３図は、従来のタイム・ディレ
ィ測定装置の構成図、第４図は、従来の装置において、
送信トリガが発生してから基準信号が受信されるまでの
時間的経過を示した図である。図において、（１）は送
信機、（２）はアクティブ・フェーズド・アレイ・アン
テナ、（３）は受信機、（４）は送信トリガ発生！、（
５１はレンジ・ビン数算出益、（６）は時間変換器、（
７）はメモリ、（８）は信号処理器、（９）はビーム制
御器、α■は送信トリガ、０１）は基準信号、囮はディ
ジタル受信信号、（１３）は送信素子、（４）は受信素
子である。 なお、図中、同一あるいは相当部分には同一符号を付し
て示しである。
Claims (2)
- （１）アクティブ・フェーズド・アレイ・アンテナにお
いて、送信トリガが発生したと同時にアンテナ開口面の
１素子から基準信号を送信させ、それと同時にこの素子
とは別の１素子を常に受信状態にして、この基準信号か
らの漏れ込みを受信させ、この受信した基準信号を増幅
して振幅検波後ディジタル信号に変換し、この受信信号
のレンジ・ビン数を調べ、さらにそのレンジ・ビン数を
時間に変換することによりハード・ウェアの構成によっ
て生じる送信・受信間のタイム・ディレィを測定するこ
とを特徴とするタイム・ディレィ測定方法。 - （２）上記のタイム・ディレィ測定方法を実現するため
に、基準信号を発生する送信機、上記送信機からの基準
信号を送信するための素子と基準信号の漏れ込みを受信
するための素子を有するアクティブ・フェーズド・アレ
イ・アンテナ、上記基準信号の漏れ込みを受信した素子
からの受信信号を増幅し、振幅検波を行いディジタル信
号に変換する受信機、上記アンテナ開口面の各素子の送
信・受信の制御を行うビーム制御器、上記送信機とビー
ム制御器への送信トリガの発生および上記受信機からの
ディジタル受信信号のレンジ・ビン数の算出を行い、さ
らにそのレンジ・ビン数を時間に変換し、その値をメモ
リ内に保持しておく信号処理器を備えたことを特徴とす
るタイム・ディレィ測定装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63321373A JPH02165084A (ja) | 1988-12-20 | 1988-12-20 | タイム・ディレイ測定方法及びその装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63321373A JPH02165084A (ja) | 1988-12-20 | 1988-12-20 | タイム・ディレイ測定方法及びその装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02165084A true JPH02165084A (ja) | 1990-06-26 |
Family
ID=18131841
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63321373A Pending JPH02165084A (ja) | 1988-12-20 | 1988-12-20 | タイム・ディレイ測定方法及びその装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02165084A (ja) |
-
1988
- 1988-12-20 JP JP63321373A patent/JPH02165084A/ja active Pending
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