JPH0219665B2 - - Google Patents

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JPH0219665B2
JPH0219665B2 JP10255985A JP10255985A JPH0219665B2 JP H0219665 B2 JPH0219665 B2 JP H0219665B2 JP 10255985 A JP10255985 A JP 10255985A JP 10255985 A JP10255985 A JP 10255985A JP H0219665 B2 JPH0219665 B2 JP H0219665B2
Authority
JP
Japan
Prior art keywords
value
signal
counter
clock pulse
phase shift
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP10255985A
Other languages
English (en)
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JPS61261947A (ja
Inventor
Yojiro Yokoi
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Kyosan Electric Manufacturing Co Ltd
Original Assignee
Kyosan Electric Manufacturing Co Ltd
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Filing date
Publication date
Application filed by Kyosan Electric Manufacturing Co Ltd filed Critical Kyosan Electric Manufacturing Co Ltd
Priority to JP10255985A priority Critical patent/JPS61261947A/ja
Publication of JPS61261947A publication Critical patent/JPS61261947A/ja
Publication of JPH0219665B2 publication Critical patent/JPH0219665B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L27/00Modulated-carrier systems
    • H04L27/18Phase-modulated carrier systems, i.e. using phase-shift keying
    • H04L27/20Modulator circuits; Transmitter circuits
    • H04L27/2032Modulator circuits; Transmitter circuits for discrete phase modulation, e.g. in which the phase of the carrier is modulated in a nominally instantaneous manner
    • H04L27/2053Modulator circuits; Transmitter circuits for discrete phase modulation, e.g. in which the phase of the carrier is modulated in a nominally instantaneous manner using more than one carrier, e.g. carriers with different phases
    • H04L27/2057Modulator circuits; Transmitter circuits for discrete phase modulation, e.g. in which the phase of the carrier is modulated in a nominally instantaneous manner using more than one carrier, e.g. carriers with different phases with a separate carrier for each phase state

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Digital Transmission Methods That Use Modulated Carrier Waves (AREA)

Description

【発明の詳細な説明】
〔産業上の利用分野〕 本発明は、各種データの伝送に際し、特定周波
数の搬送波に対し変調信号により位相偏移変調を
行なう方法に関するものである。 〔従来の技術〕 位相偏移(以下、PSK)変調を行なうには、
周知のとおり、原搬送波に対し移相回路により特
定の位相偏移を与え、移相搬送波を得たうえ、2
値の変調信号によりスイツチ等を制御し、原搬送
波と移相搬送波とを選択してPSK信号を得るの
が一般的となつている。 〔発明が解決しようとする問題点〕 しかし、前述の方法においては、スイツチ等に
よる選択を行なつているため、PSK信号の位相
変化が急激となり、これに応じて搬送波の高低両
側方に側波帯が広域に発生し、この側波帯を狭域
として他への妨害を阻止する目的上、急峻な遮断
特性の帯域波器を用いねばならず、これが高価
かつ大形となる問題を生じている。 なお、複数の互に異なる周波数を有する搬送波
を用いる場合には、各搬送波毎に帯域波器を必
要とし、全装置として高価かつ大形となる問題が
更に顕著となる。 〔問題点を解決するための手段〕 前述の問題を解決するため、本発明はつぎの手
段により構成するものとなつている。 すなわち、内部に第1および第2のカウンタを
設けたマイクロコンピユータに対し、搬送波の周
波数に対して整数倍の高い周波数を有する第1の
クロツクパルスおよび位相偏移信号の位相変位過
渡期間に応じた周波数を有する第2のクロツクパ
ルスを各々第1および第2の割込入力へ与え、か
つ、2値の変調信号および位相偏移量を示す信号
をデータとして与えると共に、第1のクロツクパ
ルスに応じ第1のカウンタに一定値を逐次加算
し、変調信号が第1の値を示すとき、第2のカウ
ンタのカウント値が零となるまで第2のクロツク
パルスに応じて逐次減算し、変調信号が第2の値
を示すときは、位相偏移量と第2のカウンタのカ
ウント値とが一致するまで第2のクロツクパルス
に応じて逐次加減算し、第1および第2のカウン
タの各カウント値を加算した値を正弦波データへ
変換して送出する動作を反復してマイクロコンピ
ユータのプロセツサに行なわせ、正弦波データを
アナログ信号へ変換してPSK信号を発生するも
のとしている。 〔作用〕 したがつて、第1のクロツクパルスに応じて第
1のカウンタが一定値までの加算を反復し、これ
のカウント値が搬送波の各瞬時値を示すものとな
る一方、変調信号の値にしたがつて第2のカウン
タが第2のクロツクパルスに応じて加算または減
算を行ない、これのカウント値が位相偏移量を示
すものとなり、第1および第2のカウンタの各カ
ウント値を加算すればPSK信号の各瞬時値が得
られるため、これを正弦波データへ変換してから
アナログ信号へ更に変換すると、PSK信号が得
られる。 このため、以上の動作を反復することにより、
変調信号が第1の値であれば原位相の搬送波が生
じ、変調信号が第2の値であれば進んだ位相の搬
送波が生ずるとともに、位相変化の過渡期間が第
2のカウンタの加算および減算速度により定ま
り、PSK信号の位相変化が急激とならず、広域
な側波帯が生じない。 〔実施例〕 以下、実施例を示す図によつて本発明の詳細を
説明する。 第1図は全構成のブロツク図であり、マイクロ
コンピユータ(以下、μCP)1は、プロセツサ
(以下、CPU)11,固定メモリ(以下、ROM)
12,可変メモリ(以下、RAM)12,インタ
ーフエイス(以下、I/F)14〜16により構
成され、ROM12中の命令をCPU11が実行
し、必要とするデータをRAM13に対してアク
セスしながら所定の動作を行なうものになつてい
ると共に、CPU11中のレジスタまたはRAM1
3中の特定エリアにより第1および第2のカウン
タが構成されており、これがPSK信号の発生に
用いられるものとなつている。 なお、ROM12またはRAM13中には、正
弦波信号のデータが少なくとも1/2周期分のテー
ブルとして格納されており、これを用いてCPU
11が正弦波データへの変換を行なうものとなつ
ている。 また、μCP1は、第1および第2の割込入力
INT1,INT2を有し、これらには、PSK信号の
搬送波周波数fTに対し、整数N倍の高い周波数
N・fTを有する第1のクロツクパルスPC1,およ
び、PSK信号の位相変化過渡期間に応じた周波
数fSを有する第2のクロツクパルスPC2が各個に
与えられており、これらに応じてCPU11が割
込処理を行なうと共に、2値の変調信号SMおよ
びaビツトからなる位相偏移量を示す信号SSV
I/F14,15を介し、各々データとして与え
られており、これらに応じて所定の動作を反復
し、正弦波データDsをI/F16から送出する
ものとなつている。 正弦波データDsは、デイジタル・アナログ変
換器(以下、DAC)2によりアナログ信号へ変
換されるが、これには、μCP1のデイジタル処理
による量子化雑音を含んでおり、低域波器(以
下、LPF)3によりこれを除去したうえ、PSK
信号SPSとして送出される。 第2図は、CPU11による定常処理のフロー
チヤートであり、上述の第1および第2のカウン
タの各カウント値“n1+n2=n”101を演算
し、上述のテーブルにより、“nに基づきDsへ変
換”102を行ない、これによつて求めた正弦波
データ“Ds送出”103を行なつたうえ、ステ
ツプ101以降を反復する。 ここにおいて、一定値をN−1とし、これが例
えば3桁の2進数〔111〕により示されるものと
すれば、カウント値n1は、後述のとおり〔000〕
〜N−1をクロツクパルスPC1に応じ、一定周期
により反復しており、カウント値n2を3桁の2進
数〔010〕および〔100〕とした場合、各カウント
値n1,n2と加算値nとの関係は次表のとおりにな
る。 すなわち、最下位桁から4桁目への桁上げを切
捨てるものとすれば、n1が#0〜#7,#8〜
#15を1周期として変化し、#7,#15が最大値
となるのに対し、n2a=〔010〕では、n1+n2a=
naの最大値が#5および#13へシフトし、n2b=
〔100〕のときは、n1+n2b=nbの最大値が#3お
よび#11へシフトしており、n2の値に応じてnの
変化状況位相が進むものとなり、かつ、nは最大
値〔111〕のつぎに必ず〔000〕のリセツト状態へ
自動的に戻るものとなる。 ただし、所要の桁数はN−1に応じて定めれば
よく、これに対応するビツト数の加算器をCPU
11により、または、CPU11とRAM13とに
より構成し、ステツプ101用として適用すれば
よい。
〔発明の効果〕
以上の説明により明らかなとおり本発明によれ
ば、広域の側波帯を生ぜず、高価かつ大形な帯域
波器が不要となり、装置を安全かつ小形とする
ことができると共に、位相偏移量の設定が自在で
あり、各種用途のPSK変調において顕著な効果
が得られる。
【図面の簡単な説明】
図は本発明の実施例を示し、第1図は全体のブ
ロツク図、第2図乃至第4図はプロセツサの動作
状況を示すフローチヤート、第5図は各値および
データの変化状況を示すタイミングチヤートであ
る。 1……μCP(マイクロコンピユータ)、2……
DAC(デイジタル・アナログ変換器)、11……
CPU(プロセツサ)、12……ROM(固定メモ
リ)、13……RAM(可変メモリ)、14〜15
……I/F(インターフエイス)、INT1,INT2
…割込入力、PC1,PC2……クロツクパルス、SM
…変調信号、SSV……位相偏移量信号、DS……正
弦波データ、SPS……PSK(位相偏移)信号。

Claims (1)

    【特許請求の範囲】
  1. 1 内部に第1および第2のカウンタを設けたマ
    イクロコンピユータに対し、搬送波の周波数に対
    して整数倍の高い周波数を有する第1のクロツク
    パルスおよび位相偏移信号の位相変化過渡期間に
    応じた周波数を有する第2のクロツクパルスを
    各々第1および第2の割込入力へ与え、かつ、2
    値の変調信号および位相偏移量を示す信号をデー
    タとして与えると共に、前記第1のクロツクパル
    スに応じ第1のカウンタに一定値を逐次加算し、
    前記変調信号が第1の値を示すとき前記第2のカ
    ウンタのカウント値が零となるまで前記第2のク
    ロツクパルスに応じて逐次減算し、前記変調信号
    が第2の値を示すときは前記位相偏移量と第2の
    カウンタのカウント値とが一致するまで前記第2
    のクロツクパルスに応じて逐次加減算し、前記第
    1および第2のカウンタの各カウント値を加算し
    た値を正弦波データへ変換して送出する動作を反
    復して前記マイクロコンピユータのプロセツサに
    行なわせ、前記正弦波データをアナログ信号へ変
    換して位相偏移信号を発生することを特徴とした
    位相偏移変調方法。
JP10255985A 1985-05-16 1985-05-16 位相偏移変調方法 Granted JPS61261947A (ja)

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JP10255985A JPS61261947A (ja) 1985-05-16 1985-05-16 位相偏移変調方法

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JPS61261947A JPS61261947A (ja) 1986-11-20
JPH0219665B2 true JPH0219665B2 (ja) 1990-05-02

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