JPH02202059A - Semiconductor device - Google Patents
Semiconductor deviceInfo
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- JPH02202059A JPH02202059A JP1021316A JP2131689A JPH02202059A JP H02202059 A JPH02202059 A JP H02202059A JP 1021316 A JP1021316 A JP 1021316A JP 2131689 A JP2131689 A JP 2131689A JP H02202059 A JPH02202059 A JP H02202059A
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Abstract
Description
【発明の詳細な説明】
[vA要]
半導体装置に係り、特にホットエレクトロントランジス
タに関し、
ベース−コレクタ間の耐圧を確保する一方で、動作速度
を高速化すると共に、電流増幅率を向上させることがで
きる半導体装置を提供することを目的とし、
第1および第2の半導体層の間にバリア層を有する半導
体装置において、前記バリア層と前記第2の半導体層と
の間に、前記バリア層よりも電子親和力の大きい真正半
導体層が設けられているように構成する。[Detailed Description of the Invention] [vA Required] Regarding semiconductor devices, especially hot electron transistors, it is possible to increase the operating speed and improve the current amplification factor while ensuring the withstand voltage between the base and the collector. The object of the present invention is to provide a semiconductor device having a barrier layer between a first and a second semiconductor layer, in which a barrier layer is provided between the barrier layer and the second semiconductor layer. The structure is such that a genuine semiconductor layer having a large electron affinity is provided.
[産業上の利用分野]
本発明は半導体装置に係り、特にホットエレクトロント
ランジスタに関する。[Industrial Field of Application] The present invention relates to a semiconductor device, and particularly to a hot electron transistor.
[従来の技術]
従来のホットエレクトロントランジスタを、第4図を用
いて説明する。[Prior Art] A conventional hot electron transistor will be explained using FIG. 4.
第4図(a)は、従来のホットエレクトロントランジス
タの断面を示す断面図、第4図(b)は、第4図(a)
に対応する伝導帯底のエネルギー準位Vcを示すバンド
ダイアダラム、第4図(c)は、第4図(a)の一部を
拡大した概念図、第4図(d)は、第4図(c)に対応
する伝導帯底のエネルギー準位Vcを示すバンドダイア
ダラムである。FIG. 4(a) is a cross-sectional view showing a cross section of a conventional hot electron transistor, and FIG. 4(b) is a cross-sectional view of a conventional hot electron transistor.
A band diagram showing the energy level Vc of the bottom of the conduction band corresponding to This is a band diagram showing the energy level Vc at the bottom of the conduction band corresponding to figure (c).
従来のホットエレクトロントランジスタにおいては、例
えばi型GaAsからなる基板10上に、n型GaAs
からなるコレクタ層4.1型A1GaAsからなるコレ
クタバリア層6a、n型GaAsからなるベース層2、
i型AN GaAsからなるエミッタバリア層12、お
よびn型GaAsからなるエミツタ層14が積層され、
縦積多層へテロ構造となっている。In a conventional hot electron transistor, for example, n-type GaAs is placed on a substrate 10 made of i-type GaAs.
Collector layer 4 consisting of 1-type A1GaAs collector barrier layer 6a, base layer 2 consisting of n-type GaAs,
An emitter barrier layer 12 made of i-type AN GaAs and an emitter layer 14 made of n-type GaAs are laminated,
It has a vertically laminated multilayer heterostructure.
このように、エミツタ層14、ベース層2、およびコレ
クタ層4にはそれぞれ例えばGaAsが用いられている
のに対して、エミッタバリア層12およびコレクタバリ
ア層6aには、GaAsよりも電子親和力が小さいAj
GaAsが用いられ、第4図(b)に示されるように、
エネルギー障壁を形成している。In this way, while GaAs is used for the emitter layer 14, base layer 2, and collector layer 4, respectively, the emitter barrier layer 12 and the collector barrier layer 6a have a smaller electron affinity than GaAs. Aj
GaAs is used, as shown in FIG. 4(b),
It forms an energy barrier.
そしてコレクタ層4、ベース層2、およびエミツタ層1
4上には、それぞれコレクタ電極16、ベースtiis
、およびエミッタt[120が設けられている。and a collector layer 4, a base layer 2, and an emitter layer 1
4 have a collector electrode 16 and a base tiis, respectively.
, and an emitter t[120.
また、こうしたホットエレクトロントランジスタにおい
ては、ベース−コレクタ間の耐圧を大きくとるには、第
4図(c)、(d)に示されるように、ベース層2とコ
レクタ層4との間に一定の電圧を印加した際の伝導帯底
のエネルギー準位Vcが緩やかな傾斜をとる必要がある
ため、コレクタバリア層6aの厚さがかなり厚く、例え
ば2000人程度スケっている。In addition, in such a hot electron transistor, in order to increase the withstand voltage between the base and collector, as shown in FIGS. Since the energy level Vc at the bottom of the conduction band when a voltage is applied needs to have a gentle slope, the thickness of the collector barrier layer 6a is quite thick, for example, about 2000 layers.
[発明が解決しようとする課題]
このように、上記従来のホットエレクトロントランジス
タにおいては、ベース−コレクタ間の耐圧を確保するた
めに、電子親和力が小さいコレクタバリア層6aの厚さ
をかなり厚くとる必要があった。[Problems to be Solved by the Invention] As described above, in the conventional hot electron transistor described above, in order to ensure the withstand voltage between the base and the collector, it is necessary to make the collector barrier layer 6a, which has a small electron affinity, considerably thick. was there.
このために、ホットエレクトロンがコレクタバリア層6
aを通過するに要する時間が長くなり、トランジスタの
動作速度が遅くなるという問題があっな。For this reason, hot electrons are transferred to the collector barrier layer 6.
There is a problem that the time required to pass through a becomes longer and the operating speed of the transistor becomes slower.
また、ベース層2とコレクタ層4との間の印加電圧が低
い場合や弱い逆バイアス状態の場合、ホットエレクトロ
ンの輸送効率が低下し、電流増幅率が低下するという間
層もあった。In addition, when the applied voltage between the base layer 2 and the collector layer 4 is low or in a weak reverse bias state, there was an interlayer in which the hot electron transport efficiency decreased and the current amplification factor decreased.
そこで本発明は、ベース−コレクタ間の耐圧を確保する
一方で、動作速度を高速化すると共に、電流増幅率を向
上させることができる半導体装置を提供することを目的
とする。SUMMARY OF THE INVENTION Therefore, an object of the present invention is to provide a semiconductor device that can increase operating speed and improve current amplification factor while ensuring a base-collector breakdown voltage.
[課題を解決するための手段] 第1図は、本発明の原理説明図である。[Means to solve the problem] FIG. 1 is a diagram explaining the principle of the present invention.
第1図(a)に示される半導体装置は、ベース層2とコ
レクタ層4との間に電子親和力の小さいコレクタバリア
層6を有すると共に、コレクタバリア層6とコレクタ層
4との間に、コレクタバリア層6よりも電子親和力が大
きい真正半導体層8を有している。The semiconductor device shown in FIG. 1(a) has a collector barrier layer 6 with low electron affinity between the base layer 2 and the collector layer 4, and a collector barrier layer 6 between the collector barrier layer 6 and the collector layer 4. It has a true semiconductor layer 8 having a higher electron affinity than the barrier layer 6.
そしてコレクタバリア層6と真正半導体層8との合計の
厚さが、従来のコレクタバリア層の厚さと同程度となっ
ている。すなわち、真正半導体8が存在する分だけ、コ
レクタバリア層6の厚さは薄くなっている。The total thickness of the collector barrier layer 6 and the genuine semiconductor layer 8 is approximately the same as the thickness of the conventional collector barrier layer. That is, the thickness of the collector barrier layer 6 is reduced by the amount of the genuine semiconductor 8 present.
[作 用コ
第1図(a)のベース層2とコレクタ層4との間に一定
の電圧を印加した際の伝導帯底のエネルギー準位Vcの
バンドダイアダラムを第1図(b)に示す。[Function] The band diagram of the energy level Vc at the bottom of the conduction band when a constant voltage is applied between the base layer 2 and the collector layer 4 in Fig. 1(a) is shown in Fig. 1(b). show.
ベース層2とコレクタ層4との間に印加された電圧は、
キャリア濃度が低いコレクタバリア層6にかかるだけで
なく、同様にキャリア濃度が低い真正半導体層8にもか
かる。そしてコレクタバリア[6と真正半導体層8との
合計の厚さが従来のコレクタバリア層の厚さと同程度で
あるため、コレクタバリア層6にかかる電界強度、言い
替えれば伝導帯底のエネルギー準位Vcの傾斜は従来と
同程度となり、従ってベース層2との境界近傍における
コレクタバリア層6のバンドの様子も、従来と同様とな
る。The voltage applied between the base layer 2 and collector layer 4 is
It is applied not only to the collector barrier layer 6, which has a low carrier concentration, but also to the genuine semiconductor layer 8, which has a similarly low carrier concentration. Since the total thickness of the collector barrier [6 and the genuine semiconductor layer 8 is approximately the same as the thickness of the conventional collector barrier layer, the electric field strength applied to the collector barrier layer 6, in other words, the energy level at the bottom of the conduction band Vc The slope of the collector barrier layer 6 is approximately the same as that of the prior art, and therefore the appearance of the band of the collector barrier layer 6 near the boundary with the base layer 2 is also the same as that of the prior art.
そしてベース層2からコレクタ層4へ注入される電子の
数は、ベース層2との境界近傍におけるコレクタバリア
層6のバンドの様子で決まるため、従来と同様のベース
−コレクタ間の耐圧が確保される。The number of electrons injected from the base layer 2 to the collector layer 4 is determined by the shape of the band of the collector barrier layer 6 near the boundary with the base layer 2, so that the same base-collector breakdown voltage as before is ensured. Ru.
一方、ベース層2とコレクタ層4との間を通過するホッ
トエレクトロンは、電子親和力が小さいコレクタバリア
層6から電子親和力の大きい真正半導体層8に入ること
により、その速度は速くなる。また、一般に電子親和力
が大きい半導体はどキャリアの有効質量が小さくなるた
め、ホットエレクトロンの走行速度はさらに加速される
。こうして、ホットエレクトロンがベース層2からコレ
クタ層4へ走行するに要する時間が短縮される。On the other hand, the speed of hot electrons passing between the base layer 2 and the collector layer 4 increases as they enter the true semiconductor layer 8, which has a large electron affinity, from the collector barrier layer 6, which has a small electron affinity. Furthermore, since the effective mass of carriers in semiconductors, which generally have a large electron affinity, becomes small, the traveling speed of hot electrons is further accelerated. In this way, the time required for hot electrons to travel from the base layer 2 to the collector layer 4 is shortened.
また、ベース層2から従来と比べて厚さが薄いコレクタ
バリア層6を通過して真正半導体層8に達したホットエ
レクトロンは、散乱等によってエネルギーを失ってもコ
レクタ層4に達するため、ベース−コレクタ間の印加電
圧が低い場合や逆バイアス状態である場合におけるホッ
トエレクトロンの輸送効率が高くなる。Furthermore, the hot electrons that have passed through the collector barrier layer 6 from the base layer 2 and reached the true semiconductor layer 8, which is thinner than the conventional one, reach the collector layer 4 even if they lose energy due to scattering or the like. The hot electron transport efficiency increases when the voltage applied between the collectors is low or when the voltage is reverse biased.
[実施例]
以下、本発明を図示する実施例に基づいて具体的に説明
する。[Example] The present invention will be specifically described below based on an illustrative example.
第2図(a>は、本発明の一実施例による半導体装置の
断面を示す断面図、第2図(b)は、第2図(a)に対
応する伝導帯底のエネルギー準位Vcを示すバンドダイ
アダラムである。FIG. 2(a) is a cross-sectional view showing a cross section of a semiconductor device according to an embodiment of the present invention, and FIG. 2(b) shows the energy level Vc at the bottom of the conduction band corresponding to FIG. 2(a). This is the band diagram shown.
本実施例による半導体装置は、第2図(a)に示される
ように、例えばl型GaAsからなる基板10上に、n
型GaAsからなるコレクタ層4.1型GaAsからな
る真正半導体層8、l型AjGaAsからなるコレクタ
バリア層6、n型GaAsからなるベース層2、l型A
jGaAsからなるエミッタバリア層12、およびn型
GaAsからなるエミツタ層14が積層され、縦積多層
へテロ構造となっている。As shown in FIG. 2(a), the semiconductor device according to this embodiment has a substrate 10 made of, for example, l-type GaAs,
Collector layer 4 made of type GaAs. Authentic semiconductor layer 8 made of 1 type GaAs, collector barrier layer 6 made of l type AjGaAs, base layer 2 made of n type GaAs, l type A.
An emitter barrier layer 12 made of jGaAs and an emitter layer 14 made of n-type GaAs are stacked to form a vertically stacked multilayer heterostructure.
このように、エミツタ層14、ベース層2、コレクタ層
4、および真正半導体層8はそれぞれ例えばGaAsか
らなっているのに対して、エミッタバリア層12および
コレクタバリア層6aは、それぞれGaAsよりも電子
親和力が小さいAJ!GaAsからなっており、第2図
(b)に示されるようなエネルギー障壁を形成している
。In this way, the emitter layer 14, the base layer 2, the collector layer 4, and the genuine semiconductor layer 8 are each made of, for example, GaAs, whereas the emitter barrier layer 12 and the collector barrier layer 6a are each made of GaAs. AJ with low affinity! It is made of GaAs and forms an energy barrier as shown in FIG. 2(b).
そしてコレクタバリア層6の厚さは、従来のおよそ半分
の1000人であり、また真正半導体層8の厚さも10
00八となっており、真正半導体8の厚さの分だけコレ
クタバリア層6の厚さが従来よりも薄くなっている。The thickness of the collector barrier layer 6 is 1000 nm, which is about half of the conventional thickness, and the thickness of the true semiconductor layer 8 is also 1000 nm.
008, and the thickness of the collector barrier layer 6 is thinner than the conventional one by the thickness of the genuine semiconductor 8.
また、コレクタ層4、ベース層2、およびエミツタ層1
4上には、それぞれA u / Crからなるコレクタ
電極16、ベース電極18、およびエミッタ電極20が
設けられている。In addition, a collector layer 4, a base layer 2, and an emitter layer 1
4 are provided with a collector electrode 16, a base electrode 18, and an emitter electrode 20, each made of A u /Cr.
本実施例による半導体装置において、ベース層2とコレ
クタ層4との間に電圧が印加されると、コレクタバリア
層6と真正半導体層8との合計の厚さ2000人は従来
のコレクタバリア層の厚さと同程度であるため、ベース
層2との境界近傍におけるコレクタバリア層6のバンド
は、従来と同様の様子を示す、従って、従来と同様のベ
ースコレクタ間の耐圧を確保することができる。In the semiconductor device according to this embodiment, when a voltage is applied between the base layer 2 and the collector layer 4, the total thickness of the collector barrier layer 6 and the genuine semiconductor layer 8 is 2000 mm compared to the conventional collector barrier layer. Since the thickness is approximately the same as that of the collector barrier layer 6, the band of the collector barrier layer 6 near the boundary with the base layer 2 exhibits the same appearance as in the conventional case. Therefore, it is possible to secure the same breakdown voltage between the base and the collector as in the conventional case.
また、ベース層2とコレクタ層4との間を走行するホッ
トエレクトロンは、コレクタバリア層6を通過して真正
半導体層8に入ると、電子親和力が小さいi型AjGa
As層から電子親和力の大きいl型GaAs層に移行す
るため、運動エネルギーが増加し、その走行速度が速く
なる。そしてまた、電子の有効質量はAll GaAs
中よりGaAs中のほうが小さいため、その走行速度は
さらに加速される。Furthermore, when the hot electrons traveling between the base layer 2 and the collector layer 4 pass through the collector barrier layer 6 and enter the genuine semiconductor layer 8, the hot electrons pass through the collector barrier layer 6 and enter the genuine semiconductor layer 8.
Since the As layer is transferred to the l-type GaAs layer having a large electron affinity, the kinetic energy increases and the traveling speed becomes faster. And also, the effective mass of the electron is All GaAs
Since the GaAs medium is smaller than the GaAs medium, its traveling speed is further accelerated.
こうして、ベース層2とコレクタ層4との間のホットエ
レクトロンの走行時間を短縮することができ、従って半
導体装置の動作速度を高速化することができる。In this way, the travel time of hot electrons between the base layer 2 and the collector layer 4 can be shortened, and the operating speed of the semiconductor device can therefore be increased.
さらにまた、ベース層2とコレクタ層4との間を走行す
るホットエレクトロンは、従来と比べて厚さが半分に薄
くなったコレクタバリア層6を通過して真正半導体71
8に達しさえすれば、散乱等によってエネルギーを失っ
ても、コレクタ層4に達することができる。このなめベ
ース−コレクタ間の低バイアス状態または逆バイアス状
態において、ホットエレクトロンの輸送効率を高くする
ことができる。従って、半導体装!の電流増幅率を向上
させることができる。Furthermore, the hot electrons traveling between the base layer 2 and the collector layer 4 pass through the collector barrier layer 6, which is half as thin as the conventional one, and pass through the genuine semiconductor 71.
8, it can reach the collector layer 4 even if it loses energy due to scattering or the like. In this low bias state or reverse bias state between the diagonal base and the collector, the hot electron transport efficiency can be increased. Therefore, semiconductor equipment! The current amplification factor can be improved.
なお、上記実施例においては、コレクタバリア層6の厚
さを1000人、また真正半導体層8の厚さを100O
Aとしたが、例えばコレクタバリア層6の厚さを500
人、また真正半導体層8の厚さを1500人としてもよ
い、コレクタバリア層6の厚さを薄くすればするほど、
半導体装置の動作速度を高速化することができる。In the above embodiment, the thickness of the collector barrier layer 6 was set to 1000 nm, and the thickness of the genuine semiconductor layer 8 was set to 100 nm.
A, but for example, if the thickness of the collector barrier layer 6 is 500
The thickness of the true semiconductor layer 8 may also be set to 1500. The thinner the collector barrier layer 6 is, the more
The operating speed of a semiconductor device can be increased.
そしてその限界は、コレクタバリア層6の厚さがあまり
薄くなり過ぎて、コレクタバリア層6の伝導帯底のエネ
ルギー準位Vcの傾斜は従来と同程度であっても、ベー
ス層2との境界近傍におけるコレクタバリア層6のバン
ドの様子、いわゆる三角ポテンシャルの形状が従来と変
化して、ベース層2からコレクタバリア層6へ注入され
る電子の数が急激に増加する点であり、これ以上にコレ
クタバリア層6の厚さが薄くなると、ベース−コレクタ
間の耐圧が劣化する。The limit is that the thickness of the collector barrier layer 6 becomes too thin, and even though the slope of the energy level Vc at the bottom of the conduction band of the collector barrier layer 6 is the same as that of the conventional one, the boundary with the base layer 2 The shape of the band of the collector barrier layer 6 in the vicinity, the shape of the so-called triangular potential, changes from the conventional one, and the number of electrons injected from the base layer 2 to the collector barrier layer 6 increases rapidly. When the thickness of the collector barrier layer 6 becomes thin, the breakdown voltage between the base and the collector deteriorates.
また、上記実施例においては、電子親和力が小さいバリ
ア層と電子親和力の大きい半導体層として、AjGaA
sとGaAsとの組み合わせを用いたが、これに限らず
、InAjAsとI nGaAs、I nGaAj A
sとI nGaAs、SiとGe、CdTeとHgCd
Te等、はとんどすべての半導体へテロ接合を用いたバ
リア構造を有する半導体装置に適用可能である。In addition, in the above embodiment, AjGaA is used as a barrier layer with a small electron affinity and a semiconductor layer with a large electron affinity.
Although a combination of InAjAs and GaAs was used, the combination is not limited to this, and InAjAs and InGaAs, InGaAj A
s and I nGaAs, Si and Ge, CdTe and HgCd
Te, etc. can be applied to almost all semiconductor devices having a barrier structure using a semiconductor heterojunction.
次に、第2図に示される半導体装置の製造方法を、第3
図を用いれて説明する。Next, the method for manufacturing the semiconductor device shown in FIG.
This will be explained using figures.
l型G a A sからなる基板10上に、エピタキシ
ャル成長法を用いて、n型GaAsからなるコレクタ1
4、i型G a A sからなる厚さ1000人の真正
半導体層8、GaAsよりも電子親和力が小さいi型A
jGaAsからなる厚さ1000人のコレクタバリア層
6、n型GaAsからなるベース層2.1型AjGaA
sからなるエミッタバリア層12、およびn型GaAs
からなるエミZり層14を順に積層し、縦積多層へテロ
構造を形成する(第3図(a)参照)。A collector 1 made of n-type GaAs is grown on a substrate 10 made of l-type GaAs using an epitaxial growth method.
4. Authentic semiconductor layer with a thickness of 1000 nm consisting of i-type GaAs 8, i-type A with a smaller electron affinity than GaAs
Collector barrier layer 6 made of AjGaAs with a thickness of 1000 nm, base layer 2 made of n-type GaAs, 2.1 type AjGaA
Emitter barrier layer 12 made of s and n-type GaAs
The emitter layers 14 consisting of the following are stacked in order to form a vertically stacked multilayer heterostructure (see FIG. 3(a)).
次いで、エミツタ層14上に所定パターンのマスク材2
2を形成し、このマスク材22をマスクとしてエミツタ
層14およびエミッタバリア層12の選択的なエツチン
グを行ない、ベース層2を露出させる(第3図(b)参
照)。Next, a predetermined pattern of mask material 2 is applied on the emitter layer 14.
Using this mask material 22 as a mask, the emitter layer 14 and the emitter barrier layer 12 are selectively etched to expose the base layer 2 (see FIG. 3(b)).
次いで、エミツタ層14およびベース層2上に再び所定
パターンのマスク材24を形成し、このマスク材24を
マスクとしてベース層2、コレクタバリア層6、および
真正半導体層8の選択的なエツチングを行ない、コレク
タ層4を露出させる(第3図(c)参照)。Next, a mask material 24 having a predetermined pattern is formed again on the emitter layer 14 and the base layer 2, and the base layer 2, the collector barrier layer 6, and the genuine semiconductor layer 8 are selectively etched using the mask material 24 as a mask. , exposing the collector layer 4 (see FIG. 3(c)).
次いで、コレクタ層4、ベース層2、およびエミツタ層
14上に、それぞれA u / Crからなるコレクタ
電f#116、ベース電極18、およびエミッタ電極2
0を形成する(第3図(d)参照)。Next, on the collector layer 4, base layer 2, and emitter layer 14, a collector electrode f#116, a base electrode 18, and an emitter electrode 2 each made of Au/Cr are formed.
0 (see FIG. 3(d)).
このようにして、第2図に示す半導体装置を製造する。In this way, the semiconductor device shown in FIG. 2 is manufactured.
[発明の効果]
以上のように本発明によれば、ベース層とコレクタ層と
の間に挟まれているコレクタバリア層と真正半導体層と
の合計の厚さを従来のコレクタバリア層の厚さと同程度
とすることにより、従来と同様のベース−コレクタ間の
耐圧を確保することができる。[Effects of the Invention] As described above, according to the present invention, the total thickness of the collector barrier layer and the true semiconductor layer sandwiched between the base layer and the collector layer is equal to the thickness of the conventional collector barrier layer. By making it approximately the same, it is possible to ensure the same base-collector breakdown voltage as in the conventional case.
そして、コレクタバリア層が従来よりも薄くなっている
分だけコレクタバリア層より電子親和力の大きい真正半
導体層が設けられていることにより、ベース−コレクタ
間を走行するホットエレクトロンの走行速度が速くなっ
て走行時間を短縮することができ、従って半導体装置の
動作速度を高速化することができる。Since the collector barrier layer is thinner than before, a true semiconductor layer with a higher electron affinity than the collector barrier layer is provided, so the traveling speed of hot electrons traveling between the base and the collector becomes faster. The running time can be shortened, and the operating speed of the semiconductor device can therefore be increased.
また、ベース−コレクタ間の低バイアス状態または逆バ
イアス状態においてホットエレクトロンの輸送効率を高
くすることができ、従って半導体装置の電流増幅率を向
上させることができる。Further, the transport efficiency of hot electrons can be increased in a low bias state or a reverse bias state between the base and the collector, and therefore the current amplification factor of the semiconductor device can be improved.
第1図は、本発明の原理説明図、
第2図は、本発明の一実施例による半導体装置を示す図
、
第3図は、第2図の半導体装置の製造方法を示す工程図
、
第4図は、従来の半導体装置を説明するための図である
。
図において、
2・・・・・・ベース層、
4・・・・・・コレクタ層、
6.6a・・・・・・コレクタバリア層、8・・・・・
・真正半導体層、
10・・・・・・基板、
12・・・・・・エミッタバリア層、
14・・・・・・エミツタ層、
16・・・・・・コレクタを極、
18・・・・・・ベース電極、
20・・・・・・エミッタ電極、
22.24・・・・・・マスク材。
コレクタ層
真正半導体層
本発明の原理説明図
第1図1 is a diagram illustrating the principle of the present invention; FIG. 2 is a diagram showing a semiconductor device according to an embodiment of the present invention; FIG. 3 is a process diagram showing a method for manufacturing the semiconductor device of FIG. 2; FIG. 4 is a diagram for explaining a conventional semiconductor device. In the figure, 2...Base layer, 4...Collector layer, 6.6a...Collector barrier layer, 8...
- Genuine semiconductor layer, 10...Substrate, 12...Emitter barrier layer, 14...Emitter layer, 16...Collector as pole, 18... ... Base electrode, 20 ... Emitter electrode, 22.24 ... Mask material. Collector layer Genuine semiconductor layer Figure 1, explanatory diagram of the principle of the present invention
Claims (1)
層(6)を有する半導体装置において、前記バリア層(
6)と前記第2の半導体層(4)との間に、前記バリア
層(6)よりも電子親和力の大きい真正半導体層(8)
が設けられていることを特徴とする半導体装置。In a semiconductor device having a barrier layer (6) between the first and second semiconductor layers (2) and (4), the barrier layer (
6) and the second semiconductor layer (4), an authentic semiconductor layer (8) having a higher electron affinity than the barrier layer (6).
A semiconductor device characterized by being provided with.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1021316A JP2771214B2 (en) | 1989-01-31 | 1989-01-31 | Semiconductor device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1021316A JP2771214B2 (en) | 1989-01-31 | 1989-01-31 | Semiconductor device |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02202059A true JPH02202059A (en) | 1990-08-10 |
| JP2771214B2 JP2771214B2 (en) | 1998-07-02 |
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Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1021316A Expired - Fee Related JP2771214B2 (en) | 1989-01-31 | 1989-01-31 | Semiconductor device |
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| Country | Link |
|---|---|
| JP (1) | JP2771214B2 (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05190834A (en) * | 1991-10-02 | 1993-07-30 | Mitsubishi Electric Corp | High speed operating semiconductor device and manufacture thereof |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63132477A (en) * | 1986-08-21 | 1988-06-04 | 朱恩均 | Kinetic Energy Adjustment Hot Electron Transistor |
-
1989
- 1989-01-31 JP JP1021316A patent/JP2771214B2/en not_active Expired - Fee Related
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63132477A (en) * | 1986-08-21 | 1988-06-04 | 朱恩均 | Kinetic Energy Adjustment Hot Electron Transistor |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05190834A (en) * | 1991-10-02 | 1993-07-30 | Mitsubishi Electric Corp | High speed operating semiconductor device and manufacture thereof |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2771214B2 (en) | 1998-07-02 |
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