JPH02213936A - 図形表示装置 - Google Patents
図形表示装置Info
- Publication number
- JPH02213936A JPH02213936A JP3466289A JP3466289A JPH02213936A JP H02213936 A JPH02213936 A JP H02213936A JP 3466289 A JP3466289 A JP 3466289A JP 3466289 A JP3466289 A JP 3466289A JP H02213936 A JPH02213936 A JP H02213936A
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- JP
- Japan
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- horizontal
- straight line
- line
- pixels
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- 238000010586 diagram Methods 0.000 description 4
- 238000000034 method Methods 0.000 description 1
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- Digital Computer Display Output (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は図形表示装置の改良に関し、特に図形描画の高
速化に関する。
速化に関する。
（従来の技術）
従来、この種の図形表示装置において直線を表示する場
合、直線上に画素のアドレスを１画素ずつ計算し、描画
してゆくように構成されていた。
合、直線上に画素のアドレスを１画素ずつ計算し、描画
してゆくように構成されていた。
（発明が解決しようとする課題）
上述した従来の図形表示装置は、直線の傾きを考慮しな
いために、傾きをもつ直線においても直線を構成する画
素のアドレスを１画素ずつ計算して描画している。この
ため、直線を描画する速度が遅いという欠点がある。
いために、傾きをもつ直線においても直線を構成する画
素のアドレスを１画素ずつ計算して描画している。この
ため、直線を描画する速度が遅いという欠点がある。
本発明の目的は、直線描画の際くいその直＠が水平か否
かを判定し、表示部における水平方向に対応した表示メ
モリ上の連続し九Ｎ画素（Ｎは２以上の自然数）を同時
に描画するとともにＮ画素内の他の任意に対する描画を
禁止し、直線上の各点のＮ画素内における位置を検出し
て直線上の各点のアドレスを１点ずつ発生するとともに
、水平線描画の場合にはＮ画素単位に’７ドレスを発生
するととＫより上記欠点を除去し、直線を高速描画でき
るように構成した図形表示装置を提供するととＫある。
かを判定し、表示部における水平方向に対応した表示メ
モリ上の連続し九Ｎ画素（Ｎは２以上の自然数）を同時
に描画するとともにＮ画素内の他の任意に対する描画を
禁止し、直線上の各点のＮ画素内における位置を検出し
て直線上の各点のアドレスを１点ずつ発生するとともに
、水平線描画の場合にはＮ画素単位に’７ドレスを発生
するととＫより上記欠点を除去し、直線を高速描画でき
るように構成した図形表示装置を提供するととＫある。
（課題を解決するための手段）
本発明による図形表示装置は、水平線判定手段と、描画
手段と、マスク生成手段と、アドレス生成手段とを具備
して構成したものである。
手段と、マスク生成手段と、アドレス生成手段とを具備
して構成したものである。
水平線判定手段は、直線描画の際にＭ線が水平線である
か否かを判定するためのものである。
か否かを判定するためのものである。
描画手段は、表示部における水平方向に対応した表示メ
モリ上の連続した２以上の画素を同時に描画するための
ものである。
モリ上の連続した２以上の画素を同時に描画するための
ものである。
マスク生成手段は、２以」−の画素の内で他の任意の画
素に対する描画を禁止するだめのものである。
素に対する描画を禁止するだめのものである。
アドレス生成手段は、上記直線上の２以上の画素の内で
位置を検出して直線上の各点のアドレスを１点づつ発生
するとともに、水平線の描画の場合には上記２以上の画
素の単位にアドレスを発生するためのものである。
位置を検出して直線上の各点のアドレスを１点づつ発生
するとともに、水平線の描画の場合には上記２以上の画
素の単位にアドレスを発生するためのものである。
（実施例）
次に、本発明について図面を参照して説明する。
第１図は、本発明による図形表示装置の一実施例を示す
ブロック図である。
ブロック図である。
第１図において、１は入力処理部、２はＹ座標演算部、
３はＸ座標演算部、４は水平線判定部、５はマスク生成
Ｓ、Ｓはフレームバッファメモリ、７−：表示部である
。
３はＸ座標演算部、４は水平線判定部、５はマスク生成
Ｓ、Ｓはフレームバッファメモリ、７−：表示部である
。
入力処理部１は入力される直線データのうち、イ′れぞ
”ｉ１始／終点の水平方向座標Ｊ Ｈ／ Ｚ ６と、垂
山方向座優’Ｉ ｓ ／ ’／ ｅとを保持する。水平
線判定部４け、ｙ、とｙｅとの値を比較する。ｙ、と’
Ｉｅとが等しい場合には、その直線は水平線であると判
断し、等しくない場合知は傾きをもった線分であると判
断する。
”ｉ１始／終点の水平方向座標Ｊ Ｈ／ Ｚ ６と、垂
山方向座優’Ｉ ｓ ／ ’／ ｅとを保持する。水平
線判定部４け、ｙ、とｙｅとの値を比較する。ｙ、と’
Ｉｅとが等しい場合には、その直線は水平線であると判
断し、等しくない場合知は傾きをもった線分であると判
断する。
Ｙ座標演算部２およびＸ喫漂演算部５は、それぞれ描画
する４碌の画素アドレスをＸ座標、Ｘ座標として出力す
る。Ｘ座標演算部３はさらに直線の始点／終点の情報と
、直線のＸ方向に対する描画方向とをマスク生成部５に
出力する。
する４碌の画素アドレスをＸ座標、Ｘ座標として出力す
る。Ｘ座標演算部３はさらに直線の始点／終点の情報と
、直線のＸ方向に対する描画方向とをマスク生成部５に
出力する。
マスク生成部５は水平線判定部４およびＸ座標演算部３
からの情報により、２ビツトのマスクデータを生成し、
フレームバッファメモリ８へこれを出力する。フレーム
バッファメモリ６はＣＲＴ表示用のピットマツプメモリ
であり、２画素単位での描画が可能である。よって、７
レームバツ７アメモリ８の描画に対するアドレスは、Ｘ
座標演算部ＳおよびＹ座標演算部２よりＸ座標、Ｙ座標
として指示される。各２画素単位において、どちらか一
方の画素に対する描画であるか、または両方の画素に対
する描画であるかは、マスク生成部６から出力される２
ビツトのマスクデータで指示すレル。７レームパツフア
メモリ８の内容は順次、読出され、表示部Ｔ上に表示さ
れる。
からの情報により、２ビツトのマスクデータを生成し、
フレームバッファメモリ８へこれを出力する。フレーム
バッファメモリ６はＣＲＴ表示用のピットマツプメモリ
であり、２画素単位での描画が可能である。よって、７
レームバツ７アメモリ８の描画に対するアドレスは、Ｘ
座標演算部ＳおよびＹ座標演算部２よりＸ座標、Ｙ座標
として指示される。各２画素単位において、どちらか一
方の画素に対する描画であるか、または両方の画素に対
する描画であるかは、マスク生成部６から出力される２
ビツトのマスクデータで指示すレル。７レームパツフア
メモリ８の内容は順次、読出され、表示部Ｔ上に表示さ
れる。
いま、始点／終点の（ｘ、ｙ）幅標が（１，０）／（４
、Ｏ）の場合について考える。
、Ｏ）の場合について考える。
このときの描画結果は第２図の斜線に示すように水平線
になり、どのときのマスクデータは第２図の（１） 、
（ＩＩ ） 、 （ｉｉｉ ）で示す値をとる。マス
クデータが％ＯＩのときには描画が禁止され、ｓｌｒの
ときには描画が許可される。このときの（ｚ、ｙ）描画
アドレスおよびマスクデータは、「８１発明の詳細な説
明」の末ＭＫ記載する第１表のようＫなり、３回のメモ
リサイクルで直線が描画される。
になり、どのときのマスクデータは第２図の（１） 、
（ＩＩ ） 、 （ｉｉｉ ）で示す値をとる。マス
クデータが％ＯＩのときには描画が禁止され、ｓｌｒの
ときには描画が許可される。このときの（ｚ、ｙ）描画
アドレスおよびマスクデータは、「８１発明の詳細な説
明」の末ＭＫ記載する第１表のようＫなり、３回のメモ
リサイクルで直線が描画される。
次に１始点／終点が（１，０）／（４，８）の場合につ
いて考える。
いて考える。
この直線は始点／終点のＹｌｌｔｌが等しくないため、
水平線判定部４によって水平線ではないと判定される。
水平線判定部４によって水平線ではないと判定される。
よって、Ｘ座標演算部ＳおよびＹ座標演算部２により、
１画素ずつ描画が行われる。このときの描画結果は第８
図の斜線に示すようになシ、マスクデータは第８図の（
１）〜（１■）で示す値をとる。このときの（、ｚ、ｙ
’）座標アドレスおよびマスクデータは「８１発明の詳
細な説明」の末尾に記載する第２表のようになシ、４回
のメモリサイクルで直線が描画される。
１画素ずつ描画が行われる。このときの描画結果は第８
図の斜線に示すようになシ、マスクデータは第８図の（
１）〜（１■）で示す値をとる。このときの（、ｚ、ｙ
’）座標アドレスおよびマスクデータは「８１発明の詳
細な説明」の末尾に記載する第２表のようになシ、４回
のメモリサイクルで直線が描画される。
（発明の効果）
以上説明したように本発明は、直線描画の際に水平線で
あるか否かを判断し、水平線であった場合には２画素以
上を同時に描画することによシ、水平直線の描画を高速
化できるという効果がある。
あるか否かを判断し、水平線であった場合には２画素以
上を同時に描画することによシ、水平直線の描画を高速
化できるという効果がある。
Ｄ ：
Ｏ進数
第１図は、本発明による図形表示装置の一実施例を示す
ブロック図である。 第２図は、第１図におｈて水平線の場合の描画例を示す
説明図である。 第ｓｒｇＪは、第１図において水平線ではない場合の描
画例を示す説明図である。 １＠−の入力処理部 ２・Φ・Ｙ座標演算部 ３・・φＸ座標演算部 ４・＠―水水平判定部 ５・争・ｉスフ生成部 ６・１１１＋７レームバツ７アメモリ Ｔ−−譬表示部
ブロック図である。 第２図は、第１図におｈて水平線の場合の描画例を示す
説明図である。 第ｓｒｇＪは、第１図において水平線ではない場合の描
画例を示す説明図である。 １＠−の入力処理部 ２・Φ・Ｙ座標演算部 ３・・φＸ座標演算部 ４・＠―水水平判定部 ５・争・ｉスフ生成部 ６・１１１＋７レームバツ７アメモリ Ｔ−−譬表示部
Claims (1)
- 直線描画の際に前記直線が水平線であるか否かを判定す
るための水平線判定手段と、表示部における水平方向に
対応した表示メモリ上の連続した２以上の画素を同時に
描画するための描画手段と、前記２以上の画素の内で他
の任意の画素に対する描画を禁止するためのマスク生成
手段と、前記直線上の２以上の画素の内で位置を検出し
て前記直線上の各点のアドレスを１点づつ発生するとと
もに前記水平線の描画の場合には前記２以上の画素の単
位にアドレスを発生するためのアドレス生成手段とを具
備して構成したことを特徴とする図形表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3466289A JPH02213936A (ja) | 1989-02-14 | 1989-02-14 | 図形表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3466289A JPH02213936A (ja) | 1989-02-14 | 1989-02-14 | 図形表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02213936A true JPH02213936A (ja) | 1990-08-27 |
Family
ID=12420650
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3466289A Pending JPH02213936A (ja) | 1989-02-14 | 1989-02-14 | 図形表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02213936A (ja) |
-
1989
- 1989-02-14 JP JP3466289A patent/JPH02213936A/ja active Pending
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