JPH0221614B2 - - Google Patents

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JPH0221614B2
JPH0221614B2 JP57214364A JP21436482A JPH0221614B2 JP H0221614 B2 JPH0221614 B2 JP H0221614B2 JP 57214364 A JP57214364 A JP 57214364A JP 21436482 A JP21436482 A JP 21436482A JP H0221614 B2 JPH0221614 B2 JP H0221614B2
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JP
Japan
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mode
register
value
arithmetic processing
address
Prior art date
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Expired - Lifetime
Application number
JP57214364A
Other languages
English (en)
Other versions
JPS59103146A (ja
Inventor
Yoshio Nakano
Yutaka Takano
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP57214364A priority Critical patent/JPS59103146A/ja
Publication of JPS59103146A publication Critical patent/JPS59103146A/ja
Publication of JPH0221614B2 publication Critical patent/JPH0221614B2/ja
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    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F7/00Methods or arrangements for processing data by operating upon the order or content of the data handled
    • G06F7/38Methods or arrangements for performing computations using exclusively denominational number representation, e.g. using binary, ternary, decimal representation
    • G06F7/48Methods or arrangements for performing computations using exclusively denominational number representation, e.g. using binary, ternary, decimal representation using non-contact-making devices, e.g. tube, solid state device; using unspecified devices

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  • Physics & Mathematics (AREA)
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  • Theoretical Computer Science (AREA)
  • Computational Mathematics (AREA)
  • Computing Systems (AREA)
  • Mathematical Analysis (AREA)
  • Mathematical Optimization (AREA)
  • Pure & Applied Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • Storage Device Security (AREA)
  • Microcomputers (AREA)

Description

【発明の詳細な説明】 産業上の利用分野 本発明はマイクロコンピユータなどの計算機シ
ステムにおける演算処理装置の動作モード表示を
行なう動作モード表示装置に関するものである。
従来例の構成とその問題点 マイクロコンピユータの発展に伴い、マイクロ
コンピユータシステムも大型し、処理内容も以前
の小型ミニコンピユータに匹敵する程度のものが
要求・実現されるようになつてきている。システ
ムの規模が小さい間はすべてを利用者管理にする
ことが可能であつたが、規模が大型化するに従い
利用者プログラムや周辺機器、主記憶などの資源
を管理し、より効率よく演算処理装置を稼働させ
るように制御する制御プログラムというものを導
入し、利用者管理を大幅に削減していくとが望ま
れる。この場合、利用者プログラムと制御プログ
ラムとはその処理内容の性格上扱える資源という
ものが厳然と区別される。この点を入出力管理と
いう側面を一例にして説明する。
計算機システムの持つ代表的な入出力装置とし
ては二次記憶装置がある。二次記憶装置上には、
プログラムやデータがフアイルという形で保持さ
れており、それらはシステムで定義された一定の
形式に従つて記録されている。この一定の形式と
いうものは利用者が管理するのではなく、制御プ
ログラムが管理し、利用者はフアイルの形式とい
うものを知らなくても良いようになつている。し
たがつて、二次記憶装置への入出力は、利用者プ
ログラムからは直接には行えず、必ず制御プログ
ラムを仲介するように構成しなければならない。
つまり、利用者プログラム実行中は入出力装置へ
のアクセスを禁止または無効にし、制御プログラ
ム実行中のみ入出力装置へのアクセスが許される
ようにハードウエア装置の制御を切換えることが
必要になる。
このように、ハードウエア装置の切換を指示す
るために、動作中のプログラムが特権プログラム
(制御プログラム)か非特権プログラム(利用者
プログラム)かを表示する動作モード表示装置と
いうものが必要となる。この動作モード表示とい
う機能はミニコンピユータ以上においては演算処
理装置自体が持つているが、現存し広範囲で使用
されているマイクロプロセツサには設計上の思想
またはLSI(大規模集積回路)化のためのピン数
制限のために、動作モード表示機能を持つていな
いので、高機能マイクロプロセツサシステムを構
築する上での大きな障害となつている。また特権
モードなるものが複数種類存在する場合もあり、
さらにはこの動作モードの変更によるハードウエ
アの切換は、プログラムの特権、非特権という性
格上、プログラムの分岐(動作モードの変更)と
同時にハードウエア的に行なわなければならな
い。
発明の目的 本発明は上記欠点に鑑み、演算処理装置自体に
動作モード表示機能のないシステムの動作モード
表示装置を提供することを目的とする。
発明の構成 本発明は上記目的を達するために予め設定され
たアドレスを命令コード読み込みサイクルとして
アクセスしたことを検出して、その際に定義づけ
られた動作モード値を動作モードレジスタに格納
し動作モードを表現させるようにしたものであ
る。
実施例の説明 以下図面を参照しながら、本発明の一実施例に
ついて説明する。
図は本発明の一実施例における動作モード表示
装置の構成を示すものである。
同図において、11は演算処理装置、12は主
記憶装置、13はデータ母線、14はアドレス母
線である。15,25はモード切換番地レジス
タ、19,29は設定モード値レジスタ、21は
演算処理装置11が主記憶装置12を命令コード
読み込みサイクルとしてアクセスしていることを
示す命令読み込み状態表示信号線(以下、フエツ
チ信号線と記す)、17はモードレジスタ、22
はモード退避レジスタ、16,26は制御部であ
る。
今、演算処理装置11はモードM1での実行が
許されているプログラムP1を実行中であり、モ
ードM2での実行が許されているプログラムP2
に分岐し、プログラムP2の処理終了後再びプロ
グラムP1に復帰しモードM1での処理を続行す
るものとする。
さて現在実行中のプログラムP1はモードM1
での実行が許されているので、プログラムP1で
の実行が開始されると同時にモードレジスタ17
には動作モードがM1であることを表示するため
にM1という値が格納されている。なお、モード
切換番地レジスタ15にはプログラムP2の実行
開始番地が設定モード値レジスタ19にはプログ
ラムP2の実行が許されているモード値M2が予
め設定されている。制御部16はフエツチ信号線
21が“1”の時にアドレス母線14の値とモー
ド切換番地レジスタ15の内容を比較し一致して
いなければモード切換信号線18に“0”を出力
し一致していればモード切換信号線18に“1”
を出力しこの信号“1”に同期してモードレジス
タ17の内容をモード表示信号線23を介してモ
ード退避レジスタ22に転送し、設定モード値レ
ジスタ19の内容を設定モードデータ線20を介
してモードレジスタ17に転送する。制御部26
も同様の機能を持つが現時点でのモード切換番地
レジスタ25および設定モード値レジスタ29の
内容は不定である。
モードM1で実行中のプログラムP1がモード
M2で実行可能なプログラムP2を呼び出すと、
演算処理装置11はプログラムP2の実行開始番
地をアドレス母線14に出し同時にフエツチ信号
線21に“1”を出力する。すると、制御部16
はモード切換番地レジスタ15の内容と同じ値が
アドレス母線14に命令のフエツチサイクルで出
力されたことを検出し、前述の機能により、モー
ド退避レジスタ22にはモードレジスタ17の内
容M1が格納され、モードレジスタ17には設定
モード値レジスタ19の内容M2が格納される。
これにより、プログラム制御がプログラムP1か
らプログラムP2に分岐したのち同時に演算処理
装置11の動作モード表示値もM1からM2に変
更することができる。
次にプログラムP2の処理が終了しプログラム
P1に復帰する時はモード退避レジスタ22の内
容を読み出し(現在はM1になつている)その値
を設定モード値レジスタ29に格納し呼び出し元
プログラムへの復帰番地をモード切換番地レジス
タ25に格納後、呼び出し元プログラムへの復帰
命令を実行すると、プログラムP2の実行開始時
と同様の機構により復帰番地に格納されている命
令をフエツチしプログラム制御がプログラムP2
からプログラムP1に復帰すると同時に動作モー
ド表示値もM2から呼び出し元プログラムの動作
モード表示値(今の場合M1)にもどすことがで
きる。
以上のように本実施例によれば、演算処理装置
1自体に動作モード表示機能のないものを使用し
た計算機システムにおいても動作モードというも
のによつて定義づけられるところのプログラムお
よびハードウエアの切換が同時に行なえモードの
異なるプログラムへの分岐をせずに不当にモード
を変更してアクセスの許されていない資源へのア
クセス権を得ることを防止することができる。
なお本実施例では、モード切換番地レジスタ1
5,25設定モード値レジスタ19,29および
制御部16,26は各2組としたが各3組以上持
つ構成も可能である。また、動作モードを変更し
た後の復帰モード値、つまり本実施例における設
定モード値レジスタ29に設定する値が常に予め
分かつている値であるならば、モード退避レジス
タ23を省略することも可能である。
またモード表示信号線23にLED等を接続し
て表示状態を分るようにしてもよい。
また、動作モードが複数定義されている場合、
プログラム自体のネステイングと同様に動作モー
ド自体もネステイング構造にすることも可能であ
り、モード退避レジスタ22の内容を参照するこ
とにより、呼び出し元プログラムのモードを確認
することができるので、動作モード自体が階層構
造を形成している場合の不当な呼び出し、例えば
下位レベルからP1−P2−P3とあつた場合で
もプログラムP1からプログラムP3への越し呼
び出しなどを検出することができる。
発明の効果 本発明の動作モード表示装置は以上のように予
め設定されたアドレスを命令コード読み込みサイ
クルとしてアクセスしたことを検出し、その場合
に定義づけられた動作モード値を動作モード表示
レジスタに格納する制御部を設けることにより、
動作モード表示機能を持たない演算処理装置を用
いた計算機システムにおいても、動作モードの異
なるプログラムに処理が移つた瞬間に動作モード
表示値を変更することができ、その価値は大なる
ものがある。
【図面の簡単な説明】
図は本発明の一実施例である動作モード表示装
置のブロツク図である。 11……演算処理装置、12……主記憶装置、
15,25……モード切換番地レジスタ、16,
26……制御部、17……モードレジスタ、1
9,29……設定モード値レジスタ、22……モ
ード退避レジスタ。

Claims (1)

  1. 【特許請求の範囲】 1 演算処理を行なう演算処理装置と、前記演算
    処理装置が実行するプログラムを保持する主記憶
    装置と、前記演算処理装置の動作モードを表示す
    るモードレジスタと、モードの切換えられる番地
    の値が格納されているモード切換番地レジスタ
    と、切換えられるモードの値が格納されている設
    定モード値レジスタと、前記演算処理装置が前記
    主記憶装置を命令コード読み込みサイクルとして
    出力したアドレス値と前記モード切換番地レジス
    タの内容とを比較し一致していれば前記設定モー
    ド値レジスタの内容を前記モードレジスタに格納
    する制御部とを具備する動作モード表示装置。 2 モード切換番地レジスタ、設定モード値レジ
    スタおよび制御部を複数組有することを特徴とす
    る特許請求の範囲第1項記載の動作モード表示装
    置。 3 演算処理を行なう演算処理装置と、前記演算
    処理装置が実行するプログラムを保持する主記憶
    装置と、前記演算処理装置の動作モードを表示す
    るモードレジスタと、モードの切換えられる番地
    の値が格納されているモード切換番地レジスタ
    と、切換えられるモードの値が格納されている設
    定モード値レジスタと、モード退避レジスタと、
    前記演算処理装置が前記主記憶装置を命令コード
    読み込みサイクルとして出力したアドレス値と前
    記モード切換番地レジスタの内容とを比較し、一
    致していれば前記モードレジスタの内容を前記モ
    ード退避レジスタに格納後、前記設定モード値レ
    ジスタの内容を前記モードレジスタに格納する制
    御部とを有することを特徴とする動作モード表示
    装置。 4 モード切換番地レジスタ、設定モード値レジ
    スタおよび制御部を複数組有することを特徴とす
    る特許請求の範囲第3項記載の動作モード表示装
    置。
JP57214364A 1982-12-06 1982-12-06 動作モ−ド表示装置 Granted JPS59103146A (ja)

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JP57214364A JPS59103146A (ja) 1982-12-06 1982-12-06 動作モ−ド表示装置

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Application Number Priority Date Filing Date Title
JP57214364A JPS59103146A (ja) 1982-12-06 1982-12-06 動作モ−ド表示装置

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JPS59103146A JPS59103146A (ja) 1984-06-14
JPH0221614B2 true JPH0221614B2 (ja) 1990-05-15

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Application Number Title Priority Date Filing Date
JP57214364A Granted JPS59103146A (ja) 1982-12-06 1982-12-06 動作モ−ド表示装置

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Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62105237A (ja) * 1985-10-31 1987-05-15 Nec Corp マイクロプログラム制御装置
JPH0516679U (ja) * 1991-08-12 1993-03-02 調 内田 多用途テイツシユペーパーケースの保持具

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS53132240A (en) * 1977-04-25 1978-11-17 Hitachi Ltd Processing mode selection system
JPS57120300A (en) * 1981-01-20 1982-07-27 Canon Inc Program protection system

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JPS59103146A (ja) 1984-06-14

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