JPH02224583A - 画面表示装置 - Google Patents
画面表示装置Info
- Publication number
- JPH02224583A JPH02224583A JP1047517A JP4751789A JPH02224583A JP H02224583 A JPH02224583 A JP H02224583A JP 1047517 A JP1047517 A JP 1047517A JP 4751789 A JP4751789 A JP 4751789A JP H02224583 A JPH02224583 A JP H02224583A
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- JP
- Japan
- Prior art keywords
- display
- signal
- control circuit
- circuit
- video signal
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- Studio Circuits (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
この発明は、ブラウン管などの表示装置に表示されでい
る放送画像中に、チャンネル番号等の文字やパターンを
表示させる画面表示装置に関するものである。
る放送画像中に、チャンネル番号等の文字やパターンを
表示させる画面表示装置に関するものである。
［従来の技術］
第３図に従来のこの種の画面表示装置の構成の一例を示
す。第３図において、１はπ型ＬＣ発振回路１ａの発振
出力が供給される表示用発振回路、２は上記表示用発振
回路１で発振させた信号で各種タイミングを発生するタ
イミングジェネレータ。
す。第３図において、１はπ型ＬＣ発振回路１ａの発振
出力が供給される表示用発振回路、２は上記表示用発振
回路１で発振させた信号で各種タイミングを発生するタ
イミングジェネレータ。
３はこのタイミングジェネレータ２の出力と本画面表示
装置を制御するための図示しないマイコン等から各入力
端子３８〜３ｃに入力される制御データ（表示オン、オ
フ等のコマンドやキャラクタコード）とを入力する入力
制御回路、４はデータ制御回路、５はアドレス制御回路
、７は制御データを記憶する表示用データメモリで、Ｒ
ＡＭよりなる。８は表示すべき文字たパターン等を第４
図に示す字体構成で記憶する表示キャラクタメモリで、
ＲＯＭよりなる。６は入力制御回路３の出力のうち表示
制御等のコマンドをラッチする表示制御レジスタ、９は
端子９ａ、９ｂに供給される画像信号の水平、垂直同期
信号、又は内部で発生させた水平、垂直同期信号のいず
れか一方の同期信号を選択的に出力する同期信号切換回
路、１１は上記表示装置における文字やパターン等の表
示位置を検出するための表示位置検出回路、１２は上記
表示用データメモリ７から表示すべきキャラクタのデー
タを読出す読出しアドレス制御回路、１３は表示制御回
路で、表示キャラクタメモリ８の出力を表示制御レジス
タ６の表示命令に応じて表示制御を行なうものである０
本画面表示装置は以上の各回路により構成されており、
表示制御回路１３の出力は、ビデオミキサー１７に供給
され、このビデオミキサー１７よりＣＶＩＤＥＯ端子１
７ａを介してビデオ信号が出力される。また表示制御回
路１３からは、Ｒ，Ｇ、Ｂの色信号等が端子１３ａ〜１
３ｆを介して出力される。１０はＨカウンタ、１４はシ
フトレジスタ、１５は発振素子回路１５ａの発振出力が
供給される同期信号発生用発振回路、１６は同期信号発
生用タイミングジェネレータ、２１はブリンキング回路
である。
装置を制御するための図示しないマイコン等から各入力
端子３８〜３ｃに入力される制御データ（表示オン、オ
フ等のコマンドやキャラクタコード）とを入力する入力
制御回路、４はデータ制御回路、５はアドレス制御回路
、７は制御データを記憶する表示用データメモリで、Ｒ
ＡＭよりなる。８は表示すべき文字たパターン等を第４
図に示す字体構成で記憶する表示キャラクタメモリで、
ＲＯＭよりなる。６は入力制御回路３の出力のうち表示
制御等のコマンドをラッチする表示制御レジスタ、９は
端子９ａ、９ｂに供給される画像信号の水平、垂直同期
信号、又は内部で発生させた水平、垂直同期信号のいず
れか一方の同期信号を選択的に出力する同期信号切換回
路、１１は上記表示装置における文字やパターン等の表
示位置を検出するための表示位置検出回路、１２は上記
表示用データメモリ７から表示すべきキャラクタのデー
タを読出す読出しアドレス制御回路、１３は表示制御回
路で、表示キャラクタメモリ８の出力を表示制御レジス
タ６の表示命令に応じて表示制御を行なうものである０
本画面表示装置は以上の各回路により構成されており、
表示制御回路１３の出力は、ビデオミキサー１７に供給
され、このビデオミキサー１７よりＣＶＩＤＥＯ端子１
７ａを介してビデオ信号が出力される。また表示制御回
路１３からは、Ｒ，Ｇ、Ｂの色信号等が端子１３ａ〜１
３ｆを介して出力される。１０はＨカウンタ、１４はシ
フトレジスタ、１５は発振素子回路１５ａの発振出力が
供給される同期信号発生用発振回路、１６は同期信号発
生用タイミングジェネレータ、２１はブリンキング回路
である。
次に動作について説明する。入力制御回路３は、マイコ
ン等から端子３８〜３ｃを介して入力される制御データ
を処理して、表示制御等のコマンドを表示制御レジスタ
６にラッチさせ、表示内容であるキャラクタコード等を
表示用データメモリ７に記憶させる。表示時は、表示用
データメモリ７に記憶したキャラクタコードが出力デー
タとして表示キャラクタメモリ８をアクセスし、このキ
ャラクタメモリ８により出力される表示文字フォントを
表示制御回路１３へ入力する。ここで表示用データメモ
リ７は、１ワードが（ａ＋ｂ）ビット。
ン等から端子３８〜３ｃを介して入力される制御データ
を処理して、表示制御等のコマンドを表示制御レジスタ
６にラッチさせ、表示内容であるキャラクタコード等を
表示用データメモリ７に記憶させる。表示時は、表示用
データメモリ７に記憶したキャラクタコードが出力デー
タとして表示キャラクタメモリ８をアクセスし、このキ
ャラクタメモリ８により出力される表示文字フォントを
表示制御回路１３へ入力する。ここで表示用データメモ
リ７は、１ワードが（ａ＋ｂ）ビット。
その表示文字数をＣとすると合計（ａ＋ｂ） ・Ｃビ
ットで構成されている。一方、表示キャラクタメモリ８
は１フオントが（ＪＩＸｍ）ビットで構成されており、
その種類がｎキャラクタ分存在しているものとする。
ットで構成されている。一方、表示キャラクタメモリ８
は１フオントが（ＪＩＸｍ）ビットで構成されており、
その種類がｎキャラクタ分存在しているものとする。
また、表示時のタイミングは画像信号からの同期信号を
同期信号切換回路９に入力し、この同期信号をＨカウン
タ１０でカウントし、このカウント値に基づき表示位置
検出回路１１によって表示文字の位置を決定する。表示
制御回路１３では表示文字出力を外部の映像信号に同期
させ、表示制御レジスタ６の内容に従って表示制御して
表示信号を生成し、この表示信号を出力してビデオミキ
サー１７に供給する。また、上記表示信号とは別にＲ，
Ｇ、Ｂの色信号であるＲＧＢ信号を上記表示制御レジス
タ６からの信号に基づいて生成し、上記ＲＧＢ信号を各
ポート端子１３ａ〜１３ｃから出力する。
同期信号切換回路９に入力し、この同期信号をＨカウン
タ１０でカウントし、このカウント値に基づき表示位置
検出回路１１によって表示文字の位置を決定する。表示
制御回路１３では表示文字出力を外部の映像信号に同期
させ、表示制御レジスタ６の内容に従って表示制御して
表示信号を生成し、この表示信号を出力してビデオミキ
サー１７に供給する。また、上記表示信号とは別にＲ，
Ｇ、Ｂの色信号であるＲＧＢ信号を上記表示制御レジス
タ６からの信号に基づいて生成し、上記ＲＧＢ信号を各
ポート端子１３ａ〜１３ｃから出力する。
なお、同期信号発生用発振回路１５は１発振素子回路１
５ａによりＮＴＳＣ方式又はＰＡＬ方式の同期信号の発
生が可能であり、この切換えをＮ／Ｐ端子１５ｂからの
信号で行い、これにより４ｆｓｃ又は２ｆｓｃの発振を
出力し、同期信号発生用タイミングジェネレータ１６で
同期信号の発生をするので、無信号時でもＴＶ画面に表
示が可能である。
５ａによりＮＴＳＣ方式又はＰＡＬ方式の同期信号の発
生が可能であり、この切換えをＮ／Ｐ端子１５ｂからの
信号で行い、これにより４ｆｓｃ又は２ｆｓｃの発振を
出力し、同期信号発生用タイミングジェネレータ１６で
同期信号の発生をするので、無信号時でもＴＶ画面に表
示が可能である。
また、ビデオミキサー１７により、ＮＴＳＣ方式及びＰ
ＡＬ方式の複合ビデオ信号の発生と外部の複合ビデオ信
号へのスーパインポーズが可能である。複合ビデオ信号
は、キャラクタレベル（ＬＥＣＨＡ）、外部複合ビデオ
入力（ＣＶＩＮ）、ブランキングレベル（ＬＥＢＫ）、
背景搬送色信号入力（Ｒ３ＩＮ）、カラーバースト入力
（ＣＢＩＮ）及びシンクチップレベルの六つの信号をア
ナログスイッチで切換えて出力する。
ＡＬ方式の複合ビデオ信号の発生と外部の複合ビデオ信
号へのスーパインポーズが可能である。複合ビデオ信号
は、キャラクタレベル（ＬＥＣＨＡ）、外部複合ビデオ
入力（ＣＶＩＮ）、ブランキングレベル（ＬＥＢＫ）、
背景搬送色信号入力（Ｒ３ＩＮ）、カラーバースト入力
（ＣＢＩＮ）及びシンクチップレベルの六つの信号をア
ナログスイッチで切換えて出力する。
［発明が解決しようとする課題］
従来の画面表示装置は以上のように構成されており、Ｒ
ＧＢ信号を出力するとそれに応じた複合ビデオ信号も出
力されてしまい、例えば複合ビデオ信号によりＶＴＲを
制御し、かつＲＧＢ信号でＶＴＲカメラのファインダー
画面を制御するなど表示する内容に応じて出力される各
信号に対する機器を別個に制御することができず、上記
各信号の用途が限定されるなどの問題点があった。
ＧＢ信号を出力するとそれに応じた複合ビデオ信号も出
力されてしまい、例えば複合ビデオ信号によりＶＴＲを
制御し、かつＲＧＢ信号でＶＴＲカメラのファインダー
画面を制御するなど表示する内容に応じて出力される各
信号に対する機器を別個に制御することができず、上記
各信号の用途が限定されるなどの問題点があった。
この発明は上記のような問題点を解消するためになされ
たもので、上記複合ビデオ信号とＲＧＢ信号とをそれぞ
れ別個にオン、オフ制御できる画面表示装置を得ること
を目的とする。
たもので、上記複合ビデオ信号とＲＧＢ信号とをそれぞ
れ別個にオン、オフ制御できる画面表示装置を得ること
を目的とする。
［課題を解決するための手段］
この発明に係る画面表示装置において１表示制御回路は
、複合ビデオ信号を出力するビデオミキサーと’ＲＧ
Ｂ信号を出力するポート出力制御回路とをそれぞれ制御
して、上記複合ビデオ信号とＲＧＢ信号とを別個にオン
、オフする出力制御手段を有し、かつ表示制御レジスタ
は、上記出力制御手段を制御する出力制御レジスタを有
するものである。
、複合ビデオ信号を出力するビデオミキサーと’ＲＧ
Ｂ信号を出力するポート出力制御回路とをそれぞれ制御
して、上記複合ビデオ信号とＲＧＢ信号とを別個にオン
、オフする出力制御手段を有し、かつ表示制御レジスタ
は、上記出力制御手段を制御する出力制御レジスタを有
するものである。
［作用］
この発明における画面表示装置は、表示制御レジスタの
出力制御レジスタにより出力制御手段を制御し、ビデオ
ミキサーから出力される複合ビデオ信号及びポート出力
制御回路から出力されるＲＧＢ信号とをそれぞれオン、
オフ制御し、複合ビデオ信号及びＲＧＢ信号に応じた機
器へ個別に出力する。
出力制御レジスタにより出力制御手段を制御し、ビデオ
ミキサーから出力される複合ビデオ信号及びポート出力
制御回路から出力されるＲＧＢ信号とをそれぞれオン、
オフ制御し、複合ビデオ信号及びＲＧＢ信号に応じた機
器へ個別に出力する。
［実施例］
以下、この発明の一実施例を第１図及び第２図を用いて
説明する。なお、第３図及び第４図と同じものは同一の
符号を用いて説明を省略する。
説明する。なお、第３図及び第４図と同じものは同一の
符号を用いて説明を省略する。
１８は各種内部ビデオ信号を発生させビデオミキサー１
７に出力するビデオ信号発生回路、１９は表示制御回路
から出力されるＲＯＢ信号又は表示制御レジスタ６から
出力されるデータをポート出力端子１９ａ〜１９ｆから
出力するポート出力制御回路である。表示制御回路１３
は、複合ビデオ信号を出力するビデオミキサー１７とＲ
ＯＢ信号を出力する上記ポート出力制御回路１９とをそ
れぞれ制御し、上記複合ビデオ信号とＲＧＢ信号とを別
個にオン、オフする出力制御手段１３ａを有する。また
、表示制御レジスタ６は、上記出力制御手段１３ａを制
御する出力制御レジスタ６１を有する。この出力制御レ
ジスタ６１は、上記ビデオミキサー１７の出力を制御す
るＶフラグエリア６１ａと、上記ポート出力制御回路１
９の出力を制御するＰフラグエリア６１ｂと、ポート出
力制御回路１９にデータを出力するためのデータエリア
６１ｃとからなる。
７に出力するビデオ信号発生回路、１９は表示制御回路
から出力されるＲＯＢ信号又は表示制御レジスタ６から
出力されるデータをポート出力端子１９ａ〜１９ｆから
出力するポート出力制御回路である。表示制御回路１３
は、複合ビデオ信号を出力するビデオミキサー１７とＲ
ＯＢ信号を出力する上記ポート出力制御回路１９とをそ
れぞれ制御し、上記複合ビデオ信号とＲＧＢ信号とを別
個にオン、オフする出力制御手段１３ａを有する。また
、表示制御レジスタ６は、上記出力制御手段１３ａを制
御する出力制御レジスタ６１を有する。この出力制御レ
ジスタ６１は、上記ビデオミキサー１７の出力を制御す
るＶフラグエリア６１ａと、上記ポート出力制御回路１
９の出力を制御するＰフラグエリア６１ｂと、ポート出
力制御回路１９にデータを出力するためのデータエリア
６１ｃとからなる。
上記構成において、外付制御装置から入力制御回路３を
介して出力制御レジスタ６１のＶフラグエリア６１ａに
′″１″が入力されると、出力制御手段１３ａによりビ
デオミキサー１７の図示しない出力ポートを開き、ＣＶ
ＩＤＥＯ端子１７ａを介して複合ビデオ信号が出力され
る。次にＰフラグエリア６１ｂに１′″が入力されると
、出力制御手段１３ａによりポート出力制御回路１９の
図示しない出力ポートを開き、ポート端子１９ａ〜１９
ｃを介してＲＧＢ信号が出力される。すなわち、複合ビ
デオ信号及びＲＧＢ信号を出力する機器の使用状態に応
じて、上記各信号の出力をオン。
介して出力制御レジスタ６１のＶフラグエリア６１ａに
′″１″が入力されると、出力制御手段１３ａによりビ
デオミキサー１７の図示しない出力ポートを開き、ＣＶ
ＩＤＥＯ端子１７ａを介して複合ビデオ信号が出力され
る。次にＰフラグエリア６１ｂに１′″が入力されると
、出力制御手段１３ａによりポート出力制御回路１９の
図示しない出力ポートを開き、ポート端子１９ａ〜１９
ｃを介してＲＧＢ信号が出力される。すなわち、複合ビ
デオ信号及びＲＧＢ信号を出力する機器の使用状態に応
じて、上記各信号の出力をオン。
オフできる。例えば、複合ビデオ信号をＶＴＲに出力し
たあと、この複合ビデオ信号と別の表示内容のＲＧＢ信
号をＶＴＲのカメラのファインダー画面に出力すること
により、ＶＴＲとカメラに異なる表示を行うことができ
、機器の使用用途が広がる。
たあと、この複合ビデオ信号と別の表示内容のＲＧＢ信
号をＶＴＲのカメラのファインダー画面に出力すること
により、ＶＴＲとカメラに異なる表示を行うことができ
、機器の使用用途が広がる。
［発明の効果］
以上のように、この発明によれば画面表示装置を、複合
ビデオ信号を出力するビデオミキサーとＲＧＢ信号を出
力するポート出力制御回路とをそれぞれ制御して、上記
複合ビデオ信号とＲＧＢ信号とを別個にオン、オフする
出力制御手段を有する表示制御回路と、上記出力制御手
段を制御する出力制御レジスタを有する表示レジスタと
を設けたので、上記複合ビデオ信号とＲＯＢ信号とをそ
れぞれオン、オフ制御でき、使用する機器に応じた内容
の信号を個別に出力して、機器の使用用途を広げられる
。
ビデオ信号を出力するビデオミキサーとＲＧＢ信号を出
力するポート出力制御回路とをそれぞれ制御して、上記
複合ビデオ信号とＲＧＢ信号とを別個にオン、オフする
出力制御手段を有する表示制御回路と、上記出力制御手
段を制御する出力制御レジスタを有する表示レジスタと
を設けたので、上記複合ビデオ信号とＲＯＢ信号とをそ
れぞれオン、オフ制御でき、使用する機器に応じた内容
の信号を個別に出力して、機器の使用用途を広げられる
。
第１図及び第２図はこの発明の一実施例である画面表示
装置の構成図及び部分ブロック図、第３図は従来の画面
表示装置の構成図、第４図は表示キャラクタの構成を示
す図である。 １・・・表示用発振回路、２・・・タイミングジェネレ
ータ、３・・・入力制御回路、４・・・データ制御回路
、５・・・アドレス制御回路、６・・・表示制御レジス
タ、７・・・表示用データメモリ、８・・・表示キャラ
クタメモリ、９・・・同期信号切換回路、１０・・・Ｈ
カウンタ、１１・・・表示検出回路、１３・・・表示制
御回路、１３ａ・・・出力制御手段、１７・・・ビデオ
ミキサー。 １８・・・ビデオ信号発生回路、１９・・・ポート出力
制御回路、６１・・・出力制御レジスタ。
装置の構成図及び部分ブロック図、第３図は従来の画面
表示装置の構成図、第４図は表示キャラクタの構成を示
す図である。 １・・・表示用発振回路、２・・・タイミングジェネレ
ータ、３・・・入力制御回路、４・・・データ制御回路
、５・・・アドレス制御回路、６・・・表示制御レジス
タ、７・・・表示用データメモリ、８・・・表示キャラ
クタメモリ、９・・・同期信号切換回路、１０・・・Ｈ
カウンタ、１１・・・表示検出回路、１３・・・表示制
御回路、１３ａ・・・出力制御手段、１７・・・ビデオ
ミキサー。 １８・・・ビデオ信号発生回路、１９・・・ポート出力
制御回路、６１・・・出力制御レジスタ。
Claims (1)
- 【特許請求の範囲】 ブラウン管などの表示装置に文字やパターン等を表示さ
せる画面表示装置において、 各種のタイミングの基準となる信号を発生する発振回路
と、上記発振回路の発振信号に基づいて各種のタイミン
グ信号を発生するタイミングジェネレータと、マイクロ
コンピュータ等の外付制御回路からの制御信号を受け入
れて処理する入力制御回路と、上記表示装置に写し出す
映像信号の同期信号を入力する同期信号切換回路と、こ
の同期信号をカウントして上記表示装置の表示位置を検
出する表示位置検出回路と、上記入力制御回路により処
理され上記表示装置に表示されるべき文字、パターンの
コードやブリンキング情報等の制御データを記憶する表
示用データメモリと、上記表示内容として表示される文
字の字体フォントを記憶する表示キャラクタメモリと、
表示信号の色を設定するための各内部ビデオ信号を発生
させるビデオ信号発生回路と、上記表示位置検出回路か
らの位置検出信号により表示装置の所定の位置に表示内
容を表示すべく各モード回路からの所定の表示信号及び
Ｒ、Ｇ、Ｂの色信号であるＲＧＢ信号を出力する表示制
御回路と、この表示制御回路からの表示信号と上記映像
信号とをミキシングした複合ビデオ信号を出力するビデ
オミキサーと、上記外付制御回路から上記入力制御回路
に入力されるデータを保持する表示制御レジスタと、こ
の表示制御レジスタからのデータ又は上記表示制御回路
からのＲＧＢ信号を各ポート端子から出力するポート出
力制御回路とを備え、上記表示制御回路は、上記ビデオ
ミキサーとポート出力制御回路とをそれぞれ制御し、上
記複合ビデオ信号とＲＧＢ信号とを別個にオン、オフす
る出力制御手段を有し、かつ上記表示制御レジスタは、
上記出力制御手段を制御する出力制御レジスタを有する
ことを特徴とする画面表示装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1047517A JPH02224583A (ja) | 1989-02-27 | 1989-02-27 | 画面表示装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1047517A JPH02224583A (ja) | 1989-02-27 | 1989-02-27 | 画面表示装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH02224583A true JPH02224583A (ja) | 1990-09-06 |
Family
ID=12777301
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1047517A Pending JPH02224583A (ja) | 1989-02-27 | 1989-02-27 | 画面表示装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH02224583A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6288488A (ja) * | 1985-10-15 | 1987-04-22 | Mitsubishi Electric Corp | 映像処理装置 |
-
1989
- 1989-02-27 JP JP1047517A patent/JPH02224583A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6288488A (ja) * | 1985-10-15 | 1987-04-22 | Mitsubishi Electric Corp | 映像処理装置 |
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