JPH02257295A - バーコード読取り方法及びその装置 - Google Patents
バーコード読取り方法及びその装置Info
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- JPH02257295A JPH02257295A JP1079379A JP7937989A JPH02257295A JP H02257295 A JPH02257295 A JP H02257295A JP 1079379 A JP1079379 A JP 1079379A JP 7937989 A JP7937989 A JP 7937989A JP H02257295 A JPH02257295 A JP H02257295A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔目次〕
〔概要〕
〔産業上の利用分野〕
〔従来の技術〕
〔発明が解決しようとする課題〕
〔課題を解決するための手段〕
原理ブロック図(第1図)
〔実施例〕
本発明の一実施例(第2図乃至第4図)〔発明の効果〕
〔概 要〕
アドオン(ADD−ON)コードなどの特殊バーコード
を付加したバーコードの読取り方法及びその装置に関し
、 2以上のバーコード体系から構成されるバーコードのデ
ータを読み取ることを目的とし、バーコードの走査を第
1のバーコード側から該第1のバーコードとは異なるバ
ーコード体系の第2のバーコード側へ、又は逆方向へ行
ない、その走査において読み取られたバーコードのデー
タの各々を順次に格納し、その格納最中に現れる右バー
コードブロックの右端のガードバ−2又は前記逆方向に
おいてはセンターバーを認識し、認識時における前記格
納のためのアドレスを前記格納された第2のバーコード
のデータへのアクセスに用いるようにして構成し、記憶
装置と、データ入力回路と、書込みアドレス発生回路と
、カウンタと、右バーコードブロック右端のガードバ−
又はセンターバー読取検出回路とを設けて検出回路の出
力に応答してアドレス発生回路から出力されるアドレス
を記憶装置に記憶されているバーコードのデータのアク
セスに用いるように構成した。
を付加したバーコードの読取り方法及びその装置に関し
、 2以上のバーコード体系から構成されるバーコードのデ
ータを読み取ることを目的とし、バーコードの走査を第
1のバーコード側から該第1のバーコードとは異なるバ
ーコード体系の第2のバーコード側へ、又は逆方向へ行
ない、その走査において読み取られたバーコードのデー
タの各々を順次に格納し、その格納最中に現れる右バー
コードブロックの右端のガードバ−2又は前記逆方向に
おいてはセンターバーを認識し、認識時における前記格
納のためのアドレスを前記格納された第2のバーコード
のデータへのアクセスに用いるようにして構成し、記憶
装置と、データ入力回路と、書込みアドレス発生回路と
、カウンタと、右バーコードブロック右端のガードバ−
又はセンターバー読取検出回路とを設けて検出回路の出
力に応答してアドレス発生回路から出力されるアドレス
を記憶装置に記憶されているバーコードのデータのアク
セスに用いるように構成した。
本発明は、アドオン(ADD−ON)コードなどのバー
コード体系の異なるバーコードを付加したバーコードの
読取り方法及びその装置に関する。
コード体系の異なるバーコードを付加したバーコードの
読取り方法及びその装置に関する。
情報処理システムにおけるPOSシステム(販売時点処
理システム)において処理される商品には、バーコード
を印刷したラベルが添付されている。そのバーコードは
、商品の販売処理に必要な情報を帯有せしめてラベル上
に印刷されている。
理システム)において処理される商品には、バーコード
を印刷したラベルが添付されている。そのバーコードは
、商品の販売処理に必要な情報を帯有せしめてラベル上
に印刷されている。
商品の販売に際しては、その商品のラベルをバーコード
スキャナに対して所定の位置関係を保って移動させて読
み取り、読み取られたバーコード信号をデコードして得
られる情報を商品の販売処理に用いている。
スキャナに対して所定の位置関係を保って移動させて読
み取り、読み取られたバーコード信号をデコードして得
られる情報を商品の販売処理に用いている。
従来のPOSシステムにおいて、商品に添付されるラベ
ルに印刷されるバーコードは、バーコード体系を同じく
するバーコードのみであり、それに伴ってPOSシステ
ム内におけるバーコード読取り系も又、そのバーコード
だけが読み取り得るように構成されていた。
ルに印刷されるバーコードは、バーコード体系を同じく
するバーコードのみであり、それに伴ってPOSシステ
ム内におけるバーコード読取り系も又、そのバーコード
だけが読み取り得るように構成されていた。
上述のようなラベルに印刷されるバーコードとして、別
バーコード体系のバーコードを付加して成るバーコード
をラベルに印刷して上述のPOSシステムにおいて用い
ようとする要求がある。このような場合に、2又は2以
上のバーコード体系で構成されるバーコードを従来PO
Sシステムのバーコード読取り系で読み取ろうとしても
、そのバーコード読取り系をそのままにして置いたので
は読み取られたバーコード信号からそのバーコードに与
えられている情報を正しくデコードすることは出来ない
。
バーコード体系のバーコードを付加して成るバーコード
をラベルに印刷して上述のPOSシステムにおいて用い
ようとする要求がある。このような場合に、2又は2以
上のバーコード体系で構成されるバーコードを従来PO
Sシステムのバーコード読取り系で読み取ろうとしても
、そのバーコード読取り系をそのままにして置いたので
は読み取られたバーコード信号からそのバーコードに与
えられている情報を正しくデコードすることは出来ない
。
本発明は、斯かる問題点に鑑みて創作されたもので、2
以上のバーコード体系から構成されるバーコードを読み
取り得るバーコード読取り方法及びその装置を提供する
ことをその目的とする。
以上のバーコード体系から構成されるバーコードを読み
取り得るバーコード読取り方法及びその装置を提供する
ことをその目的とする。
第1の発明は、左右のバーコードブロック間にセンター
バーを、左バーコードブロックの左端及び右バーコード
ブロックの右端にガードバ−を付加した第1のバーコー
ドと、前記右バーコードブロックの右端に付加されたガ
ードバ−に続けて設けられる前記第1のバーコードとは
異なるバーコード体系の第2のバーコードとから成るバ
ーコードの走査を前記第1のバーコード側から前記第2
のバーコード側へ行ない、その走査において読み取られ
たバーコードのデータの各々を順次に格納し、その格納
最中に現れる前記右バーコードブロックの右端のガード
バ−を認識し、該認識時における前記格納のためのアド
レスを前記格納された第2のバーコードのデータへのア
クセスに用いるようにして構成される。第2の発明は、
左右のバーコードブロック間にセンターバーを、左バー
コードブロックの左端及び右バーコードブロックの右端
にガードバ−を付加した第1のバーコードと、前記右バ
ーコードブロックの右端に付加されたガードバ−に続け
て設けられる前記第1のバーコードとは異なるバーコー
ド体系の第2のバーコードとから成るバーコードの走査
を前記第2のバーコード側から前記第1のバーコード側
へ行ない、その走査において読み取られたバーコードの
データの各々を順次に格納し、その格納最中に現れる前
記センターバーを認識し、該認識時における前記格納の
ためのアドレスを前記格納された第2のバーコードのデ
ータへのアクセスに用いるようにして構成される。第3
の発明は、第1図(そのl)に示されるように、記憶袋
W2と、バーコードデータを前記記憶装置2へ入力させ
るデータ入力回路4と、バーコードのキャラクタを表す
信号に応答して前記バーコードデータのためのアドレス
を順次に発生する書込みアドレス発生回路6と、前記バ
ーコードのキャラクタを表す信号をカウント入力に受け
るカウンタ8と、第1のバーコード側から第2のバーコ
ード側への読取りにおいて該第1のバーコード内の右バ
ーコードブロック右端のガードバ−の読取りを検出する
検出回路lOとを設け、該検出回路lOの出力に応答し
て前記書込みアドレス発生回路6から出力されるアドレ
スを前記記憶装置2に記憶されている前記第2のバーコ
ードのデータのアクセスに用いるようにして構成される
。第4の発明は、第1図(その2)に示されるように、
記憶装置2と、バーコードデータを前記記憶装置2へ入
力させるデータ入力回路4と、バーコードのキャラクタ
を表す信号に応答して前記バーコードデータのためのア
ドレスを順次に発生する書込みアドレス発生回路6と、
第2のバーコード側から該バーコード体系の異なる第1
のバーコード側への読取りにおいて該第1のバーコード
内のセンターバーの読取りを検出する検出回路14と、
該検出回路14の出力に応答して前記書込みアドレス発
生回路6から出力されるアドレスを前記記憶装置2に記
憶されている前記第2のバーコードのデータのアクセス
に用いるようにして構成される。
バーを、左バーコードブロックの左端及び右バーコード
ブロックの右端にガードバ−を付加した第1のバーコー
ドと、前記右バーコードブロックの右端に付加されたガ
ードバ−に続けて設けられる前記第1のバーコードとは
異なるバーコード体系の第2のバーコードとから成るバ
ーコードの走査を前記第1のバーコード側から前記第2
のバーコード側へ行ない、その走査において読み取られ
たバーコードのデータの各々を順次に格納し、その格納
最中に現れる前記右バーコードブロックの右端のガード
バ−を認識し、該認識時における前記格納のためのアド
レスを前記格納された第2のバーコードのデータへのア
クセスに用いるようにして構成される。第2の発明は、
左右のバーコードブロック間にセンターバーを、左バー
コードブロックの左端及び右バーコードブロックの右端
にガードバ−を付加した第1のバーコードと、前記右バ
ーコードブロックの右端に付加されたガードバ−に続け
て設けられる前記第1のバーコードとは異なるバーコー
ド体系の第2のバーコードとから成るバーコードの走査
を前記第2のバーコード側から前記第1のバーコード側
へ行ない、その走査において読み取られたバーコードの
データの各々を順次に格納し、その格納最中に現れる前
記センターバーを認識し、該認識時における前記格納の
ためのアドレスを前記格納された第2のバーコードのデ
ータへのアクセスに用いるようにして構成される。第3
の発明は、第1図(そのl)に示されるように、記憶袋
W2と、バーコードデータを前記記憶装置2へ入力させ
るデータ入力回路4と、バーコードのキャラクタを表す
信号に応答して前記バーコードデータのためのアドレス
を順次に発生する書込みアドレス発生回路6と、前記バ
ーコードのキャラクタを表す信号をカウント入力に受け
るカウンタ8と、第1のバーコード側から第2のバーコ
ード側への読取りにおいて該第1のバーコード内の右バ
ーコードブロック右端のガードバ−の読取りを検出する
検出回路lOとを設け、該検出回路lOの出力に応答し
て前記書込みアドレス発生回路6から出力されるアドレ
スを前記記憶装置2に記憶されている前記第2のバーコ
ードのデータのアクセスに用いるようにして構成される
。第4の発明は、第1図(その2)に示されるように、
記憶装置2と、バーコードデータを前記記憶装置2へ入
力させるデータ入力回路4と、バーコードのキャラクタ
を表す信号に応答して前記バーコードデータのためのア
ドレスを順次に発生する書込みアドレス発生回路6と、
第2のバーコード側から該バーコード体系の異なる第1
のバーコード側への読取りにおいて該第1のバーコード
内のセンターバーの読取りを検出する検出回路14と、
該検出回路14の出力に応答して前記書込みアドレス発
生回路6から出力されるアドレスを前記記憶装置2に記
憶されている前記第2のバーコードのデータのアクセス
に用いるようにして構成される。
第1のバーコード側から第2のバーコード側への走査、
又はその逆方向への走査が行なわれて得られるバーコー
ドデータは、書込みアドレス発生回路6から発生される
バーコードデータ対応の書込みアドレスで指定される記
憶装置2の記憶位置に書き込まれる。その書込みアドレ
ス発生回路6における書込みアドレスの発生は、前記走
査に応答して発生されるところのバーコードのキャラク
タを表す信号に応答して生ぜしめられる。
又はその逆方向への走査が行なわれて得られるバーコー
ドデータは、書込みアドレス発生回路6から発生される
バーコードデータ対応の書込みアドレスで指定される記
憶装置2の記憶位置に書き込まれる。その書込みアドレ
ス発生回路6における書込みアドレスの発生は、前記走
査に応答して発生されるところのバーコードのキャラク
タを表す信号に応答して生ぜしめられる。
前記第1のバーコード側から第2のバーコード側への走
査において、右バーコードブロックの右端のガードバ−
が検出回路10によって検出されたとき、その検出に応
答してその時刻に前記書込みアドレス発生回路6から発
生されているアドレスを前記記憶装置2に書き込まれて
いる前記第2のバーコードのデータの読出しに用いるこ
とによって、行なうことが出来る。
査において、右バーコードブロックの右端のガードバ−
が検出回路10によって検出されたとき、その検出に応
答してその時刻に前記書込みアドレス発生回路6から発
生されているアドレスを前記記憶装置2に書き込まれて
いる前記第2のバーコードのデータの読出しに用いるこ
とによって、行なうことが出来る。
又、前記逆方向への走査において、センターバーが検出
回路14によって検出されたとき、その検出に応答して
その時刻に前記書込みアドレス発生回路6から発生され
ているアドレスを、前記記憶装置2に書き込まれたバー
コードデータの内の前記第2のバーコードのデータの読
出しに用いることによって、行なうことが出来る。
回路14によって検出されたとき、その検出に応答して
その時刻に前記書込みアドレス発生回路6から発生され
ているアドレスを、前記記憶装置2に書き込まれたバー
コードデータの内の前記第2のバーコードのデータの読
出しに用いることによって、行なうことが出来る。
第2図は本発明の一実施例を示す。この図において、入
力レジスタ20及び右ブロック認識回路22はバーコー
ドデータ入力線21に接続されている。その入力レジス
タ20は書込みデータバス24を介してRAM2.及び
オーバーフロー検出回路25に接続されている。RAM
2.は図示しないCPUの制御の下にその書込み及び読
出しが行なわれる。右ブロック認識回路22は右ブロッ
ク認識信号RIGHT及びセンターバー認識信号CBを
出力する。タイミング制御回路26は前記右ブロック認
識信号RIGHT及びセンターバー認識信号CB、5F
TIN信号、オーバーフロー検出回路25からの信号、
カウンタ8からの信号、並びに前記CPUからのリセッ
ト信号を受ける。
力レジスタ20及び右ブロック認識回路22はバーコー
ドデータ入力線21に接続されている。その入力レジス
タ20は書込みデータバス24を介してRAM2.及び
オーバーフロー検出回路25に接続されている。RAM
2.は図示しないCPUの制御の下にその書込み及び読
出しが行なわれる。右ブロック認識回路22は右ブロッ
ク認識信号RIGHT及びセンターバー認識信号CBを
出力する。タイミング制御回路26は前記右ブロック認
識信号RIGHT及びセンターバー認識信号CB、5F
TIN信号、オーバーフロー検出回路25からの信号、
カウンタ8からの信号、並びに前記CPUからのリセッ
ト信号を受ける。
タイミング制御回路26はRAfM21への書込み能動
化信号、並びにカウンタ8及び書込みアドレスカウンタ
6、へのカウント制御信号を出力する。
化信号、並びにカウンタ8及び書込みアドレスカウンタ
6、へのカウント制御信号を出力する。
書込みアドレスカウンタ61の出力は書込みアドレスバ
ス28を介してRA M 2 r及びラッチ回路12へ
接続されている。ラッチ回路12は、そのセット制御入
力に前記右ブロック認識信号RIGHT及びセンターバ
ー認識信号CBを受ける。
ス28を介してRA M 2 r及びラッチ回路12へ
接続されている。ラッチ回路12は、そのセット制御入
力に前記右ブロック認識信号RIGHT及びセンターバ
ー認識信号CBを受ける。
入力レジスタ20は第1図のデータ入力回路4に対応す
る。書込みアドレスカウンタ61は第1図の書込みアド
レス発生回路6に対応する。RAM2.は第1図の記憶
装置2に対応する。右ブロック認識回路22並びにタイ
ミング制御回路26内の後述インバータ36及びアンド
回路38が第1図の検出回路10に対応し、又右ブロッ
ク認識回路22が第1図の検出回路14に対応する。
る。書込みアドレスカウンタ61は第1図の書込みアド
レス発生回路6に対応する。RAM2.は第1図の記憶
装置2に対応する。右ブロック認識回路22並びにタイ
ミング制御回路26内の後述インバータ36及びアンド
回路38が第1図の検出回路10に対応し、又右ブロッ
ク認識回路22が第1図の検出回路14に対応する。
右ブロック認識回路22は、第3図に示すようにUPC
バーコード復調部50 (UPCはユニバーサル・プロ
ダクト・コードの略称)、GB識別回路52、CB識別
回路54、キャラクタ(CHR)識別回路56、イーブ
ン構成判定回路58、シーケンサ60.CB/GB判別
回路62、アンド回路64から成る。UPCバーコード
復調部50は二値のバーコードデータ信号から2進復調
データを出力する。イーブン構成判定回路58はバーコ
ードがイーブン構成であるか否かを判定する。
バーコード復調部50 (UPCはユニバーサル・プロ
ダクト・コードの略称)、GB識別回路52、CB識別
回路54、キャラクタ(CHR)識別回路56、イーブ
ン構成判定回路58、シーケンサ60.CB/GB判別
回路62、アンド回路64から成る。UPCバーコード
復調部50は二値のバーコードデータ信号から2進復調
データを出力する。イーブン構成判定回路58はバーコ
ードがイーブン構成であるか否かを判定する。
そのCB/GB判別回路62はイーブン構成判定回路5
8の出力及びGB識別回路52、CB識別回路54の出
力に応答して第3図に示す如きH(ハイ)レベルの前記
センターバー認識信号CB。
8の出力及びGB識別回路52、CB識別回路54の出
力に応答して第3図に示す如きH(ハイ)レベルの前記
センターバー認識信号CB。
又はガードバ−認識信号CBを出力する。シーケンサ6
0はCB識別回路52、CB識別回路54、キャラクタ
識別回路56の出力に応答して前記センターバー認識信
号CB、キャラクタ及びガードバ−認識信号CBのシー
ケンスの正常性を判定する。アンド回路64はシーケン
サ60、並びにGBgli別回路52、CB識別回路5
4、及びイーブン構成判定回路58の出力に応答して第
3図に示す如きHレベルの前記右ブロック認識信号RI
GHTを出力する。
0はCB識別回路52、CB識別回路54、キャラクタ
識別回路56の出力に応答して前記センターバー認識信
号CB、キャラクタ及びガードバ−認識信号CBのシー
ケンスの正常性を判定する。アンド回路64はシーケン
サ60、並びにGBgli別回路52、CB識別回路5
4、及びイーブン構成判定回路58の出力に応答して第
3図に示す如きHレベルの前記右ブロック認識信号RI
GHTを出力する。
タイミング制御回路26は、第4図に示すように、前記
右ブロック認識信号RIGHT及びセンターバー認識信
号CBを受けるアンド回路30と、オア回路29と、ア
ンド回路30及びオア回路29の出力を受けるアンド回
路32と、アンド回路32の出力、前記5FTIN信号
及び前記CPtJからのリセット信号を受けるRAM書
込みタイミング制御回路34と、前記右ブロック認識回
路RIG)IT、及びセンターバー認識信号CBをイン
バータ36を介して受けるアンド回路38と、カウンタ
8の出力及びオーバーフロー検出回路25の出力を受け
るアンド回路40とから成る。アン゛ド回路40の出力
はオア回路29の入力へ接続されている。RAM書込み
タイミング制御回路34はRA M 2 +への書込み
能動化信号、並びに書込みアドレスカウンタ6、へのカ
ウント制御信号を出力する。アンド回路38の出力及び
前記5FTIN信号が上述のカウント制御信号としてカ
ウンタ8へ供給される。又、センターバー認識信号CB
はCPU42へ供給され、RAM書込みタイミング制御
回路34の出力はCPU42へ停止トリガ信号として供
給される。カウンタ8は、アンド回路38の出力、前記
5FTIN信号及び前記CPUからのリセット信号を受
ける。
右ブロック認識信号RIGHT及びセンターバー認識信
号CBを受けるアンド回路30と、オア回路29と、ア
ンド回路30及びオア回路29の出力を受けるアンド回
路32と、アンド回路32の出力、前記5FTIN信号
及び前記CPtJからのリセット信号を受けるRAM書
込みタイミング制御回路34と、前記右ブロック認識回
路RIG)IT、及びセンターバー認識信号CBをイン
バータ36を介して受けるアンド回路38と、カウンタ
8の出力及びオーバーフロー検出回路25の出力を受け
るアンド回路40とから成る。アン゛ド回路40の出力
はオア回路29の入力へ接続されている。RAM書込み
タイミング制御回路34はRA M 2 +への書込み
能動化信号、並びに書込みアドレスカウンタ6、へのカ
ウント制御信号を出力する。アンド回路38の出力及び
前記5FTIN信号が上述のカウント制御信号としてカ
ウンタ8へ供給される。又、センターバー認識信号CB
はCPU42へ供給され、RAM書込みタイミング制御
回路34の出力はCPU42へ停止トリガ信号として供
給される。カウンタ8は、アンド回路38の出力、前記
5FTIN信号及び前記CPUからのリセット信号を受
ける。
上述回路構成の本発明装置の動作を以下に説明する。
バーコードデータ入力線21を介して入力されて来るバ
ーコードデータは入力レジスタ2o及び右ブロック認識
回路22へ入力される。そのバーコードデータは入力レ
ジスタ20においてビット並列のデータとされて書込み
データバス24を介してRA M 2 rへ送られるほ
か、オーバーフロー検出回路25へも送られる。RAM
2.へ送られるビット並列のデータは書込みアドレスカ
ウンタ61から書込みアドレスバス28を介して与えら
れるR A M 2 r のアドレスに書き込まれる。
ーコードデータは入力レジスタ2o及び右ブロック認識
回路22へ入力される。そのバーコードデータは入力レ
ジスタ20においてビット並列のデータとされて書込み
データバス24を介してRA M 2 rへ送られるほ
か、オーバーフロー検出回路25へも送られる。RAM
2.へ送られるビット並列のデータは書込みアドレスカ
ウンタ61から書込みアドレスバス28を介して与えら
れるR A M 2 r のアドレスに書き込まれる。
そのアドレスは次のようにして発生される。
上述のように、バーコードデータ入力線21を介してバ
ーコードデータが入力されるのに先立って、CPU42
によってRAM書込みタイミング制御回路34及びカウ
ンタ8はリセットされる。
ーコードデータが入力されるのに先立って、CPU42
によってRAM書込みタイミング制御回路34及びカウ
ンタ8はリセットされる。
そして、バーコードスキャナによる商品に付されたラベ
ル上のバーコードの読取りが行なわれ、従来と同様にし
て上述の5FTIN信号がRAM書込みタイミング制御
回路34へ入力された時刻には、センターバー認識信号
CBも又、前記右ブロック認識信号HIGHTも、未だ
発生していない。
ル上のバーコードの読取りが行なわれ、従来と同様にし
て上述の5FTIN信号がRAM書込みタイミング制御
回路34へ入力された時刻には、センターバー認識信号
CBも又、前記右ブロック認識信号HIGHTも、未だ
発生していない。
従って、RAM書込みタイミング制御回路34へは停止
トリガ信号は入力されないから、RAM書込みタイミン
グ制御回路34から書込みアドレスカウンタ6Iヘ力ウ
ントアツプ信号が順次に送出される。このカウントアツ
プ信号によって、書込みアドレスカウンタ61はカウン
ト動作を行なって、入力レジスタ20から書込みデータ
バス24を介してRA M 2 lへ与えられるデータ
対応の書込みアドレスを順次に発生する。つまり、カウ
ンタ6、の計数値がアドレスとなる。それらのアドレス
で指定されるRAM2.の書込み位置に対応するデータ
が上述のようにして書き込まれる。
トリガ信号は入力されないから、RAM書込みタイミン
グ制御回路34から書込みアドレスカウンタ6Iヘ力ウ
ントアツプ信号が順次に送出される。このカウントアツ
プ信号によって、書込みアドレスカウンタ61はカウン
ト動作を行なって、入力レジスタ20から書込みデータ
バス24を介してRA M 2 lへ与えられるデータ
対応の書込みアドレスを順次に発生する。つまり、カウ
ンタ6、の計数値がアドレスとなる。それらのアドレス
で指定されるRAM2.の書込み位置に対応するデータ
が上述のようにして書き込まれる。
その書き込まれるデータの上述バーコードの読取りが、
第5図の■に示すような読取りであったとする。その読
取りが進んでいきラベル上のセンターバーの読取りが行
なわれるとき、右ブロック認識回路22において、その
UPCバーコード復調部50及びイーブン構成判定回路
58によって復調されたコードデータがイーブン構成で
ないことの出力及びCB識別回路54からのセンターバ
ー識別信号に応答するCB/GB判別回路62からセン
ターバー認識信号CBが出力される。このセンターバー
認識信号CBが出力された後も、上述バーコードの読取
りは、なお続行され、遂にはラベル上のガードバ−を読
み取る。その読取りが行なわれるとき、上述と同様に、
右ブロック認識回路22においてそのUPCバーコード
復調復調部長0イーブン構成判定回路58によって復調
されたコードデータがイーブン構成でないことの出力、
GB識別回路52からのガードバ−識別信号及びシーケ
ンサ60からの出力に応答するアンド回路64から右ブ
ロック認識信号RIGHTが出力される。この右ブロッ
ク認識信号HIGHTは、その時刻に書込みアドレスカ
ウンタ6Iから出力されるアドレスをラッチ回路12に
ラッチさせる。
第5図の■に示すような読取りであったとする。その読
取りが進んでいきラベル上のセンターバーの読取りが行
なわれるとき、右ブロック認識回路22において、その
UPCバーコード復調部50及びイーブン構成判定回路
58によって復調されたコードデータがイーブン構成で
ないことの出力及びCB識別回路54からのセンターバ
ー識別信号に応答するCB/GB判別回路62からセン
ターバー認識信号CBが出力される。このセンターバー
認識信号CBが出力された後も、上述バーコードの読取
りは、なお続行され、遂にはラベル上のガードバ−を読
み取る。その読取りが行なわれるとき、上述と同様に、
右ブロック認識回路22においてそのUPCバーコード
復調復調部長0イーブン構成判定回路58によって復調
されたコードデータがイーブン構成でないことの出力、
GB識別回路52からのガードバ−識別信号及びシーケ
ンサ60からの出力に応答するアンド回路64から右ブ
ロック認識信号RIGHTが出力される。この右ブロッ
ク認識信号HIGHTは、その時刻に書込みアドレスカ
ウンタ6Iから出力されるアドレスをラッチ回路12に
ラッチさせる。
前記右ブロック認識信号HIGHTの発生によって、こ
の時刻に“L”レベルにあるセンターバー認識信号CB
をインバータ36を介して受けているアンド回路38か
らカウンタ8ヘ力ウントイネーブル信号〔信号(3)〕
が供給される。そのカウンタ8のカウント動作が、この
時刻に上述のようにして入力され続けている5FTIN
信号によって開始される。このカウント開始以降の5F
TIN信号は、丁度アドオンコードのキャラクタ数を表
しているから、そのアドオンコードについての上述読取
りが終了したときに、カウンタ8からその旨を表す信号
〔信号(4)〕が〕送され、オア回路29を介してアン
ド回路32へ信号〔信号(5)〕が与えられる。これに
より、RAM書込みタイミング制御回路34へ停止トリ
ガ信号が出力される。
の時刻に“L”レベルにあるセンターバー認識信号CB
をインバータ36を介して受けているアンド回路38か
らカウンタ8ヘ力ウントイネーブル信号〔信号(3)〕
が供給される。そのカウンタ8のカウント動作が、この
時刻に上述のようにして入力され続けている5FTIN
信号によって開始される。このカウント開始以降の5F
TIN信号は、丁度アドオンコードのキャラクタ数を表
しているから、そのアドオンコードについての上述読取
りが終了したときに、カウンタ8からその旨を表す信号
〔信号(4)〕が〕送され、オア回路29を介してアン
ド回路32へ信号〔信号(5)〕が与えられる。これに
より、RAM書込みタイミング制御回路34へ停止トリ
ガ信号が出力される。
又、上述のようにして、RA M 2 Iへ書き込まれ
たアドオンコードのデータを、上述のようにして、ラッ
チ回路12にラッチされているアドレスがCPU42に
よって取り込まれ、そのアドレスを用いてRAM2.を
アクセスすることによってCPU42で知ることが出来
る。
たアドオンコードのデータを、上述のようにして、ラッ
チ回路12にラッチされているアドレスがCPU42に
よって取り込まれ、そのアドレスを用いてRAM2.を
アクセスすることによってCPU42で知ることが出来
る。
又、バーコードスキャナによる商品に付されたラベル上
のバーコードの読取りが、第5図の■に示すように、行
なわれた場合におけるRAM2゜へのバーコードデータ
の書込みは、上述と同様に5FTIN信号によるRAM
書込みタイミング制御回路34の起動によって開始され
、入力レジスタ20から順次に出力されるバーコードデ
ータは、アドオンコードのデータを先にRA M 2
+へ書き込むようにして、書込みアドレスカウンタ6、
から出力されるバーコードデータ対応のアドレスで指定
されるR A M 2 Iの対応書込み位置に、順次に
書き込まれる。このようにしてRA M 2 rへ書き
込まれたアドオンコードのデータのCPU42による利
用は、次のようにして達成される。
のバーコードの読取りが、第5図の■に示すように、行
なわれた場合におけるRAM2゜へのバーコードデータ
の書込みは、上述と同様に5FTIN信号によるRAM
書込みタイミング制御回路34の起動によって開始され
、入力レジスタ20から順次に出力されるバーコードデ
ータは、アドオンコードのデータを先にRA M 2
+へ書き込むようにして、書込みアドレスカウンタ6、
から出力されるバーコードデータ対応のアドレスで指定
されるR A M 2 Iの対応書込み位置に、順次に
書き込まれる。このようにしてRA M 2 rへ書き
込まれたアドオンコードのデータのCPU42による利
用は、次のようにして達成される。
上述第5図の■に示すようなバーコードの°読取りが行
なわれるときにも、右ブロック認識回路22において、
上述と同様ラベル上のバーコード内のセンターバー検出
がCB/GB判定回路62において為される。その時の
センターバー認識信号CBが又、入力レジスタ20にお
いて用いられて前記センターバー検出時刻において書込
みアドレスカウンタ6Iから発生されたアドレスをラッ
チ回路12にセットされる。このアドレスから右ブロッ
ク内のキャラクタ数分のアドレス値だけCPU42で差
し引くことにより、RA M 2 Iへ書き込まれてい
るアドオンコードのデータの内の、RA M 2 rへ
最後に書き込まれたアドオンコードのデータを書き込ん
でいるアドレスを得ることが出来る。こうして得られた
アドレスを用いてRAM2Iに書き込まれているすべて
のアドオンコードのデータをRA M 2 +から読み
出すことが出来る。
なわれるときにも、右ブロック認識回路22において、
上述と同様ラベル上のバーコード内のセンターバー検出
がCB/GB判定回路62において為される。その時の
センターバー認識信号CBが又、入力レジスタ20にお
いて用いられて前記センターバー検出時刻において書込
みアドレスカウンタ6Iから発生されたアドレスをラッ
チ回路12にセットされる。このアドレスから右ブロッ
ク内のキャラクタ数分のアドレス値だけCPU42で差
し引くことにより、RA M 2 Iへ書き込まれてい
るアドオンコードのデータの内の、RA M 2 rへ
最後に書き込まれたアドオンコードのデータを書き込ん
でいるアドレスを得ることが出来る。こうして得られた
アドレスを用いてRAM2Iに書き込まれているすべて
のアドオンコードのデータをRA M 2 +から読み
出すことが出来る。
又、第5図の■に示すようなバーコードの読取りが行な
われるときにも、右ブロックのガードバ−の読取り時に
アンド回路64から右ブロック認識信号RIGHTが発
生され、そしてその読取りが進んでいくとき、アドオン
コードの途中でその読取りビームがアドオンコードから
抜は出る。そうすると、そのときのバーコードデータを
受けているオーバーフロー検出回路25はその旨の信号
を出力する。この信号はアンド回路40、そしてオア回
路29を介して信号〔信号(5)〕を送出せしめる。ア
ンド回路32から停止トリガ信号が発生され、RAM書
込みタイミング制御回路34の制御は停止せしめられ、
RA M 2 +へのそれ以上の書込みは生ぜしめられ
ない、又、停止トリガ信号は、上述と同様にCPU42
へ送られる。
われるときにも、右ブロックのガードバ−の読取り時に
アンド回路64から右ブロック認識信号RIGHTが発
生され、そしてその読取りが進んでいくとき、アドオン
コードの途中でその読取りビームがアドオンコードから
抜は出る。そうすると、そのときのバーコードデータを
受けているオーバーフロー検出回路25はその旨の信号
を出力する。この信号はアンド回路40、そしてオア回
路29を介して信号〔信号(5)〕を送出せしめる。ア
ンド回路32から停止トリガ信号が発生され、RAM書
込みタイミング制御回路34の制御は停止せしめられ、
RA M 2 +へのそれ以上の書込みは生ぜしめられ
ない、又、停止トリガ信号は、上述と同様にCPU42
へ送られる。
なお、前記実施例においては、前記5FTIN信号によ
るカウンタ8のカウント動作を、その5FTIN信号が
表すキャラクタ毎の信号によるソフトカウンタのカウン
ト動作に替えてもよい。
るカウンタ8のカウント動作を、その5FTIN信号が
表すキャラクタ毎の信号によるソフトカウンタのカウン
ト動作に替えてもよい。
以上述べたところから明らかなように本発明によれば、
従来のバーコードに、該バーコードとはそのバーコード
体系の異なるバーコードを付加して成るバーコードの読
取りを行なうことが出来る。
従来のバーコードに、該バーコードとはそのバーコード
体系の異なるバーコードを付加して成るバーコードの読
取りを行なうことが出来る。
第1図は本発明の原理ブロック図、
第2図は本発明の一実施例を示す図、
第3図は右ブロック認識回路の詳細図、第4図はタイミ
ング制御回路及びカウンタの関係を詳細に示す図、 第5図は本発明によって読み取ろうとする異なるバーコ
ード体系で構成されるバーコードの例を示す図である。 ウンタ6+)、 8はカウンタ、 10.14は検出回路(右ブロック認識回路22、タイ
ミング制御回路26内のインバータ36及びアンド回路
3B)、 12はラッチ回路である。 第1図において、 2は記憶装置f (RAM21 )、 4はデータ入力回路(入力レジスタ20)、6は書込み
アドレス発生回路(書込みアドレスカド発A の7F、
!7v ・y7 ]”;xり第1図(マのj) 千460日cJsV7b−v’;fi’!:J第 1
図4の2) 梼ロトーレJrl 第2図 第 図
ング制御回路及びカウンタの関係を詳細に示す図、 第5図は本発明によって読み取ろうとする異なるバーコ
ード体系で構成されるバーコードの例を示す図である。 ウンタ6+)、 8はカウンタ、 10.14は検出回路(右ブロック認識回路22、タイ
ミング制御回路26内のインバータ36及びアンド回路
3B)、 12はラッチ回路である。 第1図において、 2は記憶装置f (RAM21 )、 4はデータ入力回路(入力レジスタ20)、6は書込み
アドレス発生回路(書込みアドレスカド発A の7F、
!7v ・y7 ]”;xり第1図(マのj) 千460日cJsV7b−v’;fi’!:J第 1
図4の2) 梼ロトーレJrl 第2図 第 図
Claims (4)
- (1)左右のバーコードブロック間にセンターバーを、
左バーコードブロックの左端及び右バーコードブロック
の右端にガードバーを付加した第1のバーコードと、前
記右バーコードブロックの右端に付加されたガードバー
に続けて設けられる前記第1のバーコードとは異なるバ
ーコード体系の第2のバーコードとから成るバーコード
の走査を前記第1のバーコード側から前記第2のバーコ
ード側へ行ない、 その走査において読み取られたバーコードのデータの各
々を順次に格納し、 その格納最中に現れる前記右バーコードブロックの右端
のガードバーを認識し、 該認識時における前記格納のためのアドレスを前記格納
された第2のバーコードのデータへのアクセスに用いる
ことを特徴とするバーコード読取り方法。 - (2)左右のバーコードブロック間にセンターバーを、
左バーコードブロックの左端及び右バーコードブロック
の右端にガードバーを付加した第1のバーコードと、前
記右バーコードブロックの右端に付加されたガードバー
に続けて設けられる前記第1のバーコードとは異なるバ
ーコード体系の第2のバーコードとから成るバーコード
の走査を前記第2のバーコード側から前記第1のバーコ
ード側へ行ない、 その走査において読み取られたバーコードのデータの各
々を順次に格納し、 その格納最中に現れる前記センターバーを認識し、 該認識時における前記格納のためのアドレスを前記格納
された第2のバーコードのデータへのアクセスに用いる
ことを特徴とするバーコード読取り方法。 - (3)記憶装置(2)と、 バーコードデータを前記記憶装置(2)へ入力させるデ
ータ入力回路(4)と、 バーコードのキャラクタを表す信号に応答して前記バー
コードデータのためのアドレスを順次に発生する書込み
アドレス発生回路(6)と、前記バーコードのキャラク
タを表す信号をカウント入力に受けるカウンタ(8)と
、 第1のバーコード側から第2のバーコード側への読取り
において該第1のバーコード内の右バーコードブロック
右端のガードバーの読取りを検出する検出回路(10)
とを設け、 該検出回路(10)の出力に応答して前記書込みアドレ
ス発生回路(6)から出力されるアドレスを前記記憶装
置(2)に記憶されている前記第2のバーコードのデー
タのアクセスに用いることを特徴とするバーコードデー
タ読取り装置。 - (4)記憶装置(2)と、 バーコードデータを前記記憶装置(2)へ入力させるデ
ータ入力回路(4)と、 バーコードのキャラクタを表す信号に応答して前記バー
コードデータのためのアドレスを順次に発生する書込み
アドレス発生回路(6)と、第2のバーコード側から該
バーコード体系の異なる第1のバーコード側への読取り
において該第1のバーコード内のセンターバーの読取り
を検出する検出回路(14)とを設け、 該検出回路(14)の出力に応答して前記書込みアドレ
ス発生回路(6)から出力されるアドレスを前記記憶装
置(2)に記憶されている前記第2のバーコードのデー
タのアクセスに用いることを特徴とするバーコードデー
タ読取り装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1079379A JPH07101427B2 (ja) | 1989-03-29 | 1989-03-29 | バーコード読取り方法及びその装置 |
| US07/501,987 US5128527A (en) | 1989-03-29 | 1990-03-29 | Apparatus for reading a bar code |
| DE69020766T DE69020766T2 (de) | 1989-03-29 | 1990-03-29 | Gerät für das Lesen von Strichkodierungen. |
| EP90106055A EP0390162B1 (en) | 1989-03-29 | 1990-03-29 | An apparatus for reading a bar code |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1079379A JPH07101427B2 (ja) | 1989-03-29 | 1989-03-29 | バーコード読取り方法及びその装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02257295A true JPH02257295A (ja) | 1990-10-18 |
| JPH07101427B2 JPH07101427B2 (ja) | 1995-11-01 |
Family
ID=13688239
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1079379A Expired - Lifetime JPH07101427B2 (ja) | 1989-03-29 | 1989-03-29 | バーコード読取り方法及びその装置 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5128527A (ja) |
| EP (1) | EP0390162B1 (ja) |
| JP (1) | JPH07101427B2 (ja) |
| DE (1) | DE69020766T2 (ja) |
Families Citing this family (64)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| US5340966A (en) * | 1990-10-23 | 1994-08-23 | Matsushita Electric Industrial Co., Ltd. | Automatic facsimile-receiving-sheet recognizing apparatus |
| EP0647917A2 (en) * | 1991-03-04 | 1995-04-12 | Fujitsu Limited | Bar-code reading apparatus and method |
| WO1993003455A1 (en) * | 1991-08-02 | 1993-02-18 | Intermec Corporation | Method and apparatus for scanning symbols |
| US5504318A (en) * | 1991-09-13 | 1996-04-02 | Symbol Technologies, Inc. | Analog waveform decoder using peak locations |
| CA2053460A1 (en) * | 1991-09-13 | 1993-03-14 | Eugene Bernard Joseph | Analog waveform decoder |
| US5262625A (en) * | 1991-11-15 | 1993-11-16 | Ncr Corporation | Multiple bar code decoding system and method |
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| US5734152A (en) * | 1995-05-31 | 1998-03-31 | Symbol Technologies, Inc. | Optical scanners and signal processors therefor |
| US6170749B1 (en) | 1995-05-31 | 2001-01-09 | Symbol Technologies, Inc. | Method of scanning indicia using selective sampling |
| US5449893A (en) * | 1992-04-02 | 1995-09-12 | Symbol Technologies, Inc. | Digitizer for bar code reader |
| US6164540A (en) | 1996-05-22 | 2000-12-26 | Symbol Technologies, Inc. | Optical scanners |
| US5311000A (en) * | 1992-07-31 | 1994-05-10 | Spectra-Physics Scanning Systems, Inc. | Bar code scanner and method of scanning |
| AU681421B2 (en) * | 1993-09-14 | 1997-08-28 | Symbol Technologies, Inc. | Bar code scan stitching |
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| US5581064A (en) * | 1994-11-01 | 1996-12-03 | Pennsylvania Food Merchants Association | Automated coupon processing system employing coupon with identifying code and chosen second identifying code uniquely identifying the coupon |
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| JPH09179927A (ja) | 1995-12-26 | 1997-07-11 | Fujitsu Ltd | バーコード読取装置 |
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| US6419155B1 (en) | 1998-10-29 | 2002-07-16 | Casio Computer Co., Ltd. | Laser beam scan type barcode reader and program recording mediums |
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