JPH02260551A - 半導体装置 - Google Patents

半導体装置

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JPH02260551A
JPH02260551A JP1081072A JP8107289A JPH02260551A JP H02260551 A JPH02260551 A JP H02260551A JP 1081072 A JP1081072 A JP 1081072A JP 8107289 A JP8107289 A JP 8107289A JP H02260551 A JPH02260551 A JP H02260551A
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JP
Japan
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electrode
insulating substrate
chip
connection
bonding
Prior art date
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Pending
Application number
JP1081072A
Other languages
English (en)
Inventor
Tetsuo Yabushita
藪下 哲男
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Filing date
Publication date
Application filed by Seiko Epson Corp filed Critical Seiko Epson Corp
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Publication of JPH02260551A publication Critical patent/JPH02260551A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は半導体装置の接続技術に関するものである。
〔従来の技術〕
従来は、第4図に示す様なICチップ1の電極2とリー
ドフレーム9上に設置された導電性を有する中継範囲8
を有する絶縁基板7と信号を取り出す為にインナーリー
ド5部を金属細線6で接続するワイヤーボンディング(
以下中継ボンディング方式と呼ぶ)において用いられる
ボンディング方式はそのほとんどがポールボンディング
が用いられている。
〔発明が解決しようとする課題〕
最近、ASIC(用途特定IC)などでは入出力端子数
の増加に対する要求が急激に高まって来ており、200
ビンを超える半導体装置も出来ている。この様な要求は
今後もますます高まってゆくものと考えられ、多ビンの
半導体装置を組立てる為に中継ボンディング方式が採用
されつつあるが、従来の技術において問題となるのは次
の点である。
200ピンを超える電極を持つICチップにおいてポー
ルボンディングを用いた場合、周知の如くポールボンド
においては電極ピッチは少なくとも130μm以上は必
要な為、最適な電極配置が出来たとしてもICチップサ
イズは6.5mm2以上となってしまう。従ってICチ
ップ内の回路パターンが微細化等によって縮少出来ても
、ICチップ自体は電極数によってサイズが決定してし
まい目的とするICチップ縮少が達成出来ない。
中継ボンディング方式において、ポールボンディング方
式を用いるとリードフレームはかなり大きさの違うIC
チップを塔載出来るがICチップサイズは縮少化に制限
を与える事になる。この事は1ウエハーで製造可能なI
Cチップ数を増やす事が出来ずコストダウンが図れない
事になる。
〔課題を解決するための手段〕
本発明は、前記課題を解決すべくなされたもので、ポー
ルボンディングよりも狭い電極チップを得る事が出来る
。ウェッジボンド方式、TAB方式、フェースダウン方
式を接続方式として用いる事により、中継ボンディング
方式の優秀さをより一層大きくするものである。
〔実 施 例〕
第1図は、本発明の実施例を示すウェッジボンド方式を
用いた接続方式の模式図である。リードフレーム9上に
設置された絶縁基板7に形成された中継範囲8とICチ
ップ1の電極2は第1図(C)に示されるウェッジボン
ド方式を用いた金属細線6により接続される。この場合
、必要であれば、中継範囲8とインナーリード5の接続
についても中継範囲8と電極2の接続と同様のウェッジ
ボンド方式を用いてもかまわない。又、中継範囲8は中
継の用途のみならず、絶縁基板7上に回路配線として利
用する事も出来る。これらの事は後述する接続方式にお
いても同様である。第1図(b)は第1図の側面図であ
る。
第2図は本発明の接続方式としてTAB方式を用いた実
施例の側面図である=ポリイミド等の絶縁フィルム3に
よって支持された銅箔4は電極2と金−スズ合金化等の
金属間合金化により接続され、中継範囲8と銅箔4は同
様の合金化又はハンダ付けにより接続される。
第3図は本発明の接続方式としてフェースダウン方式を
用いた実施例の側面図である。電極2と中継範囲8の接
続は金属間合金化又は導電性接着剤を用いて行なわれる
〔発明の効果〕
前記の如く本発明で用いられる接続方式の、ウェッジボ
ンド方式、TAB方式、フェイスダウン方式はいずれも
ポールボンディングで使用可能な電極ピッチより狭い電
極ピッチのICチップを用いて半導体装置を製造する事
が可能である。例えば、ウェッジボンド方式及びTAB
方式においては電極ピッチは80μmくらいが可能で、
最適な電極配置を行なえば200ピン°のICチップサ
イズは4mm’となり、フェイスダウン方式ではそれ以
上縮少出来る。従って、前記ポールボンディングのIC
チップサイズと比較すると面積比で6゜5mm”/4m
m’″t2.23となり、半分以下のICチップで同機
能の半導体装置を得る事が出来る様になる。これをコス
トで考えると当然ICチップは半分以下の製造コストで
出来、大目夏なコストダウンが実現出来る事になる。
本発明の各前記接続方式は、中継ボンディング方式では
ない直接電極とインナーリード部を接続する方式におい
ては発表されている。しかし、中継ボンディング方式を
採用している200ピン以上の電極を有するICチップ
はそのほとんどが大規模集積回路でチップサイズも大き
く、経済性や電気的特性を向上させる為に縮少させなけ
ればならない。縮少させる為には電極ピッチも含めての
事であるので本発明の効果は絶大である。
【図面の簡単な説明】
第1図(a)は本発明実施例の模式図、第1図(b)は
本発明実施例の模式断面図、第1図(C)は本発明実施
例のウェッジボンド方式模式図である。 第2図は本発明実施例のTAB方式模式断面図、第3図
は本発明実施例のフェイスダウン方式模式断面図、第4
図は従来実施例の模式図である。 φICチップ ・電極 Φ絶縁フィルム ・銅箔 会インナー曹ノード ・金属細線 ・絶縁基板 ・中継範囲 ・リードフレーム 以 上 出願人 セイコーエプソン株式会社 代理人 弁理士 鈴 木 喜三部(他1名)第1rjX
Nb> 第1図(C’)

Claims (3)

    【特許請求の範囲】
  1. (1)ICチップの電極とリードフレーム上に設置され
    た導電性を有する中継範囲を有する絶縁基板と信号を取
    り出す為にリードフレームに設けられたインナーリード
    部からなる半導体装置において、少なくとも前記電極と
    前記絶縁基板の接続がウェッジボンド方式によってワイ
    ヤーボンディングされている事を特徴とする半導体装置
  2. (2)少なくとも前記電極と前記絶縁基板の接続がTA
    B方式によって接続されている事を特徴とする請求項1
    記載の半導体装置。
  3. (3)少なくとも前記電極と前記絶縁基板の接続がフェ
    イスダウン方式によって接続されている事を特徴とする
    請求項1記載の半導体装置。
JP1081072A 1989-03-31 1989-03-31 半導体装置 Pending JPH02260551A (ja)

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JP1081072A JPH02260551A (ja) 1989-03-31 1989-03-31 半導体装置

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JP1081072A JPH02260551A (ja) 1989-03-31 1989-03-31 半導体装置

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ID=13736188

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JP1081072A Pending JPH02260551A (ja) 1989-03-31 1989-03-31 半導体装置

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7115977B2 (en) * 2000-09-28 2006-10-03 Oki Electric Industry Co., Ltd. Multi-chip package type semiconductor device
DE102012224355A1 (de) 2012-04-11 2013-10-17 Mitsubishi Electric Corporation Leistungsmodul

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US7115977B2 (en) * 2000-09-28 2006-10-03 Oki Electric Industry Co., Ltd. Multi-chip package type semiconductor device
US8053278B2 (en) 2000-09-28 2011-11-08 Oki Semiconductor Co., Ltd. Multi-chip package type semiconductor device
DE102012224355A1 (de) 2012-04-11 2013-10-17 Mitsubishi Electric Corporation Leistungsmodul
US8674492B2 (en) 2012-04-11 2014-03-18 Mitsubishi Electric Corporation Power module
DE102012224355B4 (de) * 2012-04-11 2016-06-23 Mitsubishi Electric Corporation Leistungsmodul

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