JPH0227587A - Magnetic memory element driving method - Google Patents

Magnetic memory element driving method

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Publication number
JPH0227587A
JPH0227587A JP63176628A JP17662888A JPH0227587A JP H0227587 A JPH0227587 A JP H0227587A JP 63176628 A JP63176628 A JP 63176628A JP 17662888 A JP17662888 A JP 17662888A JP H0227587 A JPH0227587 A JP H0227587A
Authority
JP
Japan
Prior art keywords
magnetic field
vbl
bias magnetic
pair
pulselike
Prior art date
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Pending
Application number
JP63176628A
Other languages
Japanese (ja)
Inventor
Kenji Mizuno
健二 水野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
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Publication of JPH0227587A publication Critical patent/JPH0227587A/en
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Abstract

PURPOSE:To prevent a transferring error from being generated by providing a pulse pause period longer than the rise time of a pulselike bias magnetic field after the pulselike bias magnetic field. CONSTITUTION:A magnetic wall 13 on the external side of a stripe magnetic domain 12 stabilized around a groove 11 cut into a garnet is made into the transferring path of a pair of Bloch lines (VBL), a current is applied through a parallel conductor 21, a local magnetic field is generated, and a stable position 5 of the VBL pair is formed on the magnetic wall 13, a pulselike bias magnetic field 31 is externally impressed, and a VBL pair 1 are transferred to the next stable position 5. Thereafter, by the pulse pause period longer than the rise time of the pulselike bias magnetic field, the VBL pair 1 are stabilized at the root of a local intra-surface magnetic field potential by means of the parallel conductor. Thus, the dispersion of the pause position of the VBL pair driven by the pulselike bias magnetic field is eliminated, the start line of the VBL pair for the next driving is aligned, and the transferring error can be prevented.

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明は、ブロッホラインメモリに用いられるパルス状
バイアス磁界による垂直ブロッホライン対の駆動方法に
関するものである。
DETAILED DESCRIPTION OF THE INVENTION (Field of Industrial Application) The present invention relates to a method for driving a pair of vertical Bloch lines using a pulsed bias magnetic field used in a Bloch line memory.

(従来の技術) 磁気バブルメ、そり素子に代わる一超高密度固体磁気記
憶素子として、膜面垂直方向を磁化容易方向とする強磁
性体(フェリ磁性体を含む)膜に存在するストライプ磁
区の境界を形成するブロッホ磁壁の中に、安定に存在す
る垂直ブロッホライン2個からなるブロッホライン対(
以下、VBL対と称する)を記憶単位として用いるブロ
ッホラインメモリ素子が発明された(特開昭57−18
2346)。
(Prior art) As an ultra-high density solid-state magnetic memory element to replace magnetic bubble magnets and warped elements, boundaries between striped magnetic domains existing in a ferromagnetic (including ferrimagnetic) film whose easy magnetization direction is perpendicular to the film surface. A Bloch line pair consisting of two vertical Bloch lines (
A Bloch line memory element using VBL pairs (hereinafter referred to as VBL pairs) as a memory unit was invented (Japanese Patent Laid-Open No. 57-18
2346).

ブロッホラインメモリ素子においてはマイナーループを
構成する安定化されたストライプ磁区周辺のブロッホ磁
壁に沿って情報をVBL対の形で書き込み、またVBL
対という微小領域で表される情報単位を読み出す手段、
およびマイナーループ上でVBL対をビット毎に転送保
持する手段が不可欠である。
In a Bloch line memory element, information is written in the form of VBL pairs along the Bloch domain wall around the stabilized stripe magnetic domains that constitute a minor loop, and the VBL
means for reading out information units represented by minute regions called pairs;
Also, a means for transferring and holding VBL pairs bit by bit on the minor loop is essential.

ストライプ磁区の安定化には溝堀りによるストライプ固
定法が、また安定化されたストライプ上でのVBL対の
ビット固定には、バタン化された面内磁化膜や電流導体
から発生する局所面内磁界のポテンシャルを利用するの
が一般的である。第3図にその具体例を示す。
The stripe fixing method by trenching is used to stabilize striped magnetic domains, and the local in-plane fixation method generated from battened in-plane magnetized films and current conductors is used to fix bits of VBL pairs on the stabilized stripes. It is common to use the potential of a magnetic field. A specific example is shown in FIG.

第3図において、11はガーネ層に掘り込んだ溝、12
はマイナループを構成するストライプ磁区、13はスト
ライプ磁区周辺のブロッホ磁壁、5はVBL対の安定位
置、1はVBL対、21はビット固定用の並行導体パタ
ン、25はビット固定用電流である。ストライプ磁区1
2は溝11の周りに安定化され、12の外側の磁壁13
がVBL対の転送路となる。
In Figure 3, 11 is a trench dug into the Garne layer, 12
1 is a striped magnetic domain constituting a minor loop, 13 is a Bloch domain wall around the striped magnetic domain, 5 is a stable position of a VBL pair, 1 is a VBL pair, 21 is a parallel conductor pattern for bit fixing, and 25 is a bit fixing current. Stripe magnetic domain 1
2 is stabilized around the groove 11 and the outer domain wall 13 of 12
becomes the transfer path for the VBL pair.

並行導体パタン21に電流25を流すと局所的な面内磁
界が発生し、各導体のVBL対の安定位置5が形成され
る。
When a current 25 is passed through the parallel conductor pattern 21, a local in-plane magnetic field is generated, and a stable position 5 of the VBL pair of each conductor is formed.

VBL対の転送は、ストライプ磁区にパルス状のバイア
ス磁界を加えて磁壁をストライプ磁区の法線方向に移動
させ、それに伴うジャイロ力によりVBL対が磁壁内を
横すべりすることを利用して行う。しかし、矩形波状の
バイアス磁界パルスであると、パルスの立下り時にスト
ライプ磁区が元に戻るときVBL対は反対方向へ移動し
、合計の移動量はほとんど零となる。そこで、第4図(
aXb)のようにバイアス磁界パルス31の立下り時間
を長くし、VBL対の戻りを抑えてVBL対の移動の一
方向性を確保している。VBL対の移動距離は、パルス
状バイアス磁界の大きさ、立上り時間に依存する。(第
4図(b)はクロック33を示す。) (発明が解決しようとする課題) しかしながら、ビット固定位置は広がりをもっており、
あるビット固定位置に対して移動してきた個々のVBL
対は厳密にいつも同じ位置に停止するとは限らない。さ
らに、メモリ素子温度の変動やパルス状バイアス磁界条
件の変動等の要因によりVBL対の転送エラーを発生す
る場合がある。
Transfer of the VBL pairs is performed by applying a pulsed bias magnetic field to the striped magnetic domains to move the domain walls in the normal direction of the striped magnetic domains, and by utilizing the accompanying gyroscopic force that causes the VBL pairs to slide laterally within the domain walls. However, in the case of a rectangular-wave bias magnetic field pulse, when the stripe magnetic domain returns to its original state at the fall of the pulse, the VBL pair moves in opposite directions, and the total amount of movement becomes almost zero. Therefore, Figure 4 (
aXb), the falling time of the bias magnetic field pulse 31 is lengthened to suppress the return of the VBL pair and ensure unidirectionality of movement of the VBL pair. The moving distance of the VBL pair depends on the magnitude and rise time of the pulsed bias magnetic field. (FIG. 4(b) shows the clock 33.) (Problem to be solved by the invention) However, the bit fixed positions are spread out,
Individual VBLs that have moved relative to a fixed bit position
Pairs do not always stop at exactly the same position. Furthermore, VBL pair transfer errors may occur due to factors such as variations in memory element temperature and pulsed bias magnetic field conditions.

本発明の目的はこの問題点を解決した磁気記憶素子の駆
動方法を提供することにある。
An object of the present invention is to provide a method for driving a magnetic memory element that solves this problem.

(課題を解決するための手段) 本発明の要旨とするところは、膜面に垂直な方向を磁化
容易方向とする強磁性体(フェリ磁性体を含む)膜に、
膜面に垂直な方向にパルス状のバイアス磁界を印加し、
前記強磁性体に存在するストライプドメインの境界のブ
ロッホ磁壁中につくった相隣る2つの垂直ブロッホライ
ンからなるVBL対を転送保持し記憶担体とする磁気記
憶素子の駆動方法において、前記パルス状バイアス磁界
の後に前記パルス状バイアス磁界の立上り時間より長い
パルス休止期間を設けることである。
(Means for Solving the Problems) The gist of the present invention is to provide a ferromagnetic (including ferrimagnetic) film whose easy magnetization direction is perpendicular to the film surface.
A pulsed bias magnetic field is applied in the direction perpendicular to the film surface,
In the method for driving a magnetic memory element in which a VBL pair consisting of two adjacent perpendicular Bloch lines formed in a Bloch domain wall at the boundary of a striped domain existing in the ferromagnetic material is transferred and held as a storage carrier, the pulsed bias The magnetic field is followed by a pulse pause period that is longer than the rise time of the pulsed bias magnetic field.

(作用) VBL対の転送エラーが発生するのは、メモリ素子温度
の変動やパルス状バイアス磁界条件の変動等の要因によ
り、バイアス磁界パルスにより駆動されたVBL対の停
止位置がばらつき、このばらつきが累積されることに起
因している。バイアス磁界パルスの後にパルス状バイア
ス磁界の立上り時間より長いパルス休止期間を設けるこ
とによって、VBL対はビット固定用局所面内磁界のポ
テンシャルの谷底に落着き、VBL対の停止位置のばら
つきを除去することができる。
(Function) VBL pair transfer errors occur because the stopping position of the VBL pair driven by the bias magnetic field pulse varies due to factors such as variations in memory element temperature and pulsed bias magnetic field conditions, and this variation This is due to the fact that it is cumulative. By providing a pulse pause period that is longer than the rise time of the pulsed bias magnetic field after the bias magnetic field pulse, the VBL pair settles at the bottom of the potential of the local in-plane magnetic field for bit fixing, thereby eliminating variations in the stopping position of the VBL pair. I can do it.

(実施例) 以下、本発明の実施例について図面を参照して説明する
(Example) Hereinafter, an example of the present invention will be described with reference to the drawings.

第1図(aXb)は本発明の一実施例を示すパルス波形
図である。本発明を第1図および第3図を用いて説明す
れば、ガーネットに掘り込んだ溝11の周りに安定化さ
れたストライプ磁区12の外側の磁壁13をVBL対の
転送路となし、並行導体21に電流を流して局所的な面
内磁界を発生させて磁壁13上にVBL対の安定位置5
を形成しておき、外部から第1図31のパルス状バイア
ス磁界を印加して、VBL対1を次の安定位置5に転送
する。その後、パルス状バイス磁界の立上り時間より長
いパルス休止期間によって、前記並行導体による局所的
な面内磁界ポテンシャルの谷底にVBL対1を安定化さ
せるものである。33はクロックである。
FIG. 1 (aXb) is a pulse waveform diagram showing one embodiment of the present invention. To explain the present invention using FIGS. 1 and 3, the outer domain wall 13 of the striped magnetic domain 12 stabilized around the groove 11 dug in garnet is used as a transfer path for the VBL pair, and parallel conductors 21 to generate a local in-plane magnetic field to create a stable position 5 of the VBL pair on the domain wall 13.
is formed, and a pulsed bias magnetic field as shown in FIG. 1 is applied from the outside to transfer VBL pair 1 to the next stable position 5. Thereafter, the VBL pair 1 is stabilized at the bottom of the local in-plane magnetic field potential due to the parallel conductor by a pulse pause period that is longer than the rise time of the pulsed bias magnetic field. 33 is a clock.

第2図は前記実施例の効果を示す図であり、5pmバブ
ル材料を用いたデバイスのパルス状バイアス駆動磁界マ
ージン特性である。図において、縦軸は静的なバイアス
磁界、横軸はパルス状バイアス駆動磁界である。211
m幅、1μmギャップの並行導体パタンに1mAの電流
を流して3pm周期のVBL対の安定位置を形成した。
FIG. 2 is a diagram showing the effect of the above embodiment, and shows the pulsed bias drive magnetic field margin characteristics of a device using a 5 pm bubble material. In the figure, the vertical axis represents a static bias magnetic field, and the horizontal axis represents a pulsed bias drive magnetic field. 211
A current of 1 mA was passed through parallel conductor patterns with a width of m and a gap of 1 μm to form a stable position of a VBL pair with a period of 3 pm.

大きさ60e、立上り時間100ns、パルス平坦部2
00ns、立下り時間500nsのパルス状バイアス駆
動磁界を印加した後、500nsのパルス休止期間を設
けて第2図のマージンを得た。第2図に破線で示すマー
ジンは、前記パルス休止期間を50ns l、か設けな
かった場合のマージンである。
Size 60e, rise time 100ns, pulse flat part 2
After applying a pulsed bias drive magnetic field of 00 ns and fall time of 500 ns, a pulse pause period of 500 ns was provided to obtain the margin shown in FIG. The margin shown by the broken line in FIG. 2 is the margin when the pulse pause period is 50 nsl or not provided.

前記パルス状バイアス磁界の立上り時間より長いパルス
休止期間を設けることによってマージンの上限および下
限近傍が改善された。
By providing a pulse pause period that is longer than the rise time of the pulsed bias magnetic field, the upper and lower limits of the margin were improved.

(発明の効果) このように本発明は、パルス状バイアス磁界により駆動
されたVBL対の停止位置のばらつきを除去するもので
あり、次の駆動に対するVBL対のスタートラインをそ
ろえることにより転送エラーをなくし、大きな動作マー
ジンが得られる。
(Effects of the Invention) As described above, the present invention eliminates variations in the stop position of the VBL pair driven by a pulsed bias magnetic field, and eliminates transfer errors by aligning the start lines of the VBL pair for the next drive. A large operating margin can be obtained.

なお、本実施例では並行導体に流す電流によるVBL対
の安定化法を用いたが、バタン化された面内磁化膜等を
用いた場合でも同様の効果が得られることは明らかであ
る。
In this embodiment, a method of stabilizing the VBL pair using a current flowing through parallel conductors was used, but it is clear that the same effect can be obtained even when a battened in-plane magnetized film or the like is used.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図(a)、 (b)は本発明の一実施例を示すパル
ス波形図、第2図はVBL対転送のパルス状バイアス磁
界マージン特性の測定結果を示す図、第3図はストライ
プ磁区およびVBL対の安定化法の一例を示すバタン図
、第4図(a)、 (b)は磁気記憶素子の従来の駆動
方法を示すパルス波形図である。 図において、1は垂直ブロッホライン対、5は垂直ブロ
ッホライン対の安定位置、11はガーネットに掘り込ん
だ溝、12はストライプ磁区、13は磁壁、21は並行
導体バタン、25はビット固定用の電流、31はバイア
ス磁界パルス、32はバイアス磁界パルス休止期間、3
3はクロックである。
Figures 1 (a) and (b) are pulse waveform diagrams showing one embodiment of the present invention, Figure 2 is a diagram showing measurement results of pulsed bias magnetic field margin characteristics of VBL versus transfer, and Figure 3 is a diagram showing striped magnetic domains. FIGS. 4(a) and 4(b) are pulse waveform diagrams showing a conventional method for driving a magnetic memory element. In the figure, 1 is a pair of vertical Bloch lines, 5 is a stable position of a pair of vertical Bloch lines, 11 is a groove dug into garnet, 12 is a striped magnetic domain, 13 is a domain wall, 21 is a parallel conductor button, and 25 is a bit fixing hole. current, 31 is a bias magnetic field pulse, 32 is a bias magnetic field pulse pause period, 3
3 is a clock.

Claims (1)

【特許請求の範囲】[Claims] 膜面に垂直な方向を磁化容易方向とする強磁性体(フェ
リ磁性体を含む)膜に、膜面に垂直な方向にパルス状の
バイアス磁界を印加し、前記強磁性体に存在するストラ
イプドメインの境界のブロッホ磁壁中に作った相隣る2
つの垂直ブロッホラインからなる垂直ブロッホライン対
を転送保持し記憶担体とする磁気記憶素子の駆動方法に
おいて、前記パルス状バイアス磁界の後に前記パルス状
バイアス磁界の立上り時間より長いパルス休止期間を設
けたことを特徴とする磁気記憶素子の駆動方法。
A pulsed bias magnetic field is applied in the direction perpendicular to the film surface to a ferromagnetic material (including ferrimagnetic material) film whose easy magnetization direction is perpendicular to the film surface, and the striped domains existing in the ferromagnetic material are Two adjacent blocks created in the Bloch domain wall at the boundary of
In a method for driving a magnetic memory element that transfers and holds a vertical Bloch line pair consisting of two vertical Bloch lines as a storage carrier, a pulse pause period longer than a rise time of the pulsed bias magnetic field is provided after the pulsed bias magnetic field. A method for driving a magnetic memory element characterized by:
JP63176628A 1988-07-14 1988-07-14 Magnetic memory element driving method Pending JPH0227587A (en)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03272491A (en) * 1990-03-22 1991-12-04 Nippon Seimitsu Denki Kk Detector of overlapping of thin plates

Cited By (1)

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