JPH0227676A - デバイス用ソケット - Google Patents

デバイス用ソケット

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JPH0227676A
JPH0227676A JP63177046A JP17704688A JPH0227676A JP H0227676 A JPH0227676 A JP H0227676A JP 63177046 A JP63177046 A JP 63177046A JP 17704688 A JP17704688 A JP 17704688A JP H0227676 A JPH0227676 A JP H0227676A
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JP
Japan
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contact
lead
socket
pin
pins
Prior art date
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Pending
Application number
JP63177046A
Other languages
English (en)
Inventor
Nobuhide Maruo
延秀 丸尾
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
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Publication of JPH0227676A publication Critical patent/JPH0227676A/ja
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  • Testing Of Short-Circuits, Discontinuities, Leakage, Or Incorrect Line Connections (AREA)
  • Tests Of Electronic Circuits (AREA)
  • Connecting Device With Holders (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔概要〕 高密度型のデバイス評価用ソケットに関し、必要に応じ
て任意にリードとコンタクトピンとの接触不良を検査で
きることを目的とし、集積回路のデバイスをソケットに
@置して該デバイスのリードを該ソケットのコンタクト
ピンに当接させ、該ソケットの回動する蓋に設けた突起
部で前記リードを押圧して前記コンタクトピンに圧接す
るデバイス用ソケットにおいて、前記コンタクトピンを
2本のビンに分割し、これら2本のビンが互いに独立に
前記リードと接触するように構成する。
〔産業上の利用分野〕
本発明は高密度型のデバイス評価用ソケットに関するも
のである。
近年、半導体製造技術の進歩に伴い高密度の集積回路が
出現してきた。このような高密度型のデバイスとしては
、スモール・アウトライン・パッケージ(SOP)や四
方向フラットパッケージ(QFP)等の表面実装型(S
MT)LS Iがある。SMT型LSIはパッケージの
四辺から複数本のリードが突設されており、リードは細
線化し、密集している。かくして、SMT型のLSIで
は各リードをソケットのコンタクトピンに圧接して接続
を図る方式が主流になっており、圧接であるため、全て
のリードについて接触が確実であることが積極的にhl
EiJできるソケットの開発が望まれている。
〔従来の技術〕
従来、デバイスのリードとソケットのコンタクトピンと
の接触不良の検査はデバイス側に内蔵された保護用ダイ
オードのV−1(電圧−電流)特性を利用して行ってい
る。
第5図において、aは保護用ダイオードで、過電圧印加
時の回路保護のためにデバイス1内に予め設けられてい
る。デバイス1のリード2が基板3上のコンタクトピン
4に絶縁性の押圧バー5により圧接されて、デバイス1
はソケットの基板3上に支持され実装される。デバイス
lは5OP(スモール・アウトライン・パッケージ)や
SMT(表面実装)型の薄型高密度LSIでありパッケ
ージの四辺から複数本のり−ド2が突設されている。こ
のような高密度LSIのリード2は細く互いに接近して
密集しており、スルーホールに挿入したり、ソケットの
挿入ビンに挿通することは困難である。従って圧接方式
が採用されている。
このように圧接されたり一部2とコンタクトピン4との
接触不良は以下のように検査していた。
コンタクトピン4に数百μへ程度の負電流■を供電部6
より印加する。このとき、供電部6の他端は基板3のグ
ランドGに接続されている。今、ダイオードaに順方向
に電流■が流れると、グランドGとコンタクトピン4と
の間に、0.4〜0.8V程度の順方向電圧陳下による
電圧VFが生じる。
この電圧■、を検出器7で検知する、電圧■rが発生す
ればリード2とコンタクトピン4との接触が正常、発生
しなければ接触不良と判別する。
〔発明が解決しようとする課題〕
しかしながら、従来の方法では、回路構成上保護用ダイ
オードを内蔵しないデバイスのリードとソケット側のコ
ンタクトピンとの接触不良の検査は不可能であるという
欠点があった。
この発明は上記欠点を解消するためになされたもので、
必要に応じて任意にリードとコンタクトピンとの接触不
良を検査できるデバイス用ソケットを提供することを目
的としている。
〔課題を解決するための手段〕
本発明を実施例に対応する第1図に基づいて説明すると
、 デバイス1をソケット10に載置して該デバイス1のリ
ード2をコンタクトピン11に当接させ、蓋14に設け
た突起部15でリード2を押圧してコンタクトピン11
に圧接させるソケットであって、前記コンタクトピン1
1を2本のビンIIa、Ilbに分割し、これら2本の
ビンlla、ttbが互いに独立に前リード2と接触す
るようにした。
〔作用〕
上記実施例に基づき、本発明では、突起部I5でリード
2を押圧すると、リード2は分割された各ビンlla、
llbと別々の位置で夫々接触する。するとビンlla
、リード2、ビンllbは直列の配線路を形成するので
、一方のビン11aと他方のビンllbに所定の導電テ
スタを接続すれば、リード2とビンlla、llbとが
同時に接触しているかどうか積極的に検知することがで
きる。
〔実施例〕
以下、本発明を図面に基いて説明する。
第1図は本発明のソケットの一部を拡大した断面図を示
し、第2図は本発明のソケットを蓋を開いたときの全体
の平面図を示している。第2図において、ソケット10
はコンタクトピン11が多数植設された基板12と基板
12にシャフト13を介して回動可能に連結された蓋1
4とから構成されている。基板12及びlj[14の中
央部には略同形の矩形孔17.16が形成され、矩形孔
17の四辺の周囲にはコンタクトピン11が配設されて
いる。蓋14の矩形孔16の四辺の周囲には突起部15
がM14の延在面から略垂直に形成され、蓋14をシャ
フト13の回りに回動して基板10に重ねたとき突起部
15がコンタクトピン11と重なるような位置に配設さ
れている。第3図はこのソケットに実装されるフラット
パッケージ型の電子回路デバイスlを示し、デバイス1
の4側面から多数のり一ド2が突設されている。このデ
バイスlは高密度型のSOP、SMTタイプであり、薄
型でリード2は複数本もあり、細線で互いに密集してい
る。リード2は略クランク状の金属片からなり、水平な
基端部2a、垂直部2b、水平な先端部2Cが連続して
構成される。
第1図において、ソケット10の基板12はプラスチッ
ク等により形成され、基板12に植設されたコンタクト
ピン11は独立した2本のビン11a、llbから構成
されている。各ビン11a、llbの下端部は基板12
を貫通して下面から突出し、その上端部は上面に突出し
、中間部が互いに外方にふくらんでバネ部を形成してい
る。
各ビンlla、llbの上端面は路間−平面上にあり、
各ビンlla、llbは互いに対向した位置にあるが離
隔している。ソケット10上にデバイス1が矩形孔17
に重なるように載置され、リード2の先端部2cを各ビ
ンlla、llbの先端面と夫々当接させる。次に蓋1
4を回動して閉じることにより、蓋14が基板12に重
なり、突起部15の先端面がリード2の先端部2cを」
−方から押圧する。蓋14を図示外の係止具で基板12
に係止すると突起部15は更にリード2の先端部2cを
圧接するので、先端部2cの下面は、各ビンlla、1
1bの先端面を押圧する。これにより各ビンlla、l
lbはバネ部が弾性変形し、リードと確実に接触する。
デバイス1の周囲の全てのり一ド2と、ソケット10の
全てのコンタクトピン11とが同様な構成で接触される
かくて、デバイスlのリード2とソケット10のコンタ
クトピン11との接触不良検査は、ビンlla、リード
2及びビンllbの直列配線がオーブン状態か、シーt
 −ト状態かをマイクロアンメータ等で検査することが
できる。即ち、一方のビンllbに数百μA程度の電流
■を供電部6より印加し、マイクロアンメータ等の検出
器7で他方のビンllaからの微弱電流を検出する。検
出器7により数百μA程度の電流が検知されたら、ビン
llb、リード2及びビンllaの直列配線は正常であ
り、検知がなければ接触不良である。
このような検査を全てのり−ド2とコンタクトピン11
について、所定の並列検査器もしくはスキャン型検査器
で行って、全体的な接触の正常、異常をを検査する。な
お一方のビンllaが接触していても、他方のビンll
bが接触不良でも本発明の検査では不良の判断となるが
、2回路が正常なときのみ接触正常とするフェイルセー
フ型の接続方式となる。
第4図は本発明の他の実施例を示し、コンタクトピン1
1はビンllcとビンllbとにて分割されている。ビ
ンllcはビンllbよす長<形成され、またビンll
cはリード2の垂直部2bより離れて矩形孔17寄りに
植設されている。
このためビンllcの先端面はり一ド2の基端部2aの
下面と当接するようになっている。突起部15により先
端部2Cの上面から押圧すると、先端部2Cの下面がビ
ンllbの上端面と圧接し、更にバネ部の弾性変形によ
りビンllbがたわむ、略同時に基端部2aの下面がビ
ンllcの上端面に圧接する。なおこれらの接触検査は
上述と同様に行う。これによりデバイス1の内部回路構
成と無関係に接触不良の検査ができる。
なお、このデバイス用ソケットはデバイス1を動作評価
するための試験用ソケッt・とじて用いてもよい。デバ
イス1の動作評価時には蓋14を開閉して各種デバイス
を入れ替えて評価試験をするが、複数本もあるリードと
コンタクトピンとの接触を積極的に調べることができる
ので確実な評価試験が実行される。
〔発明の効果〕
以上の説明から明らかなように、本発明のデバイス用ソ
ケットによれば、デバイスの内部回路と無関係にソケッ
トとの接続状態を確実に検査できるので、デバイスの動
作テストや、デバイスの能力評価時に接触不良等の内部
回路以外の要因を排し、デバイスそのものの評価が正確
にできる、又保守の場合にも大いに便利となる。
【図面の簡単な説明】
第1図は本発明の要部断面図、 第2図は本発明のソケットの全体平面図、第3図は集積
回路デバイスの斜視図、 第4図は本発明の他の実施例の断面図、第5図は従来の
方法の構成図である。 図において、 1はデバイス、 はリード、 は供電部、 は検出部、 0はソケット、 1はコンタクトピン、 1a、llb、llcはビン、 2は基板、 4は蓋、 5は突起部を示す。

Claims (1)

    【特許請求の範囲】
  1. 集積回路のデバイス(1)をソケット(10)に載置し
    て該デバイス(1)のリード(2)を該ソケット(10
    )のコンタクトピン(11)に当接させ、該ソケット(
    10)の回動する蓋(14)に設けた突起部(15)で
    前記リード(2)を押圧して前記コンタクトピン(11
    )に圧接するデバイス用ソケット(10)において、前
    記コンタクトピン(11)を2本のピン(11a、11
    b)に分割し、これら2本のピン(11a、11b)が
    互いに独立に前記リード(2)と接触するようにしたこ
    とを特徴とするデバイス用ソケット。
JP63177046A 1988-07-18 1988-07-18 デバイス用ソケット Pending JPH0227676A (ja)

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JP63177046A JPH0227676A (ja) 1988-07-18 1988-07-18 デバイス用ソケット

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JP63177046A JPH0227676A (ja) 1988-07-18 1988-07-18 デバイス用ソケット

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ID=16024192

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JP63177046A Pending JPH0227676A (ja) 1988-07-18 1988-07-18 デバイス用ソケット

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5528466A (en) * 1991-11-12 1996-06-18 Sunright Limited Assembly for mounting and cooling a plurality of integrated circuit chips using elastomeric connectors and a lid
US5800209A (en) * 1993-11-12 1998-09-01 Berg Technology, Inc. Electrical connector and affixing member

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5819882A (ja) * 1981-07-28 1983-02-05 山一電機工業株式会社 集積回路板の接続器
JPS6255887B2 (ja) * 1981-07-23 1987-11-21 Kao Corp

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