JPH0228811A - Over-current detector - Google Patents

Over-current detector

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JPH0228811A
JPH0228811A JP63180817A JP18081788A JPH0228811A JP H0228811 A JPH0228811 A JP H0228811A JP 63180817 A JP63180817 A JP 63180817A JP 18081788 A JP18081788 A JP 18081788A JP H0228811 A JPH0228811 A JP H0228811A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.

Description

【発明の詳細な説明】 [産業上の利用分野] この発明は、制御装置にワンチップマイクロコンピュー
タが用いられた空気調和機や電気冷蔵庫等の負荷保護機
能の過電流検出装置に係り、更に詳しくは制御装置の電
源投入時に、所定時間過電流検出が行なわれたものと見
なし、負荷駆動のパワートランジスタ回路にスイッチン
グパルスを出力するベース駆動回路の電源をOFFとし
、そのパワートランジスタ回路の破壊を防止する過電流
検出装置に関するものである。
[Detailed Description of the Invention] [Industrial Application Field] The present invention relates to an overcurrent detection device for load protection functions of air conditioners, electric refrigerators, etc., in which a one-chip microcomputer is used as a control device. When the control device is powered on, it is assumed that overcurrent has been detected for a predetermined period of time, and the power to the base drive circuit that outputs switching pulses to the load-driven power transistor circuit is turned off to prevent damage to the power transistor circuit. The present invention relates to an overcurrent detection device.

[従 来 例コ 近年、空気調和機や電気冷蔵庫にはワンチップマイクロ
コンピュータが用いられ、その空気調和機や電気冷蔵庫
の負荷制御はインバータ方式が主流となっている。
[Conventional Examples] In recent years, one-chip microcomputers have been used in air conditioners and electric refrigerators, and the inverter method has become mainstream for load control of these air conditioners and electric refrigerators.

このインバータ方式では、マイクロコンピュータにて負
荷を駆動するパワートランジスタ回路の制御用パルスを
生成している。この制御用パルスに基づいて、パワート
ランジスタ回路がスイッチングされ、負荷がインバータ
制御される。このとき、パワートランジスタ回路をスイ
ッチングするパルスは、上記制御用パルスに基づいてベ
ース駆動回路にて得られるようになっている。また、上
記パワートランジスタ回路が過電流にて破壊されないよ
うに、過電流検出装置が設けられ、過電流が検出された
とき、上記マイクロコンピュータにて制御用パルスをオ
フとし、パワートランジスタ回路のスイッチング動作を
停止させ、負荷に過電流を流すことなく、しかもパワー
トランジスタ回路の破壊を防止するようにしている。
In this inverter system, a microcomputer generates control pulses for a power transistor circuit that drives a load. Based on this control pulse, the power transistor circuit is switched and the load is controlled by the inverter. At this time, a pulse for switching the power transistor circuit is obtained by the base drive circuit based on the control pulse. In order to prevent the power transistor circuit from being destroyed by overcurrent, an overcurrent detection device is provided, and when overcurrent is detected, the control pulse is turned off in the microcomputer and the switching operation of the power transistor circuit is performed. This prevents overcurrent from flowing through the load and prevents damage to the power transistor circuit.

[発明が解決しようとする課題] ところで、上記過電流検出装置においては、制御装置の
電源が投入されて所定時間(マイクロコンピュータのイ
ニシャライズ)後に、制御用パルスが生成され、それら
から過電流検出装置が動作される。しかしながら、その
制御装置の電源投入直後においては、上記制御用パルス
を出力するマイクロコンピュータのボートは不安定な状
態にあり、上記パワートランジスタ回路のアーム間を短
終する条件となることもある。すなわち、そのようなと
き、ベース駆動回路からはパワートランジスタのアーム
間(例えばエミッタ・コレクタ間)を短絡するスイッチ
ングパルスが出力され、パワ−1〜ランジスタ回路を破
壊してしまうという問題点があった。
[Problems to be Solved by the Invention] By the way, in the above-mentioned overcurrent detection device, control pulses are generated after a predetermined time (initialization of the microcomputer) after the control device is powered on, and the overcurrent detection device is operated. However, immediately after the control device is powered on, the microcomputer boat that outputs the control pulses is in an unstable state, which may create a condition for short-term termination between the arms of the power transistor circuit. In other words, in such a case, the base drive circuit outputs a switching pulse that short-circuits the arms of the power transistor (for example, between the emitter and collector), causing the power transistor circuit to be destroyed. .

この発明は上記問題点に鑑みなされたものであり、その
目的は電源投入直後において、負荷を駆動するパワート
ランジスタ回路の破壊を防止することができるようにし
た過電流検出装置を提供することにある。
This invention has been made in view of the above problems, and its purpose is to provide an overcurrent detection device that can prevent damage to a power transistor circuit that drives a load immediately after power is turned on. .

[課題を解決するための手段] 上記目的を達成するために、この発明は、空気調和機等
の制御装置のマイクロコンピュータにてパワートランジ
スタ回路を駆動し、その空気調和機等の負荷をインバー
タ制御する際、そのパワートランジスタ回路の過電流を
検出する過電流検出装置において、上記制御装置の電源
投入時に、所定時間過電流検出と見なす信号を出力する
擬似信号発生手段を設け、その擬似的信号にて前記パワ
−トランジスタ回路のスイッチングパルスを出力するベ
ース駆動回路の電源をOFF状態とするようにしたもの
である。
[Means for Solving the Problems] In order to achieve the above object, the present invention drives a power transistor circuit in a microcomputer of a control device for an air conditioner, etc., and controls the load of the air conditioner, etc. using an inverter. In this case, the overcurrent detection device for detecting overcurrent in the power transistor circuit is provided with a pseudo signal generating means that outputs a signal deemed to be overcurrent detection for a predetermined period of time when the power of the control device is turned on, and the pseudo signal is Then, the power of the base drive circuit that outputs the switching pulse of the power transistor circuit is turned off.

また、この発明の過電流検出装置は、上記擬似信号発生
手段にC−R時定数の積分回路を用い、上記電源投入時
よりそのC−R時定数の間上記過電流と見なす信号を出
力するようにしたものである。
Further, the overcurrent detection device of the present invention uses an integrator circuit with a C-R time constant as the pseudo signal generating means, and outputs a signal deemed to be the overcurrent for a period of the C-R time constant from when the power is turned on. This is how it was done.

[作  用] 上記構成としたので、上記制御装置の電源投入直後にお
いて、上記積分回路にてその時定数の間上記ベース駆動
回路の電源をOFFとする擬似制御信号が得られる。す
なわち、その制御装置のワンチップマイクロコンピュー
タの出力ボートが不安定にあり、その出力ボートから上
記パワートランジスタ回路のアーム間を短絡する制御用
パルスが出力されても、その制御用パルスに基づき、上
記ベース駆動回路にてパワートランジスタ回路をスイッ
チングするスイッチングパルスが得られない。
[Function] With the above configuration, immediately after the control device is powered on, the integration circuit obtains a pseudo control signal that turns off the power to the base drive circuit for the time constant. In other words, even if the output port of the one-chip microcomputer of the control device is unstable and a control pulse that short-circuits the arms of the power transistor circuit is output from the output port, the control pulse that short-circuits the arms of the power transistor circuit is A switching pulse for switching the power transistor circuit cannot be obtained in the base drive circuit.

したがって、上記電源投入直後においては、パワートラ
ンジスタ回路はON、OFF駆動されず、そのアーム間
の短絡等も生じない。
Therefore, immediately after the power is turned on, the power transistor circuit is not turned ON or OFF, and no short circuit occurs between the arms.

[実 施 例] 以下、この発明の実施例を図面に基づいて説明する。[Example] Embodiments of the present invention will be described below based on the drawings.

第1図において、商用電源1が整流部2にて所定直流電
圧に変換され、パワートランジスタ回路3に印加されて
いる。その商用電源1の投入により、ワンチップマイク
ロコンピュータ4にて制御用パルスが生成され、この制
御用パルスに基づいてベース駆動回路5にてスイッチン
グパルスが得られる。このスイッチングパルスにてパワ
ートランジスタ回路3が駆動され、負荷6のインバータ
制御が行なわれる。パワートランジスタ回路3の入力段
には、過電流を検出するための電流検出用抵抗(シャン
1−抵抗)7が設けられている。パワートランジスタ回
路3のアーム間短絡等による過電流がその電流検出用抵
抗7を介して第1の電流検出回路8および第2の電流検
出回路9に検出される。この場合、第1の電流検出回路
8は比較的低い電流で動作し、第2の電流検出回路9は
負荷短絡等による急激な大電流で動作する。そのため、
第1の電流検出回路8には、その電流変化を検出する抵
抗回路8aと、その検出信号をアイソレートするカプラ
回路8bとが設けられ、第2の電流検出回路9には同じ
く抵抗回路9aと、カプラ回路9bとが設けられている
In FIG. 1, a commercial power source 1 is converted into a predetermined DC voltage by a rectifier 2 and is applied to a power transistor circuit 3. When the commercial power supply 1 is turned on, a control pulse is generated in the one-chip microcomputer 4, and a switching pulse is obtained in the base drive circuit 5 based on this control pulse. The power transistor circuit 3 is driven by this switching pulse, and the inverter control of the load 6 is performed. At the input stage of the power transistor circuit 3, a current detection resistor (shan 1-resistance) 7 is provided for detecting overcurrent. An overcurrent caused by a short circuit between arms of the power transistor circuit 3 is detected by the first current detection circuit 8 and the second current detection circuit 9 via the current detection resistor 7. In this case, the first current detection circuit 8 operates with a relatively low current, and the second current detection circuit 9 operates with a sudden large current due to a load short circuit or the like. Therefore,
The first current detection circuit 8 is provided with a resistance circuit 8a that detects the current change, and a coupler circuit 8b that isolates the detection signal, and the second current detection circuit 9 is provided with a resistance circuit 9a and a coupler circuit 8b that isolates the detection signal. , and a coupler circuit 9b are provided.

第1の電流検出回路8による検出信号は積分回路10を
介して2ナンド回路11の一入力端子に入力され、この
他方入力端子には第2の電流検出回路9による検出信号
が入力される。上記積分回路10においては、上記商用
電源1の投入(当該制御装置の電源投入)直後、C−R
時定数の間過電流が生じたものとみなす擬似信号(Lレ
ベル信号)が得られる。また、上記2ナンド回路11の
出力は第1あるいは第2の電流検出回路8,9の少なく
とも何れか一方にて過電流が検出されるとHレベルとな
り、この出力信号はインバータ回路12にて反転され、
RSフリップ・フロップ回路13に入力される。
The detection signal from the first current detection circuit 8 is input to one input terminal of the 2-NAND circuit 11 via the integrating circuit 10, and the detection signal from the second current detection circuit 9 is input to the other input terminal. In the integrating circuit 10, immediately after turning on the commercial power supply 1 (powering on the control device), the C-R
A pseudo signal (L level signal) is obtained that indicates that an overcurrent has occurred during the time constant. Further, the output of the 2-NAND circuit 11 becomes H level when an overcurrent is detected in at least one of the first or second current detection circuits 8 and 9, and this output signal is inverted by the inverter circuit 12. is,
The signal is input to the RS flip-flop circuit 13.

RSフリップ・フロップ回路13は二つの2ナンド回路
13a、13bから構成され、その反転された信号は2
ナンド回路13bの一入力端子に入力される。
The RS flip-flop circuit 13 is composed of two 2-NAND circuits 13a and 13b, and the inverted signal is 2
It is input to one input terminal of the NAND circuit 13b.

そして、2ナンド回路13bの他方入力端子には2ナン
ド回路13aの出力信号が入力され、またその出力信号
はワンチップマイクロコンピュータ(CPII)4の入
力ポートA(過電流割込み端子)に入力される。なお、
入力ポートAにLレベル信号が入力されると、ワンチッ
プマイクロコンピュータ4は過電流保護の割込み処理プ
ログラムを実行する。また、ワンチップマイクロコンピ
ュータ4の出力ポートBからのセット信号は2ナンド回
路13aの一入力端子に入力され、この他方入力端子に
は2ナンド回路13bの出力信号が入力される。さらに
、その2ナンド回路13bの出力信号はPNP型トラン
ジスタ14を介してベース駆動回路5の電源ON。
The output signal of the 2-NAND circuit 13a is input to the other input terminal of the 2-NAND circuit 13b, and the output signal is input to the input port A (overcurrent interrupt terminal) of the one-chip microcomputer (CPII) 4. . In addition,
When an L level signal is input to input port A, one-chip microcomputer 4 executes an overcurrent protection interrupt processing program. Further, the set signal from the output port B of the one-chip microcomputer 4 is input to one input terminal of the 2-NAND circuit 13a, and the output signal of the 2-NAND circuit 13b is input to the other input terminal. Further, the output signal of the 2-NAND circuit 13b turns on the power to the base drive circuit 5 via the PNP transistor 14.

OFFの制御信号とされる。また、ワンチップマイクロ
コンピュータ4の出力ポートCがらは上記制御用パルス
がベース駆動回路5に出力される。
This is an OFF control signal. Further, the above control pulse is output from the output port C of the one-chip microcomputer 4 to the base drive circuit 5.

次に、空気調和機等の制御装置に用いられる上記構酸の
負荷過電流検出回路の動作を第2図のタイムチャートに
基づいて説明する。
Next, the operation of the above-mentioned structural acid load overcurrent detection circuit used in a control device such as an air conditioner will be explained based on the time chart shown in FIG.

まず、制御装置の電源が投入されると、第2図(a)に
示されるように、積分回路10の出力はC・R時定数以
後に一定(Hレベル)となる。そのC・R時定数の間は
、略Lレベルとみなすことができ、第2図(c)に示さ
れるように、2ナンド回路11の出力はHレベルに保た
れる。すると、インバータ回路12の出力がLレベルと
されるため、第2図(e)に示されるように、2ナンド
回路13bの出力はHレベルとされ、RSフリップ・フ
ロップ回路13はリセットされる。これにより、PNP
型トランジスタ14はOFF状態とされ、ベース駆動回
路5には電源OFFの制御信号が入力されることになる
。すなわち、第2図(f)の破線部分子に示される間(
電源投入時における出力ポートが不安定な間)、2アン
ド回路11の出方は確実にHレベルに保たれるため、ベ
ース駆動回路5が動作されず、スイッチングパルスの出
力がなく、パワートランジスタ回路5のスイッチング動
作は行なわれない。
First, when the control device is powered on, the output of the integrating circuit 10 becomes constant (H level) after the C.R time constant, as shown in FIG. 2(a). During the C/R time constant, it can be regarded as approximately L level, and as shown in FIG. 2(c), the output of the 2-NAND circuit 11 is maintained at H level. Then, since the output of the inverter circuit 12 is set to the L level, the output of the 2-NAND circuit 13b is set to the H level, as shown in FIG. 2(e), and the RS flip-flop circuit 13 is reset. This allows PNP
The type transistor 14 is turned off, and a power-off control signal is input to the base drive circuit 5. That is, while (
(While the output port is unstable when the power is turned on), the output of the 2-AND circuit 11 is reliably kept at the H level, so the base drive circuit 5 is not operated, there is no output of switching pulses, and the power transistor circuit The switching operation No. 5 is not performed.

このように、積分回路10の時定数の間、すなわちワン
チップマイクロコンピュータ4の出力ポートが不安定な
期間はパワートランジスタ回路3に過電流が流れること
もない。なお、上記C−R時定数は、ワンチップマイク
ロコンピュータのリセット期間より僅かに短くてもよい
In this way, no overcurrent flows through the power transistor circuit 3 during the time constant of the integrating circuit 10, that is, during the period when the output port of the one-chip microcomputer 4 is unstable. Note that the CR time constant may be slightly shorter than the reset period of the one-chip microcomputer.

続いて、上記以後、第2図(a)に示されるように、積
分回路10の出力はHレベルに保たれ、またその以前に
出力ポートBからはLレベルのセット信号が出力される
ため、2ナンド回路13aの出力はHレベルに保たれ(
第2図(g)示す)、2ナンド回路13bの出力はLレ
ベルとされる(第2図(e)示す)。すると、 PNP
型トランジスタ14はON状態とされ、ベース駆動回路
5は電源ON状態にされる(電源が供給される)。さら
に、第2図(f)に示されるように、ワンチップマイク
ロコンピュータ4のイニシャライズ(リセット)が終了
し、出力ポートBからはHレベル信号が出力される共に
、出力ポートCからは制御用パルスが出力される。
Subsequently, after the above, as shown in FIG. 2(a), the output of the integrating circuit 10 is kept at H level, and before that, an L level set signal is output from output port B. The output of the 2 NAND circuit 13a is kept at H level (
The output of the 2-NAND circuit 13b is set to L level (as shown in FIG. 2(e)). Then, PNP
The type transistor 14 is turned on, and the base drive circuit 5 is turned on (power is supplied). Furthermore, as shown in FIG. 2(f), the initialization (resetting) of the one-chip microcomputer 4 is completed, and an H level signal is output from output port B, and a control pulse is output from output port C. is output.

ここで、第1および第2の電流検出回路8,9にて過電
流が検出されない場合、ワンチップマイクロコンピュー
タ4にて負荷6をインバータ制御するための制御用パル
スが出力される。これにより、ベース駆動回路5からは
スイッチングパルスが出力され、パワートランジスタ回
路3がON、OFF駆動され、負荷は正常にインバータ
制御される。
Here, if the first and second current detection circuits 8 and 9 do not detect an overcurrent, the one-chip microcomputer 4 outputs a control pulse for inverter control of the load 6. As a result, a switching pulse is output from the base drive circuit 5, the power transistor circuit 3 is turned on and off, and the load is normally controlled by the inverter.

さらに、図示しないが、第1の電流検出回路8にて過電
流が検出されると、カプラ回路8bの出力がLレベルと
されるため、2ナンド回路11の出力はHレベルとされ
る。すると、2ナンド回路13bの出力がHレベルとな
り、RSフリップ・フロップ回路13はリセット(2ナ
ンド回路13aの出カニLレベル)されるため、ワンチ
ップマイクロコンピュータ4には従来同様の過電流検出
の割込み信号(Lレベル信号)が入力される。すなわち
、ワンチップマイクロコンピュータ4にて過電流保護の
ための割込み処理が実行され、例えば出力ポートからは
制御用パルスが出力されなくなる。これにより、パワー
トランジスタ回路3におけるON。
Furthermore, although not shown, when the first current detection circuit 8 detects an overcurrent, the output of the coupler circuit 8b is set to L level, and therefore the output of the 2-NAND circuit 11 is set to H level. Then, the output of the 2-NAND circuit 13b goes to H level, and the RS flip-flop circuit 13 is reset (the output of the 2-NAND circuit 13a goes to L level), so the one-chip microcomputer 4 is equipped with the conventional overcurrent detection function. An interrupt signal (L level signal) is input. That is, the one-chip microcomputer 4 executes interrupt processing for overcurrent protection, and for example, control pulses are no longer output from the output port. As a result, the power transistor circuit 3 is turned on.

OFF駆動が行なわれず、負荷6のインバータ制御が停
止される。
OFF drive is not performed and inverter control of the load 6 is stopped.

その過電流検出が行なわれないとき、第2図(a)に示
されるように、積分回路10の出力はそのC−R時定数
後Hレベルを保護する。そして、上記割込み処理後に、
出力ポートBからはセット信号(Lレベル信号)が出力
されるため、RSフリップ・フロップ回路13がセット
される(第2図(g)に示す)。すなわち、入力ポート
Aにはその2ナンド回路13aの出力信号が入力され、
ワンチップマイクロコンピュータ4は負荷6を通常通り
インバータ制御するための制御用パルスを生成するプロ
グラムを実行することになる。
When overcurrent detection is not performed, the output of the integrating circuit 10 protects the H level after the C-R time constant, as shown in FIG. 2(a). Then, after the above interrupt processing,
Since a set signal (L level signal) is output from output port B, the RS flip-flop circuit 13 is set (as shown in FIG. 2(g)). That is, the output signal of the 2 NAND circuit 13a is input to the input port A,
The one-chip microcomputer 4 executes a program that generates control pulses for controlling the load 6 as usual with the inverter.

このようにして、負荷6がインバータ制御されていると
き、第2図(b)に示されるように、第2の電流検出回
路9にて過電流が検出されると、カプラ回路9bからは
Lレベル信号が出力される。
In this way, when the load 6 is under inverter control, when an overcurrent is detected in the second current detection circuit 9 as shown in FIG. 2(b), the coupler circuit 9b outputs an L A level signal is output.

すると、第2図(e)に示されるように、2ナンド回路
13bの出力がHレベルとなり、RSフリップ・フロッ
プ回路13はリセット状態とされる。これにより、入力
ポートAにはLレベルの割込み信号が入力され、ワンチ
ップマイクロコンピュータ4は従来同様に過電流のため
の割込み処理を実行することになる。
Then, as shown in FIG. 2(e), the output of the 2-NAND circuit 13b becomes H level, and the RS flip-flop circuit 13 is placed in a reset state. As a result, an L-level interrupt signal is input to the input port A, and the one-chip microcomputer 4 executes interrupt processing for overcurrent as in the conventional case.

このように、制御装置の電源投入時において、ワンチッ
プマイクロコンピュータ4の出力ポートが不安定状態に
なっている間、C−R時定数(その不安定期間以上)の
積分回路10にてRSフリップ・フリップ回路13をリ
セットし、過電流検出があったものと見なしている。し
かも、そのRSフリップ・フロップ回路13の2ナンド
回路13bの出力信号をベース駆動回路5の電源をOF
Fする制御信号としている。したがって、上記電源投入
時における出力ポートが不安定状態時において、ワンチ
ップマイクロコンピュータ4の出力ポートに、パワート
ランジスタ回路3のアーム間を短絡するような条件の制
御用パルスが現れたとしても、そのパワートランジスタ
回路3にはスイッチングパルスが入力されない。すなわ
ち、その短絡等による過電流が生ずることもなく、パワ
ートランジスタ回路3のトランジスタの破壊を防止する
ことができる。
In this way, when the power of the control device is turned on, while the output port of the one-chip microcomputer 4 is in an unstable state, the RS flip is performed in the integrating circuit 10 with a C-R time constant (longer than the unstable period). - The flip circuit 13 is reset and it is assumed that an overcurrent has been detected. Moreover, the output signal of the 2-NAND circuit 13b of the RS flip-flop circuit 13 is turned off when the base drive circuit 5 is turned off.
The control signal is F. Therefore, even if a control pulse with a condition that short-circuits the arms of the power transistor circuit 3 appears at the output port of the one-chip microcomputer 4 when the output port is in an unstable state when the power is turned on, the No switching pulse is input to the power transistor circuit 3. In other words, no overcurrent occurs due to the short circuit or the like, and the transistors of the power transistor circuit 3 can be prevented from being destroyed.

[発明の効果コ 以上説明したように、この発明の過電流検出装置によれ
ば、負荷制御にワンチップマイクロコンピュータを用い
ている空気調和機等の制御装置で、その電源投入時に、
過電流検出信号にてリセットされるRSフリップ・フロ
ップ回路をC−R時定数の間リセット状態とする積分回
路を設け、そのリセット状態の間、負荷駆動のパワート
ランジスタ回路3にスイッチングパルスを出力するベー
ス駆動回路5の電源をOFF状態とする制御信号を得る
ようにしたので、ワンチップマイクロコンピュータの出
力ポートが不安定状態となる間、パワートランジスタ回
路におけるON、OFF駆動が行なわれず、そのアーム
間の短絡等が起こらず、パワートランジスタ回路の破壊
を防止することができる。
[Effects of the Invention] As explained above, according to the overcurrent detection device of the present invention, when the power is turned on in a control device such as an air conditioner that uses a one-chip microcomputer for load control,
An integrating circuit is provided that resets the RS flip-flop circuit that is reset by the overcurrent detection signal during the C-R time constant, and outputs a switching pulse to the load-driven power transistor circuit 3 during the reset state. Since a control signal for turning off the power of the base drive circuit 5 is obtained, while the output port of the one-chip microcomputer is in an unstable state, the power transistor circuit is not turned on or off, and the arm This prevents short-circuiting, etc., and prevents damage to the power transistor circuit.

【図面の簡単な説明】[Brief explanation of the drawing]

第1図はこの発明の一実施例を示す過電流検出装置の概
略的回路図、第2図は上記過電流検出装置の動作を説明
するためのタイムチャート図である。 図中、3はパワートランジスタ回路、4はワンチップマ
イクロコンピュータ、5はベース駆動回路、6は負荷、
7は電流検出用抵抗、8は第1の電流検出回路、9は第
2の電流検出回路、1oは積分回路、11.13a 、
 13bは2ナンド回路、12はインバータ回路、13
はRSフリップ・フロップ回路、14はPNP型トラン
ジスタである。 特許出願人 株式会社富士通ゼネラル 代理人 弁理士  大 原  拓 也
FIG. 1 is a schematic circuit diagram of an overcurrent detection device showing an embodiment of the present invention, and FIG. 2 is a time chart diagram for explaining the operation of the overcurrent detection device. In the figure, 3 is a power transistor circuit, 4 is a one-chip microcomputer, 5 is a base drive circuit, 6 is a load,
7 is a current detection resistor, 8 is a first current detection circuit, 9 is a second current detection circuit, 1o is an integration circuit, 11.13a,
13b is a 2 NAND circuit, 12 is an inverter circuit, 13
1 is an RS flip-flop circuit, and 14 is a PNP type transistor. Patent applicant: Fujitsu General Co., Ltd. Patent attorney: Takuya Ohara

Claims (2)

【特許請求の範囲】[Claims] (1)空気調和機等の制御装置のマイクロコンピュータ
にてパワートランジスタ回路を駆動し、その空気調和機
等の負荷をインバータ制御する際、そのパワートランジ
スタ回路の過電流を検出する過電流検出装置において、 前記制御装置の電源投入時に、所定時間過電流検出と見
なす信号を出力する擬似信号発生手段を設け、 その擬似的信号にて前記パワートランジスタ回路のスイ
ッチングパルスを出力するベース駆動回路の電源をOF
F状態とするようにしたことを特徴とする過電流検出装
置。
(1) In an overcurrent detection device that detects overcurrent in the power transistor circuit when a power transistor circuit is driven by a microcomputer in a control device of an air conditioner, etc., and the load of the air conditioner, etc. is controlled by an inverter. , a pseudo signal generating means is provided for outputting a signal regarded as overcurrent detection for a predetermined period of time when the control device is powered on, and the pseudo signal is used to turn off the power to the base drive circuit that outputs the switching pulse of the power transistor circuit.
An overcurrent detection device characterized in that it is set in an F state.
(2)前記擬似信号発生手段はC・R時定数の積分回路
であり、前記電源投入時よりそのC・R時定数の間前記
過電流と見なす信号を出力する請求項(1)記載の過電
流検出装置。
(2) The pseudo signal generating means is an integrator circuit with C and R time constants, and outputs the signal deemed to be the overcurrent during the C and R time constants from when the power is turned on. Current detection device.
JP63180817A 1988-07-19 1988-07-19 Overcurrent detection device Expired - Lifetime JPH0755078B2 (en)

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015070728A (en) * 2013-09-30 2015-04-13 サンケン電気株式会社 Motor driver

Citations (1)

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Publication number Priority date Publication date Assignee Title
JPS5249443A (en) * 1975-10-16 1977-04-20 Sony Corp Power source circuit

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