JPH02303384A - 高速サーチサーボ回路 - Google Patents
高速サーチサーボ回路Info
- Publication number
- JPH02303384A JPH02303384A JP1124072A JP12407289A JPH02303384A JP H02303384 A JPH02303384 A JP H02303384A JP 1124072 A JP1124072 A JP 1124072A JP 12407289 A JP12407289 A JP 12407289A JP H02303384 A JPH02303384 A JP H02303384A
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- JP
- Japan
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- frequency
- output
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- 238000010586 diagram Methods 0.000 description 2
- 239000003990 capacitor Substances 0.000 description 1
- 238000006243 chemical reaction Methods 0.000 description 1
- 238000007796 conventional method Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 230000007257 malfunction Effects 0.000 description 1
Landscapes
- Control Of Electric Motors In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
本発明は、ディジタルオーディオテープレコーダ（以下
ＤＡＴという）等のキャプスタンモータあるいはリール
モータ制御装置に用いられる高速サーチサーボ回路に関
する。
ＤＡＴという）等のキャプスタンモータあるいはリール
モータ制御装置に用いられる高速サーチサーボ回路に関
する。
［従来の技１１ｒ１
Ｄ Ａ ’Ｉ’において、早送り（ＦＦ）／巻き戻しく
ＲＥＷ）・サーチ動作（以下、これらを総称してサーチ
動作という）を行うと、プレイ（ＰＬＡＹ）時を１＠速
として、ストップ（ＳＴＯＰ）時であればＯ倍速、ＰＬ
ＡＹ時であれば１倍速から、−気に２００倍速攻でテー
プ速度が変化する。一方、サーチ時においても、曲の番
号、演奏時間などのサブコード信号の読取りを行う必要
がある。
ＲＥＷ）・サーチ動作（以下、これらを総称してサーチ
動作という）を行うと、プレイ（ＰＬＡＹ）時を１＠速
として、ストップ（ＳＴＯＰ）時であればＯ倍速、ＰＬ
ＡＹ時であれば１倍速から、−気に２００倍速攻でテー
プ速度が変化する。一方、サーチ時においても、曲の番
号、演奏時間などのサブコード信号の読取りを行う必要
がある。
［発明が解決しようとする課Ｂ］
ところで、上記のようにサーチ動作時に一気にテープ速
度を立上げると、テープに無理な力がかかることも原因
して、瞬間、サブコード信号を読み落とす可能性が高く
なる。
度を立上げると、テープに無理な力がかかることも原因
して、瞬間、サブコード信号を読み落とす可能性が高く
なる。
本発明は、このような問題を解消するもので、サーチ動
作の立上がり時にテープ速度をＶ１階的に上げてテープ
に無理な力が加わることを防止し、サブコード読取りを
正確に行うことができる高速サーチサーボ回路を提供す
ることを目的とする。
作の立上がり時にテープ速度をＶ１階的に上げてテープ
に無理な力が加わることを防止し、サブコード読取りを
正確に行うことができる高速サーチサーボ回路を提供す
ることを目的とする。
［課題を解決するための手段］
上記目的を達成するために本発明は、キャプスタンモー
タあるいはり一ルモータ制御装置に用いられ、テープを
高速サーチするときのサーボ回路において、高速サーチ
の制御信号を取込む積分回路と、その積分回路の出力信
号をディジタル化してカウント出力するＡ／Ｄ変換器と
、カウント出力に応じて順次出力か切換わるマルチプレ
クサと、キャプスタンモータあるいはリールモータから
の周波数信号を分周して数種類の周波数を作り、各周波
数毎に並列に前記マルチプレクサへ出力するカウンタと
、前記マルチプレクサからの周波数に反比例する電圧出
力を取出すＦＶ変換器とを具備したものである。
タあるいはり一ルモータ制御装置に用いられ、テープを
高速サーチするときのサーボ回路において、高速サーチ
の制御信号を取込む積分回路と、その積分回路の出力信
号をディジタル化してカウント出力するＡ／Ｄ変換器と
、カウント出力に応じて順次出力か切換わるマルチプレ
クサと、キャプスタンモータあるいはリールモータから
の周波数信号を分周して数種類の周波数を作り、各周波
数毎に並列に前記マルチプレクサへ出力するカウンタと
、前記マルチプレクサからの周波数に反比例する電圧出
力を取出すＦＶ変換器とを具備したものである。
［作用］
上記構成において、サーチ動作の立上がり時の指令信号
を受けた積分回路の出力によりＡ／Ｄ変換器にカウント
出力が得られ、このカウント出力でもって、キャプスタ
ンモータあるいはり一ルモータからの周波数信号の分周
出力を高い周波数より順次選択、取出して、この周波数
信号をＦＶ変換器にて逆比例に電圧変換する。この変換
電圧は段階的に電圧が上昇するものとなり、この出力を
キャプスタンモータあるいはリールモータへ与えること
により、段階的にスピードを上げることができる。
を受けた積分回路の出力によりＡ／Ｄ変換器にカウント
出力が得られ、このカウント出力でもって、キャプスタ
ンモータあるいはり一ルモータからの周波数信号の分周
出力を高い周波数より順次選択、取出して、この周波数
信号をＦＶ変換器にて逆比例に電圧変換する。この変換
電圧は段階的に電圧が上昇するものとなり、この出力を
キャプスタンモータあるいはリールモータへ与えること
により、段階的にスピードを上げることができる。
［実施例］
本発明の一実施例としてキャプスタンモータ制御装置に
用いられた高速サーチサーボ回路について第１図 第２
図、第３図を参照して説明する。
用いられた高速サーチサーボ回路について第１図 第２
図、第３図を参照して説明する。
高速サーチサーボ回路は、キャプスタンモータ１１の周
波数（ＦＣ，）信号を帰還し速度可変を行うサーチ速度
可変回路１を主体構成とする。そして、このサーチ速度
可変回路１は、キャプスタンモー９ 制御１７１マイク
ロコンピユータ（マイコン） ゛回路９からのサーチ（
ＦＡＳＴ）切換信号を取込む積分回路２と、積分回路２
の出力信号をディジタル信号に変換し、３ビツトのカウ
ンタ出力とするＡ／Ｄ変換器３と、カウント出力に合わ
せ順次出力が切換わるマルチプレクサ４と、キャプスタ
ンモータ１１に連結された周波数（ＰＧ）発電機１２か
らのＦＧ倍信号増幅するＦＧ信号増幅器５と、このＦＧ
倍信号分周しマルチプレクサ４へ出力するバイナリカウ
ンタ６と、マルチプレクサ４の出力が入力され、この入
力に対して反比例した出力が取出せるＦ／Ｖ′Ｒ換、？
ｉｉ７と、Ｆ／Ｖ変換器の出力を増幅し、高速時のキャ
プスタンモータ１１駆動用の信号を出力する増幅器８と
からなる。
波数（ＦＣ，）信号を帰還し速度可変を行うサーチ速度
可変回路１を主体構成とする。そして、このサーチ速度
可変回路１は、キャプスタンモー９ 制御１７１マイク
ロコンピユータ（マイコン） ゛回路９からのサーチ（
ＦＡＳＴ）切換信号を取込む積分回路２と、積分回路２
の出力信号をディジタル信号に変換し、３ビツトのカウ
ンタ出力とするＡ／Ｄ変換器３と、カウント出力に合わ
せ順次出力が切換わるマルチプレクサ４と、キャプスタ
ンモータ１１に連結された周波数（ＰＧ）発電機１２か
らのＦＧ倍信号増幅するＦＧ信号増幅器５と、このＦＧ
倍信号分周しマルチプレクサ４へ出力するバイナリカウ
ンタ６と、マルチプレクサ４の出力が入力され、この入
力に対して反比例した出力が取出せるＦ／Ｖ′Ｒ換、？
ｉｉ７と、Ｆ／Ｖ変換器の出力を増幅し、高速時のキャ
プスタンモータ１１駆動用の信号を出力する増幅器８と
からなる。
マイコン回路９は、ＰＬＡＹ時とＦＦ／ＲＥＷ、サーチ
時で切換スイッチＳＷを切換作動する信号を出力すると
共に、上述したように高速時に高速（ＦＡＳＴ）切換信
号を積分回路２へ出力する。
時で切換スイッチＳＷを切換作動する信号を出力すると
共に、上述したように高速時に高速（ＦＡＳＴ）切換信
号を積分回路２へ出力する。
ドライブ増幅器１０はＰＬＡＹ時と高速時とで切換スイ
ッチＳＷにより選択された出力を受けてキャプスタンモ
ータ１１を駆動するものである。
ッチＳＷにより選択された出力を受けてキャプスタンモ
ータ１１を駆動するものである。
第２図はサーチ速度可変回路１の具体構成例を示してい
る。ここに、積分回路２はコンデンサＣ１と抵抗Ｒ１と
トランジスタからなり、Ａ／Ｄ変換器３は比較器Ａ１〜
Ａ７とエクスクル−シブＯＲ回路Ｅ１〜Ｅ７とＯＲ回路
０１，０２，０３等からなり、フラッシュ型と称せられ
るものである。
る。ここに、積分回路２はコンデンサＣ１と抵抗Ｒ１と
トランジスタからなり、Ａ／Ｄ変換器３は比較器Ａ１〜
Ａ７とエクスクル−シブＯＲ回路Ｅ１〜Ｅ７とＯＲ回路
０１，０２，０３等からなり、フラッシュ型と称せられ
るものである。
マルチプレクサ４、バイナリカウンタ６およびＦＶ変換
器７はＩＣチップで構成している。ｔた、Ａ／Ｄ変換器
３の論理表を下記の表に示す、 第３図はマイコン回路
９からの高速（ＦＡＳＴ）信号と、積分回路２の出力と
、Ａ／Ｄ変換器３の出力と、マルチプレクサ４の選択動
作と、キャプスタンモータ１１のスピードの各タイムチ
ャートを示している。
器７はＩＣチップで構成している。ｔた、Ａ／Ｄ変換器
３の論理表を下記の表に示す、 第３図はマイコン回路
９からの高速（ＦＡＳＴ）信号と、積分回路２の出力と
、Ａ／Ｄ変換器３の出力と、マルチプレクサ４の選択動
作と、キャプスタンモータ１１のスピードの各タイムチ
ャートを示している。
上記第３図のタイムチャートを参照して本高速サーチサ
ーボ回路の動作を以下に説明する。マ、イコン９にサー
チ動作の指令が入力されると、マイコン９からのＦＡＳ
Ｔ切換信号は、「ト■」からｒＬ」に切換えられる。こ
の信号が積分回路２に取込まれて積分され、Ａ／Ｄ変換
器３により図示のような３ビツトのカウント出力となり
、マルチプレクサ４に入力される。
ーボ回路の動作を以下に説明する。マ、イコン９にサー
チ動作の指令が入力されると、マイコン９からのＦＡＳ
Ｔ切換信号は、「ト■」からｒＬ」に切換えられる。こ
の信号が積分回路２に取込まれて積分され、Ａ／Ｄ変換
器３により図示のような３ビツトのカウント出力となり
、マルチプレクサ４に入力される。
一方、キャプスタンモータ１１からのＦＧ信号増幅器５
の出力は、バイナリカウンタ６により８段階に分周され
、マルチプレクサ４に入力される。
の出力は、バイナリカウンタ６により８段階に分周され
、マルチプレクサ４に入力される。
マルチプレクサ４においては、Ａ／Ｄ変換器３のカウン
ト出力に同期して、上記バイナリカウンタ６からの１／
１．１／２．１／４．１／８．・・・１／１２８の８段
階に分周された周波数を、高周波数より順に選択する。
ト出力に同期して、上記バイナリカウンタ６からの１／
１．１／２．１／４．１／８．・・・１／１２８の８段
階に分周された周波数を、高周波数より順に選択する。
そして、その出力は■？■変換器７へ入力される。この
ＦＶ変換器７では、高周波数の時は低電圧に反転した信
号電圧を出力する。したがって、この出力は低電圧より
順次高電圧なって増幅器８へ送られ、さらに増幅器８の
出力は、サーチ動作を選択しているスイッチＳＷを介し
てドライブ増幅器１０に与えられ、キャプスタンモータ
１１を駆動する。この結果、キャプスタンモータ１１は
１倍速、２倍速、４倍速、ｌａ速・・・２５６倍速と順
次スピードを上げていく、このようにして、高速Ｍｅを
複数段階に分けて立上げることができる。
ＦＶ変換器７では、高周波数の時は低電圧に反転した信
号電圧を出力する。したがって、この出力は低電圧より
順次高電圧なって増幅器８へ送られ、さらに増幅器８の
出力は、サーチ動作を選択しているスイッチＳＷを介し
てドライブ増幅器１０に与えられ、キャプスタンモータ
１１を駆動する。この結果、キャプスタンモータ１１は
１倍速、２倍速、４倍速、ｌａ速・・・２５６倍速と順
次スピードを上げていく、このようにして、高速Ｍｅを
複数段階に分けて立上げることができる。
（以下、余白）
タイムチャート表
［発明の効果］
以上のように本発明によれば、テープのサーチ等の高速
駆動の立上げ時に、キャプスタンモータあるいはリール
モータのスピードを順次高めていくことができるので、
テープに無理な力がかかることが無くなり、また、再生
ヘッドからのサブコードの読取りが正確に行われ、希望
曲の頭出しなどにおいて、誤動作を生じることなく正し
く選曲することができる。
駆動の立上げ時に、キャプスタンモータあるいはリール
モータのスピードを順次高めていくことができるので、
テープに無理な力がかかることが無くなり、また、再生
ヘッドからのサブコードの読取りが正確に行われ、希望
曲の頭出しなどにおいて、誤動作を生じることなく正し
く選曲することができる。
第１図は本発明の実施例による高速サーチサーボ回路の
構成図、第２図は同回路の主要部の具体構成図、第３図
は同回路の動作を説明するためのタイムチャートである
。 ２・・・積分０路、３・・・Ａ／Ｄ変換器、４・・・マ
ルチプレクサ、６・・・バイナリカウンタ、７・・・Ｆ
Ｖ変換器、１１・・・キャプスタンモータ、１２・・・
ＦＧＩ電機。
構成図、第２図は同回路の主要部の具体構成図、第３図
は同回路の動作を説明するためのタイムチャートである
。 ２・・・積分０路、３・・・Ａ／Ｄ変換器、４・・・マ
ルチプレクサ、６・・・バイナリカウンタ、７・・・Ｆ
Ｖ変換器、１１・・・キャプスタンモータ、１２・・・
ＦＧＩ電機。
Claims (1)
- （１）キャプスタンモータあるいはリールモータ制御装
置に用いられ、テープを高速サーチするときのサーボ回
路において、 高速サーチの制御信号を取込む積分回路と、その積分回
路の出力信号をディジタル化してカウント出力するＡ／
Ｄ変換器と、カウント出力に応じて順次出力が切換わる
マルチプレクサと、キャプスタンモータあるいはリール
モータからの周波数信号を分周して数種類の周波数を作
り、各周波数毎に並列に前記マルチプレクサへ出力する
カウンタと、前記マルチプレクサからの周波数に反比例
する電圧出力を取出すＦＶ変換器とを具備したことを特
徴とする高速サーチサーボ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1124072A JP2561147B2 (ja) | 1989-05-17 | 1989-05-17 | 高速サーチサーボ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1124072A JP2561147B2 (ja) | 1989-05-17 | 1989-05-17 | 高速サーチサーボ回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02303384A true JPH02303384A (ja) | 1990-12-17 |
| JP2561147B2 JP2561147B2 (ja) | 1996-12-04 |
Family
ID=14876245
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1124072A Expired - Lifetime JP2561147B2 (ja) | 1989-05-17 | 1989-05-17 | 高速サーチサーボ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2561147B2 (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4841214A (ja) * | 1971-09-28 | 1973-06-16 | ||
| JPH01114388A (ja) * | 1987-10-26 | 1989-05-08 | Matsushita Electric Ind Co Ltd | アクチュエーター制御装置 |
-
1989
- 1989-05-17 JP JP1124072A patent/JP2561147B2/ja not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4841214A (ja) * | 1971-09-28 | 1973-06-16 | ||
| JPH01114388A (ja) * | 1987-10-26 | 1989-05-08 | Matsushita Electric Ind Co Ltd | アクチュエーター制御装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2561147B2 (ja) | 1996-12-04 |
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