JPH0230606B2 - Kahenritokuzofukuki - Google Patents
KahenritokuzofukukiInfo
- Publication number
- JPH0230606B2 JPH0230606B2 JP12788681A JP12788681A JPH0230606B2 JP H0230606 B2 JPH0230606 B2 JP H0230606B2 JP 12788681 A JP12788681 A JP 12788681A JP 12788681 A JP12788681 A JP 12788681A JP H0230606 B2 JPH0230606 B2 JP H0230606B2
- Authority
- JP
- Japan
- Prior art keywords
- gain
- variable
- switches
- resistor
- operational amplifier
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03G—CONTROL OF AMPLIFICATION
- H03G3/00—Gain control in amplifiers or frequency changers
- H03G3/02—Manually-operated control
- H03G3/04—Manually-operated control in untuned amplifiers
Landscapes
- Control Of Amplification And Gain Control (AREA)
Description
【発明の詳細な説明】
(1) 発明の分野
この発明は、直流アナログ信号の増幅度を可変
とするための可変利得増幅器に関するものであ
る。
とするための可変利得増幅器に関するものであ
る。
(2) 従来技術
従来、可変利得増幅器として、演算増幅器の入
力抵抗または帰環抵抗を可変としたものが考えら
れる。しかしながら、ただ単に可変抵抗を調整す
るのみでは、広い範囲にわたつて、細かく利得を
可変にすることは困難である。
力抵抗または帰環抵抗を可変としたものが考えら
れる。しかしながら、ただ単に可変抵抗を調整す
るのみでは、広い範囲にわたつて、細かく利得を
可変にすることは困難である。
(3) 発明の目的
この発明の目的は、以上の点に鑑み、広い範囲
にわたつて細かく利得を可変することができる可
変利得増幅器を提供することである。
にわたつて細かく利得を可変することができる可
変利得増幅器を提供することである。
(4) 発明の実施例
第１図は、この発明の一実施例を示す構成説明
図である。図において１は入力信号eiが供給され
る入力端子、OPは入力端子１に供給された入力
信号eiがその非反転入力端子に供給される演算増
幅器、SW１は演算増幅器OPの出力側に設けら
れコモンＣより接点Ａを介して可変抵抗VRとア
ースされた抵抗RAを含む分圧抵抗２と、接点Ｂ
を介して演算増幅器OPの反転入力端子とを切換
える第１の切換スイツチ、３は分圧抵抗２と演算
増幅器OPとの間に設けられ、抵抗Ｒ２Ｒ，４Ｒ，
８Ｒ，１６Ｒ，３２Ｒ，６４Ｒ，１２８Ｒ等とス
イツチＳ１，Ｓ２，Ｓ３，Ｓ４，Ｓ５，Ｓ６，S8
等の並列接続を複数個直列接続した利得制御回
路、SW２は演算増幅器のOPの反転入力端子に
接続するコモンＣより接点Ａ，入力抵抗Ｒを介し
てアースとの間に設けられた第２の切換スイツチ
（接点Ｂはどことも接続せず），４は分圧抵抗２の
出力信号e0を取り出す出力端子である。
図である。図において１は入力信号eiが供給され
る入力端子、OPは入力端子１に供給された入力
信号eiがその非反転入力端子に供給される演算増
幅器、SW１は演算増幅器OPの出力側に設けら
れコモンＣより接点Ａを介して可変抵抗VRとア
ースされた抵抗RAを含む分圧抵抗２と、接点Ｂ
を介して演算増幅器OPの反転入力端子とを切換
える第１の切換スイツチ、３は分圧抵抗２と演算
増幅器OPとの間に設けられ、抵抗Ｒ２Ｒ，４Ｒ，
８Ｒ，１６Ｒ，３２Ｒ，６４Ｒ，１２８Ｒ等とス
イツチＳ１，Ｓ２，Ｓ３，Ｓ４，Ｓ５，Ｓ６，S8
等の並列接続を複数個直列接続した利得制御回
路、SW２は演算増幅器のOPの反転入力端子に
接続するコモンＣより接点Ａ，入力抵抗Ｒを介し
てアースとの間に設けられた第２の切換スイツチ
（接点Ｂはどことも接続せず），４は分圧抵抗２の
出力信号e0を取り出す出力端子である。
第１，第２の切換スイツチSW１，SW２がと
もに接点Ａと接続した状態を第２図に示す。この
とき帰還回路としての利得制御回路３のスイツチ
Ｓ１〜Ｓ８のうち１個または複数個を任意に選択
してオンとしたときの抵抗値をRxとし、可変抵
抗VRの有効抵抗をRTとすれば利得（増幅度，
ゲイン）Ｇは次式で与えられる。
もに接点Ａと接続した状態を第２図に示す。この
とき帰還回路としての利得制御回路３のスイツチ
Ｓ１〜Ｓ８のうち１個または複数個を任意に選択
してオンとしたときの抵抗値をRxとし、可変抵
抗VRの有効抵抗をRTとすれば利得（増幅度，
ゲイン）Ｇは次式で与えられる。
Ｇ＝（１＋Rx／Ｒ）・RA＋RT／RA＋VR ……(1)
この場合、可変抵抗VRを除外して考えれば、
Rx＝Ｏにおいて容易に利得Ｇ＝１となり、利得
Ｇ≧１の範囲においてステツプ状に可変とでき
る。又、可変抵抗VRを考慮すれば、抵抗値Rxは
抵抗Ｒの整数倍とされているので、スイツチＳ１
〜Ｓ８のいずれかをオンとすることにより離散的
に値が選択され、可変抵抗VRの抵抗RTを調整
することにより各ステツプ間を連続的に可変とで
き、広い範囲にわたり、細かく利得を可変とでき
る。又、利得切換回路３の抵抗Ｒ，……１２８Ｒ
は、2n・Ｒ（ｎ＝０，１，……）の関係にあるの
で、任意の整数値をとることができ、又、各抵抗
の温度係数αは等しいので総合抵抗Rxの温度係
数もαとなり、抵抗の温度係数の影響は受けず、
各ゲインでの精度は変化しない。
Rx＝Ｏにおいて容易に利得Ｇ＝１となり、利得
Ｇ≧１の範囲においてステツプ状に可変とでき
る。又、可変抵抗VRを考慮すれば、抵抗値Rxは
抵抗Ｒの整数倍とされているので、スイツチＳ１
〜Ｓ８のいずれかをオンとすることにより離散的
に値が選択され、可変抵抗VRの抵抗RTを調整
することにより各ステツプ間を連続的に可変とで
き、広い範囲にわたり、細かく利得を可変とでき
る。又、利得切換回路３の抵抗Ｒ，……１２８Ｒ
は、2n・Ｒ（ｎ＝０，１，……）の関係にあるの
で、任意の整数値をとることができ、又、各抵抗
の温度係数αは等しいので総合抵抗Rxの温度係
数もαとなり、抵抗の温度係数の影響は受けず、
各ゲインでの精度は変化しない。
第３図は、第１，第２の切換スイツチSW１，
SW２がともに接点Ｂと接続した状態を示し、こ
の場合の利得Ｇは次式で与えられる。
SW２がともに接点Ｂと接続した状態を示し、こ
の場合の利得Ｇは次式で与えられる。
Ｇ＝１・RA＋RT／Rx＋RA＋VR ……(2)
この場合、Rx＝０においた利得Ｇ＝１となり、
利得０＜Ｇ≦１の範囲においてステツプ状に可変
とでき、可変抵抗VRを調整することに各ステツ
プ間を連続的に可変とすることができる。
利得０＜Ｇ≦１の範囲においてステツプ状に可変
とでき、可変抵抗VRを調整することに各ステツ
プ間を連続的に可変とすることができる。
つまり、いずれの場合も、特に可変抵抗VRを
利得切換回路３の総合抵抗値Rxの切換によるス
テツプ間隔の影響を無視できるような範囲に選択
すれば、全ゲインにわたり連続的可変でき、ゲイ
ンとびが少ないものとなる。又、切換スイツチＳ
１，Ｓ２および利得切換回路３のスイツチＳ１〜
Ｓ８をMOS・FETのような半導体スイツチと
し、ロジツク信号により切り換えるようにすれ
ば、自動可変利得回路とすることができる。又、
入力抵抗Ｒとして、利得切換回路３のようなラダ
ー抵抗、スイツチを設ければ、より広範囲の利得
の可変ができる。又、入力抵抗Ｒをα倍すれば利
得は容易に全体としてシフトでき、入力抵抗Ｒ，
ラダー抵抗Ｒ，……１２８Ｒをモジユール抵抗化
すれば、いつそう高精度となる。
利得切換回路３の総合抵抗値Rxの切換によるス
テツプ間隔の影響を無視できるような範囲に選択
すれば、全ゲインにわたり連続的可変でき、ゲイ
ンとびが少ないものとなる。又、切換スイツチＳ
１，Ｓ２および利得切換回路３のスイツチＳ１〜
Ｓ８をMOS・FETのような半導体スイツチと
し、ロジツク信号により切り換えるようにすれ
ば、自動可変利得回路とすることができる。又、
入力抵抗Ｒとして、利得切換回路３のようなラダ
ー抵抗、スイツチを設ければ、より広範囲の利得
の可変ができる。又、入力抵抗Ｒをα倍すれば利
得は容易に全体としてシフトでき、入力抵抗Ｒ，
ラダー抵抗Ｒ，……１２８Ｒをモジユール抵抗化
すれば、いつそう高精度となる。
又、以上の例において、利得切換回路として抵
抗とスイツチの並列接続を複数個接続したものを
示したが、抵抗とスイツチの直列接続を複数個並
列に接続したものを用いるようにしても同様の効
果が得られる。なお、この場合においても、各抵
抗を2n・Ｒ（ｎ＝０，１，２，………）と選択し
ておき、任意の１きざみの抵抗値を得ることがで
きるようにすると、ロータリースイツチのような
ものと比較して大幅にスイツチの個数を減少させ
ることができる。
抗とスイツチの並列接続を複数個接続したものを
示したが、抵抗とスイツチの直列接続を複数個並
列に接続したものを用いるようにしても同様の効
果が得られる。なお、この場合においても、各抵
抗を2n・Ｒ（ｎ＝０，１，２，………）と選択し
ておき、任意の１きざみの抵抗値を得ることがで
きるようにすると、ロータリースイツチのような
ものと比較して大幅にスイツチの個数を減少させ
ることができる。
(5) 発明の要約
以上述べたように、この発明は、演算増幅器の
出力側と入力側との間に抵抗とスイツチの並列接
続を複数個直列接続したような利得切換回路を設
け、２つの切換スイツチを切り換えて分圧抵抗よ
り出力を得るようにした可変利得増幅器である。
出力側と入力側との間に抵抗とスイツチの並列接
続を複数個直列接続したような利得切換回路を設
け、２つの切換スイツチを切り換えて分圧抵抗よ
り出力を得るようにした可変利得増幅器である。
(6) 発明の効果
従つて、切換スイツチ，スイツチを切り換える
ことにより、入力を演算増幅器の非反転入力端子
に入力させて高入力インピーダンスを保持した回
路において、入出力の極性も同一で利得が１以
下，１以上のいずれの場合も可変とすることがで
きる。又、利得切換回路によりステツプ状に細か
く離散的に切り換えられるとともに、分圧抵抗を
可変とすることによりその小区間において連続的
に可変とでき、広範囲に幅広く、細かく利得を可
変とすることができる。
ことにより、入力を演算増幅器の非反転入力端子
に入力させて高入力インピーダンスを保持した回
路において、入出力の極性も同一で利得が１以
下，１以上のいずれの場合も可変とすることがで
きる。又、利得切換回路によりステツプ状に細か
く離散的に切り換えられるとともに、分圧抵抗を
可変とすることによりその小区間において連続的
に可変とでき、広範囲に幅広く、細かく利得を可
変とすることができる。
第１図，第２図，第３図は、この発明の一実施
例を示す構成説明図である。 １……入力端子、２……分圧抵抗、３……利得
切換回路、４……出力端子、SW１，SW２……
切換スイツチ、Ｓ１〜Ｓ８……スイツチ、Ｒ〜１
２８Ｒ……抵抗、VR……可変抵抗、OP……演
算増幅器。
例を示す構成説明図である。 １……入力端子、２……分圧抵抗、３……利得
切換回路、４……出力端子、SW１，SW２……
切換スイツチ、Ｓ１〜Ｓ８……スイツチ、Ｒ〜１
２８Ｒ……抵抗、VR……可変抵抗、OP……演
算増幅器。
Claims (1)
- 【特許請求の範囲】 １ 入力信号が非反転入力端子に供給される演算
増幅器と、この演算増幅器の反転入力端子とアー
スに接続された分圧抵抗とを切換える前記演算増
幅器の出力側にコモンが接続された第１の切換ス
イツチと、前記演算増幅器の反転入力端子と分圧
抵抗との間に設けられ抵抗とスイツチの並列接続
を複数組直列接続するかまたは抵抗とスイツチの
直列接続を複数個並列接続するかしこれらスイツ
チを選択してオンとすることにより任意の抵抗値
とされる利得切換回路と、前記演算増幅器の反転
入力端子とアースに接続された抵抗との間に設け
られた第２の切換のスイツチとを備え、前記第
１、第２の切換スイツチおよび前記利得切換回路
のスイツチを切り換えることにより利得を可変と
することを特徴とする可変利得増幅器。 ２ 前記分圧抵抗として可変抵抗を含むものを用
い可変としたことを特徴とする特許請求の範囲第
１項記載の可変利得増幅器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12788681A JPH0230606B2 (ja) | 1981-08-14 | 1981-08-14 | Kahenritokuzofukuki |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12788681A JPH0230606B2 (ja) | 1981-08-14 | 1981-08-14 | Kahenritokuzofukuki |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5829209A JPS5829209A (ja) | 1983-02-21 |
| JPH0230606B2 true JPH0230606B2 (ja) | 1990-07-09 |
Family
ID=14971080
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12788681A Expired - Lifetime JPH0230606B2 (ja) | 1981-08-14 | 1981-08-14 | Kahenritokuzofukuki |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0230606B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60172518A (ja) * | 1984-02-17 | 1985-09-06 | Purakoo:Kk | 押出成形用ダイ |
| US5793249A (en) * | 1996-09-30 | 1998-08-11 | Advanced Micro Devices, Inc. | System for providing tight program/erase speeds that are insensitive to process variations |
-
1981
- 1981-08-14 JP JP12788681A patent/JPH0230606B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5829209A (ja) | 1983-02-21 |
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