JPH0233641A - 半導体メモリ装置 - Google Patents
半導体メモリ装置Info
- Publication number
- JPH0233641A JPH0233641A JP63183463A JP18346388A JPH0233641A JP H0233641 A JPH0233641 A JP H0233641A JP 63183463 A JP63183463 A JP 63183463A JP 18346388 A JP18346388 A JP 18346388A JP H0233641 A JPH0233641 A JP H0233641A
- Authority
- JP
- Japan
- Prior art keywords
- semiconductor memory
- memory device
- switch
- loaded
- state
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Classifications
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02D—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN INFORMATION AND COMMUNICATION TECHNOLOGIES [ICT], I.E. INFORMATION AND COMMUNICATION TECHNOLOGIES AIMING AT THE REDUCTION OF THEIR OWN ENERGY USE
- Y02D10/00—Energy efficient computing, e.g. low power processors, power management or thermal management
Landscapes
- Power Sources (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
る。
第1図は本発明の一実施例を示す。図において、1は半
導体メモリ装置、2はCPUである。3はコネクタ4を
介して人力されたデータを格納するメモリ、5はメモリ
3をバックアップするバックアップ電源としてのバック
アップ電池である。
導体メモリ装置、2はCPUである。3はコネクタ4を
介して人力されたデータを格納するメモリ、5はメモリ
3をバックアップするバックアップ電源としてのバック
アップ電池である。
6はバックアップ電池5をオン/オフするスライドスイ
ッチで、スイッチロッド7が第2図(a)の状態から右
方向に移動されたときオンされ、第2図(b)の状態か
ら左方向に移動されたとき、オフされる。スライドスイ
ッチ6のスライダは、メモリ3の誤消去を考慮して、通
常は、外部から触れられないようにしである。スイッチ
ロッド7は半導体メモリ装置lがデータ記憶再生装置8
に装填されたとき、第2図(a)の状態から右方向に移
動され、半導体メモリ装置1がデータ記憶再生装置8か
ら抜脱されても、移動された位置に残留する。また、ス
イッチロッド7は全消去装置9に装填されたとき、第2
図(a)の状態から左方向に移動され、半導体メモリ装
置1が全消去装置9から抜脱されても、移動された位置
に残留す2る。lOは接点で、半導体メモリ装置1をデ
ータ記憶再生装置8に装填した場合、データ記憶再生装
置8の接点11と接触し、全消去装置9に装填した場合
、全消去装置9の接点12と接触するようになっている
。13はソレノイドで、全消去装置9に設けてあり、ス
イッチ6がオフするようにスイッチロッド7を移動させ
るものである。
ッチで、スイッチロッド7が第2図(a)の状態から右
方向に移動されたときオンされ、第2図(b)の状態か
ら左方向に移動されたとき、オフされる。スライドスイ
ッチ6のスライダは、メモリ3の誤消去を考慮して、通
常は、外部から触れられないようにしである。スイッチ
ロッド7は半導体メモリ装置lがデータ記憶再生装置8
に装填されたとき、第2図(a)の状態から右方向に移
動され、半導体メモリ装置1がデータ記憶再生装置8か
ら抜脱されても、移動された位置に残留する。また、ス
イッチロッド7は全消去装置9に装填されたとき、第2
図(a)の状態から左方向に移動され、半導体メモリ装
置1が全消去装置9から抜脱されても、移動された位置
に残留す2る。lOは接点で、半導体メモリ装置1をデ
ータ記憶再生装置8に装填した場合、データ記憶再生装
置8の接点11と接触し、全消去装置9に装填した場合
、全消去装置9の接点12と接触するようになっている
。13はソレノイドで、全消去装置9に設けてあり、ス
イッチ6がオフするようにスイッチロッド7を移動させ
るものである。
まず、メモリ3に何も記録されていない場合は、第2図
(a)に示すように、スライドスイッチ6はオフされて
いる。従って、この状態においてはバックアップ電流は
流れない。
(a)に示すように、スライドスイッチ6はオフされて
いる。従って、この状態においてはバックアップ電流は
流れない。
次に、この半導体メモリ装置1をデータ記録再生装置8
に装填すると、スイッチロッド7は第2図(a) にお
いて右方向に突出部8tにより移動され、スライドスイ
ッチ6のスライダは閉位置まで移動されてスライドスイ
ッチ6がオンされる。すると、CPII 2によりメモ
リ3等の初期化が行なわれ、データの記録再生が可能な
状態にされる。他方、半導体メモリ装置1がデータ記録
再生装置8から抜脱されても、スライドスイッチ6のス
ライダは自動復帰せず残留し、スライドスイッチ6はオ
フすることなく、メモリ3のバックアップが続けられる
。半導体メモリ装置1をデータ記録再生装置8に装填し
た状態を第3図に示す。
に装填すると、スイッチロッド7は第2図(a) にお
いて右方向に突出部8tにより移動され、スライドスイ
ッチ6のスライダは閉位置まで移動されてスライドスイ
ッチ6がオンされる。すると、CPII 2によりメモ
リ3等の初期化が行なわれ、データの記録再生が可能な
状態にされる。他方、半導体メモリ装置1がデータ記録
再生装置8から抜脱されても、スライドスイッチ6のス
ライダは自動復帰せず残留し、スライドスイッチ6はオ
フすることなく、メモリ3のバックアップが続けられる
。半導体メモリ装置1をデータ記録再生装置8に装填し
た状態を第3図に示す。
次に、記tiされているデータを全て消去する場合、半
導体メモリ装置を全消去装置9に装填する。全消去の場
合は、ソレノイド13の励磁コイルに電流が流れてソレ
ノイド13が飛び出し、スイッチロット7を第2図(b
)の状態から左方向に移動させ、スライドスイッチ6を
オフする。従って、メモリ3のバックアップかなされな
くなり、メモリ3は全消去されることになる。この状態
を第4図に示す。
導体メモリ装置を全消去装置9に装填する。全消去の場
合は、ソレノイド13の励磁コイルに電流が流れてソレ
ノイド13が飛び出し、スイッチロット7を第2図(b
)の状態から左方向に移動させ、スライドスイッチ6を
オフする。従って、メモリ3のバックアップかなされな
くなり、メモリ3は全消去されることになる。この状態
を第4図に示す。
本実施例の半導体メモリ装置は、このように構成したの
で、工場から出荷した後、ユーザか実際に使用するまで
の間、電池の消耗を防止することができる。
で、工場から出荷した後、ユーザか実際に使用するまで
の間、電池の消耗を防止することができる。
また、−旦、全データを消去した後、再ひ、使用するま
での間も、電池の消耗を防止することができる。
での間も、電池の消耗を防止することができる。
[発明の効果]
以上説明したように、本発明によれば、上記のように構
成したので、未記録状態から最初のデータが記録される
までの間のTL源の消耗を防止することができるという
効果がある。
成したので、未記録状態から最初のデータが記録される
までの間のTL源の消耗を防止することができるという
効果がある。
第1図は本発明実施例の半導体メモリ装置を示すブロッ
ク図、 第2図は実施例におけるスライドスイッチ6のオンオフ
を説明する説明図、 第3図は半導体メモリ装置tをデータ記録再生装置8に
装填した状態を示す一部破断断面図、第4図は半導体メ
モリ装置1を全消去装置9に装填した状態を示す断面図
である。 3・・・メモリ、 5・・・バックアップ電池、 6・・・スライドスイッチ。 6ス斗什゛スイ・干 第1図 第3図 第2図 第4図
ク図、 第2図は実施例におけるスライドスイッチ6のオンオフ
を説明する説明図、 第3図は半導体メモリ装置tをデータ記録再生装置8に
装填した状態を示す一部破断断面図、第4図は半導体メ
モリ装置1を全消去装置9に装填した状態を示す断面図
である。 3・・・メモリ、 5・・・バックアップ電池、 6・・・スライドスイッチ。 6ス斗什゛スイ・干 第1図 第3図 第2図 第4図
Claims (1)
- 【特許請求の範囲】 1)データを記憶する半導体メモリと、 該半導体メモリをバックアップするバックアップ電源と を有する半導体メモリ装置であって、 操作力により開から閉または閉から開にされ、閉状態で
前記バックアップ電源をメモリに電気的に接続し、開状
態で前記バックアップ電源を半導体メモリから電気的に
切り離し、かつ、与えた操作力を解除しても、前記開状
態または閉状態を保持するスイッチ を備えたことを特徴とする半導体メモリ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63183463A JPH0233641A (ja) | 1988-07-25 | 1988-07-25 | 半導体メモリ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63183463A JPH0233641A (ja) | 1988-07-25 | 1988-07-25 | 半導体メモリ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0233641A true JPH0233641A (ja) | 1990-02-02 |
Family
ID=16136223
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63183463A Pending JPH0233641A (ja) | 1988-07-25 | 1988-07-25 | 半導体メモリ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0233641A (ja) |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6044129B2 (ja) * | 1980-10-16 | 1985-10-02 | ワイケイケイ株式会社 | スライドフアスナ−エレメントの製造方法並に装置 |
| JPS61150088A (ja) * | 1984-12-25 | 1986-07-08 | Toshiba Corp | メモリカ−ド |
| JPS61269292A (ja) * | 1985-05-24 | 1986-11-28 | Nec Corp | Mosランダムアクセスメモリ装置 |
-
1988
- 1988-07-25 JP JP63183463A patent/JPH0233641A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6044129B2 (ja) * | 1980-10-16 | 1985-10-02 | ワイケイケイ株式会社 | スライドフアスナ−エレメントの製造方法並に装置 |
| JPS61150088A (ja) * | 1984-12-25 | 1986-07-08 | Toshiba Corp | メモリカ−ド |
| JPS61269292A (ja) * | 1985-05-24 | 1986-11-28 | Nec Corp | Mosランダムアクセスメモリ装置 |
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