JPH0237574A - デイジタル信号処理装置 - Google Patents
デイジタル信号処理装置Info
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- JPH0237574A JPH0237574A JP18880388A JP18880388A JPH0237574A JP H0237574 A JPH0237574 A JP H0237574A JP 18880388 A JP18880388 A JP 18880388A JP 18880388 A JP18880388 A JP 18880388A JP H0237574 A JPH0237574 A JP H0237574A
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- JP
- Japan
- Prior art keywords
- signal
- circuit
- digital
- output
- reset
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- Granted
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- Signal Processing For Digital Recording And Reproducing (AREA)
- Indexing, Searching, Synchronizing, And The Amount Of Synchronization Travel Of Record Carriers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
この発明は、ディジタル信号を伝送するインターフェー
スフォーマットを用いて制御信号を伝送する時の信号処
理装置に関するものである。
スフォーマットを用いて制御信号を伝送する時の信号処
理装置に関するものである。
（従来の技術ｌ
以下、回転ヘッド式ディジタルオーディオテープレコー
ダ（以ド、ｒＤＡＴＪという）を例に取って説明する。
ダ（以ド、ｒＤＡＴＪという）を例に取って説明する。
なお、このＤ Ａ ＴはＩ） Ａ ’ｒ懇談会で標準化
された仕様に準拠したものである。（ラジオ技術１９８
７年４月号Ｐ、７２〜Ｐ、７８参照） 第；３図は、従来のディジタル磁気記録１り主装置のド
ラム、ヘッドおよび磁気テープの配置を示す図である。
された仕様に準拠したものである。（ラジオ技術１９８
７年４月号Ｐ、７２〜Ｐ、７８参照） 第；３図は、従来のディジタル磁気記録１り主装置のド
ラム、ヘッドおよび磁気テープの配置を示す図である。
図において、Ａ磁気ヘッド（５０２Ａ）と１３磁気ヘツ
ド（５０２１３）、は互いに１８０’の角度でドラム（
５０１）に取り付けられている。磁気テープ（５０４）
は２００Ｏｒ、ｐ。
ド（５０２１３）、は互いに１８０’の角度でドラム（
５０１）に取り付けられている。磁気テープ（５０４）
は２００Ｏｒ、ｐ。
ｍ、で回転するドラム（５０１）に９０’の巻き付は角
で巻き付けられ、アジマス角の異なる２個の磁気ヘッド
（５０２Ａ）、（５０２Ｂ）”？’、第４図に示すよう
に、磁気テープ（５０４）の長手方向に対して斜めに順
次トラック（５０５）を形成するように記録される。
で巻き付けられ、アジマス角の異なる２個の磁気ヘッド
（５０２Ａ）、（５０２Ｂ）”？’、第４図に示すよう
に、磁気テープ（５０４）の長手方向に対して斜めに順
次トラック（５０５）を形成するように記録される。
第４図は磁気テープ（５０４）上に従来のディジタル磁
気記録再生装置で信号を記録した時のトラックパターン
を示す図である。図において、矢印（５０６）は磁気テ
ープ（５０４）の走行方向、矢印（５０７）は磁気ヘッ
ドの走査方向で、トラック（５０５Ａ）Ｇ；ｔＡ磁気ヘ
ッド（５０２Ａ）で、またトラック（５０５Ｂ）はＢ磁
気ヘッド（５０２Ｂ）でそれぞれ記録される。
気記録再生装置で信号を記録した時のトラックパターン
を示す図である。図において、矢印（５０６）は磁気テ
ープ（５０４）の走行方向、矢印（５０７）は磁気ヘッ
ドの走査方向で、トラック（５０５Ａ）Ｇ；ｔＡ磁気ヘ
ッド（５０２Ａ）で、またトラック（５０５Ｂ）はＢ磁
気ヘッド（５０２Ｂ）でそれぞれ記録される。
第５図（ｂ）は第４図に示した１つのトラック（５０５
）に記録される信号を示す図で、１トラツクに記録され
る信号は、１９６ブロツクからなり、それぞれ８ブロツ
クからなる付加情報を記録するサブコード領域（５１１
）および（５１５）と、１２８ブロツクからなるオーデ
ィオ信号をディジタル信号に変換した信号（以下、「オ
ーディオシンボル」という）、および誤り訂正を行うた
めの冗長信号（以下、「チエツクシンボル」という）を
記録するＰＣＭ領域（５１３）が含まれている。
）に記録される信号を示す図で、１トラツクに記録され
る信号は、１９６ブロツクからなり、それぞれ８ブロツ
クからなる付加情報を記録するサブコード領域（５１１
）および（５１５）と、１２８ブロツクからなるオーデ
ィオ信号をディジタル信号に変換した信号（以下、「オ
ーディオシンボル」という）、および誤り訂正を行うた
めの冗長信号（以下、「チエツクシンボル」という）を
記録するＰＣＭ領域（５１３）が含まれている。
第５図（Ｃ）はサブコード領域（５１１）（５１５）に
記録される１ブロツクの構成を示す図である。図におい
て、１ブロツクは３６シンボル（ｌシンボル＝８ビット
のディジタルデータ）からなり、Ｉシンボルからなるブ
ロック同期信号が記録されているＳ領域（５２０）と、
３シンボルからなるコントロール情報が記録されている
ＩＤ領域（５２１）と、３２シンボルからなる時間情報
等の付加データおよびチエツクシンボルが記録されてい
るＤΔＴ八領へ（５２２）とから構成されている。
記録される１ブロツクの構成を示す図である。図におい
て、１ブロツクは３６シンボル（ｌシンボル＝８ビット
のディジタルデータ）からなり、Ｉシンボルからなるブ
ロック同期信号が記録されているＳ領域（５２０）と、
３シンボルからなるコントロール情報が記録されている
ＩＤ領域（５２１）と、３２シンボルからなる時間情報
等の付加データおよびチエツクシンボルが記録されてい
るＤΔＴ八領へ（５２２）とから構成されている。
第５図（ｄ）はＩＤ領域（５２１）の内容を示しており
、第１シンボルの先頭４ビツトにコントロールｌ Ｄ
（ＣＩ）〜（Ｃａ）が記録されている。このうち、この
発明に関係するショートニングＩＤ（以下、ｒＳＫ Ｉ
ＤＪという）はＣＩに、またスタートＩＤ（以下、
ｒ ＳＴ Ｉ ＤＪ トイウ） ｌ；ｔｃａ Ｇ：ソ
れぞれ記録されている。この２つのＩＤは、ｌトラック
に多重書きされており、トラック単位でデータが変化す
る。
、第１シンボルの先頭４ビツトにコントロールｌ Ｄ
（ＣＩ）〜（Ｃａ）が記録されている。このうち、この
発明に関係するショートニングＩＤ（以下、ｒＳＫ Ｉ
ＤＪという）はＣＩに、またスタートＩＤ（以下、
ｒ ＳＴ Ｉ ＤＪ トイウ） ｌ；ｔｃａ Ｇ：ソ
れぞれ記録されている。この２つのＩＤは、ｌトラック
に多重書きされており、トラック単位でデータが変化す
る。
ＳＴ Ｉ Ｄは、記録されている音楽の曲頭を示す信号
で、曲の始めから３００±３０フレーム（１フレームは
２トラツク分の信号）連続して“ｌ”が１１己録される
ように、また、５ＫＩＤｉよ、３３フレーム±３フレー
ム記録されるよう規格で定められており、Ｄ△ゴは、Ｓ
Ｋ Ｉ Ｄ＝ １を検出すると次の曲頭までテープを高
速で送り、５ＴＩＤと５ＫＩＤ間の例えば無記録部を高
速で飛ばして次の音楽を聞＜°１ｔができる。ただし、
５ＫＩＤを検出しても高速道りにするか、通常の両生を
行うかは自由に設定できる。
で、曲の始めから３００±３０フレーム（１フレームは
２トラツク分の信号）連続して“ｌ”が１１己録される
ように、また、５ＫＩＤｉよ、３３フレーム±３フレー
ム記録されるよう規格で定められており、Ｄ△ゴは、Ｓ
Ｋ Ｉ Ｄ＝ １を検出すると次の曲頭までテープを高
速で送り、５ＴＩＤと５ＫＩＤ間の例えば無記録部を高
速で飛ばして次の音楽を聞＜°１ｔができる。ただし、
５ＫＩＤを検出しても高速道りにするか、通常の両生を
行うかは自由に設定できる。
第６図は従来のＤΔ′「の記録再生信号処理回路（６５
０）を示すブロック回路図である。図において、図面の
中央より上側は記録系の信号処理回路を示し、下側は再
生系の信号処理回路を示している。記録系の入力端子（
６００ａ） （６００ｂ）にはり、Ｒ２チャンネルのアナログ信号（
ｆ３０１ａ）および（６０１ｂ）が入力され、その出力
端子＜６２０）には記録信号（６０９ａ）が出力される
６また、再生系の入力端子（６１０）にはＩＩ７生信号
（６］Ｏａ）が入力され、その出力端子（６１９ａ）、
（６１９ｂ）にはり、Ｒ２チャンネルの再生アナログ信
号（６１７ａ）、（６１７ｂ）が出力される。
０）を示すブロック回路図である。図において、図面の
中央より上側は記録系の信号処理回路を示し、下側は再
生系の信号処理回路を示している。記録系の入力端子（
６００ａ） （６００ｂ）にはり、Ｒ２チャンネルのアナログ信号（
ｆ３０１ａ）および（６０１ｂ）が入力され、その出力
端子＜６２０）には記録信号（６０９ａ）が出力される
６また、再生系の入力端子（６１０）にはＩＩ７生信号
（６］Ｏａ）が入力され、その出力端子（６１９ａ）、
（６１９ｂ）にはり、Ｒ２チャンネルの再生アナログ信
号（６１７ａ）、（６１７ｂ）が出力される。
以下、記録系信号処理回路の構成とその動作をサンプリ
ング周波数Ｆｇが４８ Ｋ Ｉ（ｚ 、チャンネル数が
２の場合を例に説明する。入力端子（６０＋ａ）、（ｅ
ｏ＋ｂ）より入力されたり、Ｒ２チャンネルのアナログ
信号（６０１ａ）、（６０ｌｂ）は、ローパスフィルタ
（６０２）を経てΔＤ変換器（６０３）でディジタル信
号に変換され、メモリ（６０４）へ−旦貯えられる。こ
のオーディオ信号は、２トラツクを単位として以下のよ
うな信号処理がなされる。メモリ（６０４）へ貯えられ
たドラム（５０１）の１回転期間（３０ｍｓｅｃ）に発
生した２８８０ワード（２チャンネル分）のオーディオ
サンプルは、Ａ磁気ヘッド（５０２Δ）およびＢ磁気ヘ
ッド（５０２Ｂ）で記録されるデータ群に２分割され、
１トラツクに記録されるオーディオサンプルを単位とし
てエンコーダ（６０６）で誤り訂正の符号化がなされて
、次段の変調器（６０７）へ送られる。変調器（６０７
）では、メモリ（６０４）からのデータと、コントロー
ル情報および付加情報生成回路（６２１）からのデータ
とをシンボル（８ビツト）を単位に１０ビツトに変換す
る８ビット−ＩＱピット変調を行った後、次段の信号合
成回路（６０８）へ出力する。信号合成回路（６０８）
では、ブロック同期信号５（５２０）（第５図（Ｃ）図
示）などを付加して第５図（ｂ）に示す！９６ブロツク
の信号を作成し、記録アンプ（６０９）を介して出力端
’Ｐ（６２０）より記録信号（６０９ａ）として出力し
て２個の磁気ヘッド（５０２Ａ）、（５０２Ｂ）で記録
する。アドレス制御回路（６０５）は、メモリ（６０４
）の書き込みおよび読み出しアドレスを制御する。
ング周波数Ｆｇが４８ Ｋ Ｉ（ｚ 、チャンネル数が
２の場合を例に説明する。入力端子（６０＋ａ）、（ｅ
ｏ＋ｂ）より入力されたり、Ｒ２チャンネルのアナログ
信号（６０１ａ）、（６０ｌｂ）は、ローパスフィルタ
（６０２）を経てΔＤ変換器（６０３）でディジタル信
号に変換され、メモリ（６０４）へ−旦貯えられる。こ
のオーディオ信号は、２トラツクを単位として以下のよ
うな信号処理がなされる。メモリ（６０４）へ貯えられ
たドラム（５０１）の１回転期間（３０ｍｓｅｃ）に発
生した２８８０ワード（２チャンネル分）のオーディオ
サンプルは、Ａ磁気ヘッド（５０２Δ）およびＢ磁気ヘ
ッド（５０２Ｂ）で記録されるデータ群に２分割され、
１トラツクに記録されるオーディオサンプルを単位とし
てエンコーダ（６０６）で誤り訂正の符号化がなされて
、次段の変調器（６０７）へ送られる。変調器（６０７
）では、メモリ（６０４）からのデータと、コントロー
ル情報および付加情報生成回路（６２１）からのデータ
とをシンボル（８ビツト）を単位に１０ビツトに変換す
る８ビット−ＩＱピット変調を行った後、次段の信号合
成回路（６０８）へ出力する。信号合成回路（６０８）
では、ブロック同期信号５（５２０）（第５図（Ｃ）図
示）などを付加して第５図（ｂ）に示す！９６ブロツク
の信号を作成し、記録アンプ（６０９）を介して出力端
’Ｐ（６２０）より記録信号（６０９ａ）として出力し
て２個の磁気ヘッド（５０２Ａ）、（５０２Ｂ）で記録
する。アドレス制御回路（６０５）は、メモリ（６０４
）の書き込みおよび読み出しアドレスを制御する。
次に再生系信号処理回路の構成とその動作を説明する。
Δ磁気ヘッド（５０２Ａ）および１３ｆｆｌ気ヘツド（
５０２Ｂ）で再生された信号（６１０ａ）（第５図（ａ
）図示）は、入力端子（６１０）より人力され、再生ア
ンプ（６１１）で増幅された後、復調器（６１２）で１
０１９６１１１位に８ビツトに変換され１元のディジタ
ル信号に戻されてメモリ（６１３）へ貯えられる。
５０２Ｂ）で再生された信号（６１０ａ）（第５図（ａ
）図示）は、入力端子（６１０）より人力され、再生ア
ンプ（６１１）で増幅された後、復調器（６１２）で１
０１９６１１１位に８ビツトに変換され１元のディジタ
ル信号に戻されてメモリ（６１３）へ貯えられる。
このメモリ（６１３）へ貯えられたＰＣＭ信号は、デコ
ーダ（６１５）で１トラツクを単位として誤り訂正が施
され、訂正処理された２トラツク分のオーディオサンプ
ル（６１３ａ）を単位として元の発生順序に戻して次段
のＤＡ変換器（６１６）へ送り出し、ここで、アナログ
信号に変換されて、ローパスフィルタ（６１７）を介し
て１゜。
ーダ（６１５）で１トラツクを単位として誤り訂正が施
され、訂正処理された２トラツク分のオーディオサンプ
ル（６１３ａ）を単位として元の発生順序に戻して次段
のＤＡ変換器（６１６）へ送り出し、ここで、アナログ
信号に変換されて、ローパスフィルタ（６１７）を介し
て１゜。
Ｒ２ヂャンネルの再生アナログ信’＞（６１７ａ＞、（
６１７ｂ）として出力端子（６１９ａ）（６１９ｂ）よ
り出力される。
６１７ｂ）として出力端子（６１９ａ）（６１９ｂ）よ
り出力される。
アドレス制御回路（６１４）は、復調データの書き込み
、誤り訂正のためのデータの読み出し、Ｍき込みおよび
ＤＡ変換器（６１６）へ出力するデータの読み出しを行
うためのメモリ制御を行っており、クロック生成回路（
６１８）は、システム全体の；ＩＩＩ＋御を行うための
クロックを生成している。
、誤り訂正のためのデータの読み出し、Ｍき込みおよび
ＤＡ変換器（６１６）へ出力するデータの読み出しを行
うためのメモリ制御を行っており、クロック生成回路（
６１８）は、システム全体の；ＩＩＩ＋御を行うための
クロックを生成している。
他方サブ情報は、サブ情報再生回路（６２２）で処理さ
れる。サブ情報再生回路（６２２）では、５ＴＩＤ、５
ＫＩＤのデータ（６１３ｂ）をメモリ（６］ ３）から
読み出してＩＤの有無を判定し、ＳＴ Ｉ Ｄ （６２
２ａ）および５ＫＩＤ（６２２ｂ）を出力端子（６２３
ａ）、（６２３ｂ）より出力する。この判定動作は１ト
ラツクから再生される信号を単位として行われる。
れる。サブ情報再生回路（６２２）では、５ＴＩＤ、５
ＫＩＤのデータ（６１３ｂ）をメモリ（６］ ３）から
読み出してＩＤの有無を判定し、ＳＴ Ｉ Ｄ （６２
２ａ）および５ＫＩＤ（６２２ｂ）を出力端子（６２３
ａ）、（６２３ｂ）より出力する。この判定動作は１ト
ラツクから再生される信号を単位として行われる。
第７図はクレーム信号、曲頭部に挿入されるＳ’［ｌ
Ｄ （６２２ａ） 、およびオーディオサンプル（６１
３ａ）の関係を示しており、ｌＰＣＭフレームとはドラ
ム１回転期間（３０ｍｓｅｃ）を示し、フレーム信号は
ｌＰＣＭフレームごとに反転するクロックである。
Ｄ （６２２ａ） 、およびオーディオサンプル（６１
３ａ）の関係を示しており、ｌＰＣＭフレームとはドラ
ム１回転期間（３０ｍｓｅｃ）を示し、フレーム信号は
ｌＰＣＭフレームごとに反転するクロックである。
第８図は２台のＤＡＴでダビングを行う時の接続図で、
Ｄ Ａ Ｔ Ｉ Ｌｔ送信側（７）ＤＡＴ、ｒ）ＡＴ２
は受信側のＤＡＴ、（６５０）は第８図に示す信号処理
回路の再生系、（６５１）はディジタルインターフェー
スのためのＩ／Ｑフォーマット化回路、（６５０ａ）は
Ｉ／Ｑフォーマット化回路（６５１）を動作させるため
の各種クロックを示しており、ｌ） Ａ Ｔ１とＤ Ａ
Ｔ ２は光ケーブル又は、同軸ケーブル（６５２）で
接続されて信号伝送が行われる。
Ｄ Ａ Ｔ Ｉ Ｌｔ送信側（７）ＤＡＴ、ｒ）ＡＴ２
は受信側のＤＡＴ、（６５０）は第８図に示す信号処理
回路の再生系、（６５１）はディジタルインターフェー
スのためのＩ／Ｑフォーマット化回路、（６５０ａ）は
Ｉ／Ｑフォーマット化回路（６５１）を動作させるため
の各種クロックを示しており、ｌ） Ａ Ｔ１とＤ Ａ
Ｔ ２は光ケーブル又は、同軸ケーブル（６５２）で
接続されて信号伝送が行われる。
第９図は規格で決められているディジタルインターフェ
ースのサブフレームフォーマットを示したもので、３２
ビツトで構成されている。図において（６７０）は同期
信号、（６７１）は補助信号、（６７２）はオーディオ
サンプル、（６７３）はオーディオサンプルの信頼性フ
ラグ、（６７４）はユーザデータ、（６７５）はチャン
ネルステータス、（６７６）はパリティを記録する領域
である。このサブフレームにより１つのオーディオサン
プルが伝送され、５ＴＩＤおよび５ＫＩＤは、ユーザデ
ータ（６７４）ビット（以下、「Ｕビット」という）を
用いて伝送される。
ースのサブフレームフォーマットを示したもので、３２
ビツトで構成されている。図において（６７０）は同期
信号、（６７１）は補助信号、（６７２）はオーディオ
サンプル、（６７３）はオーディオサンプルの信頼性フ
ラグ、（６７４）はユーザデータ、（６７５）はチャン
ネルステータス、（６７６）はパリティを記録する領域
である。このサブフレームにより１つのオーディオサン
プルが伝送され、５ＴＩＤおよび５ＫＩＤは、ユーザデ
ータ（６７４）ビット（以下、「Ｕビット」という）を
用いて伝送される。
ＤＡＴのフォーマットでは、第７図に示すＰＣＭフレー
ムの第１ワードＬｏを転送するサブフレームの【Ｊビッ
トは、５ＹＮＣビツトを示ｂ１“ｌ”が伝送され、５Ｔ
ＩＤおよび５ＫＩＤは。
ムの第１ワードＬｏを転送するサブフレームの【Ｊビッ
トは、５ＹＮＣビツトを示ｂ１“ｌ”が伝送され、５Ｔ
ＩＤおよび５ＫＩＤは。
それぞれＲ６，ＬＩを伝送するサブフレームのＵビット
を用いて伝送され、その他のサブフレームのＵビットは
“０“が伝送される。
を用いて伝送され、その他のサブフレームのＵビットは
“０“が伝送される。
第１０図はＤＡＴの信号処理回路（６５０）と、Ｉ／Ｑ
フォーマット化回路（６５１）の処理タイミングを示し
たもので、同図（Ｊ）は、第５図（ａｌ に示したもの
と同じ再生信号（６１０ａ）の波形でΔ、Ｂはそれぞれ
Ａ磁気ヘッド（５０２Ａ）、Ｂ１．！気ヘッド（５０２
Ｂ）から再生された信号を示している。
フォーマット化回路（６５１）の処理タイミングを示し
たもので、同図（Ｊ）は、第５図（ａｌ に示したもの
と同じ再生信号（６１０ａ）の波形でΔ、Ｂはそれぞれ
Ａ磁気ヘッド（５０２Ａ）、Ｂ１．！気ヘッド（５０２
Ｂ）から再生された信号を示している。
時刻し＋ｏｘｔｕで再生信号Ａｏがメモリ（６１３）（
第６図図示）に書き込まれ、時刻Ｌ１〜ＬＩｌ！で誤り
訂正が行われる。訂正された信号Ａｓに含まれる５Ｔ１
１）及び５ＫＩＤは、時刻ｔ ｎ 〜し１斗の期間にサ
ブ情報再生回路（６２２）でフラグの有無が判定される
。第１０図は１時刻ｔｌ＃で判定された例を示しており
、５ＴＩＤ （６２２ａ）及びＳＫ Ｉ Ｄ （６２２
ｂ）は、第１Ｏ図（Ｍ）に示すタイミングで出力される
。
第６図図示）に書き込まれ、時刻Ｌ１〜ＬＩｌ！で誤り
訂正が行われる。訂正された信号Ａｓに含まれる５Ｔ１
１）及び５ＫＩＤは、時刻ｔ ｎ 〜し１斗の期間にサ
ブ情報再生回路（６２２）でフラグの有無が判定される
。第１０図は１時刻ｔｌ＃で判定された例を示しており
、５ＴＩＤ （６２２ａ）及びＳＫ Ｉ Ｄ （６２２
ｂ）は、第１Ｏ図（Ｍ）に示すタイミングで出力される
。
１／Ｑフオ一マツト化回路（６５１）（第８図図示）で
は、フレーム信号Ａのステート変化点でＩＤフラグの有
無を判定し、フラグ有の場合には、第１１図に示す位置
にフラグを立てて伝送する。第１０図（Ｑ）はＩ／Ｑフ
ォーマット化回路（６５１）の出力すなわちディジタル
インターフェースＬのＩ ＋）が変化するタイミングを
示したものである。
は、フレーム信号Ａのステート変化点でＩＤフラグの有
無を判定し、フラグ有の場合には、第１１図に示す位置
にフラグを立てて伝送する。第１０図（Ｑ）はＩ／Ｑフ
ォーマット化回路（６５１）の出力すなわちディジタル
インターフェースＬのＩ ＋）が変化するタイミングを
示したものである。
以」二説明したような処理を施されたオーディオ信号及
びＩＤは、光ケーブル又は同軸ケーブル（６５１ａ）を
介してＤＡＴ２へ伝送される。ＤＡＴ２ではこれを受信
し、オーディオ信号とＩＤを分離し所定の処理を施した
後、磁気テープ（５０４）上に記録する。
びＩＤは、光ケーブル又は同軸ケーブル（６５１ａ）を
介してＤＡＴ２へ伝送される。ＤＡＴ２ではこれを受信
し、オーディオ信号とＩＤを分離し所定の処理を施した
後、磁気テープ（５０４）上に記録する。
［発明が解決しようとする課題］
従来の装置は以−Ｌのように構成されているので、ＤＡ
Ｔ Ｅで再生ずる磁気テープにキズ等があった場合、５
ＴＩＤが検出できず、３００１）ＣＭフレーム期間の途
中で５ＴＩＤがなくなる場合が生じ、規格に反した信号
を送出するため、頭出し誤操作が生じるという不都合が
あった。
Ｔ Ｅで再生ずる磁気テープにキズ等があった場合、５
ＴＩＤが検出できず、３００１）ＣＭフレーム期間の途
中で５ＴＩＤがなくなる場合が生じ、規格に反した信号
を送出するため、頭出し誤操作が生じるという不都合が
あった。
この発明は、上記のような問題点を解消するためになさ
れたもので、磁気テープの５ＴＩＤが記録されている領
域にキズ等があった場合でも、ディジタルインターフェ
ース出力の５ＴＩＤ信号は規格で定まった所定の時間送
出して正しい頭出し動作を行うことができるディジタル
信号処理装置を得ることを目的とする。
れたもので、磁気テープの５ＴＩＤが記録されている領
域にキズ等があった場合でも、ディジタルインターフェ
ース出力の５ＴＩＤ信号は規格で定まった所定の時間送
出して正しい頭出し動作を行うことができるディジタル
信号処理装置を得ることを目的とする。
［課題を解決するための手段］
この発明に係るディジタル信号処理装置６は、ディジタ
ル再生信号にＩＤが連続して所定回数台まれているか否
かを検出する手段と、このＩＤが検出されたときから所
定期間、上記ディジタル再生信号なディジタルインター
フォーマットの信号構成に変換するＩ／Ｑフォーマット
化回路に当該ＩＤに相当する信号を当該ＩＤに代えて連
続して人力する手段とを備えた点を特徴とする。
ル再生信号にＩＤが連続して所定回数台まれているか否
かを検出する手段と、このＩＤが検出されたときから所
定期間、上記ディジタル再生信号なディジタルインター
フォーマットの信号構成に変換するＩ／Ｑフォーマット
化回路に当該ＩＤに相当する信号を当該ＩＤに代えて連
続して人力する手段とを備えた点を特徴とする。
［作用］
この発明におけるＩＤ検出手段は、所定回数、連続して
ＩＤを検出したとき検出信号を出力するので、ディジタ
ル両生信号にＩＤが含まれていることを高い精度で検出
することができる。
ＩＤを検出したとき検出信号を出力するので、ディジタ
ル両生信号にＩＤが含まれていることを高い精度で検出
することができる。
また、ＩＤに相当する信号をＩ／Ｑフォーマット化回路
に入力する手段は、検出手段からｌ ｌ）検出信号をう
けたときから、規則で定められているＩＤが在存すべき
期間の間、ＩＤに代わる信号を１／Ｑフオ一マツト化回
路にＩＤとして人力する。このため、ディジタル再生信
号中のＩＤに欠落が生じてもＩ／Ｑフォーマット化回路
からは、所定期間ＩＤが付加されたディジタルインター
フォーマット信号が出力され、ＩＤの欠落による悪影響
を排除することができる。
に入力する手段は、検出手段からｌ ｌ）検出信号をう
けたときから、規則で定められているＩＤが在存すべき
期間の間、ＩＤに代わる信号を１／Ｑフオ一マツト化回
路にＩＤとして人力する。このため、ディジタル再生信
号中のＩＤに欠落が生じてもＩ／Ｑフォーマット化回路
からは、所定期間ＩＤが付加されたディジタルインター
フォーマット信号が出力され、ＩＤの欠落による悪影響
を排除することができる。
［発明の実施例］
以下、この発明の一実施例を図について説明する。
第１図において（６６０）は５ＴＩＤ生成回路で、０回
一致検出回路（６６１）、カウンタ回路（６６２）およ
びＲＳフリップフロップ（６６３）で構成されている。
一致検出回路（６６１）、カウンタ回路（６６２）およ
びＲＳフリップフロップ（６６３）で構成されている。
次にこの実施例の動作を第２図のタイムチャートを用い
て説明する。
て説明する。
第２図（Ａ）はＩＩ）ＣＭフレームの周期（ｌドラム回
転＝３０ｍｓｅｃ）に同期したカウントフロック（６６
４）、第２図（Ｂ）はＤＡｌ”ｌで再生された５ＴＩＤ
出力（６２２ａ）で、時刻し１からし、の間が欠落して
いるものとする。
転＝３０ｍｓｅｃ）に同期したカウントフロック（６６
４）、第２図（Ｂ）はＤＡｌ”ｌで再生された５ＴＩＤ
出力（６２２ａ）で、時刻し１からし、の間が欠落して
いるものとする。
ｎ回一致検出回路（６６１）ではカウントクロック（６
６４）の立上りエツジで５ＴＩＤ出力（６２２ａ）のレ
ベルを判定し、この実施例では４回“ｌ”が連続して検
出された時刻１．１に、パルス（６６１ａ）（第２図（
ｃ）図示）を出力する。
６４）の立上りエツジで５ＴＩＤ出力（６２２ａ）のレ
ベルを判定し、この実施例では４回“ｌ”が連続して検
出された時刻１．１に、パルス（６６１ａ）（第２図（
ｃ）図示）を出力する。
ＲＳフリップフロップ（６６３）はこの出力（６６１ａ
）によりセットされ、“ｌ”の状態の信号をリセットさ
せるまでの聞出力する。と、同時に、カウンタ回路（６
６２）もリセットされてカウントクロック（６６４）の
計数を開始し、計数値が３００となる時刻ｔ６にリセッ
トクロック（６６２ａ）を出力してＲＳフリップフロッ
プ（６６３）をリセットする。したがって、ＲＳフリッ
プフロップ（６６３）は、人力された５ＴＩＤ（６２２
ａ）に欠落部があっても、３０ＯＰＣＭフレーム期間連
続した“菖“の状態の信号を出力する。この信号（６６
３ａ）を５ＴＩＤ信号として１／Ｑフオ一マツト化回路
（６５１）へ入力することにより規格に合った信号をＩ
／Ｑフォーマット化回路（６５１）からＤＡＴ２へ出力
することができる。
）によりセットされ、“ｌ”の状態の信号をリセットさ
せるまでの聞出力する。と、同時に、カウンタ回路（６
６２）もリセットされてカウントクロック（６６４）の
計数を開始し、計数値が３００となる時刻ｔ６にリセッ
トクロック（６６２ａ）を出力してＲＳフリップフロッ
プ（６６３）をリセットする。したがって、ＲＳフリッ
プフロップ（６６３）は、人力された５ＴＩＤ（６２２
ａ）に欠落部があっても、３０ＯＰＣＭフレーム期間連
続した“菖“の状態の信号を出力する。この信号（６６
３ａ）を５ＴＩＤ信号として１／Ｑフオ一マツト化回路
（６５１）へ入力することにより規格に合った信号をＩ
／Ｑフォーマット化回路（６５１）からＤＡＴ２へ出力
することができる。
なお、上記実施例では５ＴＴＤ生成回路（６６０）をｎ
回・一致検出回路（６６１）、カウンタ回路（６６２）
、およびＲＳフリップフロップ（６６３）で構成したが
、マイクロコンピュータで構成しても同様な効果を奏す
る。
回・一致検出回路（６６１）、カウンタ回路（６６２）
、およびＲＳフリップフロップ（６６３）で構成したが
、マイクロコンピュータで構成しても同様な効果を奏す
る。
また、ト記実施例では、５ＴＩＤを例に説明したが、５
ＫＩＤについてもカウンタ回路の分周数を変えることに
より、５ＴＩＤと同等の安定した信号をインターフェー
スフォーマットを用いて送ることができる。
ＫＩＤについてもカウンタ回路の分周数を変えることに
より、５ＴＩＤと同等の安定した信号をインターフェー
スフォーマットを用いて送ることができる。
また、５ＴＩＤの一致検出を３０ｍ５ｅｃごとのステー
トで、すなわち一方のトラックのＩ Ｌ）のみで判定し
たが、第１０図（Ｍ）に示す通り、信号処理回路（６５
０）から出力されるＩＤは、３０ｍ５ｅｃ期間に八、８
両トラックのものが存在するので、Ａ ｏ、 Ｂ ｏ、
Ａ ＝、 Ｂ １のように連続したトラックのＩＤが一
致するか否か判定してもよい。この場合、ｎ回一致検出
回路（６６１）に入力するクロックと、カウンタ回路（
６６２）で計数するクロックを別のクロックにするだけ
でよい。
トで、すなわち一方のトラックのＩ Ｌ）のみで判定し
たが、第１０図（Ｍ）に示す通り、信号処理回路（６５
０）から出力されるＩＤは、３０ｍ５ｅｃ期間に八、８
両トラックのものが存在するので、Ａ ｏ、 Ｂ ｏ、
Ａ ＝、 Ｂ １のように連続したトラックのＩＤが一
致するか否か判定してもよい。この場合、ｎ回一致検出
回路（６６１）に入力するクロックと、カウンタ回路（
６６２）で計数するクロックを別のクロックにするだけ
でよい。
また、カウンタ回路（６６２）のカウントクロックの周
期を３０ｍ５ｅｃにしたが、他の周期でもよ（、カウン
タ出力（６６２ａ）を出力するタイミングを決定する計
数値を変えることにより実現できる。
期を３０ｍ５ｅｃにしたが、他の周期でもよ（、カウン
タ出力（６６２ａ）を出力するタイミングを決定する計
数値を変えることにより実現できる。
さらに上記実施例では］Ｄ生成回路（６６０）のＩＤ出
力（６６３ａ）は第２図（Ｄ）および（Ｅｌに示したよ
うに、ｌＰＣＭフレーム周期（３０ｍｓｅｃ）の整数倍
としたが、第１０図に示すごと＜ｌ／Ｑフォーマット化
回路（６５１）には、フレーム信号のステート変化点で
ＩＤが取り込まれるので、フレーム信号の変化点が３０
０回含１れる長さであればよい。
力（６６３ａ）は第２図（Ｄ）および（Ｅｌに示したよ
うに、ｌＰＣＭフレーム周期（３０ｍｓｅｃ）の整数倍
としたが、第１０図に示すごと＜ｌ／Ｑフォーマット化
回路（６５１）には、フレーム信号のステート変化点で
ＩＤが取り込まれるので、フレーム信号の変化点が３０
０回含１れる長さであればよい。
［発明の効果］
以上のように、この発明によれば、ディジタル］１生信
号のＩＤのａ無を判定する手段と、“ＩＤ有“と判定し
た場合、所定期間“ＩＤ有”の状態を保持する手段とを
備えたので、記録媒体の傷等によるＩＤの欠落があった
場合でもＩＤの欠落のないディジタルμｉ生（＋ｉ号を
出力できるディジタル信号処理回路が得られる効果があ
る。
号のＩＤのａ無を判定する手段と、“ＩＤ有“と判定し
た場合、所定期間“ＩＤ有”の状態を保持する手段とを
備えたので、記録媒体の傷等によるＩＤの欠落があった
場合でもＩＤの欠落のないディジタルμｉ生（＋ｉ号を
出力できるディジタル信号処理回路が得られる効果があ
る。
第１図はこの発明の一実施例のブロック回路図、第２図
はこの実施例の動作を説明するためのタイミング図、第
３図はＤＡＴのドラム、ヘッド、デー１の配置を示す図
、第４図はトラックパターンを示す図、第５図は再生信
号波形およびトラックに記録されているディジタル信号
の構成を示す図、第６図は従来の信号処理装置の構成を
示すブロック回路図、第７図はオーディオサンプルおよ
びＳ Ｔ Ｉ Ｄの出力タイミング図、第８図はダピン
グ動作時のＤＡＴ！、２の接続図、第９図はディジタル
イン、ターフエースフォーマットのサブフレームの信号
構成を示す図、第１０図は信号処理回路、Ｉ／Ｑフォー
マット化回路のＩ Ｄ処理タイミングを示す図、第１１
図はディジタルインターフェースフォーマットのＵピッ
トデータの内容を示す図である。 （６５０）・・・Ｄ Ａ ′「の記録・再生信号処理回
路 、（６５１）・・・ｌ／Ｑフォーマット化回路、（
６６１） ・＝ ｎ回一致検出回路 （６ｆ３２ ）
−カウンタ回路 、（６６３）−Ｆ＜Ｓフリップフロ
ップ。 なお、各図中、同一符号は同一、または相当部分を示す
。
はこの実施例の動作を説明するためのタイミング図、第
３図はＤＡＴのドラム、ヘッド、デー１の配置を示す図
、第４図はトラックパターンを示す図、第５図は再生信
号波形およびトラックに記録されているディジタル信号
の構成を示す図、第６図は従来の信号処理装置の構成を
示すブロック回路図、第７図はオーディオサンプルおよ
びＳ Ｔ Ｉ Ｄの出力タイミング図、第８図はダピン
グ動作時のＤＡＴ！、２の接続図、第９図はディジタル
イン、ターフエースフォーマットのサブフレームの信号
構成を示す図、第１０図は信号処理回路、Ｉ／Ｑフォー
マット化回路のＩ Ｄ処理タイミングを示す図、第１１
図はディジタルインターフェースフォーマットのＵピッ
トデータの内容を示す図である。 （６５０）・・・Ｄ Ａ ′「の記録・再生信号処理回
路 、（６５１）・・・ｌ／Ｑフォーマット化回路、（
６６１） ・＝ ｎ回一致検出回路 （６ｆ３２ ）
−カウンタ回路 、（６６３）−Ｆ＜Ｓフリップフロ
ップ。 なお、各図中、同一符号は同一、または相当部分を示す
。
Claims (1)
- （１）ディジタル情報信号と制御フラグとが各トラック
に記録されている記録媒体から回転ヘッドを用いて上記
情報信号と制御フラグとを再生し、所定の信号処理を施
した後、当該情報信号と制御フラグとを一系統のディジ
タル信号として出力するフォーマット化手段を有するデ
ィジタル信号処理装置において、上記各トラックから再
生された信号に連続して制御フラグが所定回数立てられ
ていることを検出する手段と、この検出信号が出力され
たときから所定期間の間上記制御フラグに代わるフラグ
信号を生成する手段と、この生成されたフラグ信号を上
記一系統のディジタル信号の制御フラグとして伝送する
手段とを備えたことを特徴とするディジタル信号処理装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63188803A JPH0834037B2 (ja) | 1988-07-27 | 1988-07-27 | デイジタル信号処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63188803A JPH0834037B2 (ja) | 1988-07-27 | 1988-07-27 | デイジタル信号処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0237574A true JPH0237574A (ja) | 1990-02-07 |
| JPH0834037B2 JPH0834037B2 (ja) | 1996-03-29 |
Family
ID=16230077
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63188803A Expired - Fee Related JPH0834037B2 (ja) | 1988-07-27 | 1988-07-27 | デイジタル信号処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0834037B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02105365A (ja) * | 1988-10-14 | 1990-04-17 | Teac Corp | 情報ブロックの頭出し装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62167673A (ja) * | 1986-01-20 | 1987-07-24 | Sanyo Electric Co Ltd | デジタルオ−デイオ記録装置 |
| JPS62257691A (ja) * | 1986-04-30 | 1987-11-10 | Sanyo Electric Co Ltd | Ｐｃｍ録音再生装置のサブコ−ド信号発生装置 |
-
1988
- 1988-07-27 JP JP63188803A patent/JPH0834037B2/ja not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62167673A (ja) * | 1986-01-20 | 1987-07-24 | Sanyo Electric Co Ltd | デジタルオ−デイオ記録装置 |
| JPS62257691A (ja) * | 1986-04-30 | 1987-11-10 | Sanyo Electric Co Ltd | Ｐｃｍ録音再生装置のサブコ−ド信号発生装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH02105365A (ja) * | 1988-10-14 | 1990-04-17 | Teac Corp | 情報ブロックの頭出し装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0834037B2 (ja) | 1996-03-29 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |