JPH0242073Y2 - - Google Patents
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- JPH0242073Y2 JPH0242073Y2 JP15899280U JP15899280U JPH0242073Y2 JP H0242073 Y2 JPH0242073 Y2 JP H0242073Y2 JP 15899280 U JP15899280 U JP 15899280U JP 15899280 U JP15899280 U JP 15899280U JP H0242073 Y2 JPH0242073 Y2 JP H0242073Y2
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- 239000003990 capacitor Substances 0.000 claims description 12
- 230000002457 bidirectional effect Effects 0.000 claims description 7
- 238000001514 detection method Methods 0.000 description 8
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- Thyristor Switches And Gates (AREA)
Description
【考案の詳細な説明】
本考案は双方向3端子サイリスタトリガ回路に
係り、特に交流電力制御を行う場合、零電圧位相
近傍にて双方向3端子サイリスタ(以下トライア
ツクと呼ぶ)をトリガし、トライアツクが導通し
たことを検出してトリガ信号を停止させる機能を
有するトライアツクトリガ回路に関するものであ
る。[Detailed description of the invention] The present invention relates to a bidirectional 3-terminal thyristor trigger circuit, and particularly when performing AC power control, the bidirectional 3-terminal thyristor (hereinafter referred to as TRIACK) is triggered near the zero voltage phase, and the thyristor trigger circuit is activated. The present invention relates to a triact trigger circuit that has a function of detecting conduction and stopping the trigger signal.
従来、この種のトリガ回路は第1図に示すよう
にPNPトランジスタ4,5でトライアツク2の
端子T1と端子T2間の電圧を検出することにより、
正負両方向の零電圧位相の検出と、トライアツク
2の導通の検出を行ない、NPNトランジスタ1
0により信号を電流増幅し、トリガパルスを発生
させていた。 Conventionally, this type of trigger circuit detects the voltage between terminals T1 and T2 of triac 2 using PNP transistors 4 and 5, as shown in FIG.
Detects zero voltage phase in both positive and negative directions and detects conduction of triac 2, and detects NPN transistor 1.
0 to amplify the signal and generate a trigger pulse.
同図においてPNPトランジスタ4は交流電源
1がトライアツク2のT1端子側が正の場合零電
圧位相検出を行ないエミツタ接地増幅動作してい
る。PNPトランジスタ5はトライアツク2の端
子T2側が正の場合の零電圧位相検出を行ない、
交流電源1を信号源としてエミツタフオロワ動作
している。 In the figure, the PNP transistor 4 performs zero voltage phase detection when the T1 terminal side of the triac 2 of the AC power source 1 is positive, and performs a grounded emitter amplification operation. The PNP transistor 5 performs zero voltage phase detection when the terminal T2 side of the triac 2 is positive,
The emitter follower operates using the AC power supply 1 as a signal source.
この種の回路ではノイズの発生を小さくするた
めトリガパルスは零電圧位相になるべく近い時点
で印加するよう定数設計しているが、第1図の回
路ではPNPトランジスタ5がエミツタフオロワ
動作するため、信号の電流増幅が行なえず、抵抗
7を小さくして交流電源1が零電圧位相に近い時
点でのエミツタ電流を大きくすることにより、ト
リガパルスの供給を零電圧位相に近づけるように
している。このため、抵抗7には許容損失の大き
いものを使わなければならなかつた。またトライ
アツク2の導通後はトリガ信号を停止させるた
め、PNPトランジスタ4,5のオン電圧を抵抗
6と7で分圧し、トライアツク2導通後はPNP
トランジスタ4,5のベース・エミツタ間に加わ
る電圧を低くしている。この定数設計としてはト
ライアツク2のオン電圧のバラつき、PNPトラ
ンジスタ4,5のベース・エミツタ間電圧のバラ
つきを考慮し、抵抗6に対する抵抗7の比率を大
きくするため、PNPトランジスタ4,5の導通
は交流電源1が零電圧位相からある程度経過した
時点とならざるを得なかつた。さらに本回路では
トリガパルスの極性を負とする目的と検出信号電
流を電流増幅するため、NPNトランジスタ10
が必要であつた。 In this type of circuit, the constant design is such that the trigger pulse is applied as close to the zero voltage phase as possible in order to reduce noise generation, but in the circuit shown in Figure 1, the PNP transistor 5 operates as an emitter follower, so the signal Since current amplification cannot be performed, the resistor 7 is made small to increase the emitter current when the AC power source 1 is close to the zero voltage phase, thereby bringing the trigger pulse supply close to the zero voltage phase. For this reason, it was necessary to use a resistor 7 with a large allowable loss. In addition, in order to stop the trigger signal after triax 2 conducts, the ON voltage of PNP transistors 4 and 5 is divided by resistors 6 and 7, and after triax 2 conducts, the PNP
The voltage applied between the base and emitter of transistors 4 and 5 is reduced. This constant design takes into account variations in the on-voltage of the triac 2 and variations in the base-emitter voltage of the PNP transistors 4 and 5, and increases the ratio of the resistor 7 to the resistor 6, so that the conduction of the PNP transistors 4 and 5 is This had to happen at a certain point when the AC power supply 1 had passed from the zero voltage phase. Furthermore, in this circuit, in order to make the polarity of the trigger pulse negative and to amplify the detection signal current, an NPN transistor 10
was necessary.
本考案は零電圧位相検出用のトランジスタをエ
ミツタ接地で動作させることにより、このトラン
ジスタが検出及び電流増幅の機能を有し、零電圧
位相及びトライアツクの導通信号をT2端子とゲ
ート端子との間から得ることにより、反転増幅用
のトランジスタの省略、高許容損失抵抗の非使
用、零電圧位相近傍でのトリガパルス印加を実現
するものである。 In this invention, by operating the transistor for zero voltage phase detection with its emitter grounded, this transistor has the function of detection and current amplification, and the zero voltage phase and the conduction signal of the triac are connected between the T2 terminal and the gate terminal. By obtaining this, it is possible to omit a transistor for inverting amplification, to not use a high power loss resistor, and to apply a trigger pulse near the zero voltage phase.
第2図は本考案の一実施例であり、1は交流電
源、2はトライアツク、3は負荷抵抗、7,1
3,17,18は抵抗、11はコンデンサ、12
はダイオード、14はPNPトランジスタ、15
はNPNトランジスタ、16は定電圧ダイオード
である。 Figure 2 shows an embodiment of the present invention, in which 1 is an AC power supply, 2 is a triax, 3 is a load resistor, 7, 1
3, 17, 18 are resistors, 11 is a capacitor, 12
is a diode, 14 is a PNP transistor, 15
is an NPN transistor, and 16 is a constant voltage diode.
同図において電源1が投入されると、コンデン
サ11はダイオード12、抵抗13を通してトラ
イアツク2の端子T1側を正として充電される。
交流電源1がトライアツク2の端子T1側を正と
するサイクルの場合、PNPトランジスタ14の
ベース電流は交流電源1からトライアツク2の端
子T1、PNPトランジスタ14のエミツタ、ベー
ス、抵抗7、負荷抵抗3を通して流れるため、
PNPトランジスタ14はエミツタ接地電流増幅
動作をして、トライアツク2のトリガ電流として
はコンデンサ11から抵抗17を介したPNPト
ランジスタ14のエミツタ電流が与えられる。 In the figure, when a power source 1 is turned on, a capacitor 11 is charged through a diode 12 and a resistor 13 with the terminal T1 side of the triac 2 being positive.
When the AC power supply 1 is in a cycle in which the terminal T 1 side of the triax 2 is positive, the base current of the PNP transistor 14 flows from the AC power supply 1 to the terminal T 1 of the triax 2, the emitter, the base, the resistor 7, and the load resistance of the PNP transistor 14. Because it flows through 3,
The PNP transistor 14 performs a grounded emitter current amplification operation, and the emitter current of the PNP transistor 14 is applied from the capacitor 11 via the resistor 17 as the trigger current of the triac 2.
トリガ電流の印加により、トライアツク2が導
通すると、端子T2とゲート端子の間の電圧は端
子T1と端子T2の間のオン電圧より充分に低くな
るため、PNPトランジスタ14のベースバイア
スが与えられなくなり、トリガ電流の供給が停止
する。 When the triac 2 becomes conductive due to the application of the trigger current, the voltage between the terminal T 2 and the gate terminal becomes sufficiently lower than the on-voltage between the terminals T 1 and the terminals T 2 , so that the base bias of the PNP transistor 14 is applied. The trigger current will no longer be supplied.
このトリガ電流停止動作により、コンデンサ1
1の無駄な放電を抑えることができ、省電力設計
となつている。 This trigger current stop operation causes capacitor 1
It is possible to suppress unnecessary discharge of 1, resulting in a power-saving design.
交流電源1がトライアツク2のT2端子を正と
するサイクルの場合は、NPNトランジスタ15
のベース電流は交流電源1から負荷抵抗3、定電
圧ダイオード16、NPNトランジスタ15のベ
ース、エミツタ、コンデンサ11を通して流れる
ため、NPNトランジスタ15はエミツタ接地電
流増幅動作をして、トライアツク2のトリガ電流
としてはコンデンサ11から抵抗18を介して
NPNトランジスタ15のコレクタ電流が与えら
れる。 If the AC power supply 1 is in a cycle in which the T2 terminal of the triac 2 is positive, the NPN transistor 15
Since the base current flows from the AC power supply 1 through the load resistor 3, the constant voltage diode 16, the base of the NPN transistor 15, the emitter, and the capacitor 11, the NPN transistor 15 performs a grounded emitter current amplification operation and is used as the trigger current of the triac 2. is from capacitor 11 through resistor 18
A collector current of NPN transistor 15 is applied.
トライアツク2の導通後は交流電源1がトライ
アツク2のT1端子を正とするサイクルの場合と
同じ動作となる。 After the triax 2 is turned on, the AC power supply 1 operates in the same way as in the cycle in which the T1 terminal of the triax 2 is positive.
定電圧ダイオード16はコンデンサ11の充電
電圧をツエナー電圧に制限するため、トランジス
タ14,15のコレクタ・エミツタ間耐圧の選定
及びトリガ電流の設計を容易にし、トライアツク
2導通後は電圧レベルシフトを行ない、NPNト
ランジスタ15のコレクタ・エミツタを通してコ
ンデンサ11の電荷が無駄に消費されることを防
ぐものである。 Since the voltage regulator diode 16 limits the charging voltage of the capacitor 11 to the Zener voltage, it facilitates the selection of the collector-emitter withstand voltage of the transistors 14 and 15 and the design of the trigger current, and shifts the voltage level after the triator 2 conducts. This prevents the charge of the capacitor 11 from being wasted through the collector-emitter of the NPN transistor 15.
第3図は本考案の他の実施例である。 FIG. 3 shows another embodiment of the present invention.
第2図の実施例ではトライアツクトリガ電流は
ゲート負モードの電流であつたのに対して、第3
図におけるトリガ電流はゲート正モードとなり第
2図の実施例とは逆極性のトリガ電流である。 In the embodiment shown in FIG. 2, the triat trigger current was a gate negative mode current, whereas the third
The trigger current in the figure is in a gate positive mode and has a polarity opposite to that of the embodiment shown in FIG.
動作は第2図の実施例と同様で、第2図の
PNPトランジスタ14、NPNトランジスタ15
がそれぞれ、第3図のNPNトランジスタ19、
PNPトランジスタ20に相当し、極性が逆のト
リガ電流供給を行なう。 The operation is similar to the embodiment shown in Fig. 2;
PNP transistor 14, NPN transistor 15
are respectively the NPN transistor 19 and
It corresponds to the PNP transistor 20 and supplies a trigger current with opposite polarity.
以上のように本考案の回路では零電圧位相検出
用トランジスタをエミツタ接地で動作させること
により、このトランジスタが検出及び電流増幅の
機能を有し、零電圧位相及びトライアツクの導通
の検出を端子T2とゲート端子との間から得るこ
とにより、増幅用トランジスタを付加することな
く、また高許容損失抵抗を使用することなく、零
電圧位相近傍でトリガパルスを供給できるという
利点がある。 As described above, in the circuit of the present invention, by operating the transistor for zero voltage phase detection with its emitter grounded, this transistor has the function of detection and current amplification, and the detection of the zero voltage phase and the conduction of the triac is carried out at terminal T2 . and the gate terminal, there is an advantage that the trigger pulse can be supplied in the vicinity of the zero voltage phase without adding an amplifying transistor or using a high power dissipation resistor.
第1図は従来のトライアツクトリガ回路を示す
回路図、第2図は本考案の一実施例を示す回路
図、第3図は本考案の他の実施例を示す回路図で
ある。
尚図において、1……交流電源、2……トライ
アツク、3……負荷抵抗、4,5,14,20…
…PNPトランジスタ、6,7,8,9,13,
17,18……抵抗、10,15,19……
NPNトランジスタ、11……コンデンサ、12
……ダイオード、16……定電圧ダイオード。
FIG. 1 is a circuit diagram showing a conventional triact trigger circuit, FIG. 2 is a circuit diagram showing one embodiment of the present invention, and FIG. 3 is a circuit diagram showing another embodiment of the present invention. In the figure, 1... AC power supply, 2... Triack, 3... Load resistance, 4, 5, 14, 20...
...PNP transistor, 6, 7, 8, 9, 13,
17,18...Resistance, 10,15,19...
NPN transistor, 11...Capacitor, 12
...Diode, 16... Constant voltage diode.
Claims (1)
流電源の他端に負荷を介して第2の端子が接続さ
れた双方向3端子サイリスタと、前記交流電源の
前記一端に接続された一端を有するコンデンサ
と、前記交流電源の他端と前記コンデンサの他端
との間に接続されたダイオードと、前記双方向3
端子サイリスタのゲートに接続されたエミツタ、
前記双方向3端子サイリスタの前記第2の端子に
第1の抵抗を介して接続されたベースおよび前記
コンデンサの前記他端に第2の抵抗を介して接続
されたコレクタを有する一導電型の第1のトラン
ジスタと、前記双方向3端子サイリスタの前記ゲ
ートに第3の抵抗を介して接続されたコレクタ、
前記第1のトランジスタのベースに定電圧回路を
介して接続されたベースおよび前記コンデンサの
前記他端に接続されたエミツタを有する逆導電型
の第2のトランジスタとを備える双方向3端子サ
イリスタトリガ回路。 A bidirectional three-terminal thyristor having a first terminal connected to one end of the AC power source and a second terminal connected to the other end of the AC power source via a load, and one end connected to the one end of the AC power source. a diode connected between the other end of the AC power supply and the other end of the capacitor, and the bidirectional 3
emitter connected to the gate of the terminal thyristor,
a first conductivity type thyristor having a base connected to the second terminal of the bidirectional three-terminal thyristor via a first resistor and a collector connected to the other end of the capacitor via a second resistor; 1 transistor, and a collector connected to the gate of the bidirectional three-terminal thyristor via a third resistor;
a bidirectional three-terminal thyristor trigger circuit comprising a second transistor of opposite conductivity type having a base connected to the base of the first transistor via a constant voltage circuit and an emitter connected to the other end of the capacitor; .
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15899280U JPH0242073Y2 (en) | 1980-11-06 | 1980-11-06 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15899280U JPH0242073Y2 (en) | 1980-11-06 | 1980-11-06 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5782888U JPS5782888U (en) | 1982-05-22 |
| JPH0242073Y2 true JPH0242073Y2 (en) | 1990-11-08 |
Family
ID=29518030
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15899280U Expired JPH0242073Y2 (en) | 1980-11-06 | 1980-11-06 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0242073Y2 (en) |
-
1980
- 1980-11-06 JP JP15899280U patent/JPH0242073Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5782888U (en) | 1982-05-22 |
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