JPH0242073Y2 - - Google Patents
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- Publication number
- JPH0242073Y2 JPH0242073Y2 JP15899280U JP15899280U JPH0242073Y2 JP H0242073 Y2 JPH0242073 Y2 JP H0242073Y2 JP 15899280 U JP15899280 U JP 15899280U JP 15899280 U JP15899280 U JP 15899280U JP H0242073 Y2 JPH0242073 Y2 JP H0242073Y2
- Authority
- JP
- Japan
- Prior art keywords
- terminal
- transistor
- resistor
- bidirectional
- capacitor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 239000003990 capacitor Substances 0.000 claims description 12
- 230000002457 bidirectional effect Effects 0.000 claims description 7
- 238000001514 detection method Methods 0.000 description 8
- 230000003321 amplification Effects 0.000 description 7
- 238000003199 nucleic acid amplification method Methods 0.000 description 7
- 238000010586 diagram Methods 0.000 description 3
- 230000001960 triggered effect Effects 0.000 description 1
Landscapes
- Power Conversion In General (AREA)
- Thyristor Switches And Gates (AREA)
Description
【考案の詳細な説明】
本考案は双方向３端子サイリスタトリガ回路に
係り、特に交流電力制御を行う場合、零電圧位相
近傍にて双方向３端子サイリスタ（以下トライア
ツクと呼ぶ）をトリガし、トライアツクが導通し
たことを検出してトリガ信号を停止させる機能を
有するトライアツクトリガ回路に関するものであ
る。
係り、特に交流電力制御を行う場合、零電圧位相
近傍にて双方向３端子サイリスタ（以下トライア
ツクと呼ぶ）をトリガし、トライアツクが導通し
たことを検出してトリガ信号を停止させる機能を
有するトライアツクトリガ回路に関するものであ
る。
従来、この種のトリガ回路は第１図に示すよう
にPNPトランジスタ４，５でトライアツク２の
端子T1と端子T2間の電圧を検出することにより、
正負両方向の零電圧位相の検出と、トライアツク
２の導通の検出を行ない、NPNトランジスタ１
０により信号を電流増幅し、トリガパルスを発生
させていた。
にPNPトランジスタ４，５でトライアツク２の
端子T1と端子T2間の電圧を検出することにより、
正負両方向の零電圧位相の検出と、トライアツク
２の導通の検出を行ない、NPNトランジスタ１
０により信号を電流増幅し、トリガパルスを発生
させていた。
同図においてPNPトランジスタ４は交流電源
１がトライアツク２のT1端子側が正の場合零電
圧位相検出を行ないエミツタ接地増幅動作してい
る。PNPトランジスタ５はトライアツク２の端
子T2側が正の場合の零電圧位相検出を行ない、
交流電源１を信号源としてエミツタフオロワ動作
している。
１がトライアツク２のT1端子側が正の場合零電
圧位相検出を行ないエミツタ接地増幅動作してい
る。PNPトランジスタ５はトライアツク２の端
子T2側が正の場合の零電圧位相検出を行ない、
交流電源１を信号源としてエミツタフオロワ動作
している。
この種の回路ではノイズの発生を小さくするた
めトリガパルスは零電圧位相になるべく近い時点
で印加するよう定数設計しているが、第１図の回
路ではPNPトランジスタ５がエミツタフオロワ
動作するため、信号の電流増幅が行なえず、抵抗
７を小さくして交流電源１が零電圧位相に近い時
点でのエミツタ電流を大きくすることにより、ト
リガパルスの供給を零電圧位相に近づけるように
している。このため、抵抗７には許容損失の大き
いものを使わなければならなかつた。またトライ
アツク２の導通後はトリガ信号を停止させるた
め、PNPトランジスタ４，５のオン電圧を抵抗
６と７で分圧し、トライアツク２導通後はPNP
トランジスタ４，５のベース・エミツタ間に加わ
る電圧を低くしている。この定数設計としてはト
ライアツク２のオン電圧のバラつき、PNPトラ
ンジスタ４，５のベース・エミツタ間電圧のバラ
つきを考慮し、抵抗６に対する抵抗７の比率を大
きくするため、PNPトランジスタ４，５の導通
は交流電源１が零電圧位相からある程度経過した
時点とならざるを得なかつた。さらに本回路では
トリガパルスの極性を負とする目的と検出信号電
流を電流増幅するため、NPNトランジスタ１０
が必要であつた。
めトリガパルスは零電圧位相になるべく近い時点
で印加するよう定数設計しているが、第１図の回
路ではPNPトランジスタ５がエミツタフオロワ
動作するため、信号の電流増幅が行なえず、抵抗
７を小さくして交流電源１が零電圧位相に近い時
点でのエミツタ電流を大きくすることにより、ト
リガパルスの供給を零電圧位相に近づけるように
している。このため、抵抗７には許容損失の大き
いものを使わなければならなかつた。またトライ
アツク２の導通後はトリガ信号を停止させるた
め、PNPトランジスタ４，５のオン電圧を抵抗
６と７で分圧し、トライアツク２導通後はPNP
トランジスタ４，５のベース・エミツタ間に加わ
る電圧を低くしている。この定数設計としてはト
ライアツク２のオン電圧のバラつき、PNPトラ
ンジスタ４，５のベース・エミツタ間電圧のバラ
つきを考慮し、抵抗６に対する抵抗７の比率を大
きくするため、PNPトランジスタ４，５の導通
は交流電源１が零電圧位相からある程度経過した
時点とならざるを得なかつた。さらに本回路では
トリガパルスの極性を負とする目的と検出信号電
流を電流増幅するため、NPNトランジスタ１０
が必要であつた。
本考案は零電圧位相検出用のトランジスタをエ
ミツタ接地で動作させることにより、このトラン
ジスタが検出及び電流増幅の機能を有し、零電圧
位相及びトライアツクの導通信号をT2端子とゲ
ート端子との間から得ることにより、反転増幅用
のトランジスタの省略、高許容損失抵抗の非使
用、零電圧位相近傍でのトリガパルス印加を実現
するものである。
ミツタ接地で動作させることにより、このトラン
ジスタが検出及び電流増幅の機能を有し、零電圧
位相及びトライアツクの導通信号をT2端子とゲ
ート端子との間から得ることにより、反転増幅用
のトランジスタの省略、高許容損失抵抗の非使
用、零電圧位相近傍でのトリガパルス印加を実現
するものである。
第２図は本考案の一実施例であり、１は交流電
源、２はトライアツク、３は負荷抵抗、７，１
３，１７，１８は抵抗、１１はコンデンサ、１２
はダイオード、１４はPNPトランジスタ、１５
はNPNトランジスタ、１６は定電圧ダイオード
である。
源、２はトライアツク、３は負荷抵抗、７，１
３，１７，１８は抵抗、１１はコンデンサ、１２
はダイオード、１４はPNPトランジスタ、１５
はNPNトランジスタ、１６は定電圧ダイオード
である。
同図において電源１が投入されると、コンデン
サ１１はダイオード１２、抵抗１３を通してトラ
イアツク２の端子T1側を正として充電される。
交流電源１がトライアツク２の端子T1側を正と
するサイクルの場合、PNPトランジスタ１４の
ベース電流は交流電源１からトライアツク２の端
子T1、PNPトランジスタ１４のエミツタ、ベー
ス、抵抗７、負荷抵抗３を通して流れるため、
PNPトランジスタ１４はエミツタ接地電流増幅
動作をして、トライアツク２のトリガ電流として
はコンデンサ１１から抵抗１７を介したPNPト
ランジスタ１４のエミツタ電流が与えられる。
サ１１はダイオード１２、抵抗１３を通してトラ
イアツク２の端子T1側を正として充電される。
交流電源１がトライアツク２の端子T1側を正と
するサイクルの場合、PNPトランジスタ１４の
ベース電流は交流電源１からトライアツク２の端
子T1、PNPトランジスタ１４のエミツタ、ベー
ス、抵抗７、負荷抵抗３を通して流れるため、
PNPトランジスタ１４はエミツタ接地電流増幅
動作をして、トライアツク２のトリガ電流として
はコンデンサ１１から抵抗１７を介したPNPト
ランジスタ１４のエミツタ電流が与えられる。
トリガ電流の印加により、トライアツク２が導
通すると、端子T2とゲート端子の間の電圧は端
子T1と端子T2の間のオン電圧より充分に低くな
るため、PNPトランジスタ１４のベースバイア
スが与えられなくなり、トリガ電流の供給が停止
する。
通すると、端子T2とゲート端子の間の電圧は端
子T1と端子T2の間のオン電圧より充分に低くな
るため、PNPトランジスタ１４のベースバイア
スが与えられなくなり、トリガ電流の供給が停止
する。
このトリガ電流停止動作により、コンデンサ１
１の無駄な放電を抑えることができ、省電力設計
となつている。
１の無駄な放電を抑えることができ、省電力設計
となつている。
交流電源１がトライアツク２のT2端子を正と
するサイクルの場合は、NPNトランジスタ１５
のベース電流は交流電源１から負荷抵抗３、定電
圧ダイオード１６、NPNトランジスタ１５のベ
ース、エミツタ、コンデンサ１１を通して流れる
ため、NPNトランジスタ１５はエミツタ接地電
流増幅動作をして、トライアツク２のトリガ電流
としてはコンデンサ１１から抵抗１８を介して
NPNトランジスタ１５のコレクタ電流が与えら
れる。
するサイクルの場合は、NPNトランジスタ１５
のベース電流は交流電源１から負荷抵抗３、定電
圧ダイオード１６、NPNトランジスタ１５のベ
ース、エミツタ、コンデンサ１１を通して流れる
ため、NPNトランジスタ１５はエミツタ接地電
流増幅動作をして、トライアツク２のトリガ電流
としてはコンデンサ１１から抵抗１８を介して
NPNトランジスタ１５のコレクタ電流が与えら
れる。
トライアツク２の導通後は交流電源１がトライ
アツク２のT1端子を正とするサイクルの場合と
同じ動作となる。
アツク２のT1端子を正とするサイクルの場合と
同じ動作となる。
定電圧ダイオード１６はコンデンサ１１の充電
電圧をツエナー電圧に制限するため、トランジス
タ１４，１５のコレクタ・エミツタ間耐圧の選定
及びトリガ電流の設計を容易にし、トライアツク
２導通後は電圧レベルシフトを行ない、NPNト
ランジスタ１５のコレクタ・エミツタを通してコ
ンデンサ１１の電荷が無駄に消費されることを防
ぐものである。
電圧をツエナー電圧に制限するため、トランジス
タ１４，１５のコレクタ・エミツタ間耐圧の選定
及びトリガ電流の設計を容易にし、トライアツク
２導通後は電圧レベルシフトを行ない、NPNト
ランジスタ１５のコレクタ・エミツタを通してコ
ンデンサ１１の電荷が無駄に消費されることを防
ぐものである。
第３図は本考案の他の実施例である。
第２図の実施例ではトライアツクトリガ電流は
ゲート負モードの電流であつたのに対して、第３
図におけるトリガ電流はゲート正モードとなり第
２図の実施例とは逆極性のトリガ電流である。
ゲート負モードの電流であつたのに対して、第３
図におけるトリガ電流はゲート正モードとなり第
２図の実施例とは逆極性のトリガ電流である。
動作は第２図の実施例と同様で、第２図の
PNPトランジスタ１４、NPNトランジスタ１５
がそれぞれ、第３図のNPNトランジスタ１９、
PNPトランジスタ２０に相当し、極性が逆のト
リガ電流供給を行なう。
PNPトランジスタ１４、NPNトランジスタ１５
がそれぞれ、第３図のNPNトランジスタ１９、
PNPトランジスタ２０に相当し、極性が逆のト
リガ電流供給を行なう。
以上のように本考案の回路では零電圧位相検出
用トランジスタをエミツタ接地で動作させること
により、このトランジスタが検出及び電流増幅の
機能を有し、零電圧位相及びトライアツクの導通
の検出を端子T2とゲート端子との間から得るこ
とにより、増幅用トランジスタを付加することな
く、また高許容損失抵抗を使用することなく、零
電圧位相近傍でトリガパルスを供給できるという
利点がある。
用トランジスタをエミツタ接地で動作させること
により、このトランジスタが検出及び電流増幅の
機能を有し、零電圧位相及びトライアツクの導通
の検出を端子T2とゲート端子との間から得るこ
とにより、増幅用トランジスタを付加することな
く、また高許容損失抵抗を使用することなく、零
電圧位相近傍でトリガパルスを供給できるという
利点がある。
第１図は従来のトライアツクトリガ回路を示す
回路図、第２図は本考案の一実施例を示す回路
図、第３図は本考案の他の実施例を示す回路図で
ある。 尚図において、１……交流電源、２……トライ
アツク、３……負荷抵抗、４，５，１４，２０…
…PNPトランジスタ、６，７，８，９，１３，
１７，１８……抵抗、１０，１５，１９……
NPNトランジスタ、１１……コンデンサ、１２
……ダイオード、１６……定電圧ダイオード。
回路図、第２図は本考案の一実施例を示す回路
図、第３図は本考案の他の実施例を示す回路図で
ある。 尚図において、１……交流電源、２……トライ
アツク、３……負荷抵抗、４，５，１４，２０…
…PNPトランジスタ、６，７，８，９，１３，
１７，１８……抵抗、１０，１５，１９……
NPNトランジスタ、１１……コンデンサ、１２
……ダイオード、１６……定電圧ダイオード。
Claims (1)
- 交流電源の一端に第１の端子が接続され前記交
流電源の他端に負荷を介して第２の端子が接続さ
れた双方向３端子サイリスタと、前記交流電源の
前記一端に接続された一端を有するコンデンサ
と、前記交流電源の他端と前記コンデンサの他端
との間に接続されたダイオードと、前記双方向３
端子サイリスタのゲートに接続されたエミツタ、
前記双方向３端子サイリスタの前記第２の端子に
第１の抵抗を介して接続されたベースおよび前記
コンデンサの前記他端に第２の抵抗を介して接続
されたコレクタを有する一導電型の第１のトラン
ジスタと、前記双方向３端子サイリスタの前記ゲ
ートに第３の抵抗を介して接続されたコレクタ、
前記第１のトランジスタのベースに定電圧回路を
介して接続されたベースおよび前記コンデンサの
前記他端に接続されたエミツタを有する逆導電型
の第２のトランジスタとを備える双方向３端子サ
イリスタトリガ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15899280U JPH0242073Y2 (ja) | 1980-11-06 | 1980-11-06 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15899280U JPH0242073Y2 (ja) | 1980-11-06 | 1980-11-06 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5782888U JPS5782888U (ja) | 1982-05-22 |
| JPH0242073Y2 true JPH0242073Y2 (ja) | 1990-11-08 |
Family
ID=29518030
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15899280U Expired JPH0242073Y2 (ja) | 1980-11-06 | 1980-11-06 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0242073Y2 (ja) |
-
1980
- 1980-11-06 JP JP15899280U patent/JPH0242073Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5782888U (ja) | 1982-05-22 |
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