JPH0244444U - - Google Patents

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JPH0244444U
JPH0244444U JP12208188U JP12208188U JPH0244444U JP H0244444 U JPH0244444 U JP H0244444U JP 12208188 U JP12208188 U JP 12208188U JP 12208188 U JP12208188 U JP 12208188U JP H0244444 U JPH0244444 U JP H0244444U
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JP
Japan
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receives
output
delay line
circuit
gate
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JP12208188U
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  • Synchronisation In Digital Transmission Systems (AREA)

Description

【図面の簡単な説明】
第１図は本考案によるタイミング信号抽出回路
の一実施例を示すブロツク図、第２図は第１図に
おける微分折り返し回路および遅延加算回路の実
施例を示す回路図、第３図、第４図および第５図
は第１図、第２図の動作説明に供するタイムチヤ
ート、第６図はマーク率に対する同調回路の出力
振幅の変化を示す特性図、第７図は従来のタイミ
ング信号抽出回路の一例を示すブロツク図、第８
図および第９図は第７図の動作説明に供するタイ
ムチヤートである。 １２……微分折り返し回路、１２―１……遅延
線、１２―２……排他的論理和ゲート、１３……
遅延加算回路、１３―１……遅延線、１３―２…
…論理和ゲート。

Claims (1)

    【実用新案登録請求の範囲】
  1. 受信等化信号を入力とする1/4タイムスロツト
    の遅延線とこの遅延線の出力と前記受信等化信号
    を入力とする排他的論理和ゲートにより前記受信
    等化信号からタイミング信号を抽出する微分折り
    返し回路と、この微分折り返し回路の出力を入力
    とする1/2タイムスロツトの遅延線とこの遅延線
    の出力と前記微分折り返し回路の出力を入力とす
    る論理和ゲートを組み合わせた遅延加算回路とを
    備えてなることを特徴とするタイミング信号抽出
    回路。
JP12208188U 1988-09-20 1988-09-20 Pending JPH0244444U (ja)

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JP12208188U JPH0244444U (ja) 1988-09-20 1988-09-20

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JP12208188U JPH0244444U (ja) 1988-09-20 1988-09-20

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JPH0244444U true JPH0244444U (ja) 1990-03-27

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ID=31369673

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JP12208188U Pending JPH0244444U (ja) 1988-09-20 1988-09-20

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