JPH025350B2 - - Google Patents

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JPH025350B2
JPH025350B2 JP57012945A JP1294582A JPH025350B2 JP H025350 B2 JPH025350 B2 JP H025350B2 JP 57012945 A JP57012945 A JP 57012945A JP 1294582 A JP1294582 A JP 1294582A JP H025350 B2 JPH025350 B2 JP H025350B2
Authority
JP
Japan
Prior art keywords
circuit
output
image signals
shift register
line
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP57012945A
Other languages
English (en)
Other versions
JPS58130671A (ja
Inventor
Nobuyuki Kachi
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
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Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP1294582A priority Critical patent/JPS58130671A/ja
Publication of JPS58130671A publication Critical patent/JPS58130671A/ja
Publication of JPH025350B2 publication Critical patent/JPH025350B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N1/00Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
    • H04N1/04Scanning arrangements, i.e. arrangements for the displacement of active reading or reproducing elements relative to the original or reproducing medium, or vice versa
    • H04N1/17Scanning arrangements, i.e. arrangements for the displacement of active reading or reproducing elements relative to the original or reproducing medium, or vice versa the scanning speed being dependent on content of picture

Landscapes

  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Facsimile Scanning Arrangements (AREA)

Description

【発明の詳細な説明】 本発明は画情報を2値化して伝送するフアクシ
ミリ及びその類似装置の副走査線密度決定回路に
関する。
従来、画信号を2値化して伝送するフアクシミ
リにおいては、原画の画情報密度の高低により、
副走査線の線密度を原画ごとに適宜切り換えて伝
送する方式がある。この方式は1枚の原画の中に
複雑な画像と単純な画像が混在している場合に
は、途中で線密度を切り換えられない欠点があ
る。
この欠点を改善するために、1走査線ごと或い
は1走査線の所定区間ごとに情報の伝送量を判定
して、1枚の原画の中で複雑な画像の部分は走査
線を多くし、単純な画像の部分は少ない走査線に
するという方式が提案されている。この方式は複
雑な画像が局在する場合に、単純な画像と判定さ
れる可能性があるばかりでなく、副走査線方向に
同じ画像が続く場合にも、変化画素が多いと、走
査線が密なまま伝送され、伝送時間が短縮されな
いという欠点がある。
本発明は従来技術に内在する上記欠点を除去す
るためになされたものであり、その目的は、現送
出ラインと、次送出ラインとの差異を、相異画素
が局在する場合をも適確に判定して走査線密度決
定を行う回路を提供することにある。
本発明の上記目的は、ラン毎に読み取られ2値
化された画信号を2ライン分連続して貯え、転送
クロツクによつて出力する2つのシフトレジスタ
回路と、各々のシフトレジスタ回路から転送クロ
ツクによつて出力される画信号を順次比較し、異
つている画信号を第1ビツト目から検出・計数す
る回路と、その比較されたつの画信号を各々所定
の転送クロツク数だけ遅延させた後、再び出力す
るつのシフトレジスタ回路と、その出力を上記の
比較を行つている回路と同じ転送クロツクによつ
て同様に第1ビツト目から順次比較し、異つてい
る画信号を検出・計数する回路と、上記2つの計
数値の差が規定値に達したか否かを、転送クロツ
クによつて出力されるビツト毎に順次検出する回
路とを具備し、該検出手段の出力により2ライン
間の相関の強さを判定して副走査線密度を決定す
ることにより達成される。
以下本発明を実施例により図面を参照して説明
する。第1図は本発明の一実施例のブロツク図で
ある。図において、1,2,3は1ライン分の画
素を貯えることの出来るシフトレジスタである。
4,5もシフトレジスタで例えば40画素分貯える
ことができる。6はシフトレジスタ4,5が貯え
る画素数と同じ数の画信号転送クロツクを計数す
ると、出力がローレベル(以下Lと略記する)か
らハイレベル(以下Hと略記する)になるカウン
タ、7は同じくカウンタで各ライン終了時に、例
えば画信号転送クロツク256個毎に1個のパルス
を出力するものである。11,12はカウンタで
CLA入力がHのときカウントを行い、プリセツ
ト入力Hでカウント値が「0」となる。13は減
算回路でカウンタ11の出力からカウンタ12の
出力を減じたものを出力する。14は例えば5
(00000101)を常時出力する定数ジエネレータで
ある。15は比較器で (減算回路13の出力) ≧(定数ジエネレータ14の出力) のときHを出力する。17,18はDフリツプフ
ロツプ(以下FFと略記する)、16,20はOR
回路、20はインバータ、8はAND回路、9,
10は排他論理和回路である。
次に第1図の回路の動作について説明する。
まず、ラインの初めには、カウンタ7によつて
カウンタ6,11,12、比較回路15、FF1
7はリセツトされ、カウンタ6はL、カウンタ1
1,12は「0」、比較回路15、FF17はLを
出力している。
次に、原画を走査して得られた黒及び白信号そ
れぞれH、Lの原信号が入力端子Pに、その転送
クロツクが入力端子Cに加えられると、2ライン
間の対応する画素であるシフトレジスタ回路1,
2の出力が排他論理和され、相異つた画素数がカ
ウンタ11によつて計数されて行く。画信号転送
クロツクが40に達するとカウンタ6によりカウン
タ12の入力がHになり、カウンタ12は
計数可能となる。この時点からシフトレジスタ
4,5の出力は、シフトレジスタ1,2より40画
素遅れた画信号をそれぞれ出力し始めることにな
る。即ちカウンタ12の出力はカウンタ11に比
べ、40画素前までの対応する2ライン間の相異つ
た画素数を表わしていることになる。減算器13
は転送クロツク毎に(カウンタ11の値)−(カウ
ンタ12の値)の結果、即ちその転送クロツク以
前の40画素分の相異画素数を出力しており、比較
器15はその結果と規定値を常に比較し、規定値
を超えるとHを出力する。そして1度でも規定値
を超えると、FF17によつてH出力として1ラ
イン終了までラツチされる。即ち2ライン間の相
異画素は所定区間40画素の幅をもつて1転送クロ
ツク毎に監視されているため、2ライン間の相異
画素がいかなる位置にあつても2ライン間の相関
の強さを適確に判定することになる。
次に上記実施例の動作を第2図に示すタイムチ
ヤートを使用して説明する。
第2図のaは入力端子cに加えられる画信号転
送パルス、bはカウンタ6の出力、cはカウンタ
7の出力の波形図である。2ライン間で相異画素
が規定値を超える区間が存在すると、上記のよう
に、その区間を判定した時点においてFF17の
出力はHとなり、そのままラツチされる。その様
子を第2図dに示す。FF17の出力は1ライン
終了時カウンタ7のパルスによつてFF18にラ
ツチされ、第2図eに示すように次ライン送出を
指示するH信号を出力端子Oに次ライン終了まで
出力するとともに、AND回路8により次ライン
をシフトレジスタ3にロード可能とする。またこ
のときカウンタ6,11,12、比較器15、
FF17はリセツトされ、初期状態に戻る。
次に比較器15の出力が1ライン中ずつとLの
場合、即ち次ラインが現ラインとどの40画素区間
においても規定値以上の相異画素が存在しないよ
うな、現ラインと酷似したラインである場合に
は、前ラインが送出ラインで出力端子OがHであ
ると、FF17の出力はLであり、この出力は第
2図e′のAに示すように、1ライン終了時カウン
タ7のパルスによつてFF18にLとしてラツチ
される。このFF18の出力は次ライン削除を指
示するL信号を出力端子Oに次ライン終了まで出
力するとともに、AND回路8により次ラインを
シフトレジスタ3にロード不可とする。またこの
ときカウンタ6,11,12、比較器15、FF
17はリセツトされ初期状態に戻るが、FF18
のL出力はインバータ19を通してFF17にフ
イードバツクされ、次の画信号転送クロツクで、
FF17にHとしてラツチされ、第2図dのBに
示されるように、FF17の出力をHとしてその
次のラインの送出を指示する信号を作る要因とな
り、削除ラインを連続することはなく、少しづつ
変化している画像が次々と削除されることのない
ように構成されている。
本回路は以上のように動作するので、送信処理
としては、1ライン走査終了時に出力端子Oの状
態を見て、OがHのときのみ送信処理速度に合わ
せて走査速度を制御すればよく、画信号としては
常にシフトレジスタ3を送出すればよい。
以上に詳細に説明したように、本発明によれ
ば、次ラインが現送出ラインに比べ酷似している
かどうかを一定幅でしかも画素シフトで監視・判
定しているので、従来のように酷似した2ライン
をもつ画像を変化画素が多いということで2ライ
ンとも送出することもなく、相異の大きい部分が
どのような形で局在する場合も、削除ラインと誤
つて判定することもなく、従つてどのような画像
をも送出ラインと規定以上に相異している場合は
高い走査線密度で、また酷似しているときは疎な
走査線密度で、鮮明に伝送することが出きる特徴
がある。
【図面の簡単な説明】
第1図は本発明にかかる走査線密度決定回路の
実施例のブロツク図、第2図は第1図で示した回
路の各部分の波形を示すタイムチヤートである。
なお、図面に使用した符号はそれぞれ以下のもの
を示す。 1,2,3,4,5……シフトレジスタ、6,
7,11,12……カウンタ、8……AND回路、
9,10……排他的論理和回路、13……減算回
路、14……定数ジエネレータ、15……比較回
路、16,20……論理和回路、17,18……
FF回路、19……否定回路。

Claims (1)

    【特許請求の範囲】
  1. 1 ライン毎に読み取られ2値化された画信号を
    2ライン分連続して貯え、転送クロツクによつて
    出力する2つのシフトレジスタ回路と、各々のシ
    フトレジスタ回路から転送クロツクによつて出力
    される画信号を順次比較し、異つている画信号を
    第1ビツト目から検出・計数する回路と、その比
    較された2つの画信号を各々所定の転送クロツク
    数だけ遅延させた後、再び出力する2つのシフト
    レジスタ回路と、その出力を上記の比較を行つて
    いる回路と同じ転送クロツクによつて同様に第1
    ビツト目から順次比較し、異つている画信号を検
    出・計数する回路と、上記2つの計数値の差が規
    定値に達したか否かを、転送クロツクによつて出
    力されるビツト毎に順次検出する回路とを具備
    し、該検出手段の出力により、2ライン間の相関
    の強さを判定して副走査線密度を決定することを
    特徴とする自動線密度決定回路。
JP1294582A 1982-01-29 1982-01-29 自動線密度決定回路 Granted JPS58130671A (ja)

Priority Applications (1)

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JP1294582A JPS58130671A (ja) 1982-01-29 1982-01-29 自動線密度決定回路

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JP1294582A JPS58130671A (ja) 1982-01-29 1982-01-29 自動線密度決定回路

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Publication Number Publication Date
JPS58130671A JPS58130671A (ja) 1983-08-04
JPH025350B2 true JPH025350B2 (ja) 1990-02-01

Family

ID=11819415

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JP1294582A Granted JPS58130671A (ja) 1982-01-29 1982-01-29 自動線密度決定回路

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5535595A (en) * 1978-09-05 1980-03-12 Sanyo Electric Co Ltd Facsimile transmitter

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JPS58130671A (ja) 1983-08-04

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