JPH0255424A - 符号化装置 - Google Patents
符号化装置Info
- Publication number
- JPH0255424A JPH0255424A JP63206790A JP20679088A JPH0255424A JP H0255424 A JPH0255424 A JP H0255424A JP 63206790 A JP63206790 A JP 63206790A JP 20679088 A JP20679088 A JP 20679088A JP H0255424 A JPH0255424 A JP H0255424A
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- JP
- Japan
- Prior art keywords
- section
- signal
- encoding
- unit
- control
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Compression Or Coding Systems Of Tv Signals (AREA)
- Compression, Expansion, Code Conversion, And Decoders (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概 要〕
テレビ信号等の画像符号化装置の制御方式に関し、
上記装置の符号化部を増設した時、処理能力の劣化を防
ぎ柔軟な対応のできる画像符号化装置を提供することを
目的とし、 書き込んだ入力信号データを記憶し、第２の制御部から
の読み出し制御信号により読み出して、指定された符号
化部に向けて出力する記憶部と、記憶部から読み出した
信号データの符号化処理を行う複数の符号化部と、制御
部の出力の制御信号により、符号化部の起動と状態監視
、及び出力信号データのタイミング調整を行い、かつ記
憶部に対して信号データの読み出し制御信号を出力する
第２の制御部と、記憶部の起動及び第２の制御部に対し
て符号化部の起動を行うための制御信号を出力するとと
もに、記憶部に対して信号データの書き込みのための制
御信号を出力する制御部とで構成する。
ぎ柔軟な対応のできる画像符号化装置を提供することを
目的とし、 書き込んだ入力信号データを記憶し、第２の制御部から
の読み出し制御信号により読み出して、指定された符号
化部に向けて出力する記憶部と、記憶部から読み出した
信号データの符号化処理を行う複数の符号化部と、制御
部の出力の制御信号により、符号化部の起動と状態監視
、及び出力信号データのタイミング調整を行い、かつ記
憶部に対して信号データの読み出し制御信号を出力する
第２の制御部と、記憶部の起動及び第２の制御部に対し
て符号化部の起動を行うための制御信号を出力するとと
もに、記憶部に対して信号データの書き込みのための制
御信号を出力する制御部とで構成する。
本発明は、テレビ信号等の画像符号化装置の制御方式の
改良に関するものである。
改良に関するものである。
この際、上記装置の符号化部を増設した時、処理能力の
劣化を防ぎ柔軟な対応のできる画像符号化装置が要望さ
れている。
劣化を防ぎ柔軟な対応のできる画像符号化装置が要望さ
れている。
第４図は従来例の画像符号化装置の構成を示すブロック
図である。
図である。
第４図において、例えばテレビ会議等において、テレビ
カメラにより撮像した画像信号は前処理部２に入力され
、アナログ／ディジクル変換される。
カメラにより撮像した画像信号は前処理部２に入力され
、アナログ／ディジクル変換される。
その後輝度信号と変調色信号とに分離され、フレームメ
モリ部３に一旦格納される。
モリ部３に一旦格納される。
制御部１からの制御信号により、符号化部４の処理速度
に応してフレームメモリ部３から読み小規模が大きくな
ってしまう。一方、テレビ会議あるいはテレビ電話等宅
内装置では、小型化及び省電力化が要請されている。又
、各回線インタフェースに対応する伝送速度は６４Ｋｂ
／ｓ、１２８１［ｂ／ｓ等のように多種に及ぶ。
に応してフレームメモリ部３から読み小規模が大きくな
ってしまう。一方、テレビ会議あるいはテレビ電話等宅
内装置では、小型化及び省電力化が要請されている。又
、各回線インタフェースに対応する伝送速度は６４Ｋｂ
／ｓ、１２８１［ｂ／ｓ等のように多種に及ぶ。
このような伝送速度に応じた画像符号化装置を構成する
うえで符号化器（以下ＣＯＤと称する）の処理能力を考
慮すると、実現する一つの方法としてＣＯＤを増設して
並列処理する方式が考えられる。
うえで符号化器（以下ＣＯＤと称する）の処理能力を考
慮すると、実現する一つの方法としてＣＯＤを増設して
並列処理する方式が考えられる。
この場合、制御部では制御ユニットが増加することにな
る。その結果、従来の方式においてはソフトウェアの全
面変更と共に制御部の処理能力の限界を越え、画像符号
化装置の正確な動作が期待できなくなるという問題点が
あった。
る。その結果、従来の方式においてはソフトウェアの全
面変更と共に制御部の処理能力の限界を越え、画像符号
化装置の正確な動作が期待できなくなるという問題点が
あった。
したがって本発明の目的は、上記装置の符号化部を増設
した時、処理能力の劣化を防ぎ柔軟な対応のできる画像
符号化装置の制御方式を提供することにある。
した時、処理能力の劣化を防ぎ柔軟な対応のできる画像
符号化装置の制御方式を提供することにある。
したデータを高能率符号化方式を用いて符号化して、出
力をラインインタフェース部５に入力する。
力をラインインタフェース部５に入力する。
ラインインタフェース部５において、上記符号化を行っ
た画像信号データを、他のデータや音声信号データと共
に多重化して伝送路に送出する。
た画像信号データを、他のデータや音声信号データと共
に多重化して伝送路に送出する。
受信側では多重化分離部（図示しない）において受信し
た多重化した信号データを分離し、復号化部（図示しな
い）において復号化して元のデータに戻す。そして後処
理部（図示しない）において、ディジタル信号データか
ら元のアナログ信号に戻す。
た多重化した信号データを分離し、復号化部（図示しな
い）において復号化して元のデータに戻す。そして後処
理部（図示しない）において、ディジタル信号データか
ら元のアナログ信号に戻す。
制御部１は画像符号化装置を構成する各機能部（２，３
，４及び５）の制御を行い、各機能部を起動させるため
のパラメータ設定等を行うと共に各機能部の状態の監視
を行うことにより、画像符号化処理の円滑化を図ってい
る。
，４及び５）の制御を行い、各機能部を起動させるため
のパラメータ設定等を行うと共に各機能部の状態の監視
を行うことにより、画像符号化処理の円滑化を図ってい
る。
（発明が解決しようとする課題〕
画像符号化装置では大量のデータを高速に処理する必要
があるため、ハードウェアのみでは回路〔課題を解決す
るための手段〕 上記問題点は第１図に示す構成によって解決される。
があるため、ハードウェアのみでは回路〔課題を解決す
るための手段〕 上記問題点は第１図に示す構成によって解決される。
即ち第１図において、３００は書き込んだ入力信号デー
タを記憶し、第２の制御部６００からの読み出し制御信
号により読み出して、指定された符号化部４００−１〜
４００−ｎに向けて出力する記憶部である。
タを記憶し、第２の制御部６００からの読み出し制御信
号により読み出して、指定された符号化部４００−１〜
４００−ｎに向けて出力する記憶部である。
４００−１〜４００−ｎは記憶部から読み出した信号デ
ータの符号化処理を行う複数の符号化部である。
ータの符号化処理を行う複数の符号化部である。
６００は制御部１００の出力の制御信号により、符号化
部の起動と状態監視、及び出力信号データのタイミング
調整を行い、かつ記憶部に対して信号データの読み出し
制御信号を出力する第２の制御部である。
部の起動と状態監視、及び出力信号データのタイミング
調整を行い、かつ記憶部に対して信号データの読み出し
制御信号を出力する第２の制御部である。
１００は記憶部の起動及び第２の制御部に対して符号化
部の起動を行うための制御信号を出力するとともに、記
憶部に対して信号データの書き込みのための制御信号を
出力する制御部である。
部の起動を行うための制御信号を出力するとともに、記
憶部に対して信号データの書き込みのための制御信号を
出力する制御部である。
〔作 用〕
第１図において、制御部１００からの制御信号により記
憶部３００は起動し、信号データが書き込まれる。同時
に第２の制御部６００では符号化部４００１〜４００−
ｎの起動を行い、準備の完了した符号化部（例えば１０
０−１ ”）を指定して読み出し制御信号を記憶部３０
０に対して送出する。
憶部３００は起動し、信号データが書き込まれる。同時
に第２の制御部６００では符号化部４００１〜４００−
ｎの起動を行い、準備の完了した符号化部（例えば１０
０−１ ”）を指定して読み出し制御信号を記憶部３０
０に対して送出する。
記憶部ではこれを受信して記憶した信号データから所定
の信号データを読み出し、指定された符号化部（４００
−１）に向けて出力する。符号化部（４００１）９では
上記信号データを受信し、符号化処理を開始する。
の信号データを読み出し、指定された符号化部（４００
−１）に向けて出力する。符号化部（４００１）９では
上記信号データを受信し、符号化処理を開始する。
次に又、制御部１００から第２の制御部６００に別の符
号化開始の制御信号が送出される。第２の制御部６００
ではごれを受信すると、例えば符号化部４００−２が準
備完了である時記憶部３００に対して符号化部４００−
２を指定して、読み出し制御信号を送出する。記憶部３
００でこれを受信し、記憶した信号データから所定の信
号データを読み出して、指定された符号化部４００−２
に向けて出力する。符号第３図＋ａ＋において、Ｃ０Ｎ
ＴＩＯから符号化処理の開始を示す信号（ＣＯＤＳＴ）
をサブＣＰＵ部６０に送出する。
号化開始の制御信号が送出される。第２の制御部６００
ではごれを受信すると、例えば符号化部４００−２が準
備完了である時記憶部３００に対して符号化部４００−
２を指定して、読み出し制御信号を送出する。記憶部３
００でこれを受信し、記憶した信号データから所定の信
号データを読み出して、指定された符号化部４００−２
に向けて出力する。符号第３図＋ａ＋において、Ｃ０Ｎ
ＴＩＯから符号化処理の開始を示す信号（ＣＯＤＳＴ）
をサブＣＰＵ部６０に送出する。
サブＣＰＵ部６０では例えばＣ０Ｄ４０−１で符号化処
理のための準備が完了していれば、準備完了を示す信号
（ＣＯＤＡＶＬ）をＣ０ＮＴ１０ニ返送する。その後、
Ｃ０ＮＴ１０からはあらためて開始の信号（ＣＯＤＳＴ
）を送出する。
理のための準備が完了していれば、準備完了を示す信号
（ＣＯＤＡＶＬ）をＣ０ＮＴ１０ニ返送する。その後、
Ｃ０ＮＴ１０からはあらためて開始の信号（ＣＯＤＳＴ
）を送出する。
サブＣＰＵ部６０で信号（ＣＯＤＳＴ）を受信した後、
フレームメモリ部３０に読み出し制御信号を送出して、
フレームメモリ部３０に記憶した画面１フレ一ム分のデ
ータのうち、例えば左上１／４に対応するデータを読み
出し、Ｃ０Ｄ４０−１に送出するようにする。
フレームメモリ部３０に読み出し制御信号を送出して、
フレームメモリ部３０に記憶した画面１フレ一ム分のデ
ータのうち、例えば左上１／４に対応するデータを読み
出し、Ｃ０Ｄ４０−１に送出するようにする。
同時に、符号化部４０内のＣ０Ｄ４０−１に開始の信号
（ＣＯＤＳＴ）を送出する。
（ＣＯＤＳＴ）を送出する。
Ｃ０Ｄ４０−１で信号（ＣＯＤＳＴ）を受信し、準備完
了を示す信号（ＣＯＤＡＶＬ）をサブＣＰＵ部６０に返
送する。サブＣＰＵ部６０ではこれを受信し、Ｃ０Ｄ４
０−１が準備完了であることを示す信号（ＣＯＤＡＶＬ
）をＣ０ＮＴＩＯに送出すると共に、開始を示す信号を
Ｃ０Ｄ４０−１に送出する。Ｃ０Ｄ４０−１ではこれを
受信した後、画像信号デ化部４００−２では上記信号デ
ータを受信し、符号化処理を開始する。
了を示す信号（ＣＯＤＡＶＬ）をサブＣＰＵ部６０に返
送する。サブＣＰＵ部６０ではこれを受信し、Ｃ０Ｄ４
０−１が準備完了であることを示す信号（ＣＯＤＡＶＬ
）をＣ０ＮＴＩＯに送出すると共に、開始を示す信号を
Ｃ０Ｄ４０−１に送出する。Ｃ０Ｄ４０−１ではこれを
受信した後、画像信号デ化部４００−２では上記信号デ
ータを受信し、符号化処理を開始する。
符号化部４００−３以下に対しても、同様にして行う。
次に例えば符号化部４００−２において符号化処理が終
了した時、第２の制御部６００では符号化部４００−１
の符号化処理の終了を待って、符号化部４００１．４０
０−２ 、・・・の順にタイミング調整を行い、符号化
した信号データを出力する。
了した時、第２の制御部６００では符号化部４００−１
の符号化処理の終了を待って、符号化部４００１．４０
０−２ 、・・・の順にタイミング調整を行い、符号化
した信号データを出力する。
第２図は本発明の実施例の装置の構成を示すブロック図
である。
である。
第３図は実施例の方式を説明する図である。
企図を通じて同一符号は同一対象物を示す。
第２図において、本発明が従来例と異なる点は、メイン
制御部（以下Ｃ０ＮＴと称する）１０と符号化部４０の
間にサブＣＰＵ部６０を設け、ＣＯＤを増加してもＣＯ
Ｄの動作がＣ０ＮＴＩＯからは直接見えない構成とした
ことにある。
制御部（以下Ｃ０ＮＴと称する）１０と符号化部４０の
間にサブＣＰＵ部６０を設け、ＣＯＤを増加してもＣＯ
Ｄの動作がＣ０ＮＴＩＯからは直接見えない構成とした
ことにある。
一タの高能率符号化処理等を開始する。
次に再びＣ０ＮＴＩＯから開始の信号（ＣＯＤＳＴ）が
サブＣＰＵ部６０に送出されると、サブＣＰＵ部６０で
はこれを受信し、Ｃ０Ｄ４０−２が準備完了であること
を示す信号（Ｃ，０ＤＡＶＬ）をＣ０ＮＴＩＯに返送す
る。Ｃ０ＮＴＩＯではあらためて開始の信号（ＣＯＤＳ
Ｔ）を送出する。サブＣＰＵ部６０では信号（ＣＯＤＳ
Ｔ）を受信した後、フレームメモリ部３０に読み出し制
御信号を送出し、フレームメモリ部３０に記憶した画面
１フレ一ム分のデータのうち、例えば右上１／４に対応
するデータを読み出し、Ｃ０Ｄ４０−２に送出するよう
にする。
サブＣＰＵ部６０に送出されると、サブＣＰＵ部６０で
はこれを受信し、Ｃ０Ｄ４０−２が準備完了であること
を示す信号（Ｃ，０ＤＡＶＬ）をＣ０ＮＴＩＯに返送す
る。Ｃ０ＮＴＩＯではあらためて開始の信号（ＣＯＤＳ
Ｔ）を送出する。サブＣＰＵ部６０では信号（ＣＯＤＳ
Ｔ）を受信した後、フレームメモリ部３０に読み出し制
御信号を送出し、フレームメモリ部３０に記憶した画面
１フレ一ム分のデータのうち、例えば右上１／４に対応
するデータを読み出し、Ｃ０Ｄ４０−２に送出するよう
にする。
同時にＣ０Ｉ１４０−２に開始の信号（ＣＯＤＳＴ）を
送出する。Ｃ０Ｄ４０−２では信号（ＣＯＤＳＴ）を受
信した後符号化処理を開始する。Ｃ０Ｄ４０−３以下に
ついても同様にして行う。
送出する。Ｃ０Ｄ４０−２では信号（ＣＯＤＳＴ）を受
信した後符号化処理を開始する。Ｃ０Ｄ４０−３以下に
ついても同様にして行う。
次に第３図（ｂｌにおいて、Ｃ０Ｄ４０−１において符
号化処理を終了した時終了を示す信号（ＣＯＤＥＮＤ）
をサブＣＰＵ部６０に送出する。サブＣＰＵ部６０では
これを受信し、確認を示す信号をＣ０Ｄ４０−１に返送
すると共にＣ０ＮＴ１０にもＣ０Ｄ４０−１の動作の終
了を示す信号（ＣＯＤＥＮＤ）を送出する。Ｃ０ＮＴＩ
Ｏではこれを受信し、確認を示す信号をサブＣＰＵ６０
に返送する。
号化処理を終了した時終了を示す信号（ＣＯＤＥＮＤ）
をサブＣＰＵ部６０に送出する。サブＣＰＵ部６０では
これを受信し、確認を示す信号をＣ０Ｄ４０−１に返送
すると共にＣ０ＮＴ１０にもＣ０Ｄ４０−１の動作の終
了を示す信号（ＣＯＤＥＮＤ）を送出する。Ｃ０ＮＴＩ
Ｏではこれを受信し、確認を示す信号をサブＣＰＵ６０
に返送する。
次に例えばＣ０Ｄ４０−８において符号化処理を終了し
た時も、Ｃ０Ｄ４０−１の場合と同様にして終了及び確
認の信号の送受を行う。そしてサブＣＰ１１部６０にお
いて、画面１フレ一ム分のデータが入力画像信号データ
と走査の時間順序が合うようにタイミング調整を行った
後、後段のラインインタフェース部５０に向けて送出す
る。
た時も、Ｃ０Ｄ４０−１の場合と同様にして終了及び確
認の信号の送受を行う。そしてサブＣＰ１１部６０にお
いて、画面１フレ一ム分のデータが入力画像信号データ
と走査の時間順序が合うようにタイミング調整を行った
後、後段のラインインタフェース部５０に向けて送出す
る。
以上説明したように本発明によれば、汎用ＣＰＵを中心
に置いたソフトウェアヘースの装置制御部の構成のため
、従来のようなハードウェアのみによる回路に比べて制
御の複雑化や入出力信号数の増減に容易に対処すること
ができる。
に置いたソフトウェアヘースの装置制御部の構成のため
、従来のようなハードウェアのみによる回路に比べて制
御の複雑化や入出力信号数の増減に容易に対処すること
ができる。
更に、上記装置の符号化部の増設という変更時にともな
う処理能力の劣化を防ぐことが可能となる。
う処理能力の劣化を防ぐことが可能となる。
第１図は本発明の原理図、
第２図は本発明の実施例の装置の構成を示すブロック図
、 第３図は実施例の方式を説明する図、 第４図は従来例の画像符号化装置の構成を示すブロック
図である。 図において １００は制御部、 ３００は記憶部、 ４００−１〜４００−ｎは符号化部、 ６００は第２の制御部 を示す。
、 第３図は実施例の方式を説明する図、 第４図は従来例の画像符号化装置の構成を示すブロック
図である。 図において １００は制御部、 ３００は記憶部、 ４００−１〜４００−ｎは符号化部、 ６００は第２の制御部 を示す。
Claims (1)
- 【特許請求の範囲】 書き込んだ入力信号データを記憶し、第２の制御部（６
００）からの読み出し制御信号により読み出して、指定
された符号化部（４００−１〜４００−ｎ）に向けて出
力する記憶部（３００）と、 該記憶部から読み出した信号データの符号化処理を行う
複数の符号化部（４００−１〜４００−ｎ）と、制御部
（１００）の出力の制御信号により、該符号化部の起動
と状態監視、及び出力信号データのタイミング調整を行
い、かつ該記憶部に対して信号データの読み出し制御信
号を出力する第２の制御部（６００）と、 該記憶部の起動及び該第２の制御部に対して該符号化部
の起動を行うための制御信号を出力するとともに、該記
憶部に対して信号データの書き込みのための制御信号を
出力する制御部（１００）とを有することを特徴とする
符号化装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63206790A JPH0255424A (ja) | 1988-08-20 | 1988-08-20 | 符号化装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63206790A JPH0255424A (ja) | 1988-08-20 | 1988-08-20 | 符号化装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0255424A true JPH0255424A (ja) | 1990-02-23 |
Family
ID=16529138
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63206790A Pending JPH0255424A (ja) | 1988-08-20 | 1988-08-20 | 符号化装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0255424A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS607561A (ja) * | 1983-06-28 | 1985-01-16 | Fujitsu Ltd | 通信制御装置におけるコ−ド圧縮制御方式 |
| JPS63180275A (ja) * | 1987-01-22 | 1988-07-25 | Nec Corp | 符号変換器 |
-
1988
- 1988-08-20 JP JP63206790A patent/JPH0255424A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS607561A (ja) * | 1983-06-28 | 1985-01-16 | Fujitsu Ltd | 通信制御装置におけるコ−ド圧縮制御方式 |
| JPS63180275A (ja) * | 1987-01-22 | 1988-07-25 | Nec Corp | 符号変換器 |
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