JPH0272029U - - Google Patents
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- Publication number
- JPH0272029U JPH0272029U JP1988151432U JP15143288U JPH0272029U JP H0272029 U JPH0272029 U JP H0272029U JP 1988151432 U JP1988151432 U JP 1988151432U JP 15143288 U JP15143288 U JP 15143288U JP H0272029 U JPH0272029 U JP H0272029U
- Authority
- JP
- Japan
- Prior art keywords
- register
- output
- cpu
- digital
- analog converter
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 3
Landscapes
- Analogue/Digital Conversion (AREA)
Description
第１図は本考案の実施例を示すブロツク図、第
２図は第１図に示す要部の詳細を示す図、第３図
及び第４図はそれぞれ従来例の構成を示す図であ
る。 １……ＣＰＵ、２……キーボードＫＢ、３……
主記憶装置ＭＭＵ、６……レジスタＲＥＧ、８…
…デイジタル・アナログコンバータＤ／Ａ。
２図は第１図に示す要部の詳細を示す図、第３図
及び第４図はそれぞれ従来例の構成を示す図であ
る。 １……ＣＰＵ、２……キーボードＫＢ、３……
主記憶装置ＭＭＵ、６……レジスタＲＥＧ、８…
…デイジタル・アナログコンバータＤ／Ａ。
Claims (1)
- 発音体の音量データが設定されるレジスタと、
特定のキー入力を検出することにより音量の増減
指示であることを認識し、上記レジスタに対し適
当な値を設定するプログラムが格納されるメモリ
と、発振器出力とＣＰＵから与えられる発音許可
信号との論理積出力によりエネーブルされ、上記
レジスタに設定されたデータに応じたレベルの信
号を出力するデイジタル・アナログコンバータと
を具備することを特徴とする電子機器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1988151432U JPH0272029U (ja) | 1988-11-21 | 1988-11-21 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1988151432U JPH0272029U (ja) | 1988-11-21 | 1988-11-21 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0272029U true JPH0272029U (ja) | 1990-06-01 |
Family
ID=31425473
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1988151432U Pending JPH0272029U (ja) | 1988-11-21 | 1988-11-21 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0272029U (ja) |
-
1988
- 1988-11-21 JP JP1988151432U patent/JPH0272029U/ja active Pending
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