JPH0284067A - 電源回路 - Google Patents
電源回路Info
- Publication number
- JPH0284067A JPH0284067A JP23544088A JP23544088A JPH0284067A JP H0284067 A JPH0284067 A JP H0284067A JP 23544088 A JP23544088 A JP 23544088A JP 23544088 A JP23544088 A JP 23544088A JP H0284067 A JPH0284067 A JP H0284067A
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- JP
- Japan
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- switching element
- output
- error amplifier
- base
- transistor
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、メインスイッチング素子ベース電流制御方式
のスイッチング電源回路に関する。
のスイッチング電源回路に関する。
従来の技術
一般に、外部アナログ電圧信号により出力電圧を可変し
、かつ、メインスイッチング素子のベース電流を制御し
て定電圧又は定電流特性を持たせる電源回路において、
電源のオン・オフを行なうには１人力電源を直接オン・
オフさせるか、又は、出力電圧を制御する誤差増幅器の
電圧Ｖｃｃをオン・オフさせるのが普通である。
、かつ、メインスイッチング素子のベース電流を制御し
て定電圧又は定電流特性を持たせる電源回路において、
電源のオン・オフを行なうには１人力電源を直接オン・
オフさせるか、又は、出力電圧を制御する誤差増幅器の
電圧Ｖｃｃをオン・オフさせるのが普通である。
発明が解決しようとする問語点
しかし、このようなオン・オフ制御方式によると、出力
オン時に出力電圧が過大となってしまう。
オン時に出力電圧が過大となってしまう。
いわゆるオーバシュートが問語となる。即ち、出力電圧
を制御するベース回路が出力増大時にメインスイッチン
グ素子に対するベース電流を引込むことにより出力を一
定方向に制御するわけであるが、誤差増幅器のＶｃｃ又
は入力電源自体をオン・オフする方式では電源投入時に
ベース電流の引込みができず、最大出力でオーバシュー
トしてしまうものである。このようなオーバシュートが
生ずると、出力電圧過大となり、負荷回路を破損させて
しまうおそれがある。
を制御するベース回路が出力増大時にメインスイッチン
グ素子に対するベース電流を引込むことにより出力を一
定方向に制御するわけであるが、誤差増幅器のＶｃｃ又
は入力電源自体をオン・オフする方式では電源投入時に
ベース電流の引込みができず、最大出力でオーバシュー
トしてしまうものである。このようなオーバシュートが
生ずると、出力電圧過大となり、負荷回路を破損させて
しまうおそれがある。
問題点を解決するための手段
発振動作をするメインスイッチング素子を含むインバー
タ回路と、引込みスイッチ素子を含み前記メインスイッ
チング素子のベース電流を制御するベース回路と、外部
アナログ電圧信号と前記インバータ回路の出力電流又は
出力電圧のフィードバック信号とが入力され前記引込み
スイッチ素子に出力する誤差増幅器とを備え、外部アナ
ログ電圧により出力電圧を可変制御し、かつ、前記メイ
ンスイッチング素子のベース電流の制御により出力を一
定とするメインスイッチング素子ベース電流制御方式の
スイッチング電源回路において、前記誤差増幅器のフィ
ードバック信号入力端子とＯ■ラインとの間にコンデン
サとオン・オフトリガ信号によりオン・オフ制御される
スイッチ素子とを並列に接続する。
タ回路と、引込みスイッチ素子を含み前記メインスイッ
チング素子のベース電流を制御するベース回路と、外部
アナログ電圧信号と前記インバータ回路の出力電流又は
出力電圧のフィードバック信号とが入力され前記引込み
スイッチ素子に出力する誤差増幅器とを備え、外部アナ
ログ電圧により出力電圧を可変制御し、かつ、前記メイ
ンスイッチング素子のベース電流の制御により出力を一
定とするメインスイッチング素子ベース電流制御方式の
スイッチング電源回路において、前記誤差増幅器のフィ
ードバック信号入力端子とＯ■ラインとの間にコンデン
サとオン・オフトリガ信号によりオン・オフ制御される
スイッチ素子とを並列に接続する。
作用
外部アナログ電圧信号がゼロ時や無人力時から電源投入
する際においては、オン・オフトリガ信号によりスイッ
チ素子をオンさせると誤差増幅器のフィードバック信号
入力端子がＯ■ラインに短絡された状態となり、誤差増
幅器から出力が出てベース回路中の引込みスイッチ素子
をオンさせることができる。よって、電源投入時であっ
てもベース電流の引込み動作を行なわせることができ、
オーバシュートなしで出力電圧を立上げることができる
。そして、電源投入後の定常時にはこのスイッチ素子を
オフさせれば、通常通りのフィードバック信号を誤差増
幅器に入力させて制御に供することができる。また、ス
イッチ素子をオフさせた後は、コンデンサの存在により
ソフトス・ダートさせることもできる。
する際においては、オン・オフトリガ信号によりスイッ
チ素子をオンさせると誤差増幅器のフィードバック信号
入力端子がＯ■ラインに短絡された状態となり、誤差増
幅器から出力が出てベース回路中の引込みスイッチ素子
をオンさせることができる。よって、電源投入時であっ
てもベース電流の引込み動作を行なわせることができ、
オーバシュートなしで出力電圧を立上げることができる
。そして、電源投入後の定常時にはこのスイッチ素子を
オフさせれば、通常通りのフィードバック信号を誤差増
幅器に入力させて制御に供することができる。また、ス
イッチ素子をオフさせた後は、コンデンサの存在により
ソフトス・ダートさせることもできる。
実施例
本発明の一実施例を図面に基づいて説明する。
まず、基本的には１石式インバータ構成とされており、
メインスイッチング素子としてのメイントランジスタＱ
１ とインバータトランスＴとを主体とするインバータ
回路１が＋２４Ｖライン、０■ラインによる電源間に接
続されて設けられている。
メインスイッチング素子としてのメイントランジスタＱ
１ とインバータトランスＴとを主体とするインバータ
回路１が＋２４Ｖライン、０■ラインによる電源間に接
続されて設けられている。
ここに、インバータトランスＴはメイントランジスタＱ
、のコレクタ側に接続された１次巻ＪｉｉＮ。
、のコレクタ側に接続された１次巻ＪｉｉＮ。
とベース巻１１２ Ｎ ａと負荷が接続される出力側の
２次巻ｊ＋ｉＮ、とを含むものである。また、前記メイ
ントランジスタＱ、のベース側には前記ベース巻線ＮＢ
を含むベース回路２が接続されている。このベース回路
２が前記メイントランジスタＱ１ のベース電流を制御
することにより出力電圧を一定化させるものであり、抵
抗Ｒ，，Ｒ，等からなる。
２次巻ｊ＋ｉＮ、とを含むものである。また、前記メイ
ントランジスタＱ、のベース側には前記ベース巻線ＮＢ
を含むベース回路２が接続されている。このベース回路
２が前記メイントランジスタＱ１ のベース電流を制御
することにより出力電圧を一定化させるものであり、抵
抗Ｒ，，Ｒ，等からなる。
更に、このベース回路２は前記抵抗Ｒ，とＯ■ラインと
の間に接続した引込みスイッチ素子としてのトランジス
タＱ２を含んで構成されている。
の間に接続した引込みスイッチ素子としてのトランジス
タＱ２を含んで構成されている。
さらに、このトランジスタＱ２のベース側には出力によ
りこのトランジスタＱ２のオン・オフを制御する誤差増
幅器３がツェナダイオードＺＤ。
りこのトランジスタＱ２のオン・オフを制御する誤差増
幅器３がツェナダイオードＺＤ。
を介して接続されている。この誤差増幅器３は２４Ｖラ
インからの分圧抵抗群による分圧電圧信号が十入力端子
に入力されるとともに、外部アナログ電圧信号（１〜９
Ｖ可変）も分圧抵抗群により一入力端子に与えられるも
のであり、外部アナログ電圧信号を可変することにより
出力電圧が可変される。また、この誤差増幅器３の一入
力端子は２次巻ｊｇｔＮ、側からのフィードバック信号
入力端子ともなっており、出力が増大した時には誤差増
幅器３から出力を出してトランジスタＱ！ をオンさせ
ることにより、メイントランジスタＱ、に対するベース
電流をこのトランジスタＱ１で引込み。
インからの分圧抵抗群による分圧電圧信号が十入力端子
に入力されるとともに、外部アナログ電圧信号（１〜９
Ｖ可変）も分圧抵抗群により一入力端子に与えられるも
のであり、外部アナログ電圧信号を可変することにより
出力電圧が可変される。また、この誤差増幅器３の一入
力端子は２次巻ｊｇｔＮ、側からのフィードバック信号
入力端子ともなっており、出力が増大した時には誤差増
幅器３から出力を出してトランジスタＱ！ をオンさせ
ることにより、メイントランジスタＱ、に対するベース
電流をこのトランジスタＱ１で引込み。
出力が一定化されるように制御する。
しかして、本実施例では、このようなメイントランジス
タＱ１ のベース電流制御方式のものにおいて、誤差増
幅器３のフィードバック信号入力端子（一端子）とＯｖ
ラインとの間に、コンデンサＣを接続するとともに、ス
イッチ素子としてのトランジスタＱ、も並列に接続して
なる。このトランジスタＱ、はツェナダイオードＺＤ、
を介してベース入力されるオン・オフトリガ信号によ
りオン・オフ制御される。
タＱ１ のベース電流制御方式のものにおいて、誤差増
幅器３のフィードバック信号入力端子（一端子）とＯｖ
ラインとの間に、コンデンサＣを接続するとともに、ス
イッチ素子としてのトランジスタＱ、も並列に接続して
なる。このトランジスタＱ、はツェナダイオードＺＤ、
を介してベース入力されるオン・オフトリガ信号によ
りオン・オフ制御される。
このような構成において、外部アナログ電圧信号がゼロ
時や無人力時から電源投入する際に、オン・オフトリガ
信号によりトランジスタＱ、がオンする状態に制御され
る。このトランジスタＱ。
時や無人力時から電源投入する際に、オン・オフトリガ
信号によりトランジスタＱ、がオンする状態に制御され
る。このトランジスタＱ。
のオンによりフィードバック信号入力端子はＯｖライン
に短絡された状態となるため、十入力端子側が低くても
誤差増幅器３から出力が出ることになる。よって、トラ
ンジスタＱ、がオンするので。
に短絡された状態となるため、十入力端子側が低くても
誤差増幅器３から出力が出ることになる。よって、トラ
ンジスタＱ、がオンするので。
電源投入時であってもトランジスタＱ８によるベース電
流の引込みが可能となり、出力電圧なオーバシュートな
しに立上げることができる。
流の引込みが可能となり、出力電圧なオーバシュートな
しに立上げることができる。
そして、電源投入後にはこのトランジスタＱ。
をオフさせることにより、誤差増幅器３にフィードバッ
ク信号が有効に入力される通常通りの動作となるが、こ
の際、フィードバック信号入力端子・０■ライン間にコ
ンデンサＣが存在するので、その値を適切に設定するこ
とにより、ソフトスタートさせることもできる。
ク信号が有効に入力される通常通りの動作となるが、こ
の際、フィードバック信号入力端子・０■ライン間にコ
ンデンサＣが存在するので、その値を適切に設定するこ
とにより、ソフトスタートさせることもできる。
発明の効果
本発明は、上述したように誤差増幅器のフィードバック
信号入力端子とＯ■ラインとの間にオン・オフトリガ信
号によりオン・オフ制御されるスイッチ素子を接続した
ので、電源投入に際してこのスイッチ素子をオンさせる
ことにより誤差増幅器から出力を生じさせて、ベース回
路中の引込みスイッチ素子をオンさせベース電流引込み
動作を行なわせることができ、よって、電源投入に際し
てオーバシュートを生ずることなく出力電圧を立上げる
ことができ、また、このようなスイッチ素子に並列にコ
ンデンサが存在するので、ソフトスタートさせることも
できる。
信号入力端子とＯ■ラインとの間にオン・オフトリガ信
号によりオン・オフ制御されるスイッチ素子を接続した
ので、電源投入に際してこのスイッチ素子をオンさせる
ことにより誤差増幅器から出力を生じさせて、ベース回
路中の引込みスイッチ素子をオンさせベース電流引込み
動作を行なわせることができ、よって、電源投入に際し
てオーバシュートを生ずることなく出力電圧を立上げる
ことができ、また、このようなスイッチ素子に並列にコ
ンデンサが存在するので、ソフトスタートさせることも
できる。
図面は本発明の一実施例を示す回路図である。
■・・・インバータ回路、２・・・ベース回路、３・・
・誤差増幅器、Ｑ、・・・メインスイッチング素子、Ｑ
３・・・引込みスイッチ素子、Ｑ、・・・スイッチ素子
、Ｃ・・・コンデンサ
・誤差増幅器、Ｑ、・・・メインスイッチング素子、Ｑ
３・・・引込みスイッチ素子、Ｑ、・・・スイッチ素子
、Ｃ・・・コンデンサ
Claims (1)
- 発振動作をするメインスイッチング素子を含むインバー
タ回路と、引込みスイッチ素子を含み前記メインスイッ
チング素子のベース電流を制御するベース回路と、外部
アナログ電圧信号と前記インバータ回路の出力電流又は
出力電圧のフィードバック信号とが入力され前記引込み
スイッチ素子に出力する誤差増幅器とを備え、外部アナ
ログ電圧により出力電圧を可変制御し、かつ、前記メイ
ンスイッチング素子のベース電流の制御により出力を一
定とするメインスイッチング素子ベース電流制御方式の
スイッチング電源回路において、前記誤差増幅器のフィ
ードバック信号入力端子と０Ｖラインとの間にコンデン
サとオン・オフトリガ信号によりオン・オフ制御される
スイッチ素子とを並列に接続したことを特徴とする電源
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23544088A JPH0284067A (ja) | 1988-09-20 | 1988-09-20 | 電源回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23544088A JPH0284067A (ja) | 1988-09-20 | 1988-09-20 | 電源回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0284067A true JPH0284067A (ja) | 1990-03-26 |
Family
ID=16986143
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23544088A Pending JPH0284067A (ja) | 1988-09-20 | 1988-09-20 | 電源回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0284067A (ja) |
-
1988
- 1988-09-20 JP JP23544088A patent/JPH0284067A/ja active Pending
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