JPH0287967A - Ｄｃ−ｄｃコンバータ - Google Patents
Ｄｃ−ｄｃコンバータInfo
- Publication number
- JPH0287967A JPH0287967A JP23915988A JP23915988A JPH0287967A JP H0287967 A JPH0287967 A JP H0287967A JP 23915988 A JP23915988 A JP 23915988A JP 23915988 A JP23915988 A JP 23915988A JP H0287967 A JPH0287967 A JP H0287967A
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- circuit
- transformer
- switch element
- main switch
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000003990 capacitor Substances 0.000 claims abstract description 12
- 238000001514 detection method Methods 0.000 claims abstract description 8
- 238000009499 grossing Methods 0.000 claims description 3
- 238000004804 winding Methods 0.000 claims 2
- 238000010586 diagram Methods 0.000 description 15
- 238000007792 addition Methods 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
- 230000037430 deletion Effects 0.000 description 1
- 238000012217 deletion Methods 0.000 description 1
- 230000005496 eutectics Effects 0.000 description 1
Landscapes
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はＤＣ−ＤＣコンバータ、特に共融型に関するも
のである。
のである。
従来、この種の共振型コンバータにおいて、共振条件を
満足しないなどにより主スイッチ素子のターンオン時に
げ口電圧スイッチングができないときに一定時間後、強
ＩＩＩ的に主スイッチ素子をターンオンさせていた。こ
のため、ターンオン時のスイッチング損失が大きく、又
、スパイクパルスを発生するなどの欠点があった。更に
図面により詳述する。
満足しないなどにより主スイッチ素子のターンオン時に
げ口電圧スイッチングができないときに一定時間後、強
ＩＩＩ的に主スイッチ素子をターンオンさせていた。こ
のため、ターンオン時のスイッチング損失が大きく、又
、スパイクパルスを発生するなどの欠点があった。更に
図面により詳述する。
第１図Ｉま従来の共振型ＤＣ−ＤＣコンバータの一例を
示す回路図であって、７ｒ＋は主スイッチ素子、Ｔ１は
変圧器、Ｃ１は共振用コンデンサ、Ｄｌはダンパーダイ
オード、Ｄ２は整流用ダイオード、Ｃ２は平滑用コンデ
ンサであり、ｖｌは入力電圧、ｖＯは出力電圧、Ｖｃｌ
は共振用コンデンサＣ１の両端電圧、■×は変圧２１Ｔ
１の１次電流、１０は出力Ｎ流を示す。又、Ａは出力検
出誤差増幅器、Ｂは主スイッチ素子Ｔｒｌの駆動回路で
ある。
示す回路図であって、７ｒ＋は主スイッチ素子、Ｔ１は
変圧器、Ｃ１は共振用コンデンサ、Ｄｌはダンパーダイ
オード、Ｄ２は整流用ダイオード、Ｃ２は平滑用コンデ
ンサであり、ｖｌは入力電圧、ｖＯは出力電圧、Ｖｃｌ
は共振用コンデンサＣ１の両端電圧、■×は変圧２１Ｔ
１の１次電流、１０は出力Ｎ流を示す。又、Ａは出力検
出誤差増幅器、Ｂは主スイッチ素子Ｔｒｌの駆動回路で
ある。
第１図においてはＡにより出力１圧ｖＯを検出し、それ
に対応したＢからの駆動信号により主スイッチ素子Ｔｒ
１のオン期間を制御！Ｉｌする。オフ期間についてはＢ
からの駆動信号により共振回路の条件に見合った一定値
に保たれる。
に対応したＢからの駆動信号により主スイッチ素子Ｔｒ
１のオン期間を制御！Ｉｌする。オフ期間についてはＢ
からの駆動信号により共振回路の条件に見合った一定値
に保たれる。
第２図は共振条件を満たした場合の波形図を示し、（ａ
）は共振用コンデンサＣ１の両端電圧の波形図であり、
（ｂ）は変圧器Ｔ１の１次電流Ｉ×の波形図である。
）は共振用コンデンサＣ１の両端電圧の波形図であり、
（ｂ）は変圧器Ｔ１の１次電流Ｉ×の波形図である。
図において、Ｎは変圧器Ｔ１の１次・２次巻線比、ｌｎ
は変圧器Ｔ１の内部インダクタンスと共振コンデンサＣ
１によって決まる回路定数である。
は変圧器Ｔ１の内部インダクタンスと共振コンデンサＣ
１によって決まる回路定数である。
時点ｔｏで主スイッチ素子Ｔｒｌをターンオンさせ、出
力に見合ったオン期間後、ｔｌでＴｒｌをターンオフさ
せる。ｖＣｌはｔｌから増加しはじめ、Ｖｉ＋Ｎ−ＶＯ
を軸として振幅１０・Ｚｎの正弦波状の波形となる。こ
の場合、 Ｖｉ ＋Ｎ−Ｖｏ ＜１０ ・ｚｎ （＋）の
条件が成り立てばＶｃｌはＣ２の時点でゼロ電圧に達す
る。時点ｔ２〜ｔ３において、１×はダンパーダイオー
ドＤ１を流れるので、この間で、主スイッチ素子Ｔｒｉ
をターンオンさせればスイッチング損失を最小にできる
。
力に見合ったオン期間後、ｔｌでＴｒｌをターンオフさ
せる。ｖＣｌはｔｌから増加しはじめ、Ｖｉ＋Ｎ−ＶＯ
を軸として振幅１０・Ｚｎの正弦波状の波形となる。こ
の場合、 Ｖｉ ＋Ｎ−Ｖｏ ＜１０ ・ｚｎ （＋）の
条件が成り立てばＶｃｌはＣ２の時点でゼロ電圧に達す
る。時点ｔ２〜ｔ３において、１×はダンパーダイオー
ドＤ１を流れるので、この間で、主スイッチ素子Ｔｒｉ
をターンオンさせればスイッチング損失を最小にできる
。
しかしながら、第１図の回路で出力ｉｆ流１０が減少し
すると、前記（１）式を満足しないようになり、Ｖｃｌ
の共振波形は零クロスしなくなる。
すると、前記（１）式を満足しないようになり、Ｖｃｌ
の共振波形は零クロスしなくなる。
第３図は共振条件を満たさない場合、即ち、主スイッチ
素子のオフ期間におけるＣ１の両端電圧ＶＣ１が零に達
しない場合の波形図であり、（ａ）はＣ１の両端電圧の
波形図、（ｂ）はＩＸの波形図である。
素子のオフ期間におけるＣ１の両端電圧ＶＣ１が零に達
しない場合の波形図であり、（ａ）はＣ１の両端電圧の
波形図、（ｂ）はＩＸの波形図である。
第１図の従来回路においては駆動回路図Ｂの信号により
、オフ期間を共振回路の条件に見合って一定値に保って
いるのみであるから１時点ｔ４や、Ｃ６で、丁ｒ１をタ
ーンオンする可能性が高く、その場合、スイッチング損
失は極めて大となり、スパイクパルス発生等の欠点を生
ずる。
、オフ期間を共振回路の条件に見合って一定値に保って
いるのみであるから１時点ｔ４や、Ｃ６で、丁ｒ１をタ
ーンオンする可能性が高く、その場合、スイッチング損
失は極めて大となり、スパイクパルス発生等の欠点を生
ずる。
本発明は前記せる従来の共振型ＤＣ−ＤＣコンバータの
欠点を解消し、血中な回路構成、高効率、低ノイズのＤ
Ｃ−ＤＣコンバータを得ることを目的とする。
欠点を解消し、血中な回路構成、高効率、低ノイズのＤ
Ｃ−ＤＣコンバータを得ることを目的とする。
第４図は本発明の実施例を示す回路図であり、第１図と
同一符号は同一部分を示す。ＣはＶＣｌの極小電圧検出
器、ＤはＣの検出判別回路であって、第３図（ａ）にお
けるＶｃｌの極小値、即ち、時点ｔ５でのＶｃｌの極小
電圧をＣにより検出し、この検出信号をＤにより判別し
て、駆動回路Ｂに供給し、更に、Ｂの駆動信号により、
主スイッチ素子Ｔｒ１をターンオンさせる。
同一符号は同一部分を示す。ＣはＶＣｌの極小電圧検出
器、ＤはＣの検出判別回路であって、第３図（ａ）にお
けるＶｃｌの極小値、即ち、時点ｔ５でのＶｃｌの極小
電圧をＣにより検出し、この検出信号をＤにより判別し
て、駆動回路Ｂに供給し、更に、Ｂの駆動信号により、
主スイッチ素子Ｔｒ１をターンオンさせる。
ＶｃＨ））極小値の時点Ｃ５ニオイＴ Ｌｔ ｄＶｃｌ
／ ｄｔ＝ ０ ”Ｃあるから、変圧器の１次ｉｆ Ｆ
Ｅ ｌ ｘは第３図（ｂ）のごとく、零となる。従って
、Ｖｃｌの極小値を検出、判別し、Ｃ５の時点で丁ｒ１
をターンオンさせることにより、Ｖｃｌの残留電圧があ
ってもＩＸ −０におけるスイッチングとなり、損失を
著しく、減少できる。
／ ｄｔ＝ ０ ”Ｃあるから、変圧器の１次ｉｆ Ｆ
Ｅ ｌ ｘは第３図（ｂ）のごとく、零となる。従って
、Ｖｃｌの極小値を検出、判別し、Ｃ５の時点で丁ｒ１
をターンオンさせることにより、Ｖｃｌの残留電圧があ
ってもＩＸ −０におけるスイッチングとなり、損失を
著しく、減少できる。
第４図では極小電圧検出器Ｃ及び検出判別回路りの２部
分に区分して図示したが、極小電圧での【５時点検出し
、それに対抗した信号を駆動回路Ｂに供給すればよく必
ずしも分割の必要はない。
分に区分して図示したが、極小電圧での【５時点検出し
、それに対抗した信号を駆動回路Ｂに供給すればよく必
ずしも分割の必要はない。
Ｖｃｌの極小値の検出において、検出誤差等により、結
果として極小値から若干のズレを生ずることがあっても
本発明の範囲に包含されることは当然である。又、第４
図の回路図において、部分的な変更、付加、除去等があ
っても本発明の要旨の範囲で本願に含まれるものである
。例えば、共振回路の構成においても、変圧器Ｔ１内部
インダクタンスの他に直列インダクタンスを付加しても
よい。
果として極小値から若干のズレを生ずることがあっても
本発明の範囲に包含されることは当然である。又、第４
図の回路図において、部分的な変更、付加、除去等があ
っても本発明の要旨の範囲で本願に含まれるものである
。例えば、共振回路の構成においても、変圧器Ｔ１内部
インダクタンスの他に直列インダクタンスを付加しても
よい。
以上のごとく、本発明により、簡単な回路構成で、スイ
ッチング損失を最小とし、更に、低ノイズになし得る共
振型ＤＣ−ＤＣコンバータを提供でき、各ａ業用の直流
電源等に利用して効果大なるものである。
ッチング損失を最小とし、更に、低ノイズになし得る共
振型ＤＣ−ＤＣコンバータを提供でき、各ａ業用の直流
電源等に利用して効果大なるものである。
第１図は従来のＤＣ−ＤＣコンバータの一例を示す回路
図、第２図（ａ）（ｂ）は共振条件を満たした時の波形
図、第３図（ａ）（ｂ）は共振条件を満たさない時の波
形図、第４図は本発明の実施例を示す回路図であり、Ｔ
ｒｌは主スイッチ素子、Ｔ１は変圧器、Ｃ１は共娠用コ
ンデンサ、Ｄｌはダンパーダイオード、Ｄ２は整流用ダ
イオード、Ｃ２は平滑用コンデンサ、Ｖｉは入力電圧、
ＶＯは出力電圧、ＶＣｌはＣ１の両端電圧、１ｘはＴ１
の１次電流、 １０は出力電流、 Ａは出力検出誤差 増幅器、 ＢはＴｒｉの駆動回路、 Ｃは極小ＴＡ圧検出 器、 Ｄは検出判別回路である。
図、第２図（ａ）（ｂ）は共振条件を満たした時の波形
図、第３図（ａ）（ｂ）は共振条件を満たさない時の波
形図、第４図は本発明の実施例を示す回路図であり、Ｔ
ｒｌは主スイッチ素子、Ｔ１は変圧器、Ｃ１は共娠用コ
ンデンサ、Ｄｌはダンパーダイオード、Ｄ２は整流用ダ
イオード、Ｃ２は平滑用コンデンサ、Ｖｉは入力電圧、
ＶＯは出力電圧、ＶＣｌはＣ１の両端電圧、１ｘはＴ１
の１次電流、 １０は出力電流、 Ａは出力検出誤差 増幅器、 ＢはＴｒｉの駆動回路、 Ｃは極小ＴＡ圧検出 器、 Ｄは検出判別回路である。
Claims (1)
- 直流電源、変圧器の一次巻線、及び主スイッチ素子を直
列に接続し、該変圧器の１次巻線と共振回路を構成する
共振用コンデンサを接続するとともに、該変圧器の出力
を整流し、平滑するＤＣ−ＤＣコンバータにおいて、共
振条件を満たさないで、共振用コンデンサの両端電圧が
零に達しない場合、該両端電圧の極小値を検出し、その
検出信号に対応して、主スイッチ素子をターンオンする
ようにしたことを特徴とするＤＣ−ＤＣコンバータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23915988A JPH0287967A (ja) | 1988-09-24 | 1988-09-24 | Ｄｃ−ｄｃコンバータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23915988A JPH0287967A (ja) | 1988-09-24 | 1988-09-24 | Ｄｃ−ｄｃコンバータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0287967A true JPH0287967A (ja) | 1990-03-28 |
Family
ID=17040617
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23915988A Pending JPH0287967A (ja) | 1988-09-24 | 1988-09-24 | Ｄｃ−ｄｃコンバータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0287967A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62290356A (ja) * | 1986-06-09 | 1987-12-17 | Hitachi Ltd | スイツチング電源 |
-
1988
- 1988-09-24 JP JP23915988A patent/JPH0287967A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62290356A (ja) * | 1986-06-09 | 1987-12-17 | Hitachi Ltd | スイツチング電源 |
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