JPH0293832U - - Google Patents

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JPH0293832U
JPH0293832U JP226589U JP226589U JPH0293832U JP H0293832 U JPH0293832 U JP H0293832U JP 226589 U JP226589 U JP 226589U JP 226589 U JP226589 U JP 226589U JP H0293832 U JPH0293832 U JP H0293832U
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  • Channel Selection Circuits, Automatic Tuning Circuits (AREA)
  • Superheterodyne Receivers (AREA)
  • Noise Elimination (AREA)

Description

【図面の簡単な説明】
第１図ａはこの考案による受信機のチユーニン
グ装置の一実施例におけるパルス数処理回路及び
アツプ−ダウン検出回路の一例の論理回路図、第
１図ｂはその動作を説明するためのタイミング図
、第２図は上記一実施例のブロツク図、第３図は
従来技術による周波数シンセサイザ方式の受信機
の一例のブロツク図、第４図はダイアル操作量と
周波数変化量の関係を示すグラフである。 １０……周波数設定ダイアル、１１……パルス
エンコーダ、１２……デイジタル処理回路、１３
……ＣＰＵ（分周比可変設定手段）、１４……Ｐ
ＬＬ ＶＦＯ、ＳＷ……切換スイツチ。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 周波数設定ダイアルの所定回転量毎に１パ
    ルスを発生して周波数設定ダイアルの回転量及び
    回転方向を検出するためのパルスエンコーダと、
    このパルスエンコーダの出力をデイジタル処理す
    るデイジタル処理回路と、デイジタル処理回路の
    出力信号に基づき周波数シンセサイザの分周器の
    分周比を可変設定する分周比可変設定手段とを具
    備したダイアル周波数設定方式の受信機のチユー
    ニング装置において、上記デイジタル処理回路に
    上記パルスエンコーダの出力信号のパルス数をデ
    イジタル処理するパルス数処理手段を具備し、こ
    れによつて上記１パルスを得るのに必要な周波数
    設定ダイアルの上記所定回転量を切り換え可能と
    したことを特徴とする受信機のチユーニング装置
    。 (2) 前記周波数設定ダイアルの所定回転量を設
    定された復調モードに応じて切り換え可能とした
    ことを特徴とする請求項１に記載の受信機のチユ
    ーニング装置。
JP1989002265U 1989-01-12 1989-01-12 受信機のチューニング装置 Expired - Lifetime JPH0641390Y2 (ja)

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JPH0293832U true JPH0293832U (ja) 1990-07-25
JPH0641390Y2 JPH0641390Y2 (ja) 1994-10-26

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6237443U (ja) * 1985-08-23 1987-03-05

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JPS6237443U (ja) * 1985-08-23 1987-03-05

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JPH0641390Y2 (ja) 1994-10-26

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