JPH0297016A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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Publication number
JPH0297016A
JPH0297016A JP24926688A JP24926688A JPH0297016A JP H0297016 A JPH0297016 A JP H0297016A JP 24926688 A JP24926688 A JP 24926688A JP 24926688 A JP24926688 A JP 24926688A JP H0297016 A JPH0297016 A JP H0297016A
Authority
JP
Japan
Prior art keywords
wiring
insulating film
contact window
groove
diffusion region
Prior art date
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Pending
Application number
JP24926688A
Other languages
English (en)
Inventor
Tsuguhisa Yanagihara
柳原 世弥
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
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Publication date
Application filed by Matsushita Electronics Corp filed Critical Matsushita Electronics Corp
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Publication of JPH0297016A publication Critical patent/JPH0297016A/ja
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  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明は半導体装置の製造方法に関するものである。
従来の技術 一般に、半導体装置においてアルミニウム配線を行う場
合、アルミニウム配線マスクには、コンタクト窓との重
ね合わせ時のずれによる不純物拡散領域の露出を防ぐた
めの余裕を持たせている。
以下、第3図(83〜(elに基づき半導体基板上にア
ルミニウム配線を施す場合の従来の製造方法について説
明する。まず、半導体基板11の表面に不純物拡散領域
12を形成した後、その上に絶縁膜13を形成する。次
に、ドライエツチングにより、第3図(b)に示すよう
に、不純物拡散領域12上にコンタクト窓14を形成す
る。次に、第3図(elに示すように、この上にアルミ
ニウム膜15をヌパツタ蒸着により形成した後、余裕を
持たせるように、コンタクト窓14より大きい開口を有
するーアルミニウム配線用マスク16を形成する。そし
て、次に露光・現像が行なわれ、その後ドライエツチン
グによって第3 図(d)で示すようにアルミニウム配
線パターン17が形成されていた。なお、第4図に、ア
ルミニウム配線パターン完成後の平面図を示す。
発明が解決しようとする課題 しかしながら上記の従来の製造方法では、コンタクト窓
に対するアルミニウム配線マスクの余裕が、すなわち開
口部の大きさが集積回路の微細化を妨げるものとして問
題となってきている。また、コンタクト窓においては、
アルミニウム配線が落ち込んでいるため、その段差も微
細化に対する問題点となってきている。
本発明はと記問題点を解決するもので、コンタクト窓に
対する配線用マスクの余裕をなくし、さらに配線の段差
を緩和させることのできる半導体装置の製造方法を提供
するものである。
課題を解決するための手段 上記の課題を解決するための本発明の半導体装置の製造
方法は、不純物拡散領域が形成された半導体基板上に第
1絶縁膜を形成し、次にこの第1絶縁膜に、上記不純物
拡散領域に重なるようにコンタクト窓を形成し、次にこ
の上に第2絶縁膜を形成し、次にこの第2絶縁膜に、エ
ツチングにより、上記コンタクト窓内の不純物拡散領域
の一部に接続する配線用溝を形成し、次にこの配線用溝
内に導電性材料を充填して配線パターンを形成する方法
である。
作用 この半導体装置の製造方法によれば、コンタクト窓に対
する配線用マスクの余裕を必要とせず、さらに配線は溝
内に形成されるためその段差を緩和することができる。
実施例 以下、本発明の一実施例について、図面を参照しながら
説明する。
第1図(IL)〜<r>は本発明の実施例における半導
体装置の製造工程を示すものである。まず、第1図(&
)に示すように、P型シリコン基板(半導体基板)1に
n型不純物拡散層(不純物拡散領域)2を形成した後、
この上に厚さ600nm程度の第1シリコン酸化膜(第
1絶縁膜)3を成長させる。次に、第1図(b)に示す
ように、n型不純物拡散層2上のシリコン酸化膜3に、
コンタクト窓4をフォトレジストをマスクとしたドライ
エツチングにより形成する。次に、この上に、第1図(
(1)に示すように、第2シリコン酸化膜(第2絶縁膜
)5を厚さ600nm程度に成長させた後、この上にネ
ガレジストによるアルミニウム配線用マスク6を形成す
る。この場合、アルミニウム配線は抜きパターンとなり
、木ガレシストの形状は逆テーパ形状にする。第1図(
e)はアルミニウム配線パターンがコンタクト窓に対し
てずれている状態を示している。次に、第1図(d)に
示すように、異方性ドライエツチングを用いて第2シリ
コン酸化膜6をエツチングし、少なくともコンタクト窓
4の一部分を開口させて所定形状のアルミニウム配線用
パターンn7が形成される。また、第1シリコン酸化膜
3の側壁には第2シリコン酸化膜5aが残ることになる
。次に、第1図(e]に示すように、導電性材料である
アル主ニウム膜8を第2シリコン酸化膜5のドライエツ
チングで形成したアルミニウム配線用パターン溝7の深
さと同程度の膜厚で異方性スパッタ蒸着する。この時配
線用マスク6は逆テーパ形状のたへその側面にアルミニ
ウム膜8は蒸着されない。次に、第1図(f)に示すよ
うに、配線用マスク6を除去し、同時に配線用マスク6
の上面のアルミニウム膜8も除去する。
このようにして製造された半導体装置では、第2図(第
1図(f)の一部切欠平面図)に示すように、アルミニ
ウム膜8すなわちアルミニウム配線は、コンタクト窓4
の一部分しか覆っておらず、従来のように全体以上に覆
うような余裕は持っていない。またアルミニウム配線は
パターン溝7内に形成されるためその段差部も少ない。
なお、アルミニウム膜8が覆っていないコンタクト窓4
内の不純物拡散層2は第2シリコン酸化膜5によって覆
われている。
発明の効果 以とのように本発明の半導体装置の製造方法によれば、
半導体基板に形成した不純物領域上のコンタクト窓に対
して配線用マスクに余裕を設ける必要がないばかりでな
く、マヌク重ね合わせがずれてもコンタクト窓内の不純
物領域が露出しない。
さらに、配線は絶縁膜の溝の中に形成されるため、配線
自体の段差を緩和することができる。
【図面の簡単な説明】
第1図(a)〜(f)は本発明の一実施例を示す工程図
、第2図は同半導体装置の一部切欠平面図、第3図(&
)〜(d)は従来例を示す工程図、第4図は従来例の半
導体装置の平面図である。 1・・・シリコン基板、2・・・不純物拡散層、3・・
・第1シリコン酸化膜、4・・・コンタクト窓、5・・
・第2シリコン酸化膜、6・・・配線用マスク、7・・
・配線用パターン溝、8・・・アルミニウム膜。

Claims (1)

    【特許請求の範囲】
  1. 1、不純物拡散領域が形成された半導体基板上に第1絶
    縁膜を形成し、次にこの第1絶縁膜に、上記不純物拡散
    領域に重なるようにコンタクト窓を形成し、次にこの上
    に第2絶縁膜を形成し、次にこの第2絶縁膜に、エッチ
    ングにより、上記コンタクト窓内の不純物拡散領域の一
    部に接続する配線用溝を形成し、次にこの配線用溝内に
    導電性材料を充填して配線パターンを形成する半導体装
    置の製造方法。
JP24926688A 1988-10-03 1988-10-03 半導体装置の製造方法 Pending JPH0297016A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5162259A (en) * 1991-02-04 1992-11-10 Motorola, Inc. Method for forming a buried contact in a semiconductor device

Cited By (1)

* Cited by examiner, † Cited by third party
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US5162259A (en) * 1991-02-04 1992-11-10 Motorola, Inc. Method for forming a buried contact in a semiconductor device

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