JPH0310468A - 3値同期分離回路 - Google Patents
3値同期分離回路Info
- Publication number
- JPH0310468A JPH0310468A JP14467989A JP14467989A JPH0310468A JP H0310468 A JPH0310468 A JP H0310468A JP 14467989 A JP14467989 A JP 14467989A JP 14467989 A JP14467989 A JP 14467989A JP H0310468 A JPH0310468 A JP H0310468A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- separation circuit
- negative polarity
- circuit
- synchronous
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Synchronizing For Television (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
童1上■程尻分団
本発明はハイビジョン放送システムにおける同期信号分
離回路に関するものであり、特に正負両極性の3値同期
信号を具えた3値同期映像合成信号から垂直及び水平同
期信号を分離する3値同期分離回路に関するものである
。
離回路に関するものであり、特に正負両極性の3値同期
信号を具えた3値同期映像合成信号から垂直及び水平同
期信号を分離する3値同期分離回路に関するものである
。
征】眠りえ逝
従来、3値同期分離回路は第5図にそのブロック図を示
す如く、第3図のに示すような正負両極性3値同期映像
合成信号を負極性同期分離回路51に導き、該回路51
で上記3値同朋映像合成信号のの負極性の信号を取り出
し、第3図■に示すような信号を同期分離して水平同期
信号を得ていた。
す如く、第3図のに示すような正負両極性3値同期映像
合成信号を負極性同期分離回路51に導き、該回路51
で上記3値同朋映像合成信号のの負極性の信号を取り出
し、第3図■に示すような信号を同期分離して水平同期
信号を得ていた。
また、上記第3図■に示す水平同期信号をローパスフィ
ルタ52に導き、水平同期部を除去して第3図[F]に
示す如き垂直同期信号を得ていた。
ルタ52に導き、水平同期部を除去して第3図[F]に
示す如き垂直同期信号を得ていた。
Uが ′ しようとする課
前記従来の回路においては第3図■に示す水平同期信号
のうち、第3図■に示す垂直同期期間内の信号に水平同
期信号以外のパルスが含まれることになり、これにより
垂直同期期間内の水平同期が乱れ映像期間初期に、同期
乱れの悪影響が生ずることがあった。
のうち、第3図■に示す垂直同期期間内の信号に水平同
期信号以外のパルスが含まれることになり、これにより
垂直同期期間内の水平同期が乱れ映像期間初期に、同期
乱れの悪影響が生ずることがあった。
矛 ”るための
本発明は前記の課題を解決するため、正負両極性3値同
期映像合成信号を入力とする負極性同期分離回路と正極
性同期分離回路を設け、上記負極性同期分離回路の出力
より垂直同期信号を導出するためのローパスフィルタと
、上記負極性同期分離回路及び正極性同期分離回路の出
力を上記垂直同期信号で切り換え合成するスイッチング
回路と、該スイッチング回路の出力より水平同期信号を
導出する立ち下り検出回路とを設けた構成にしている。
期映像合成信号を入力とする負極性同期分離回路と正極
性同期分離回路を設け、上記負極性同期分離回路の出力
より垂直同期信号を導出するためのローパスフィルタと
、上記負極性同期分離回路及び正極性同期分離回路の出
力を上記垂直同期信号で切り換え合成するスイッチング
回路と、該スイッチング回路の出力より水平同期信号を
導出する立ち下り検出回路とを設けた構成にしている。
作−里
人力信号として到来する正負両極性の3値同朋映像合成
信号は、負極性同期分離回路と正極性同期分離回路に導
かれ、該両回路により夫々負極性信号と正極性信号とし
て導出される。上記負極性信号はローパスフィルタに導
かれ、該ローパスフィルタで高域成分が除去されて垂直
同期信号を導出する。一方、上記負極性信号及び正極性
信号はスイッチング回路により上記垂直同期信号の期間
は上記正極性信号を、また上記垂直同期信号以外の期間
は上記負極性信号を出力するように切り換えられ、その
合成信号の立ち下りを立ち下り検出回路で検出して水平
同期信号を取り出す。
信号は、負極性同期分離回路と正極性同期分離回路に導
かれ、該両回路により夫々負極性信号と正極性信号とし
て導出される。上記負極性信号はローパスフィルタに導
かれ、該ローパスフィルタで高域成分が除去されて垂直
同期信号を導出する。一方、上記負極性信号及び正極性
信号はスイッチング回路により上記垂直同期信号の期間
は上記正極性信号を、また上記垂直同期信号以外の期間
は上記負極性信号を出力するように切り換えられ、その
合成信号の立ち下りを立ち下り検出回路で検出して水平
同期信号を取り出す。
裏」1貫
第1図は本発明の実施例のブロックであり、第2図は第
1図は具体的な回路構成を例示するものであって、第1
図に対応する部分は同一符号で示している。第3図の乃
至◎は上記第1図及び第2図の各部の信号波形図であり
、第4図はハイビジョン方式システムにおける正負両極
性3値同期映像合成信号を示すものである。
1図は具体的な回路構成を例示するものであって、第1
図に対応する部分は同一符号で示している。第3図の乃
至◎は上記第1図及び第2図の各部の信号波形図であり
、第4図はハイビジョン方式システムにおける正負両極
性3値同期映像合成信号を示すものである。
第1図においてT、は第3図のに示す正負両極性の3値
同期映像合成信号■の入力端子であり、1は負極性同期
分離回路、2は正極性同期分離回路であって、該両回路
1.2の入力端子は上記入力端子T1に接続される。3
は上記負極性同期分離回路lと第3図■に示す垂直同期
信号■の出力端子18間に設けたローパスフィルタであ
り、4は上記垂直同期信号■に同期して垂直同期信号の
発生期間中は上記正極性同期分離回路2からの出力を、
また垂直同期信号の発生期間以外の期間中は上記負極性
同期分離回路1からの出力を夫々導出するアナログスイ
ッチ等より成るスイッチング回路であって、該スイッチ
ング回路4の出力はバイパスフィルタ5及び負極性取出
回路6より成る立ら下り検出回路7を介して第3図◎に
示す水平同期信号◎の出力端子T、に導く。
同期映像合成信号■の入力端子であり、1は負極性同期
分離回路、2は正極性同期分離回路であって、該両回路
1.2の入力端子は上記入力端子T1に接続される。3
は上記負極性同期分離回路lと第3図■に示す垂直同期
信号■の出力端子18間に設けたローパスフィルタであ
り、4は上記垂直同期信号■に同期して垂直同期信号の
発生期間中は上記正極性同期分離回路2からの出力を、
また垂直同期信号の発生期間以外の期間中は上記負極性
同期分離回路1からの出力を夫々導出するアナログスイ
ッチ等より成るスイッチング回路であって、該スイッチ
ング回路4の出力はバイパスフィルタ5及び負極性取出
回路6より成る立ら下り検出回路7を介して第3図◎に
示す水平同期信号◎の出力端子T、に導く。
従って、入力端子T、に導かれる第3図の及び第4図に
示す如き正負両極性の3値同朋映像合成信号のは負極性
同期分離回路lにより負極性信号が同期分離されて、第
3図0に示す波形となる。そしてこの負極性同期分離回
路lの出力波形■はローパスフィルタ3で水平同期部を
除去して出力端子T2より第3図[F]に示す垂直同期
信号を出力する。
示す如き正負両極性の3値同朋映像合成信号のは負極性
同期分離回路lにより負極性信号が同期分離されて、第
3図0に示す波形となる。そしてこの負極性同期分離回
路lの出力波形■はローパスフィルタ3で水平同期部を
除去して出力端子T2より第3図[F]に示す垂直同期
信号を出力する。
一方、上記3値同朋映像合成信号のは正極性同期分離回
路2にも同時に導入され、該回路2で正極性信号が同期
分離されて、第3図0に示す波形を出力する。
路2にも同時に導入され、該回路2で正極性信号が同期
分離されて、第3図0に示す波形を出力する。
上記負極性同期分離回路lの出力波形■は垂直同期信号
■の期間以外の期間では、正常に水平同期信号を取り出
しているが、垂直同期信号■の期間では水平同期タイミ
ング以外にも信号が導出されている。
■の期間以外の期間では、正常に水平同期信号を取り出
しているが、垂直同期信号■の期間では水平同期タイミ
ング以外にも信号が導出されている。
また、上記正極性同期分離回路2の出力波形0は垂直同
期信号[F]の期間では正常に水平同期信号を取り出し
ているが、垂直同期信号■の期間以外の期間(映像表示
期間)では映像信号が導出されている。
期信号[F]の期間では正常に水平同期信号を取り出し
ているが、垂直同期信号■の期間以外の期間(映像表示
期間)では映像信号が導出されている。
そこでスイッチング回路4により垂直同期信号[F]に
同期して、負極性同期分離回路1及び正極性同期分離回
路2の出力を切り換え、垂直同期信号[F]の期間では
正極性同期分離回路2からの出力波形0を、また垂直同
期信号[F]の期間以外の期間では負極性同期分離回路
1からの出力波形0を導出する。従って、スイッチング
回路4より第3図0に示すような上記両回路1及び2の
出力波形■及び0の正常な部分を合成した出力波形Oを
導出することができる。
同期して、負極性同期分離回路1及び正極性同期分離回
路2の出力を切り換え、垂直同期信号[F]の期間では
正極性同期分離回路2からの出力波形0を、また垂直同
期信号[F]の期間以外の期間では負極性同期分離回路
1からの出力波形0を導出する。従って、スイッチング
回路4より第3図0に示すような上記両回路1及び2の
出力波形■及び0の正常な部分を合成した出力波形Oを
導出することができる。
しかしながら、上記出力波形0は垂直同期信号■の期間
とそれ以外の期間では信号の極性が反転しており、また
垂直同期期間以外の期間における同期信号の基準位置が
1パルス分だけずれているため、これらを補正しなけれ
ばならない。
とそれ以外の期間では信号の極性が反転しており、また
垂直同期期間以外の期間における同期信号の基準位置が
1パルス分だけずれているため、これらを補正しなけれ
ばならない。
そこで、スイッチング回路4の出力波形Oをバイパスフ
ィルタ5及び負極性取出回路6より成る立ち下り検出回
路7に通して、その立ち下りを検出し第3図に示す出力
波形◎を導出する。この出力波形◎は上記信号の極性反
転や同期基準位置のずれ等が補正された正常な水平同期
信号となる。
ィルタ5及び負極性取出回路6より成る立ち下り検出回
路7に通して、その立ち下りを検出し第3図に示す出力
波形◎を導出する。この出力波形◎は上記信号の極性反
転や同期基準位置のずれ等が補正された正常な水平同期
信号となる。
上記の実施例ではスイッチング回路4の出力波形0の立
ち下りを検出するのにこの出力波形Oをバイパスフィル
タ5に通して微分した波形[F]を作り、更に負極性取
出回路6で上記波形[F]の負極性部分を取り出すこと
によって行っているが、出力波形Oの立ち下り検出は単
安定マルチバイブレータを用いても同様に実現できる。
ち下りを検出するのにこの出力波形Oをバイパスフィル
タ5に通して微分した波形[F]を作り、更に負極性取
出回路6で上記波形[F]の負極性部分を取り出すこと
によって行っているが、出力波形Oの立ち下り検出は単
安定マルチバイブレータを用いても同様に実現できる。
光五夏泣来
本発明は以上のような構成であるから、簡単な回路構成
で正負両極性3値同期映像合成信号から不要なパルスの
混入のないタイミングの正確な垂直、水平同期信号を分
離することができ、同期乱れを起す惧れのない3値同期
分離回路を提供することができる。
で正負両極性3値同期映像合成信号から不要なパルスの
混入のないタイミングの正確な垂直、水平同期信号を分
離することができ、同期乱れを起す惧れのない3値同期
分離回路を提供することができる。
第1図は本発明の実施例のブロック図、第2図は第1図
の具体的な回路例を示す図、第3図は第1図及び第2図
の動作説明に用いる各部の信号波形図、第4図は正負両
極性3値同期映像合成信号の波形図である。第5図は従
来例の説明図である。 1−負極性同期分離回路。 2−正極性同期分離回路9 3− ローパスフィルタ 4・−スイッチング回路。 7−立ち下り検出回路。
の具体的な回路例を示す図、第3図は第1図及び第2図
の動作説明に用いる各部の信号波形図、第4図は正負両
極性3値同期映像合成信号の波形図である。第5図は従
来例の説明図である。 1−負極性同期分離回路。 2−正極性同期分離回路9 3− ローパスフィルタ 4・−スイッチング回路。 7−立ち下り検出回路。
Claims (1)
- (1)正負両極性3値同期映像合成信号を入力とする負
極性同期分離回路と正極性同期分離回路を設け、上記負
極性同期分離回路の出力より垂直同期信号を導出するた
めのローパスフィルタと、上記負極性同期分離回路及び
正極性同期分離回路の出力を上記垂直同期信号で切り換
え合成するスイッチング回路と、該スイッチング回路の
出力より水平同期信号を導出する立ち下り検出回路とを
設けたことを特徴とする3値同期分離回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14467989A JPH0310468A (ja) | 1989-06-07 | 1989-06-07 | 3値同期分離回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14467989A JPH0310468A (ja) | 1989-06-07 | 1989-06-07 | 3値同期分離回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0310468A true JPH0310468A (ja) | 1991-01-18 |
Family
ID=15367733
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14467989A Pending JPH0310468A (ja) | 1989-06-07 | 1989-06-07 | 3値同期分離回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0310468A (ja) |
-
1989
- 1989-06-07 JP JP14467989A patent/JPH0310468A/ja active Pending
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