JPH0310963B2 - - Google Patents
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- JPH0310963B2 JPH0310963B2 JP56133242A JP13324281A JPH0310963B2 JP H0310963 B2 JPH0310963 B2 JP H0310963B2 JP 56133242 A JP56133242 A JP 56133242A JP 13324281 A JP13324281 A JP 13324281A JP H0310963 B2 JPH0310963 B2 JP H0310963B2
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- JP
- Japan
- Prior art keywords
- signal
- input
- output
- storage means
- setting switch
- Prior art date
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-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Program-control systems
- G05B19/02—Program-control systems electric
- G05B19/04—Program control other than numerical control, i.e. in sequence controllers or logic controllers
- G05B19/048—Monitoring; Safety
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Safety Devices In Control Systems (AREA)
- Programmable Controllers (AREA)
Description
【発明の詳細な説明】
本発明は、あらかじめ定められたプログラムに
従つて負荷を制御する電子コントロール部に、プ
ログラムを修飾するための信号を入力する入力回
路に関するものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to an input circuit that inputs a signal for modifying a program to an electronic control unit that controls a load according to a predetermined program.
現在、使用者があらかじめ定めた工程の順序、
時間等に従つて機器を制御する電子コントロール
部を具えた家庭用電気製品が広く市販されてい
る。例えば、このような電子コントロール部が設
けられた電気洗濯機においては、使用者の希望に
応じて、洗濯から脱水までの一連の動作を行なわ
せたり、脱水だけを行なわせたりすることができ
る。 Currently, the order of processes determined in advance by the user,
BACKGROUND OF THE INVENTION Household appliances are widely available on the market that include electronic controls that control devices according to time or the like. For example, an electric washing machine equipped with such an electronic control unit can perform a series of operations from washing to spin-drying, or only spin-dry, depending on the user's wishes.
しかしながら、このような電気洗濯機は、使用
者の設定した動作を忠実に実行するために、例え
ば、洗濯→すすぎ→脱水と設定すべきところを、
使用者が誤つて洗濯→脱水という「すすぎ」を抜
かした無意味な設定を行なつた場合、その設定さ
れた内容を忠実に実行してしまう。 However, in order to faithfully execute the operations set by the user, such electric washing machines, for example, change settings such as washing → rinsing → spin-drying.
If the user mistakenly makes meaningless settings such as washing → spin-drying, omitting the "rinsing", the settings will be carried out faithfully.
また、このような設定は、入力設定スイツチ内
の機械式接点の接続状態を変化させて、その接続
状態に応じた信号を電子コントロール部へ出力す
ることにより行なわれているため、機械式接点の
チヤタリング時において出力される信号が電子コ
ントロール部へ入力して機器が誤動作するという
虞があつた。 In addition, such settings are made by changing the connection state of the mechanical contacts in the input setting switch and outputting a signal according to the connection state to the electronic control unit. There was a risk that the signal output during chattering could enter the electronic control unit and cause the equipment to malfunction.
本発明は、上述した欠点を解消するために、使
用者が誤つた設定をした際に入力設定スイツチか
ら出力される信号および入力設定スイツチのチヤ
タリング時に出力される信号が電子コントロール
部へ入力することを防いで、正しく設定された信
号だけを電子コントロール部へ入力させることが
できる入力回路を提供するものである。以下、図
面により本発明を詳細に説明する。 In order to solve the above-mentioned drawbacks, the present invention has been proposed to prevent the signal output from the input setting switch when the user makes an incorrect setting and the signal output when the input setting switch is chattering to be input to the electronic control section. The present invention provides an input circuit that can input only correctly set signals to an electronic control unit while preventing such problems. Hereinafter, the present invention will be explained in detail with reference to the drawings.
第1図は本発明の基本構成を示したブロツク図
で、1はあらかじめ定められたプログラムに従つ
て負荷部2を制御する電子コントロール部、3は
工程の順序、時間等の前記プログラムを修飾する
ための信号を設定する機械式接点を有する入力設
定スイツチ部、4はあらかじめ定められたサンプ
リング時間毎に入力設定スイツチ部3の出力信号
を記憶し、その記憶した信号を次のサンプリング
の時点まで出力する第1の記憶手段、5は入力設
定スイツチ部3の出力信号と第1の記憶手段4の
出力信号とが一致しているか否かを判別して一致
しているときに一致信号を出力する第1の一致判
別手段、6は第1の一致判別手段5から一致信号
が出力されると動作し始め、第1の一致判別手段
5が一致信号の出力を停止すると初期状態に戻る
カウンタである。ここでカウンタ6は、一致信号
が出力されている間、前記サンプリング時間に同
期してサンプリング回数を計り、その回数があら
かじめ定められた値(チヤタリングの時間を考慮
して定められた値)になると、出力が反転する。
7はカウンタ6の出力が反転した時点で、第1の
記憶手段4の出力信号を記憶し、その記憶した信
号を電子コントロール部1に出力する第2の記憶
手段である。8はあらかじめ定められた入力禁止
信号を記憶し、その信号を出力する禁止入力記憶
手段、9は入力設定スイツチ部3の出力信号と禁
止入力記憶手段8の出力信号とが一致しているか
否かを判別して一致しているとき、カウンタ6に
リセツト信号を出力する第2の一致判別手段であ
る。ここで、第2の一致判別手段9の出力信号は
電子コントロール部1にも出力されており、前記
リセツト信号が出力された時点で電子コントロー
ル部1は負荷部2を制御して、使用者に対して現
在設定されている情報は電子コントロール部1に
入力されない旨を報知する。 FIG. 1 is a block diagram showing the basic configuration of the present invention, in which 1 is an electronic control unit that controls the load section 2 according to a predetermined program, and 3 is a block diagram that modifies the program such as process order and time. The input setting switch section 4, which has a mechanical contact for setting the signal for the input setting switch section 4, stores the output signal of the input setting switch section 3 at each predetermined sampling time, and outputs the stored signal until the next sampling time. The first storage means 5 determines whether the output signal of the input setting switch section 3 and the output signal of the first storage means 4 match or not, and outputs a match signal when they match. The first match determining means 6 is a counter that starts operating when a match signal is output from the first match determining means 5 and returns to the initial state when the first match determining means 5 stops outputting the match signal. . Here, the counter 6 measures the number of samplings in synchronization with the sampling time while the coincidence signal is being output, and when the number of times reaches a predetermined value (a value determined in consideration of the chattering time). , the output is inverted.
A second storage means 7 stores the output signal of the first storage means 4 when the output of the counter 6 is inverted, and outputs the stored signal to the electronic control unit 1. Reference numeral 8 indicates a prohibition input storage means for storing a predetermined input prohibition signal and outputting the signal. Reference numeral 9 indicates whether the output signal of the input setting switch section 3 and the output signal of the prohibition input storage means 8 match. This is a second coincidence determining means which outputs a reset signal to the counter 6 when the two match. Here, the output signal of the second coincidence determination means 9 is also output to the electronic control section 1, and at the time when the reset signal is output, the electronic control section 1 controls the load section 2 to notify the user. In contrast, it is notified that the currently set information will not be input to the electronic control unit 1.
以上のように構成された本発明に係る入力回路
においては、使用者の設定操作が終了してチヤタ
リングが納まると、入力設定スイツチ部3の出力
が安定してカウンタ6がサンプリング回数のカウ
ントを開始する。そして、設定された信号が正し
い信号である場合には、カウンタ6はカウントを
続行し、所定の値になるとその出力が反転するた
めに、第2の記憶手段7はその正しい信号を記憶
して電子コントロール部1に出力する。設定され
た信号が誤つている場合には、第2の一致判別手
段9からリセツト信号が出力されて、カウンタ6
はサンプリング回数のカウントを行なわずその出
力が反転しないために、第2の記憶手段7はこの
誤つた信号を記憶せず、さらに、電子コントロー
ル部1は負荷部2を制御して、設定された情報が
誤つている旨を使用者に報知する。以下、本発明
の実施例について詳細に説明する。 In the input circuit according to the present invention configured as described above, when the user completes the setting operation and the chatter subsides, the output of the input setting switch section 3 becomes stable and the counter 6 starts counting the number of sampling times. do. If the set signal is the correct signal, the counter 6 continues counting, and when the predetermined value is reached, the output is inverted, so the second storage means 7 stores the correct signal. Output to electronic control unit 1. If the set signal is incorrect, a reset signal is output from the second coincidence determination means 9 and the counter 6 is reset.
does not count the number of samplings and its output is not inverted, so the second storage means 7 does not store this erroneous signal, and furthermore, the electronic control section 1 controls the load section 2 to Notify the user that the information is incorrect. Examples of the present invention will be described in detail below.
第2図は本発明の一実施例の構成を示したもの
で、第1図と同一符号のものは同一のものを示し
ている。ここで、入力設定スイツチ部3の内部に
はスイツチ10,11が設けられており、入力設
定スイツチ部3はこのスイツチ10,11の接続
状態によつて4種類の信号を出力することができ
る。第1の記憶手段4は2つのDフリツプフロツ
プ回路12,13で構成されており、発振器14
から出力されるサンプリングパルスの立上りで、
スイツチ10,11から出力される信号を記憶
し、その記憶した信号を次のサンプリングパルス
の立上りの時点まで出力する。第1の一致判別手
段5はエク・スクルーシブOR回路15,16お
よびOR回路17で構成されており、エクスクル
ーシブOR回路15に入力する2つの信号が一致
し、且つ、エクスクルーシブOR回路16に入力
する2つの信号が一致したときだけOR回路17
の出力はLowになる。カウンタ6は第1の一致
判別手段5の出力がLowになると作動し始め、
発振器14から出力されるサンプリングパルスの
立下りでカウントを行ない、その値があらかじめ
定められた値(時間的には40ミリ秒〜100ミリ秒)
になると、その出力がLowからHighに変化する。
ここで、カウンタ6はその作動中に、第1の一致
判別手段5の出力がLowからHighになると、そ
のカウント数は0にリセツトされる。カウンタ6
の出力信号はAND回路18,19およびOR回路
20で構成された選択回路を介して第2の記憶手
段7に入力している。21は工程動作の開始を指
示するスタート信号を出力するスタートスイツ
チ、22はこのスタート信号を記憶するフリツプ
フロツプ回路であり、選択回路は上記スタート信
号が発せられる以前においては、カウンタ6の出
力信号を出力し、スタート信号の出力後において
は、カウンタ6の出力がLowからHighになつた
時点から一定の時間後、その出力がLowから
Highに変わるタイマ23の出力信号を出力する。
第2の記憶手段7は2つのDフリツプフロツプ回
路24,25で構成されており、このDフリツプ
フロツプ回路24,25はOR回路20の出力が
LowからHighになる立上りで、第1の記憶手段
4の出力信号を記憶し、その記憶した信号を電子
コントロール部1に出力する。電子コントロール
部1は、あらかじめ定められたプログラムと第2
の記憶手段7から出力される信号とにより定まる
実行すべきプログラムに従つて、表示器26、報
知器27およびモータ等の機械部28を制御す
る。禁止入力記憶手段8はフリツプフロツプ回路
29,30で構成されており、あらかじめ定めら
た入力禁止信号を出力している。第2の一致判別
手段9はエクスクルーシブOR回路31,32お
よびOR回路33で構成されており、エクスクル
ーシブOR回路31に入力する信号が一致し、且
つ、エクスクルーシブOR回路32入力する2つ
の信号が一致したときだけ、即ち、入力設定スイ
ツチ部3から出力される信号が禁止入力記憶手段
8から出力される入力禁止信号と一致したときだ
けOR回路33の出力はLowになる。このように
OR回路33の出力がLowになると、カウンタ6
はリセツトされてその出力がHighにならない。
また、OR回路33の出力がLowになると、電子
コントロール部1は表示器26および報知器27
を制御して、使用者に設定誤りがあることを報知
する。 FIG. 2 shows the configuration of an embodiment of the present invention, and the same reference numerals as in FIG. 1 indicate the same components. Here, switches 10 and 11 are provided inside the input setting switch section 3, and the input setting switch section 3 can output four types of signals depending on the connection state of the switches 10 and 11. The first storage means 4 is composed of two D flip-flop circuits 12 and 13, and an oscillator 14.
At the rising edge of the sampling pulse output from
The signals output from the switches 10 and 11 are stored, and the stored signals are output until the rising edge of the next sampling pulse. The first coincidence determination means 5 is composed of exclusive OR circuits 15 and 16 and an OR circuit 17, and the two signals input to the exclusive OR circuit 15 coincide, and the two signals input to the exclusive OR circuit 16 OR circuit 17 only when two signals match
The output of becomes Low. The counter 6 starts operating when the output of the first match determining means 5 becomes Low,
Counting is performed at the falling edge of the sampling pulse output from the oscillator 14, and the value is a predetermined value (40 milliseconds to 100 milliseconds in terms of time).
, the output changes from Low to High.
Here, while the counter 6 is in operation, when the output of the first coincidence determining means 5 changes from Low to High, the count number is reset to 0. counter 6
The output signal is input to the second storage means 7 via a selection circuit composed of AND circuits 18, 19 and an OR circuit 20. 21 is a start switch that outputs a start signal instructing the start of a process operation, 22 is a flip-flop circuit that stores this start signal, and the selection circuit outputs the output signal of the counter 6 before the start signal is issued. However, after the start signal is output, the output of counter 6 changes from low to high after a certain period of time from the time when the output of counter 6 changes from low to high.
Outputs the output signal of timer 23 which changes to High.
The second storage means 7 is composed of two D flip-flop circuits 24 and 25, and the output of the OR circuit 20 is
At the rising edge from Low to High, the output signal of the first storage means 4 is stored, and the stored signal is output to the electronic control section 1. The electronic control unit 1 controls a predetermined program and a second
The display 26, the alarm 27, and the mechanical parts 28 such as motors are controlled according to the program to be executed determined by the signal output from the storage means 7 of the controller. The inhibit input storage means 8 is composed of flip-flop circuits 29 and 30, and outputs a predetermined input inhibit signal. The second coincidence determining means 9 is composed of exclusive OR circuits 31, 32 and an OR circuit 33, and when the signals input to the exclusive OR circuit 31 match and the two signals input to the exclusive OR circuit 32 match, Only when the signal output from the input setting switch section 3 matches the input prohibition signal output from the prohibition input storage means 8, the output of the OR circuit 33 becomes Low. in this way
When the output of the OR circuit 33 becomes Low, the counter 6
is reset and its output does not go high.
Further, when the output of the OR circuit 33 becomes Low, the electronic control section 1 controls the display 26 and the alarm 27.
to notify the user that there is a setting error.
次に、以上のように構成された本実施例の動作
について説明する。先ず、プログラムを設定する
前においては、カウンタ6の出力信号(Low)
がAND回路19およびOR回路20を介してDフ
リツプフロツプ回路24,25に入力している。
そして、使用者が入力設定スイツチ部3を操作す
ると、その操作に伴つてスイツチ10,11の接
続状態が変化し、最終的には使用者が希望する内
容に対応した信号が入力設定スイツチ部3から出
力される。この使用者が設定した内容が正しい場
合には、第2の一致判別手段9の出力はHighで
あり、入力設定スイツチ部3から出力された信号
は、第1の記憶手段4に記憶され、さらに、カウ
ンタ6の出力がLowからHighに立上る時点にお
いて第2の記憶手段7に記憶されて電子コントロ
ール部1に出力される。以上のような動作におい
て、スイツチ10,11でチヤタリングが発生し
ているときには、第1の一致判別手段5の出力が
安定せずカウンタ6の出力がHighにならないた
め、このチヤタリング時に入力設定スイツチ部3
から出力される信号が第2の記憶手段7に入力す
ることはない。また、使用者の設定した内容が誤
つている場合には、第2の一致判別手段9の出力
がLowになるために、カウンタ6が作動せず第
2の記憶手段7は入力設定スイツチ部3から出力
される信号を記憶しない。さらに、このような場
合には、電子コントロール部1が表示器26、報
知器27等を制御して、使用者に対して設定され
た内容が誤つていることを報知する。 Next, the operation of this embodiment configured as above will be explained. First, before setting the program, the output signal (Low) of counter 6
is input to D flip-flop circuits 24 and 25 via an AND circuit 19 and an OR circuit 20.
When the user operates the input setting switch section 3, the connection state of the switches 10 and 11 changes in accordance with the operation, and finally a signal corresponding to the content desired by the user is sent to the input setting switch section 3. is output from. If the content set by the user is correct, the output of the second match determination means 9 is High, the signal output from the input setting switch section 3 is stored in the first storage means 4, and When the output of the counter 6 rises from Low to High, it is stored in the second storage means 7 and output to the electronic control unit 1. In the above operation, when chattering occurs in the switches 10 and 11, the output of the first coincidence determination means 5 is unstable and the output of the counter 6 does not become High. 3
The signal output from the second storage means 7 is never input to the second storage means 7. Further, if the contents set by the user are incorrect, the output of the second match determination means 9 becomes Low, so the counter 6 does not operate and the second storage means 7 inputs the input setting switch section 3. Do not store the signals output from the . Further, in such a case, the electronic control section 1 controls the display 26, the alarm 27, etc. to notify the user that the set contents are incorrect.
以上説明したように本発明によれば、誤動作の
原因となる入力設定スイツチ部のチヤタリング状
態の信号、あるいは外来ノイズ信号が電子コント
ロール部へ入力するのを確実に防止することがで
きると共に、使用者が誤つて設定した際の誤設定
信号の入力も禁止し、常に正しく設定された信号
だけが入力するという顕著な作用効果を奏するも
のである。 As explained above, according to the present invention, it is possible to reliably prevent a signal of a chattering state of the input setting switch section or an external noise signal from being input to the electronic control section, which may cause malfunction, and also to prevent the user from entering the electronic control section. This has the remarkable effect that it also prohibits the input of an erroneous setting signal when the erroneously set signal is set, and only the correctly set signal is always inputted.
第1図は本発明の基本構成を示すブロツク図、
第2図は本発明の一実施例の構成を示す回路図で
ある。
1……電子コントロール部、2……負荷部、3
……入力設定スイツチ部、4……第1の記憶手
段、5……第1の一致判別手段、6……カウン
タ、7……第2の記憶手段、8……禁止入力記憶
手段、9……第2の一致判別手段。
FIG. 1 is a block diagram showing the basic configuration of the present invention.
FIG. 2 is a circuit diagram showing the configuration of an embodiment of the present invention. 1...Electronic control section, 2...Load section, 3
...Input setting switch unit, 4...First storage means, 5...First coincidence determination means, 6...Counter, 7...Second storage means, 8...Prohibition input storage means, 9... ...Second match determining means.
Claims (1)
従つて制御する電子コントロール部に、前記プロ
グラムを修飾するための信号を入力する入力回路
において、前記プログラムを修飾するHighある
いはLowの信号を出力する入力設定スイツチ部
と、該入力設定スイツチ部の出力を一定の時間毎
にサンプリングして記憶する第1の記憶手段と、
該第1の記憶手段と前記入力設定スイツチ部との
各出力が一致するか否かを判別する第1の一致判
別手段と、該一致判別手段が一致信号を出力して
いる期間をカウントし、前記入力設定スイツチ部
のチヤタリング状態の信号あるいは外来ノイズ信
号の入力を禁止する機能を持つ計時手段と、該計
時手段のカウント数が一定数に達したとき前記第
1の記憶手段の出力を記憶し前記電子コントロー
ル部に出力する第2の記憶手段と、あらかじめ定
められた入力禁止信号を記憶した禁止入力記憶手
段と、該禁止入力記憶手段と前記第1の記憶手段
との各出力が一致するか否かを判別し、一致した
場合前記計時手段にリセツト信号を出力する第2
の一致判別手段とからなり、前記入力設定スイツ
チ部からのチヤタリング状態の信号、外来ノイズ
信号及び誤設定信号を前記第2の記憶手段から前
記電子コントロール部へ出力しないようにしたこ
とを特徴とする入力回路。1 In an input circuit that inputs a signal for modifying the program to an electronic control section that controls the load section according to a predetermined program, an input setting switch that outputs a High or Low signal for modifying the program. a first storage means for sampling and storing the output of the input setting switch section at regular intervals;
a first coincidence determining means for determining whether each output of the first storage means and the input setting switch section match; and counting a period during which the coincidence determining means outputs a coincidence signal; A timer having a function of inhibiting input of a chattering state signal or an external noise signal to the input setting switch unit, and storing an output of the first storage means when a count number of the timer reaches a certain number. Whether the outputs of the second storage means outputting to the electronic control unit, the inhibition input storage means storing a predetermined input inhibition signal, and the outputs of the inhibition input storage means and the first storage means match. a second device which determines whether or not the two clocks match, and outputs a reset signal to the clocking means if they match;
a coincidence determination means, and is characterized in that a chattering state signal, an external noise signal, and an erroneous setting signal from the input setting switch section are not output from the second storage means to the electronic control section. input circuit.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56133242A JPS5835603A (en) | 1981-08-27 | 1981-08-27 | input circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56133242A JPS5835603A (en) | 1981-08-27 | 1981-08-27 | input circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5835603A JPS5835603A (en) | 1983-03-02 |
| JPH0310963B2 true JPH0310963B2 (en) | 1991-02-14 |
Family
ID=15100026
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56133242A Granted JPS5835603A (en) | 1981-08-27 | 1981-08-27 | input circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5835603A (en) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH082723Y2 (en) * | 1988-02-05 | 1996-01-29 | 日産自動車株式会社 | Sequence controller |
| US5068489A (en) * | 1989-12-28 | 1991-11-26 | Union Carbide Chemicals And Plastics Technology Corporation | Preparation of very low molecular weight polyethylene in a fluidized bed |
Family Cites Families (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2409339A1 (en) * | 1977-11-16 | 1979-06-15 | Amiens Const Elect Mec | MANEUVERABLE WASHING MACHINE REFERRING TO THE NATURE OF THE OBJECTS TO BE WASHED |
| JPS54107786U (en) * | 1978-01-17 | 1979-07-28 | ||
| JPS5544669A (en) * | 1978-09-26 | 1980-03-29 | Toshiba Corp | Operation supervisory unit |
| JPS5572202A (en) * | 1978-11-24 | 1980-05-30 | Toshiba Corp | Computer unit for process control |
| JPS55128101U (en) * | 1979-02-27 | 1980-09-10 |
-
1981
- 1981-08-27 JP JP56133242A patent/JPS5835603A/en active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5835603A (en) | 1983-03-02 |
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