JPH03132207A - 自動利得制御装置 - Google Patents
自動利得制御装置Info
- Publication number
- JPH03132207A JPH03132207A JP27071989A JP27071989A JPH03132207A JP H03132207 A JPH03132207 A JP H03132207A JP 27071989 A JP27071989 A JP 27071989A JP 27071989 A JP27071989 A JP 27071989A JP H03132207 A JPH03132207 A JP H03132207A
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- gain
- adder
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
この発明は、電話回線における音声合成（ミキシング）
や音声レベル調整など音声信号処理に用いられるディジ
タル形の自動利得制御装置に関する。
や音声レベル調整など音声信号処理に用いられるディジ
タル形の自動利得制御装置に関する。
（従来の技術〕
近年、通信分野の発展はめざましいものであり、数々の
新しい製品が生み出されている０例えば、複数の端末を
接続することで互いに離れた場所にいる人が移動するこ
となく会議を行なうことのできるＴＶ会議システムや、
受信側の人間が不在の場合でも音声の伝言を残すことの
できる音声メール装置などはその顕著な例であり、これ
によって時間の節約が可能な限り行なわれている。
新しい製品が生み出されている０例えば、複数の端末を
接続することで互いに離れた場所にいる人が移動するこ
となく会議を行なうことのできるＴＶ会議システムや、
受信側の人間が不在の場合でも音声の伝言を残すことの
できる音声メール装置などはその顕著な例であり、これ
によって時間の節約が可能な限り行なわれている。
こうした新しい発明が忙しい都市社会で果たす役割は大
きく、あらゆる視点から多大な関心が寄せられている。
きく、あらゆる視点から多大な関心が寄せられている。
最近では、より自然な音声と安価な使用料金の実現が望
まれており伝送分野での新たな革新が期待されている。
まれており伝送分野での新たな革新が期待されている。
この高品質な音声の実現に応えるものの１つに自動利得
制御装置がある。自動利得制御（Ａｕｔｏ−ｍａｔｉｃ
Ｇａ１ｎ Ｃｏｎｔｏｒｏｌ、以下ＡＧＣと記す）と
け入力信号レベルの範囲が広い場合にもその出力を一定
の範囲に保つ働きを言い、伝送に伴う損失を補い送受信
の信号レベルの大きさを調整するために音声信号処理に
も用いられ、通信分野の発展に大きく貢献している。
制御装置がある。自動利得制御（Ａｕｔｏ−ｍａｔｉｃ
Ｇａ１ｎ Ｃｏｎｔｏｒｏｌ、以下ＡＧＣと記す）と
け入力信号レベルの範囲が広い場合にもその出力を一定
の範囲に保つ働きを言い、伝送に伴う損失を補い送受信
の信号レベルの大きさを調整するために音声信号処理に
も用いられ、通信分野の発展に大きく貢献している。
このＡＧＣ作用は通常演算増幅器を用いたアナログ回路
によって行なわれてきた。ところが近年のディジタル処
理技術の発展により、このＡＧＣ作用をディジタル回路
によって行なわせることが可能となってきた。さらに現
在ではディジタル信号処理用プロセッサシステムでディ
ジタル形ＡＧＣ回路を実現しているものも多く、より限
定された目的のためのＡＧＣ装置が開発されつつある。
によって行なわれてきた。ところが近年のディジタル処
理技術の発展により、このＡＧＣ作用をディジタル回路
によって行なわせることが可能となってきた。さらに現
在ではディジタル信号処理用プロセッサシステムでディ
ジタル形ＡＧＣ回路を実現しているものも多く、より限
定された目的のためのＡＧＣ装置が開発されつつある。
第３図はディジタル形ＡＧＣ装置の概要を示すシステム
図の一例である。ＡＧＣをかけるべきアナログ信号＾ｔ
ｎは、Ａ１０変換器（１）によりディジタル信号Ｘに変
換され、該ディジタル信号Ｘはディジタル形ＡＧＣシス
テムのＡＧＣループＡＬ内に入力される。ここで、乗算
器（２） に入り、利得係数へｇとの乗算が行なわれて
ＡＧＣ出力ｙすなわち、ｙ−八ｇ−Ｘとなる。出力ｙは
分岐されてレベル検出回路（３）及び平均化回路（４）
を経て利得係数発生部（５） に入る。ここに利得係
数へｇは利得ループＡＬを一巡することにより各出力ｙ
毎に定まる。
図の一例である。ＡＧＣをかけるべきアナログ信号＾ｔ
ｎは、Ａ１０変換器（１）によりディジタル信号Ｘに変
換され、該ディジタル信号Ｘはディジタル形ＡＧＣシス
テムのＡＧＣループＡＬ内に入力される。ここで、乗算
器（２） に入り、利得係数へｇとの乗算が行なわれて
ＡＧＣ出力ｙすなわち、ｙ−八ｇ−Ｘとなる。出力ｙは
分岐されてレベル検出回路（３）及び平均化回路（４）
を経て利得係数発生部（５） に入る。ここに利得係
数へｇは利得ループＡＬを一巡することにより各出力ｙ
毎に定まる。
上記第３図における利得ループＡＬをハードウェア的に
実現するものの一例として、例えば第４図に示す如く、
特公昭６３−１９０８９号公報に示されたものがある。
実現するものの一例として、例えば第４図に示す如く、
特公昭６３−１９０８９号公報に示されたものがある。
以下、第４図の動作について詳しく説明する。
入力音声信号＾１ｏは、＾／Ｄ変換器（１）によりディ
ジタル信号Ｘに変換された後、本回路へ与えられる。デ
ィジタル入力信号Ｘはまず乗算器（２）に入力され、こ
こで利得係数Ａｇとの乗算が行なわれて利得出力信号ｙ
が算出される。ディジタル出力信号ｙは利得ループ内に
分岐されて、先ずレベルを検出するために二乗回路（３
１）を介して加算器（３２）に入力される。ただし、加
算器（３２）にはマイナス入力として入力される。加算
器（３２）には別途基準値Ｄｒが印加されており、出力
ｙがＤ「を越えるときは負の入力として、逆にｙがＯｒ
を下回るときは正の入力として乗算器（４１）に与えら
れ、一定の重みづけ（重み係数ａ）がなされる。この乗
算器（４１）を含めて加算器（４２）ならびに遅延回路
Ｔ１が平均化を行なう。なお、乗算器（５１）に対する
ｂ１加算器（５２）に対する１、０は共に重みづけに係
わるものであり、ここで利得係数へｇを決定、発生する
。
ジタル信号Ｘに変換された後、本回路へ与えられる。デ
ィジタル入力信号Ｘはまず乗算器（２）に入力され、こ
こで利得係数Ａｇとの乗算が行なわれて利得出力信号ｙ
が算出される。ディジタル出力信号ｙは利得ループ内に
分岐されて、先ずレベルを検出するために二乗回路（３
１）を介して加算器（３２）に入力される。ただし、加
算器（３２）にはマイナス入力として入力される。加算
器（３２）には別途基準値Ｄｒが印加されており、出力
ｙがＤ「を越えるときは負の入力として、逆にｙがＯｒ
を下回るときは正の入力として乗算器（４１）に与えら
れ、一定の重みづけ（重み係数ａ）がなされる。この乗
算器（４１）を含めて加算器（４２）ならびに遅延回路
Ｔ１が平均化を行なう。なお、乗算器（５１）に対する
ｂ１加算器（５２）に対する１、０は共に重みづけに係
わるものであり、ここで利得係数へｇを決定、発生する
。
（発明が解決しようとする課題）
従来のディジタル形ＡＧＣ装置は以上のようにして構成
されているので次のような問題点がある。すなわち、第
４図において、入力の対象である音声信号はその振幅の
範囲が広い上に短時間で大きく変動する性買を有してい
るので、先に述べたように信号がＡＧＣループＡＬに入
力され、巡する毎にこのレベルを算出し、それを基に信
号利得値を求めるＡＧＣループでは、利得係数へ８の値
はサンプル毎に異なり、ＡＧＣシステムが入力信号に与
える利得値は安定した値とならないため、再生音を聴く
上でかえって不自然な感じを与える恐れがある。
されているので次のような問題点がある。すなわち、第
４図において、入力の対象である音声信号はその振幅の
範囲が広い上に短時間で大きく変動する性買を有してい
るので、先に述べたように信号がＡＧＣループＡＬに入
力され、巡する毎にこのレベルを算出し、それを基に信
号利得値を求めるＡＧＣループでは、利得係数へ８の値
はサンプル毎に異なり、ＡＧＣシステムが入力信号に与
える利得値は安定した値とならないため、再生音を聴く
上でかえって不自然な感じを与える恐れがある。
この発明は、上記のような問題点を解消するためになさ
れもので、入力信号として対象となる音声データが会話
を行う上でより自然なレベル調整を受けるように安定し
た利得を発生させることのできるディジタル利得装置を
得ることを目的とする。
れもので、入力信号として対象となる音声データが会話
を行う上でより自然なレベル調整を受けるように安定し
た利得を発生させることのできるディジタル利得装置を
得ることを目的とする。
この発明に係る自動利得制御装置は、人力信号に所定の
利得係数を乗算した乗算出力のレベルを検出し、その検
出レベルに基づいて平均値を抽出して、該平均値に基づ
いて新たな利得係数を算出する利得係数発生部を有する
自動利得制御ループを備えた自動利得制御装置において
、上記利得係数発生部に、算出された利得係数と前サン
プル時の利得係数との差が予め設定した範囲内にあるか
否かを求める比較手段と、設定範囲内にある時前サンプ
ル時の利得係数を選択すると共に、設定範囲外にある時
は上記平均値の抽出に基づいて算出される新たな利得係
数を選択する選択切換手段とを備えたものである。
利得係数を乗算した乗算出力のレベルを検出し、その検
出レベルに基づいて平均値を抽出して、該平均値に基づ
いて新たな利得係数を算出する利得係数発生部を有する
自動利得制御ループを備えた自動利得制御装置において
、上記利得係数発生部に、算出された利得係数と前サン
プル時の利得係数との差が予め設定した範囲内にあるか
否かを求める比較手段と、設定範囲内にある時前サンプ
ル時の利得係数を選択すると共に、設定範囲外にある時
は上記平均値の抽出に基づいて算出される新たな利得係
数を選択する選択切換手段とを備えたものである。
（作用）
この発明における自動利得制御装置においては、利得係
数発生部において、比較手段により、算出された利得係
数と前サンプル時の利得係数との差が予め設定した範囲
内にあるか否かが求められ、選択切換手段により、設定
範囲内にある時は前サンプル時の利得係数が選択される
と共に、設定範囲外にある時は新たに算出される利得係
数が選択される。
数発生部において、比較手段により、算出された利得係
数と前サンプル時の利得係数との差が予め設定した範囲
内にあるか否かが求められ、選択切換手段により、設定
範囲内にある時は前サンプル時の利得係数が選択される
と共に、設定範囲外にある時は新たに算出される利得係
数が選択される。
以下、この発明の一実施例を第３図及び第４図と同一部
分は同一符号を付して示す第１図について説明する。第
１図はこの発明の一実施例を示すブロック図であり、（
１）〜（５） 、（３１）、（３２）、（４１）。
分は同一符号を付して示す第１図について説明する。第
１図はこの発明の一実施例を示すブロック図であり、（
１）〜（５） 、（３１）、（３２）、（４１）。
（４２） 、 （５１） （５２）およびＴ１は第
４図に示した従来装置と同一のものである。この実施例
において、第４図と異なる点は、利得係数発生部（５）
に、加算器（５２）により算出された利得係数と遅延
回路Ｔ。
４図に示した従来装置と同一のものである。この実施例
において、第４図と異なる点は、利得係数発生部（５）
に、加算器（５２）により算出された利得係数と遅延
回路Ｔ。
からの前サンプル時の利得係数との差を求める加算器（
５３）と、その加算出力を絶対値化する絶対値回路（５
４）と、その出力が予め設定した上限と下限の範囲Ｉｆ
内にあるか否かを求める比較器（５５）と、その設定範
囲にある時比較器（５５）の指令に基づき遅延回路Ｔ、
内の前サンプル時の利得係数を選択して乗算器（２）に
与えるべくオフ側にスイッチ切り替えを行うと共に、設
定範囲外にある時は加算器（５２）により新たに算出さ
れる利得係数を選択して乗算器（２） に与えるべくオ
ン側にスイッチ切り替えを行うスイッチ回路（５６）を
備えた点である。
５３）と、その加算出力を絶対値化する絶対値回路（５
４）と、その出力が予め設定した上限と下限の範囲Ｉｆ
内にあるか否かを求める比較器（５５）と、その設定範
囲にある時比較器（５５）の指令に基づき遅延回路Ｔ、
内の前サンプル時の利得係数を選択して乗算器（２）に
与えるべくオフ側にスイッチ切り替えを行うと共に、設
定範囲外にある時は加算器（５２）により新たに算出さ
れる利得係数を選択して乗算器（２） に与えるべくオ
ン側にスイッチ切り替えを行うスイッチ回路（５６）を
備えた点である。
次に、動作について詳しく説明する。この実施例におけ
る自動利得制御装置は従来例のディジタル形ＡＧＣ装置
と同様、アナログの音声入力信号＾凰、を＾／Ｄ変換器
によりディジタル信号Ｘに変換した後、ＡＧＣループ内
に入力し順次ディジタル演算処理を行っていくものであ
る。いまｎ番目のサンプル値のディジタル信号ｘｎがＡ
ＧＣループに入力されたとする。利得係数発生部（５）
に入力されるまでは、従来例と同様の処理を施される。
る自動利得制御装置は従来例のディジタル形ＡＧＣ装置
と同様、アナログの音声入力信号＾凰、を＾／Ｄ変換器
によりディジタル信号Ｘに変換した後、ＡＧＣループ内
に入力し順次ディジタル演算処理を行っていくものであ
る。いまｎ番目のサンプル値のディジタル信号ｘｎがＡ
ＧＣループに入力されたとする。利得係数発生部（５）
に入力されるまでは、従来例と同様の処理を施される。
その後は利得係数発生部（５）に入力され、引き続き次
のような処理を行う。すなわち、入力ディジタル信号Ｘ
ｎがＡＧＣループを一巡する間に、従来例と同様の処理
によって加算器（５２）により利得係数Ａｇｎを算出す
る。これを加算器（５３）に入力し、前サンプルＸｎ−
１に対して与えられた利得係数、即ち、遅延回路Ｔ２を
経て加算器（５３）に入力される利得係数＾ｇｎ−ｒと
の差を算出する。加算器（５３）の出力はその絶対値を
取る絶対値回路（５４）を経て、続けて比較器（５５）
に入力する。そして、利得の変動を無視する幅として別
途設定した基準値Ｗｆと比較する。ここで２つの値Ａｇ
ｎと＾ｇｎ−＋ との差がＷｆより大きい時は、スイッ
チ回路（５６）はＯＮ側に接続され、利得係数は新しい
値に書き替えられ利得係数はＡｇｎ となる。逆に差が
Ｉｆより小さい時は、スイッチ回路（５６）はＯＦＦ側
に接続となり、そして現サンプルに対する利得係数＾ｇ
ｎ−１が遅延回路Ｔ２から与えられる。
のような処理を行う。すなわち、入力ディジタル信号Ｘ
ｎがＡＧＣループを一巡する間に、従来例と同様の処理
によって加算器（５２）により利得係数Ａｇｎを算出す
る。これを加算器（５３）に入力し、前サンプルＸｎ−
１に対して与えられた利得係数、即ち、遅延回路Ｔ２を
経て加算器（５３）に入力される利得係数＾ｇｎ−ｒと
の差を算出する。加算器（５３）の出力はその絶対値を
取る絶対値回路（５４）を経て、続けて比較器（５５）
に入力する。そして、利得の変動を無視する幅として別
途設定した基準値Ｗｆと比較する。ここで２つの値Ａｇ
ｎと＾ｇｎ−＋ との差がＷｆより大きい時は、スイッ
チ回路（５６）はＯＮ側に接続され、利得係数は新しい
値に書き替えられ利得係数はＡｇｎ となる。逆に差が
Ｉｆより小さい時は、スイッチ回路（５６）はＯＦＦ側
に接続となり、そして現サンプルに対する利得係数＾ｇ
ｎ−１が遅延回路Ｔ２から与えられる。
第２図は各部波形を示し、（ａ）に示すような音声信号
が入力された時、加算器（５２）より出力される値（同
図（ｂ））、加算器（５３）の出力信号（同図（ｃ））
、比較器（５５）より発生するスイッチ回路（５６）の
切り替えを行う信号（同図（ｄ））、利得係数発生部（
５） より出力される利得値Ａｇ（同図（ｅ））をそれ
ぞれ示している。この図からも分るよ−うに、本発明を
適用したＡＧＣ回路からは、微小変動を無視した安定し
た利得を得ることができる。
が入力された時、加算器（５２）より出力される値（同
図（ｂ））、加算器（５３）の出力信号（同図（ｃ））
、比較器（５５）より発生するスイッチ回路（５６）の
切り替えを行う信号（同図（ｄ））、利得係数発生部（
５） より出力される利得値Ａｇ（同図（ｅ））をそれ
ぞれ示している。この図からも分るよ−うに、本発明を
適用したＡＧＣ回路からは、微小変動を無視した安定し
た利得を得ることができる。
従って、音声の伝送においても安定した利得を確保し、
電話回線などにおいて自然な通話を行うことができると
いう効果がある。
電話回線などにおいて自然な通話を行うことができると
いう効果がある。
なお、上記実施例では、ある基準値以内の微小変動を無
視する回路を利得係数発生部（５）内に設けているが、
この代わりに平均化回路（４）内に設けて最も新しいデ
ータによる平均値が前出の利得値を算出するに当たって
参照した平均値に比べ差が小さいときには、これを無視
するようにしても同様の効果がある。
視する回路を利得係数発生部（５）内に設けているが、
この代わりに平均化回路（４）内に設けて最も新しいデ
ータによる平均値が前出の利得値を算出するに当たって
参照した平均値に比べ差が小さいときには、これを無視
するようにしても同様の効果がある。
また、上記実施例ではハードウェア処理を中心とした動
作を行うようにしであるが、この代わりにプロセッサを
中心としたソフトウェア処理で行うことも可能である。
作を行うようにしであるが、この代わりにプロセッサを
中心としたソフトウェア処理で行うことも可能である。
以上のようにこの発明によれば、ＡＧＣループ内を一巡
する度に所定の演算により算出される連続する利得値の
微小変動を無視することで、安定した利得が得られ、こ
れにより、音声信号のように短時間に振幅の範囲が大き
く変動するものが制御対象となっても安定した利得を得
ることができるという効果がある。
する度に所定の演算により算出される連続する利得値の
微小変動を無視することで、安定した利得が得られ、こ
れにより、音声信号のように短時間に振幅の範囲が大き
く変動するものが制御対象となっても安定した利得を得
ることができるという効果がある。
第１図はディジタル形ＡＧＣ装置の概要を示す構成図、
′ｓ２図は第１図の各部出力波形図、第３図は従来のデ
ィジタル形利得システムの概要を示すシステム図、第４
図は第３図をハードウェア的に示すブロック図である。 （３１） 、 （３２）はレベル検出回路（３）を構成
する二乗回路と加算器 （４１） 、 （４２） 、丁、は平均化回路（４）を
構成する乗算器と加算器及び遅延回路 （５１）〜（５６）、Ｔ２は順次、利得制御係数発生部
（５）を構成する乗算器、加算器、加算器、絶対値回路
、比較器、及びスイッチ回路と遅延回路ＡＬは自動利得
制御ループ なお、各図中、同一符号は同−又は相当部分を示・す。
′ｓ２図は第１図の各部出力波形図、第３図は従来のデ
ィジタル形利得システムの概要を示すシステム図、第４
図は第３図をハードウェア的に示すブロック図である。 （３１） 、 （３２）はレベル検出回路（３）を構成
する二乗回路と加算器 （４１） 、 （４２） 、丁、は平均化回路（４）を
構成する乗算器と加算器及び遅延回路 （５１）〜（５６）、Ｔ２は順次、利得制御係数発生部
（５）を構成する乗算器、加算器、加算器、絶対値回路
、比較器、及びスイッチ回路と遅延回路ＡＬは自動利得
制御ループ なお、各図中、同一符号は同−又は相当部分を示・す。
Claims (1)
- 入力信号に所定の利得係数を乗算した乗算出力のレベル
を検出し、その検出レベルに基づいて平均値を抽出して
、該平均値に基づいて新たな利得係数を算出する利得係
数発生部を有する自動利得制御ループを備えた自動利得
制御装置において、上記利得係数発生部に、算出された
利得係数と前サンプル時の利得係数との差が予め設定し
た範囲内にあるか否かを求める比較手段と、設定範囲内
にある時前サンプル時の利得係数を選択すると共に、設
定範囲外にある時は上記平均値の抽出に基づいて算出さ
れる新たな利得係数を選択する選択切換手段とを備えた
ことを特徴とする自動利得制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1270719A JPH0732338B2 (ja) | 1989-10-18 | 1989-10-18 | 自動利得制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1270719A JPH0732338B2 (ja) | 1989-10-18 | 1989-10-18 | 自動利得制御装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03132207A true JPH03132207A (ja) | 1991-06-05 |
| JPH0732338B2 JPH0732338B2 (ja) | 1995-04-10 |
Family
ID=17490008
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1270719A Expired - Fee Related JPH0732338B2 (ja) | 1989-10-18 | 1989-10-18 | 自動利得制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0732338B2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS566516A (en) * | 1979-06-28 | 1981-01-23 | Fujitsu Ltd | Automatic gain control circuit |
-
1989
- 1989-10-18 JP JP1270719A patent/JPH0732338B2/ja not_active Expired - Fee Related
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS566516A (en) * | 1979-06-28 | 1981-01-23 | Fujitsu Ltd | Automatic gain control circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0732338B2 (ja) | 1995-04-10 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080410 Year of fee payment: 13 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20090410 Year of fee payment: 14 |
|
| LAPS | Cancellation because of no payment of annual fees |