JPH03139933A - 回線品質測定方式 - Google Patents
回線品質測定方式Info
- Publication number
- JPH03139933A JPH03139933A JP27942589A JP27942589A JPH03139933A JP H03139933 A JPH03139933 A JP H03139933A JP 27942589 A JP27942589 A JP 27942589A JP 27942589 A JP27942589 A JP 27942589A JP H03139933 A JPH03139933 A JP H03139933A
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- JP
- Japan
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- circuit
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- Pending
Links
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- 238000000691 measurement method Methods 0.000 claims description 7
- 238000000034 method Methods 0.000 claims description 6
- 238000004891 communication Methods 0.000 claims description 2
- 238000005259 measurement Methods 0.000 abstract description 4
- 238000010586 diagram Methods 0.000 description 2
- 230000007547 defect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 238000013441 quality evaluation Methods 0.000 description 1
- 230000002194 synthesizing effect Effects 0.000 description 1
Landscapes
- Detection And Prevention Of Errors In Transmission (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明はデータＩｇＩ線の回線品質評価に関し。
特にその測定方式に関する。
（従来の技術）
従来、この種の回線品質測定方式は対象回線に一定の符
号パターンを有するデータを送出し。
号パターンを有するデータを送出し。
受信されたデータとその符号パターンとの照合管行うこ
とにより、符号誤りを検出して回線品質全測定していた
。
とにより、符号誤りを検出して回線品質全測定していた
。
（発明が解決しようとする課題）
上述した従来の回線品質測定方式では、測定のために対
象回線を専有してしまうため９回線の使用を中断する必
要があり、そのために常時。
象回線を専有してしまうため９回線の使用を中断する必
要があり、そのために常時。
測定を実施できないと云う欠点がある。
本発明の目的は、ハイレベルデータリンク制御手順にお
けるフラグシーケンス上の誤りビットを検出するととも
に、フレームチェックシーケンスによるフレーム誤り金
検出し、これらによって得られ九誤り数を合成すること
により上記欠点全除去し、常時、測定全実施できるよう
に構成した回線品質測定方式を提供することにある。
けるフラグシーケンス上の誤りビットを検出するととも
に、フレームチェックシーケンスによるフレーム誤り金
検出し、これらによって得られ九誤り数を合成すること
により上記欠点全除去し、常時、測定全実施できるよう
に構成した回線品質測定方式を提供することにある。
（課題を解決するための手段）
本発明による回線品質測定方式はフラグシーケンス誤り
検出回路と、フレーム誤り検出回路と、論理和回路と、
誤り計数回路とを具備して構成したものである〇 フラグシーケンス誤り検出回路は、ノ１イレベルデータ
リンク制御手順によりデータ通信を行う回線におけるフ
ラグシーケンス上の誤９ビツトヲ検出する九めのもので
ある。
検出回路と、フレーム誤り検出回路と、論理和回路と、
誤り計数回路とを具備して構成したものである〇 フラグシーケンス誤り検出回路は、ノ１イレベルデータ
リンク制御手順によりデータ通信を行う回線におけるフ
ラグシーケンス上の誤９ビツトヲ検出する九めのもので
ある。
フレーム誤り検出回路は、フレームチエツクジ−タンス
によるフレームの誤り全検出するためのものである。
によるフレームの誤り全検出するためのものである。
論理和回路は、フラグシーケンス誤り検出回路の誤り出
力、およびフレーム誤ジ検出回路の誤り出力の和全求め
るためのものである。
力、およびフレーム誤ジ検出回路の誤り出力の和全求め
るためのものである。
誤り計数回路は、論理和回路の出力の和を計数するため
のものである。
のものである。
（実 施 例）
次に９本発明について図面を診照して説明する。
第１図は１本発明による回線品質測定方式の一実施例を
示すブロック図である。第１図において、１は受信回線
、２はＤＯＥ、３はＤＴＪ４はフラグシーケンスｖＡｖ
検出回路、５はフレーム誤り検出回路、６は論理和回路
、７は誤り計数回路である。
示すブロック図である。第１図において、１は受信回線
、２はＤＯＥ、３はＤＴＪ４はフラグシーケンスｖＡｖ
検出回路、５はフレーム誤り検出回路、６は論理和回路
、７は誤り計数回路である。
受信回線１より入力された受信信号はＩ）ＯＲ３により
復調され、ＤＴＦＪ３に入力される。この間、１）ＯＲ
３により復調されたディジタル信号はフラグシーケンス
誤り検出回路４．およびフレーム誤り検出回路５に入力
される。
復調され、ＤＴＦＪ３に入力される。この間、１）ＯＲ
３により復調されたディジタル信号はフラグシーケンス
誤り検出回路４．およびフレーム誤り検出回路５に入力
される。
フラグシーケンス誤り検出回路４では、フラグパターン
ｒ０１１１１１１０Ｊを常時、監視している。このパタ
ーン以外のデータが入力され九とき、続くオクテツトが
フラグパターンであったときには、フラグシーケンス誤
り検出回路４はフラグシーケンスに誤りがあったものと
判断し、その誤りの数に応じたパルスを論理和回路６に
出力する。フラグシーケンス以外のデータが入力された
とき、フレーム誤り検出回路５では次のフラグシーケン
スまでのデータと。
ｒ０１１１１１１０Ｊを常時、監視している。このパタ
ーン以外のデータが入力され九とき、続くオクテツトが
フラグパターンであったときには、フラグシーケンス誤
り検出回路４はフラグシーケンスに誤りがあったものと
判断し、その誤りの数に応じたパルスを論理和回路６に
出力する。フラグシーケンス以外のデータが入力された
とき、フレーム誤り検出回路５では次のフラグシーケン
スまでのデータと。
最終の２オクテツトに存在するフラグチエツクシーケン
スとのＯＲＯ方式による誤りの有無を検出する。誤りが
あったとき、フレーム誤り検出回路５は１個のパルスを
論理和回路６に出力する。
スとのＯＲＯ方式による誤りの有無を検出する。誤りが
あったとき、フレーム誤り検出回路５は１個のパルスを
論理和回路６に出力する。
論理和回路６ではフラグシーケンス誤り検出回路４．お
よびフレームｆＡり検出回路５の出力の和をと９．誤り
計数回路７に結果金出して誤りの総和を計数する０ 誤り計数回路７にはフラグシーケンス上の唱りビット数
と、フレーム誤り数との和が計数されることになる。通
常のデータ回線の品質の最悪値は１０４程度であるが、
これ以上の良好な品質であれば、同一フレーム上で２ビ
ット以上が誤る確率は小さく、誤り計数回路７の値は対
象回線のビット誤りと推定できる。
よびフレームｆＡり検出回路５の出力の和をと９．誤り
計数回路７に結果金出して誤りの総和を計数する０ 誤り計数回路７にはフラグシーケンス上の唱りビット数
と、フレーム誤り数との和が計数されることになる。通
常のデータ回線の品質の最悪値は１０４程度であるが、
これ以上の良好な品質であれば、同一フレーム上で２ビ
ット以上が誤る確率は小さく、誤り計数回路７の値は対
象回線のビット誤りと推定できる。
（発明の効果）
以上説明し次ように本発明は、ノ１イレベルデータリン
ク制御手順におけるフラグシーケンス上の誤９ビツトを
検出するとともに、フレームチェックシーケンスによる
フレーム誤ジを検出し、これらによって得られた誤り数
全合成することにより、使用中の回線に影響を与えるこ
となく、常時１回線品質ｔ−測定することが可能となり
、特に高品質の回線を容易に測定できると云う効果があ
る。
ク制御手順におけるフラグシーケンス上の誤９ビツトを
検出するとともに、フレームチェックシーケンスによる
フレーム誤ジを検出し、これらによって得られた誤り数
全合成することにより、使用中の回線に影響を与えるこ
となく、常時１回線品質ｔ−測定することが可能となり
、特に高品質の回線を容易に測定できると云う効果があ
る。
第１図は１本発明による回線品ｇｉ、！ｊｌｌｌ定方式
の一実施例１示すブロック図である。 １・・・受信回線 ２・・・ＤＯＥ３・・・Ｄ Ｔ
Ｅ ４・・・フラグシーケンス誤り検出回路５・・・フレー
ム誤り検出回路
の一実施例１示すブロック図である。 １・・・受信回線 ２・・・ＤＯＥ３・・・Ｄ Ｔ
Ｅ ４・・・フラグシーケンス誤り検出回路５・・・フレー
ム誤り検出回路
Claims (1)
- ハイレベルデータリンク制御手順によりデータ通信を行
う回線におけるフラグシーケンス上の誤りビットを検出
するためのフラグシーケンス誤り検出回路と、フレーム
チェックシーケンスによるフレームの誤りを検出するた
めのフレーム誤り検出回路と、前記フラグシーケンス誤
り検出回路の誤り出力および前記フレーム誤り検出回路
の誤り出力の和を求めるための論理和回路と、前記論理
和回路の出力の和を計数するための誤り計数回路とを具
備して構成したことを特徴とする回線品質測定方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27942589A JPH03139933A (ja) | 1989-10-25 | 1989-10-25 | 回線品質測定方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27942589A JPH03139933A (ja) | 1989-10-25 | 1989-10-25 | 回線品質測定方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03139933A true JPH03139933A (ja) | 1991-06-14 |
Family
ID=17610901
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27942589A Pending JPH03139933A (ja) | 1989-10-25 | 1989-10-25 | 回線品質測定方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03139933A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6125265A (en) * | 1997-05-23 | 2000-09-26 | Matsushita Electric Industrial Co., Ltd. | Portable telephone device |
-
1989
- 1989-10-25 JP JP27942589A patent/JPH03139933A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6125265A (en) * | 1997-05-23 | 2000-09-26 | Matsushita Electric Industrial Co., Ltd. | Portable telephone device |
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