JPH0314252B2 - - Google Patents

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Publication number
JPH0314252B2
JPH0314252B2 JP59021238A JP2123884A JPH0314252B2 JP H0314252 B2 JPH0314252 B2 JP H0314252B2 JP 59021238 A JP59021238 A JP 59021238A JP 2123884 A JP2123884 A JP 2123884A JP H0314252 B2 JPH0314252 B2 JP H0314252B2
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JP
Japan
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crystal
timing signal
nrz
signal
differential amplifier
Prior art date
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Expired - Lifetime
Application number
JP59021238A
Other languages
English (en)
Other versions
JPS60165850A (ja
Inventor
Hiromitsu Awai
Akira Fukuda
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sumitomo Electric Industries Ltd
Original Assignee
Sumitomo Electric Industries Ltd
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Filing date
Publication date
Application filed by Sumitomo Electric Industries Ltd filed Critical Sumitomo Electric Industries Ltd
Priority to JP59021238A priority Critical patent/JPS60165850A/ja
Publication of JPS60165850A publication Critical patent/JPS60165850A/ja
Publication of JPH0314252B2 publication Critical patent/JPH0314252B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L7/00Arrangements for synchronising receiver with transmitter
    • H04L7/02Speed or phase control by the received code signals, the signals containing no special synchronisation information
    • H04L7/027Speed or phase control by the received code signals, the signals containing no special synchronisation information extracting the synchronising or clock signal from the received signal spectrum, e.g. by using a resonant or bandpass circuit
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03BGENERATION OF OSCILLATIONS, DIRECTLY OR BY FREQUENCY-CHANGING, BY CIRCUITS EMPLOYING ACTIVE ELEMENTS WHICH OPERATE IN A NON-SWITCHING MANNER; GENERATION OF NOISE BY SUCH CIRCUITS
    • H03B5/00Generation of oscillations using amplifier with regenerative feedback from output to input
    • H03B5/30Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element being electromechanical resonator
    • H03B5/32Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element being electromechanical resonator being a piezoelectric resonator
    • H03B5/36Generation of oscillations using amplifier with regenerative feedback from output to input with frequency-determining element being electromechanical resonator being a piezoelectric resonator active element in amplifier being semiconductor device

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)

Description

【発明の詳細な説明】 (イ) 発明の利用分野 この発明は、データ伝送装置の受信回路等に使
用される水晶同期発振器を用いたタイミング信号
抽出回路に関する。
(ロ) 先行技術 一般に、伝送符号形式としてNRZ(Non
Return to Zero)信号を用いるデイジタル通信
において、受信データの識別、あるいは再生中断
を行うためにビツト周波数と位相に同期したタイ
ミング信号が必要である。このタイミング信号
は、一般に外部から供給されないので受信データ
を信号処理することによつてタイミング信号を抽
出している。そして、従来、タイミング信号抽出
には位相同期発振器としてタンク回路、あるいは
PLL(Phase−Locked Loop)回路が使用されて
いる。
(ハ) 問題点 前記タンク回路においては、NRZ受信データ
の変化点検出パルスをタンク回路に入力し、この
パルスにより所定周波数の減衰発振信号を出力さ
せてタイミング信号としている。ところで、伝送
符号形式としてNRZ信号を使用しているため、
ビツト符号における「0」又は「1」が何回か連
続した信号の場合、この間NRZ受信データの変
化点は存在しないから、前記減衰発振信号の出力
は減衰して小さくなり、タイミング信号として使
用できない場合がある。この減衰発振はタンク回
路のQ値に大きく依存するもので、高周波になれ
ばなるほど大きいQ値を得ることが困難になり、
高速データ通信用としては製造が困難になる。さ
らに、タンク回路は温度特性が良好でない欠点が
ある。
一方、タイミング信号抽出回路としてPLL回
路を用いた場合には、たとえNRZ受信データ変
化点検出パルスが少なくてもタイミング信号を抽
出することができるものの、NRZ受信データ変
化点検出パルスが初めて入力されてからビツト同
期したタイミング信号が抽出されるまでに何回か
の変化点検出パルスが必要なため、タイミング信
号抽出に時間がかかる欠点がある。さらに、
PLL回路は位相比較器を用いており、この位相
比較器は高速動作が困難なため、高速通信用受信
回路として使用できにくい欠点があつた。
(ニ) 目的 この発明は前記事情に基づいてなされたもの
で、その目的とするところは、NRZ受信データ
変化点検出パルスが入力されてからビツト同期し
たタイミング信号の出力される時間が短かく、し
かもNRZ受信データ変化点検出パルスが次に入
力する時間が長くても前記タイミング信号が継続
して使用でき、高周波において安定した発振が得
られる水晶同期発振器を用いたタイミング信号抽
出回路を提供することである。
(ホ) 実施例 以下、この発明の一実施例につき第1図および
第2図に基づいて説明する。第1図は水晶同期発
振器の回路構成図を示し、同図中1は差動増幅器
で、この逆相入力端にはNRZ受信データ変化点
検出パルスが入力され、またこの逆相入力は抵抗
2を介して差動増幅器1の参照電圧VBBに接続さ
れている。差動増幅器1の逆相出力端にはコイル
3、コンデンサ4、抵抗5aの各一端が接続さ
れ、コンデンサ4の他端は接地されている。前記
コイル3の他端には固有発振周波数を有する水晶
振動子5とコンデンサ6の一端が接続され、この
各他端は前記抵抗5a、コンデンサ7および差動
増幅器1の同相入力端に接続され、コンデンサ7
の他端は接地されている。ここで、差動増幅器
1、コンデンサ4、コンデンサ7および水晶振動
子5によつてコルピツツ型水晶発振器が構成され
ている。水晶振動子5に直列にコイル3を、並列
にコンデンサ6を接続した理由は、NRZ受信デ
ータにビツト同期したタイミング信号を抽出する
ことのできるNRZ受信データのビツト周波数範
囲、即ちキヤプチヤレンジを広げるためである。
さらに、コンデンサ6は温度特性の改善にも良好
である。また、コンデンサ6の容量を変えること
により水晶同期発振器の発振周波数を変えること
ができる。前述の構成によつて差動増幅器1の逆
相出力はコイル3、水晶振動子5、コンデンサ6
を介し、また抵抗5aを介して同相入力へと帰還
される。差動増幅器1の同相出力端からはタイミ
ング信号が抽出される。
前記差動増幅器1の逆相入力にNRZ受信デー
タ変化点検出パルスが入力して無いとすると、水
晶同期発振器の発振動作により差動増幅器1の同
相出力からは第2図Aに示すように発信出力信号
が得られる。このとき、第2図Bに示すように、
差動増幅器1の逆相入力端にNRZ受信データ変
化点検出のパルスが入力したとすると、1発目の
パルスa1の差動増幅器1の逆相入力と前記発信出
力信号の同相入力の差が増幅されて差動増幅器1
の同相出力端から第2図Cの信号b1に示すように
出力される。これと同時に、差動増幅器1の逆相
出力端からは信号b1の反転信号が出力され、コイ
ル3、水晶振動子5に入力され、これにより水晶
振動子5の発振出力の位相は反転した記号b1の立
上がりに合わされる。この結果、差動増幅器1の
同相出力端からは信号b1の出力以降、パルスa1
同期した発振出力がタイミング信号として抽出さ
れる。2発目、3発目のパルスa2,a3がパルスa1
とビツト同期しているとすると、信号b1の出力以
降の前記タイミング信号もパルスa2,a3と第2図
Cに示すようにビツト同期することになる。前記
パルスa3がパルスa1と同期して無いと仮定する
と、前述と同様にして差動増幅器1の同相出力端
から、パルスa3に同期したタイミング信号がパル
スa3の入力以降新たに抽出される。ここで第2図
Bで、NRZ受信データ変化点検出パルス幅は、
第2図Aの発振出力の周期の半分となつている
が、実際には、NRZ受信データ変化点検出パル
スのパルス幅は発振出力の周期の2分の1より小
さければよい。
(ヘ) 効果 以上説明したようにこの発明によれば差動増幅
器の逆相入力にNRZ受信データ変化点検出パル
スを入力することにより、NRZ受信データ変化
点パルスの位相に水晶同期発振器の発振出力を直
接合わせているから、NRZ信号が初めて受信さ
れてからタイミング信号が抽出されるまでの時間
がPLL回路を使用した場合よりも短かい。また、
水晶同期発振器は高周波において安定に発振動作
を行うので、高速データ通信用受信回路への適用
が製造上簡単にできる。また、水晶同期発振器の
Q値が非常に大きいため、ビツト符号の「0」又
は「1」の値が連続してもその間、タイミング信
号は安定しているから、連続するビツト符号の許
容回数が大きい利点がある。さらに、水晶振動子
の使用により温度特性が良好である。
【図面の簡単な説明】
第1図はこの発明の一実施例を示す回路構成
図、第2図はこの発明の動作を説明するパルス波
形図である。 1……差動増幅器、3……コイル、4,6,7
……コンデンサ、5……水晶振動子。

Claims (1)

  1. 【特許請求の範囲】 1 伝送符号形式としてNRZ(Non Return to
    Zero)信号を用いるデータ伝送の受信回路のタ
    イミング信号の抽出を行うものであつて、差動増
    幅器の逆相出力から同相入力に水晶振動子を介し
    て帰還する、コルピツツ型水晶発振において、前
    記差動増幅器の逆相入力に前記NRZ受信データ
    変化点検出パルス信号を導入して、前記差動増幅
    器の同相出力から前記NRZ受信データ変化点検
    出パルス信号に位相同期したタイミング信号を抽
    出することを特徴とする水晶同期発振器によるタ
    イミング抽出回路。 2 前記水晶振動子に直列にコイルを直列接続し
    たことを特徴とする特許請求の範囲第1項記載の
    水晶同期発振器によるタイミング信号抽出回路。 3 前記水晶振動子に直列にコイルを直列接続
    し、さらに、並列にコンデンサを並列接続したこ
    とを特徴とする特許請求の範囲第1項記載の水晶
    同期発振器によるタイミング信号抽出回路。
JP59021238A 1984-02-08 1984-02-08 水晶同期発振器によるタイミング信号抽出回路 Granted JPS60165850A (ja)

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JP59021238A JPS60165850A (ja) 1984-02-08 1984-02-08 水晶同期発振器によるタイミング信号抽出回路

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JP59021238A JPS60165850A (ja) 1984-02-08 1984-02-08 水晶同期発振器によるタイミング信号抽出回路

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JPS60165850A JPS60165850A (ja) 1985-08-29
JPH0314252B2 true JPH0314252B2 (ja) 1991-02-26

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JP59021238A Granted JPS60165850A (ja) 1984-02-08 1984-02-08 水晶同期発振器によるタイミング信号抽出回路

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63153933A (ja) * 1986-12-17 1988-06-27 Sumitomo Electric Ind Ltd 同期再生回路
US7812682B2 (en) * 2009-03-05 2010-10-12 Nel Frequency Controls, Inc. Crystal-based oscillator for use in synchronized system

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JPS60165850A (ja) 1985-08-29

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