JPH03149882A - 電界効果トランジスタ - Google Patents

電界効果トランジスタ

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JPH03149882A
JPH03149882A JP1287820A JP28782089A JPH03149882A JP H03149882 A JPH03149882 A JP H03149882A JP 1287820 A JP1287820 A JP 1287820A JP 28782089 A JP28782089 A JP 28782089A JP H03149882 A JPH03149882 A JP H03149882A
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gate
gate insulating
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effect transistor
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研一 黒田
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康夫 田雑
Junya Kobayashi
潤也 小林
Masashi Mukoda
昌志 向田
Masahiro Sasaura
正弘 笹浦
Shintaro Miyazawa
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 【産業上の利用分野】
本発明は、超伝導体をゲート電極に用いる電界効果トラ
ンジスタに関するものである。
【−従来の技術J ゲート電極と半導体活性層との間に酸化膜、あるいは他
の絶縁膜を介在させたいわゆるMOS構造、あるいはM
IS構造の電界効果トランジスタにおいて、その高周波
特性を支配する要素は、ゲートツース間容量ca*と相
互コンダクタンスg#の比、Cgs/ggであり、この
数値が小さいほど性能が高い、すなわち、高周波性能を
向上させるには、Cj!sを小さくし、g、を大きくす
ることが必要となる。 相互コンダクタンスg、は、 glll=gm、/(l+gm、(Rs+Rg))で表
わすことができる。ここで、g+++、は真性相互コン
ダクタンス、R1はゲートツース間抵抗、R8はゲート
抵抗である。この式かられかるように、g、はゲート抵
抗に依存しており、性能を向上させるためゲート電極を
細くしようとしても。 ゲート抵抗が増大し、g、は増加しなくなる。そこでゲ
ート抵抗の問題を解決するため、ゲート電極として超伝
導体を用いた電界効果トランジスタが提案されていた。 この場合には、ゲート抵抗はほとんどゼロとなり、飛躍
的に高いg、が得られることとなる。 超伝導体として、Nb、Pbなとの金属超伝導体を用い
た場合は、これらの金属の超伝導転移温度が絶対温度1
0に以下であるため、極低温環境が必要となり、冷却に
要する装置、費用が問題であったが、超伝導転移温度が
液体窒素温度を越えるいわゆる酸化物高温超伝導体の発
見により冷却の問題はかなり軽減されることとなった。 【発明が解決しようとする課題】 しかしなから、酸化物超伝導体をゲート電極として用い
る場合、ゲート絶縁膜としてSi半導体に一般に用いら
れているS i O,を用いるとS i O,上の酸化
物超伝導体の超伝導的性質、すなわち、超伝導転移温度
、臨界電流密度などが劣化し、素子の動作温度の低下や
必要とされるゲート電流を得ることができないという問
題点が存在した。これは、酸化物超伝導体薄膜形成時の
高温環境において、界面での相互拡散、反応等により超
伝導体膜中に不純物が取り込まれてしまうことと、形成
される超伝導体薄膜が多結晶となり結晶粒界が多数存在
することなどに起因している。そこで、ゲート絶縁膜と
して酸化物超伝導体簿膜との結晶構造の類似性、格子整
合性等にすぐれたSrTiO,を用いた電界効果トラン
ジスタが提案されているが、SrTiO,の格子定数と
Siの格子整合が悪いために、Si上にSrTiO。 はエピタキシャル成長せず、多結晶となってしまい、こ
の上に形成される酸化物超伝導薄膜は、粒界が多数存在
する膜となり、臨界電流密度が低下してしまうという間
層を有していた。 本発明の目的は、半導体と超伝導体との間に介在するゲ
ート絶縁膜として、超伝導体との相互拡散、反応が起こ
らず、かつ、この絶縁膜上に酸化物超伝導膜をエピタキ
シャル成長させ、高品質の酸化物超伝導膜を実現すると
ともに、ひいては単結晶化することにより粒界の存在に
よる臨界電流密度の低下を抑制しようとするものである
。
【課題を解決するための手段】
上記目的を達成するために、本発明の電界効果トランジ
スタは、半導体基板の活性層上に絶縁膜を介してゲート
電極を有する電界効果トランジスタにおいて、前記ゲー
ト電極として。 LnBaCuO,系(Lnは、イットリウム、あるいは
ランタノイド元素のうちの少なくとも1つ、以下同様)
、B i S rcacuo、系、TIBaCaCuO
y系、あるいは N d Ce Cu O,系のうちの少なくとも1つか
ら成るペロウスカイト構造を基本とする酸化物超伝導体
を用い、かつ前記ゲート絶縁膜として、LnXO,(X
は、Fe、Go、NilAl。 Gaのうちの少なくとも1つ)、あるいはLaSrMO
,(Mは、Cr、Mn%Fe、Co。 Ni、Ga1Rh%Alのうちの少なくとも1つ)のう
ちの少なくとも1つから成るペロウスカイト構造を基本
とする絶縁物を用いたことを特徴とする特 vた、前記半導体基板がSiから成り、前記ゲート絶縁
膜の組成がその膜厚方向に変化するように形成され、前
記ゲート絶縁膜と前記活性層との界面における格子不整
合率と、前記ゲート絶縁膜と前記酸化物超伝導体との界
面における格子不整合率が各々1%以下であることを特
徴とする特*作用l Si基板上へゲート絶縁膜をヘテロエピタキシャル成長
させ、、さらにその上に酸化物超伝導体薄膜をヘテロエ
ピタキシャル成長させるためには。 ゲート絶縁膜材料の選択として、いくつかの条件を満足
する必要がある。第1にその格子定数が、Siの格子定
数とほぼ等しいこと、第2にその格子定数が、酸化物超
伝導体の格子定数とほぼ等しいこと、第3にその結晶構
造が、酸化物超伝導体と類似していることである。さら
に、Siとの反応性が低いこと、絶縁膜材料の拡散によ
る超伝導性の劣化が少ないことも重要である。本発明は
、ゲート絶縁膜材料として、酸化物超伝導体の格子定数
とほぼ合致しく格子不整合率4%以下)、かつ酸化物超
伝導体の結晶構造の基本骨格である酸素八面体で構成さ
れたペロウスカイト構造の複合酸化物番選定することを
最も主要な特徴とする。 さらに、酸化物超伝導体の構成元素である希土類元素を
複合酸化物の構成元素の1つとして含むことも補足的特
徴である。従来の技術では困難なゲート絶縁膜、酸化物
超伝導体ゲート電極を含む全ての構造を単結晶にする酸
化物超伝導体ゲートMIS形電界効果トランジスタを実
現するものである。
【実施例1 第1図は、本発明による酸化物超伝導体ゲートMIS形
電界や果トランジスタの基本構造を示す概略断面である
。1はSt基板であり、単結晶で構成されている。2は
ゲート絶縁膜で、Si基板上にエピタキシャルに構成さ
れている。、3は酸化物超伝導体よりなるゲート電極で
あり。 LnBaCuOy系(Lnは、イットリウム(Y)、あ
るいはランタノイド元素のうち少なくともその1”)を
表わす、以下同様)、Bi SrcacuO。 系、TlBaCaCuOy系、あるいはNdCeCuO
,基材料であり、ゲート絶縁膜上にエピタキシャルに形
成されている。4.5はそれぞれ、ソース、ドレイン電
極である。 このような構成を形成するには、良く知られているよう
に、超伝導転移温度Tc〜90Kを持つLn、Ba、C
u、Or系はCull子を中心にした酸素八面体が規則
的に配列したペロウスカイト構造が基本となっている。 転移温度〜8OK、〜IIOKを持つBi Srcac
uoy系超伝導体(転移温度〜80にはB i、S r
、(,a、CullOy、転移温度〜IIOにはB i
、S r、Ca、Cu、Oyと言われている、)、ある
いは転移温度〜120にのTlBaCaCuOy系超伝
導体も同様な構造とみなせる。従って、このような材料
がヘテロエピタキシャル成長する下層膜としてはペロウ
スカイト構造の物質で、格子整合する材料が望ましい。 Ln、Ba、Cu、Oy系酸化物超伝導体は基本的には
斜方晶形で格子定数はa〜3.82A、b〜3゜88A
であるが、この結晶構造は格子定数a、の擬い、また、
BiSrCaCuO,系は〜80に相も〜IIOK相も
ほぼ正方晶でa、〜5.4Aである。一般に格子構造を
考える上で対角線を副格子とみなすことができるのは結
晶学上でよく行なわれている。従って、対角線副格子と
してa、×rIr/2〜3J2Aを取ることができる。 TlBaCaCuOy系は、a、〜3,86Aの正方晶
系である。次に、単結晶を実現するための格子の不整合
程度について論議する。最も、技術的に進んでいる半導
体の分野では、その不整合率は1%以下が許容されてい
る。さらにはヘテロエピタキシャルの代表であるSi上
G a A s単結晶成長においては、〜4%の格子の
不整合が許容されている。いずれも現在良質な単結晶が
実現され実用化されている。本発明では、このような科
学技術上の一般観念から格子定数の不整合条件を4%以
下とする。前記の酸素八面体ペロウスカイト構造を持つ
複合酸化物材料は極めて数多く報告されているが、酸化
物超伝導体との格子の不整合が4%以下のものは限られ
てくる。 さらに、酸化物超伝導体と熱的、化学的に反応しにくい
材料系の方がゲート絶縁膜として適していると考えられ
る(従って、できるだけ高融点材料が望ましい、)、ま
た、以上述べてきた酸化物超伝導体は希土類元素が含ま
れており、希土類元素が混合しても超伝導特性が劣化し
ないという特徴がある。これらに着目すると、ゲート絶
縁膜材料となるペロウスカイト複合酸化物として希土類
元素を構成元素の1つとして含む化合物系が適している
と考えられる。格子定数の整合、ペロウスカイト構造、
希土類(Ln)酸化物系、の条件を満足するものとして
、斜方晶構造を持つLnXO,(XはFe、Co1Ni
のいずれか)、LnAlO,、LaGaO,−(Aグル
ープ)、あるいは、正方晶構造を持つLaSrMO,(
Mは、C「、Mn、Fe、Co、Ni%Ga%Rh%A
lのいずれか)−(iグループ)などがある。 Aグループの構造は擬正方晶にとることができ。 Bグループ材料も含めてこれらの格子定数のE7倍はS
iの格子定数5.43Aとも非常に近く、Si上に容易
にエピタキシャル成長する。 表1に前記条件を満足する代表的なペロウスカイト酸化
物系の格子定数を示す、Aグループについては擬正方晶
としたときの格子定数を示す、併せてすでに述べた酸化
物超伝導体及びSiの格子定数も示す、これらの伺れの
組み合わせでも、一般的ヘテロエピタキシャルの格子整
合条件(不整合度4%以下)の範囲内である。従って、
Si活性層上に前記の材料よりなるゲート絶縁膜、さら
にその上に酸化物超伝導体よりなるゲート電極膜をエピ
タキシャルに形成することができ、これによりゲート電
極として高い超伝導転移温度と高い臨界電流密度を有す
る超伝導体を構成することができ、ひいては、ゲート抵
抗がゼロで高いg、をもつ高性能の電界効果トランジス
タを実現することができる。 表1 材料       格子定数(A) ゲート絶縁膜 YA 10.        3.68GdAlO,3
,71 EuA 10.       3,725NdA 10
.       3.752SmA 10.     
  3.734P rA 10.       3,7
57LaAl0.       3,778NdGaO
,3,851 PrGa0.       3−863LaGa0. 
      3.875CeGaO,3,879 GdGaO,:t840 LaSrCr0.     3.84 LaSrMnO,3,88 LaSrFe0.     3.86 LaSrCo0.     3.80 LaSrNi0.    3.80 材料       格子定数(A) LaSrGaO,3,84 LaSrRh0.    3.92 LaSrAl0.     3.75 ゲート電極 (La、−xMJ *Cu0. 3.78   (M=
Ba、 Sr、 Ce)YBa、Cu、0.     
3.82  3.88   (斜方晶)BiSrcac
uO系  5.4    (/(T =3.82)TI
BaCaCuO系  3,86 NdCeCuO系    3.95 以下、余白。 次の実施例では、ゲート絶縁膜を前記の選定材料を2つ
以上混合したL n (A l a −X G a X
) Onとするものである。前記の選定材料はペロウス
カイト構造であるからXのすべてに均一混合し、従って
、そのときN格子定数は2者の中間をとることになり、
より精密な格子整合が可能になる。例えば酸化物超伝導
ゲート電極を B i Srcacuo、、ゲート絶縁膜をNd (A
1...Ga、、、)O,とすれば格子定数は3.82
AとなりBi Srcacuo、系の副格子と完全な格
子整合(不整合率θ%)となり、いわゆるエピタキシャ
ル成長として最適になる。2者の組み合わせは表1の中
で任意にすることができることは言うまでもない。この
ときSiに対しても1%以内で格子整合する。さらに厳
密な格子整合を実現するためには、及びXの値をゲート
絶縁膜の厚み方向に連続的に変化させる。例えば、酸化
物超伝導ゲート電極を丁IBaCaCuOア。 ゲート絶縁膜をL a (A I 、−xG aJ O
,とすると、Si側の界面でのXの値を0.63に酸化
物超伝導体ゲート電極側の界面でのXを0.85にし、
ゲート絶g膜の厚み方向にXを0.63から0.85ま
で連続的に変化させればよい。酸化物超伝導体ゲート電
極材料との組み合わせ、及びXの値は表1のデータを参
考に決めることができることは言うまでもない。 ゲート絶縁膜の格子定数をコントロールする方法として
は、L n G a Omのランタノイド元素の部分を
複数の組成としてそれらの組成比をSiとの界面側でS
iと格子整合をとるように定め、そこから酸化物超伝導
体との界面側へ漸次変化させ。 酸化物超伝導体との界面で酸化物超伝導体との格子整合
を実現する方法も可能である。具体的には。 Si界面側での組成をGdGaO,、酸化物超伝導体界
面側での組成をCe G a O,となるように、ゲー
ト酸化膜中の組成を次第に変化させることにより、ゲー
ト酸化膜の両側で厳密な格子整合を実現することができ
る。このとき、膜中での組成変化については、組成をG
 d 、 −X Ce x G a O,として、Gd
、Ceの組成を変えてもよいし、さらにその他のランタ
ノイド元素を混入することにより格子定数を調整するこ
とも可能である。 さらに別の実施例としてはBグループの材料をゲート絶
縁膜として用い、Siとの界面側の組成をLaSrCr
O,、またはLaSrGaO,とし、膜中で組成を変化
させ酸化物超伝導体ゲート電極界面側でLaSrFeO
,とし、超伝導体ゲート電極としてTlBaCaCuO
y系酸化物超伝導体を選ぶと、両側の界面での格子整合
性はきわめて良好なものとなる。 このように上記実施例では、酸化物超伝導体ゲート電界
効果トランジスタのゲート絶縁膜として、超伝導酸化物
ゲート電極と格子整合(不整合率4%以下)し、かつ該
酸化物超伝導体と類似の結晶構造を持ち、さらにSiと
も格子整合する材料としてしnXO,(XはFe%Go
、Niのいずれか)、LnAlO,、L n G a 
O,、(Lnはランタノイド元素またはY)−(Aグル
ープ)、あるいは、正方晶構造を持つLaSrMO,(
MはCr1Mn、Fe1Co、Ni%Ga%Rh。 Alのいずれカリー(Bグループ)などを選定したため
、Si半導体基板からゲート絶縁膜、ゲート電極まで含
めてヘテロエピタキシャル成長が可能となり、素子全体
を単結晶で成長させることができる。従って、酸化物超
伝導体ゲート電極中の結晶粒界に生じるジョセフソン接
合を完全に無くすことができ、劣化が少なく、かつ高い
超伝導転移温度と高い電流密度の実現を可能とし、ゲー
ト抵抗を減少させることができ、高性能のMIS形電界
効果トランジスタを実現することができる。 以上、述べてきた実施例の他にも、表1から格子整合条
件を満たす組み合わせを選ぶことができることは言うま
でもない。 【発明の効果】 以上説明したように、本発明によれば、酸化物超伝導体
ゲート電極中の結晶粒界に生じるジョセフソン接合を完
全に無くすことができ、劣化が少なく、かつ高い超伝導
転移温度と高い電流密度の実現を可能とし、ゲート抵抗
を減少させることができ、高性能のMIS形電界効果ト
ランジスタを実現することができる。
【図面の簡単な説明】
第1図は、本発明による酸化物超伝導体ゲートMIS形
電界効果トランジスタの基本構造の概略断面図である。 l・・・電界効果トランジスタの主要部分であるSi基
板 2・・・ゲート絶縁膜

Claims (1)

  1. 【特許請求の範囲】 1、半導体基板の活性層上に絶縁膜を介してゲート電極
    を有する電界効果トランジスタにおいて、前記ゲート電
    極として、LnBaCuO_y系(Lnは、イットリウ
    ム、あるいはランタノイド元素のうちの少なくとも1つ
    、以下同様)、BiSrCaCuO_y系、TlBaC
    aCuO_y系、あるいはNdCeCuO_y系のうち
    の少なくとも1つから成るペロウスカイト構造を基本と
    する酸化物超伝導体を用い、かつ前記ゲート絶縁膜とし
    て、LnXO、(Xは、Fe、Co、Ni、Al、Ga
    のうちの少なくとも1つ)、あるいは LaSrMO、(Mは、Cr、Mn、Fe、Co、Ni
    、Ga、Rh、Alのうちの少なくとも1つ)のうちの
    少なくとも1つから成るペロウスカイト構造を基本とす
    る絶縁物を用いたことを特徴とする電界効果トランジス
    タ。 2、前記半導体基板がSiから成り、前記ゲート絶縁膜
    の組成がその膜厚方向に変化するように形成され、前記
    ゲート絶縁膜と前記活性層との界面における格子不整合
    率と、前記ゲート絶縁膜と前記酸化物超伝導体との界面
    における格子不整合率が各々1%以下であることを特徴
    とする請求項1記載の電界効果トランジスタ。
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Cited By (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6806202B2 (en) 2002-12-03 2004-10-19 Motorola, Inc. Method of removing silicon oxide from a surface of a substrate
US6855992B2 (en) 2001-07-24 2005-02-15 Motorola Inc. Structure and method for fabricating configurable transistor devices utilizing the formation of a compliant substrate for materials used to form the same
US6885065B2 (en) 2002-11-20 2005-04-26 Freescale Semiconductor, Inc. Ferromagnetic semiconductor structure and method for forming the same
US6916717B2 (en) 2002-05-03 2005-07-12 Motorola, Inc. Method for growing a monocrystalline oxide layer and for fabricating a semiconductor device on a monocrystalline substrate
US6965128B2 (en) 2003-02-03 2005-11-15 Freescale Semiconductor, Inc. Structure and method for fabricating semiconductor microresonator devices
US6992321B2 (en) 2001-07-13 2006-01-31 Motorola, Inc. Structure and method for fabricating semiconductor structures and devices utilizing piezoelectric materials
US7005717B2 (en) 2000-05-31 2006-02-28 Freescale Semiconductor, Inc. Semiconductor device and method
US7019332B2 (en) 2001-07-20 2006-03-28 Freescale Semiconductor, Inc. Fabrication of a wavelength locker within a semiconductor structure
US7045815B2 (en) 2001-04-02 2006-05-16 Freescale Semiconductor, Inc. Semiconductor structure exhibiting reduced leakage current and method of fabricating same
US7067856B2 (en) 2000-02-10 2006-06-27 Freescale Semiconductor, Inc. Semiconductor structure, semiconductor device, communicating device, integrated circuit, and process for fabricating the same
US7105866B2 (en) 2000-07-24 2006-09-12 Freescale Semiconductor, Inc. Heterojunction tunneling diodes and process for fabricating same
US7161227B2 (en) 2001-08-14 2007-01-09 Motorola, Inc. Structure and method for fabricating semiconductor structures and devices for detecting an object
US7169619B2 (en) 2002-11-19 2007-01-30 Freescale Semiconductor, Inc. Method for fabricating semiconductor structures on vicinal substrates using a low temperature, low pressure, alkaline earth metal-rich process
US7211852B2 (en) 2001-01-19 2007-05-01 Freescale Semiconductor, Inc. Structure and method for fabricating GaN devices utilizing the formation of a compliant substrate
US7342276B2 (en) 2001-10-17 2008-03-11 Freescale Semiconductor, Inc. Method and apparatus utilizing monocrystalline insulator

Cited By (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7067856B2 (en) 2000-02-10 2006-06-27 Freescale Semiconductor, Inc. Semiconductor structure, semiconductor device, communicating device, integrated circuit, and process for fabricating the same
US7005717B2 (en) 2000-05-31 2006-02-28 Freescale Semiconductor, Inc. Semiconductor device and method
US7105866B2 (en) 2000-07-24 2006-09-12 Freescale Semiconductor, Inc. Heterojunction tunneling diodes and process for fabricating same
US7211852B2 (en) 2001-01-19 2007-05-01 Freescale Semiconductor, Inc. Structure and method for fabricating GaN devices utilizing the formation of a compliant substrate
US7045815B2 (en) 2001-04-02 2006-05-16 Freescale Semiconductor, Inc. Semiconductor structure exhibiting reduced leakage current and method of fabricating same
US6992321B2 (en) 2001-07-13 2006-01-31 Motorola, Inc. Structure and method for fabricating semiconductor structures and devices utilizing piezoelectric materials
US7019332B2 (en) 2001-07-20 2006-03-28 Freescale Semiconductor, Inc. Fabrication of a wavelength locker within a semiconductor structure
US6855992B2 (en) 2001-07-24 2005-02-15 Motorola Inc. Structure and method for fabricating configurable transistor devices utilizing the formation of a compliant substrate for materials used to form the same
US7161227B2 (en) 2001-08-14 2007-01-09 Motorola, Inc. Structure and method for fabricating semiconductor structures and devices for detecting an object
US7342276B2 (en) 2001-10-17 2008-03-11 Freescale Semiconductor, Inc. Method and apparatus utilizing monocrystalline insulator
US6916717B2 (en) 2002-05-03 2005-07-12 Motorola, Inc. Method for growing a monocrystalline oxide layer and for fabricating a semiconductor device on a monocrystalline substrate
US7169619B2 (en) 2002-11-19 2007-01-30 Freescale Semiconductor, Inc. Method for fabricating semiconductor structures on vicinal substrates using a low temperature, low pressure, alkaline earth metal-rich process
US6885065B2 (en) 2002-11-20 2005-04-26 Freescale Semiconductor, Inc. Ferromagnetic semiconductor structure and method for forming the same
US6806202B2 (en) 2002-12-03 2004-10-19 Motorola, Inc. Method of removing silicon oxide from a surface of a substrate
US6965128B2 (en) 2003-02-03 2005-11-15 Freescale Semiconductor, Inc. Structure and method for fabricating semiconductor microresonator devices

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