JPH03154114A - 半導体計算装置 - Google Patents

半導体計算装置

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JPH03154114A
JPH03154114A JP1292653A JP29265389A JPH03154114A JP H03154114 A JPH03154114 A JP H03154114A JP 1292653 A JP1292653 A JP 1292653A JP 29265389 A JP29265389 A JP 29265389A JP H03154114 A JPH03154114 A JP H03154114A
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JP
Japan
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output
frequency
frequency dividing
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instruction decoder
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Pending
Application number
JP1292653A
Other languages
English (en)
Inventor
Hideaki Yokouchi
横内　秀明
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Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Publication date
Application filed by Seiko Epson Corp filed Critical Seiko Epson Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、時計などに使われるシングルチップマイクロ
コンピュータに関する。
〔従来の技術］ 従来の時計用シングルチップマイクロコンビニーりでは
、水晶発振回路を内蔵し水晶発振回路から出力されるク
ロック信号を一定の分周比でのみ分周することによって
、計時処理を行っていた。
［発明が解決しようとする課題］ しかし、従来の技術では分周回路における分周比が固定
されていたため、計時処理をすることのできる水晶振動
子が、例えば３２．７６８ｋＨｚのものに限られていた
。
したがって、シングルチップマイクロコンピュータを用
いて１２００ｂｐｓの調歩同期型のシリアル通信手段を
実現するために３８．４ｋＨｚの水晶振動子を用いた場
合には、時計機能を実現できないという欠点があった。
〔課題を解決するための手段］ 上記問題を解決するために、本発明の半導体計算装置は
、 ａ）マイクロコードを記憶するプログラム記憶手段と、 ｂ）前記プログラム記憶手段からの出力を一時記憶する
命令記憶手段と、 Ｃ）前記命令記憶手段からの出力をデコード（ＤＥＣＯ
ＤＥ：解読）シ、各種の制御信号を発生する命令デコー
ダと、 ｄ）前記命令デコーダから出力される制御信号に従って
、少なくとも加算、論理和、論理積の演算を実行するこ
とのできる算術論理演算手段と、ｅ）前記命令デコーダ
から出力される制御信号にしたがって、前記算術論理演
算手段からの出力を一時記憶する手段を有するデータ記
憶手段とからなる半導体計算装置において、 ｆ）一定の周波数を発振する発振手段と、ｇ）前記発振
手段からのクロック信号を分周する分周手段を含み、 ｈ）前記分周手段の分周比を前記命令デコーダからの出
力によって変更することのできる手段を有し、 ｉ）前記分周手段より出力されるクロック信号によって
計時信号を出力する手段を有することを特徴とする。
〔実　施　例］ 第１図は、本発明の半導体計算装置のブロック図である
。
１は水晶振動子であり、２の発振回路に接続されている
０発振回路からの一定周波数のクロック信号３は、それ
ぞれ分周比の異なる４と５の分周回路に接続されている
。中央処理装置より出力される制御信号１６に従ってセ
レクタ６により分周回路４，５の出力のうち１つが選択
されて計数回路７に入力され、計数回路７からは、時計
機能を実現するための計時信号８が出力される。
また、中央処理装置では、プログラムが格納されるＲＯ
Ｍなどのプログラム記憶手段１４からの出力であるマイ
クロコードを命令レジスタ１３に一時記憶し、命令デコ
ーダ１２により各種制御信号が生成される。この命令デ
コーダからの出力にしたがって、データバス９を介して
算術論理演算ユニット１０ではデータの演算処理をした
り、また、各種データをＲＡＭなどのデータ記憶手段１
１に一時記憶することができる。
本発明を用いると第１図のブロック図より明らかなよう
にマイクロコンピュータのプログラムを変更するだけで
分周回路における発振クロックの分周比を変更すること
が可能となる。
分周回路の一例を第２図に示す、１９は、１／１２８分
周をする分周回路であり、２０は１／１５０分周をする
分周回路である。
１／１２８分周回路と１／１５０分周回路のそれぞれの
出力２１と２２はセレクタ２３により一方が選択される
。
本分周回路を用いると３２．７６８ｋＨｚ発振の水晶振
動子を用いた場合は１／１２８分周回路を、３２．８ｋ
Ｈｚの水晶振動子を用いた場合は１／１５０分周回路を
用いることにより、ともに２５６）１ｚの計時処理のた
めのクロック信号を得ることができ、２５６Ｈｚ以下の
計数回路は共通に用いることができる。
一般的には１時計などでは３２．７６８ｋＨｚの水晶振
動子が使われ、調歩同期式シリアルインターフェースを
使用する製品やページャなどでは３２．８ｋＨｚの水晶
振動子が使われている０本発明を用いることにより水晶
振動子の種類によらず共通のマイクロコンビニー夕を用
いることができる。
〔発明の効果］ 以上記してきた通り、本発明の半導体計算装置を用いる
ことにより、広範囲に渡った応用分野で容易に時計機能
を実現することが可能となる。特に、マイクロコンピュ
ータはプログラムを変更することで多様な応用製品に利
用することができるため本発明は特に有効である。
【図面の簡単な説明】
第１図は、本発明の半導体計算装置ブロック図。 第２図は１本発明の分周回路側図。 水晶振動子 発振回路 一定周波数の発振クロック信号 分周回路１ 分周回路２ クロック信号セレクク 計数回路 計時出力信号 データバス ｌ　Ｏ・ １１　　・ ｌ　２　・ ｌ　３　・ １４　・ ｌ　５　・ １６　・ １７　・ １８　・ ｌ　９　・ ２０　・ ２　ｌ　・ ２２　・ ２３　・ ２４　・ ２５　・

Claims (1)

  1. 【特許請求の範囲】 ａ）マイクロコードを記憶するプログラム記憶手段と、 ｂ）前記プログラム記憶手段からの出力を一時記憶する
    命令記憶手段と、 ｃ）前記命令記憶手段からの出力をデコードし、各種の
    制御信号を発生する命令デコーダと、ｄ）前記命令デコ
    ーダから出力される制御信号に従って、少なくとも加算
    、論理和、論理積の演算を実行することのできる算術論
    理演算手段と、ｅ）前記命令デコーダから出力される制
    御信号にしたがって、前記算術論理演算手段からの出力
    を一時記憶する手段を有するデータ記憶手段とからなる
    半導体計算装置において、 ｆ）一定の周波数を発振する発振手段と、 ｇ）前記発振手段からのクロック信号を分周する分周手
    段を含み、 ｈ）前記分周手段の分周比を前記命令デコーダからの出
    力によって変更することのできる手段を有し、 ｉ）前記分周手段より出力されるクロック信号によって
    計時信号を出力する手段を有することを特徴とする半導
    体計算装置。
JP1292653A 1989-11-10 1989-11-10 半導体計算装置 Pending JPH03154114A (ja)

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